JPH0420527B2 - - Google Patents

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JPH0420527B2
JPH0420527B2 JP26804785A JP26804785A JPH0420527B2 JP H0420527 B2 JPH0420527 B2 JP H0420527B2 JP 26804785 A JP26804785 A JP 26804785A JP 26804785 A JP26804785 A JP 26804785A JP H0420527 B2 JPH0420527 B2 JP H0420527B2
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JP
Japan
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signal
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delay element
output
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Juji Akishiba
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Keyence Corp
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Description

【発明の詳細な説明】 〔産業上の利用分野〕 この発明は2値化回路に関し、特にレーザ光に
よる光ビームを走査して非接触で測定対象物の外
径を測定する走査型の光学式外径測定器におい
て、測定対象物のエツジ検出を正確に行うことの
できる2値化回路に関する。
〔従来の技術〕
走査型の光学式外径測定器は非接触で外径測定
ができるので、測定対象物が移動物体、高温物体
等の場合によく用いられる。以下、この走査型の
光学式外径測定器の原理説明を第4図に基づいて
行う。
レーザ管1から投射されたレーザビームは固定
ミラー2により反射され、回転ミラー3で再度反
射され走査ビームに変換される。走査ビームはコ
リメータレンズ4により平行走査ビームに変換さ
れ、コリメータレンズ4と集光レンズ5の間に配
置された測定対象物6を高速走査する。この際、
測定対象物6の遮蔽によつて生じた平行走査ビー
ムの暗部または明部の時間の長さから、測定対象
物6の外径を測定するようにしている。
すなわち、測定対象物6の遮蔽による平行走査
ビームの明暗は、集光レンズ5の焦点位置に載置
された受光素子7の出力信号aの変化となつて検
出される。この出力信号aは増幅器8により増
幅・2値化され、セグメント選択回路9に伝達さ
れる。セグメント選択回路9は、測定対象物6が
走査されている間tだけ受光素子7の出力信号を
ゲート回路10に伝達する。ゲート回路10には
クロツクパルス発振器11からクロツクパルス
CPも入力されているので、ゲート回路10は、
測定対象物6の外径に対応した走査時間tにおけ
るクロツクパルスPを計数回路12に伝達する。
計数回路12は入力されたクロツクパルスPを計
数し、表示器13にその計数値を伝達する。表示
器13はこの計数値に基づき、測定対象物6の外
径を表示する。
このような走査型の光学式外径測定器の使用に
際して問題となる点が、第5図に示すように、測
定対象物6(第4図参照)の遮蔽による受光素子
7の出力信号aのどの部分を、測定対象物6のエ
ツジと認定するかということである。この問題点
に対して、従来は次のような方式を用いて対処し
ていた。
まず、第1の方式は固定しきい値方式と呼ばれ
るもので、第6図aに示すように、しきい値イを
固定して受光素子7の出力信号aがしきい値イを
越えた場合に、パルスが出力されるようにしてい
る。しかし、この方式では受光素子7の出力信号
aが諸要因によつて変動した際には、同図bに示
すように、同一測定対象物6にも拘わらず受光素
子7の出力信号a′の振幅が変動し、この信号a′を
2値化した際、誤差Δtが生じ誤測定を行うこと
がある。
次に、第2の方式はピークレベル方式と呼ばれ
るもので、通常、第7図に示すような回路を用い
て行う。この回路は、受光素子7の出力信号aが
伝達される端子14に増幅器15が接続され、こ
の増幅器15の出力側にはピークホールド回路1
6および比較器17の正入力側が接続されてい
る。ピークホールド回路16の出力側は、抵抗
R1,R1を介して接地されている。抵抗R1,R1
中点は比較器17の負入力側に接続されている。
比較器17の出力側は端子18に接続されてい
る。
このような構成であるので、第8図に示すよう
に、増幅器15(第7図参照)の出力信号bとこ
の信号bの1/2の振幅値の信号cのクロス点を測
定対象物6のエツジと見做し、測定対象物6の外
径に対応するパルス幅の出力パルスdを得てい
る。すなわち、増幅器15の出力信号bのピーク
値の1/2を、測定対象物6のエツジ位置での出力
値と見做すのである。しかし、この方式では、前
記出力信号bのピーク値が出力パルスdの立ち上
がり時点で判明していない。したがつて、この信
号bの1/2の振幅値である信号cを特定すること
もできず、出力パルスdの立ち上がり時点である
クロス点を定めることは不可能である。それゆ
え、走査毎に出力信号bのピーク値を一定に仮定
して信号cを得ている。だが、この仮定は光源等
の変動、背景光の変動等により成立せず、測定に
は相当な誤差が包含される。この誤差は、測定対
象物6の外径測定の精度を数μm単位まで要求さ
れる場合には致命的な欠陥となる。
このような要求に対応できる技術として、特開
昭53−114456号公報に開示されている2次微分方
式と呼ばれるものがある。この方式は受光素子7
の出力信号aを2次微分し、その零クロス点間隔
を検出することにより測定対象物6の外径測定を
行うものである。以下この方式を説明する。
第9図に示すように、受光素子7の出力信号a
は端子14に伝達され増幅器15で増幅された
後、1次微分回路19および2次微分回路20で
微分される。2次微分された信号は、零クロス点
検出回路21で零クロス点が検出され、これに基
づいて信号処理回路22で測定対象物6の外径が
判明される。零クロス点検出回路21は、第10
図に示すような回路構成である。端子23には2
次微分回路20(第9図参照)の出力信号が伝達
され、この信号は比較器210に伝達される。比
較器210は、2次微分信号の零クロス点間(測
定対象物6のエツジからエツジまでの距離に該
当)に対応する、第11図fに示すようなパルス
fを出力する。このパルスfと第11図eに示す
ようなクロツクパルス発生器211のクロツクパ
ルスeはANDゲート212に入力され、ANDゲ
ート212は第11図gに示すような出力パルス
gを信号処理回路22に伝達する。したがつて、
信号処理回路22が零クロス点間に相当する出力
パルスgを計数することにより、零クロス点間の
時間幅が判明し、それゆえ測定対象物6の外径が
判明する。
〔発明が解決しようとする問題点〕
ところが、この2次微分方式の走査型の光学式
外径測定器は2回微分して零クロス点間を検出す
る必要があるため、2つの微分回路を設けねばな
らず回路構成が複雑化するという問題点があつ
た。
この発明は走査型の光学式外径測定器におい
て、測定対象物のエツジ測定を正確に行うことが
でき、かつ、回路構成が簡単な2値化回路を提供
することを目的とする。
〔問題点を解決するための手段〕
上記問題点を解決し、この目的を達成するため
の具体的手段は、入力信号が伝達される端子に整
合用の抵抗を介在して一端が接続されるとともに
他端が開放状態にある遅延素子と、この遅延素子
の両端の電圧を比較する比較回路を具備する2値
化回路において、前記比較回路を、前記遅延素子
の一端に負入力側が接続されるとともに正入力側
が前記遅延素子の他端に接続されている比較器
と、抵抗とコンデンサからなる時定数回路を有す
る第1の比較回路と、前記遅延素子の一端に正入
力側が接続されるとともに負入力側が前記遅延素
子の他端に接続されている比較器と、抵抗とコン
デンサからなる時定数回路を有する第2の比較回
路から構成し、かつ、前記比較回路に排他的論理
和ゲートを接続するようにしたことである。
〔作用〕
この手段の実施によりもたらされる作用を第2
図に基づいて説明する。端子に伝達された受光素
子等からの入力信号は、遅延素子の一端に接続さ
れたインピーダンスの整合用の抵抗を介して遅延
素子に伝達される。この場合に、遅延素子の他端
はインピーダンスが開放状態であり、かつ前記一
端は整合状態であるので、第2図aに示すよう
に、遅延素子の一端において前記入力信号の1/2
の振幅値である伝達信号hが生じる。この伝達信
号hは、遅延素子により一定時間tdだけ遅延され
て、開放状態である遅延素子の他端(開放端)に
伝達される。この際、この開放端において伝達信
号hは全反射されて、伝達信号hの2倍の振幅値
を有する第1遅延信号i(入力信号と同振幅値)
が生じる。一方、整合状態である遅延素子の一端
(整合端)において、開放端で全反射した伝達信
号hと前記端子より伝達された伝達信号hが重畳
した、突出部j′の立ち上がりが前記第1遅延信号
iより、さらに一定時間tdだけ遅延された第2遅
延信号jが生じる。
したがつて、整合端と開放端の電圧を比較する
比較回路を遅延素子に接続することにより、第1
遅延信号iと第2遅延信号jのクロス点A,Bを
得ることができる。これらのクロス点A,Bは入
力信号の1/2の振幅値を正確に示している。すな
わち、走査型の光学式外径測定器にこの2値化回
路を用いた際には、クロス点A,Bは測定対象物
のエツジの位置を表し、同図bに示すように、比
較回路の出力パルスのパルス幅Wが測定対象物の
外径に対応している。
この場合に出力パルスの立ち上がりホ時間と立
ち下がりヘ時間に差異が生じると、正確な測定が
不可能となる。通常、この立ち上がりホ時間と立
ち下がりヘ時間は同一でないことが多い。この発
明においては、比較回路を第1の比較回路と第2
の比較回路から構成し、両比較回路を排他的論理
和ゲートに接続することにより、この問題点を解
消している。すなわち、前記遅延素子の一端に負
入力側が接続されるとともに正入力側が前記遅延
素子の他端に接続されている比較器と、抵抗とコ
ンデンサからなる時定数回路を有する第1の比較
回路の出力信号(パルス信号)と、前記遅延素子
の一端に正入力側が接続されるとともに負入力側
が前記遅延素子の他端に接続されている比較器
と、抵抗とコンデンサからなる時定数回路を有す
る第2の比較回路の出力信号(パルス信号)を、
排他的論理和ゲートに伝達し排他的論理和を採る
ことによつて、前記パルス信号の立ち上がりまた
は立ち下がりのいずれかを基準にして、前記クロ
ス点A,Bを定めている。したがつて、パルス信
号の立ち上がり時間および立ち下がり時間の差異
による誤差が生ぜず、正確なエツジ検出が可能で
ある。
〔実施例〕
この発明を、以下実施例に基づいて詳細に説明
する。なお、従来例と同一部分はその説明を省略
している。
第1図に示すように、受光素子からの受光信号
は、端子30に伝達された後増幅器31に伝達さ
れ入力信号となる。増幅器31には、インピーダ
ンスの整合用の抵抗R2を介在して遅延素子32
の一端(整合端X)が接続されている。遅延素子
32の他端(開放端Y)は、第1比較器33の正
入力側に接続され、かつ第1比較器33の負入力
側は整合端Xに接続されている。また、遅延素子
32の開放端Yには、第2比較器34の負入力側
が接続され、かつ第2比較器34の正入力側は整
合端Xに接続されている。第1比較器33の出力
側には、コンデンサC1および抵抗R3からなる時
定数回路が接続されている。抵抗R3は基準電圧
源35を介して接地され、コンデンサC1も接地
されている。同様に、第2比較器34の出力側に
はコンデンサC2および抵抗R4からなる時定数回
路が接続され、抵抗R4は基準電圧源36を介し
て接地され、コンデンサC2も接地されている。
第1比較器33、コンデンサC1および抵抗R3
ら第1の比較回路が構成され、第2比較器34、
コンデンサC2および抵抗R4から第2の比較回路
が構成されている。第1の比較回路および第2の
比較回路には、排他的論理和ゲート37が接続さ
れている。
整合端Xには、第3比較器38の負入力側およ
び第4比較器39の正入力側も接続されている。
第3比較器38の正入力側および第4比較器39
の負入力側は、基準電圧源40に抵抗R5を、あ
るいは、抵抗R5およびR6を介して接続されると
ともに、抵抗R6およびR7を、あるいは、抵抗R7
を介して接地されている。第3比較器38および
第4比較器39の出力側はANDゲートに接続さ
れ、このANDゲート41の出力側は、他方入力
接続を前記排他的論理和ゲート37とするAND
ゲート42に接続されている。ANDゲート42
の出力側には、この2値化回路の出力信号を処理
する回路部(図示省略)にANDゲート42の出
力信号を伝達するための端子43が接続されてい
る。
以上の回路構成からなるこの実施例の動作を、
第1図および第2図を参照しながら第3図に基づ
いて説明する。なお、第3図のアルフアベツトは
第1図の各部の信号のアルフアベツトに対応させ
ている。
受光素子の受光信号を増幅した信号である入力
信号により、整合端Xにおいて入力信号の1/2の
振幅値となる伝達信号h(第2図参照)が生じる。
この伝達信号hは、遅延素子32により一定時間
tdだけ遅延して開放端Yに伝達される。開放端Y
において、伝達信号hは全反射されて第3図kに
示すように、伝達信号hの2倍の振幅値を有する
第1遅延信号i(入力信号と同振幅値)が生じる。
一方、整合端Xにおいて、前記開放端Yで全反射
した伝達信号hと前記端子30より伝達された伝
達信号hが重畳した、突出部j′の立ち上がりが前
記第1遅延信号iより、さらに一定時間tdだけ遅
延した第2遅延信号jが生じる。これらの第1遅
延信号iと第2遅延信号jのクロス点A,Bは、
入力信号の1/2の振幅値を正確に示している。
第1の比較回路は第1遅延信号iと第2遅延信
号jを入力し、第3図1に示すように、立ち上り
が時定数回路のために緩やかなパルス信号lを出
力する。同様に第2の比較回路も、同図mに示す
ように、立ち上がりが緩やかなパルス信号mを出
力する。これら両パルス信号l,mを入力する排
他的論理和ゲート37は、同図nに示すように、
両パルス信号l,mの立ち下がりを基準にした測
定対象物のエツジ位置の検出用パルス信号nを出
力する。
このパルス信号nは、第1遅延信号iと第2遅
延信号jが重畳する部分ロ,ロ′で両信号の大小
が変動し、雑音パルスを出力する。したがつて、
この雑音パルスを除去するために、前述の本発明
にかかる回路以外の他の回路が必要となる。
すなわち、第3比較器38および第4比較器3
9により、同図kに示すように、前記クロス点
A,Bの上下に各々しきい値ハ,ニを設定する。
第2遅延信号jがしきい値ニを越えると、同図p
に示すように、第4比較器39の出力信号pは
HIGHになる。この信号pにより、第1遅延信号
iと第2遅延信号jがしきい値ニを越えないで重
畳する際に出力される、ロの部分の雑音パルスが
除去される。そして、第2遅延信号jがしきい値
ハを越えると、同図oに示すように、第3比較器
38の出力信号oはLOWになる。この信号oに
より、第1遅延信号iと第2遅延信号jがしきい
値ハを越えて重畳する際に出力される、ロの部分
の雑音パルスが除去される。これら両信号o,p
を入力するANDゲート41は、第1遅延信号i
および第2遅延信号jが重畳する際に出力される
ロ,ロ′の部分の雑音パルスを無視するための、
同図qに示すような出力信号qをANDゲート4
2に伝達する。
ANDゲート42はこの出力信号qと排他的論
理和ゲート37の出力信号nを入力し、第1遅延
信号iおよび第2遅延信号jが重畳する際に出力
される、ロ,ロ′の部分の雑音パルスが除去され
た出力信号rを端子43に伝達する。図示省略し
たが、この端子43には出力信号rにより、測定
対象物の外径を明示するための信号処理回路が接
続されている。
この実施例においては、第1の比較回路および
第2の比較回路の出力パルス信号l,mの立ち上
がりが緩やかになるように各々の時定数回路を構
成し、両パルス信号l,mの立ち下がりを基準に
して排他的論理和ゲート37の出力信号である、
測定対象物のエツジ位置検出用パルス信号nを得
たが、反対に両パルス信号l,mの立ち下がりが
緩やかになるように時定数回路を構成し、両パル
ス信号l,mの立ち上がりを基準にして前記パル
ス信号nを得るようにしても良い。
〔発明の効果〕
以上の説明から明らかなように、この発明にか
かる2値化回路は、入力信号が伝達される端子に
整合用の抵抗を介在して一端が接続されるととも
に他端が開放状態である遅延素子と、この遅延素
子の両端の電圧を比較する比較回路を具備する2
値化回路において、前記比較回路を、前記遅延素
子の一端に負入力側が接続されるとともに正入力
側が前記遅延素子の他端に接続されている比較器
と、抵抗とコンデンサからなる時定数回路を有す
る第1の比較回路と、前記遅延素子の一端に正入
力側が接続されるともに負入力側が前記遅延素子
の他端に接続されている比較器と、抵抗とコンデ
ンサからなる時定数回路を有する第2の比較回路
から構成し、かつ、前記比較回路に排他的論理和
ゲートを接続するようにしたので、この比較回路
の出力パルスの立ち上がりまたは立ち下がりのい
ずれかを基準にして測定対象物のエツジ検出を行
うため、比較回路のパルスの立ち上がり時間およ
び立ち下がり時間の差異による誤差を除去でき
る。したがつて、極めて簡単な回路構成で入力信
号の振幅の厳密に1/2である振幅値の信号を得る
ことができるので、走査型の光学式外径測定器に
この発明にかかる2値化回路を用いれば、測定対
象物のエツジ検出を極めて正確にでき、外径測定
の精度を高めることができる。
【図面の簡単な説明】
第1図ないし第3図はこの発明にかかる2値化
回路の説明図であり、第1図は1実施例の回路
図、第2図は原理説明図、第3図は第1図の回路
の各部の動作波形図、第4図ないし第11図は従
来例の説明図であり、第4図は走査型の光学式外
径測定器の原理説明図、第5図は従来例の問題点
の説明図、第6図は固定しきい値方式の説明図、
第7図はピークレベル方式の回路図、第8図はこ
の回路の各部の動作波形図、第9図は2次微分方
式のブロツク図、第10図は第9図の零クロス点
検出回路の回路図、第11図はこの回路の各部の
動作波形図である。 30……端子、32……遅延素子、33……第
1比較器、34……第2比較器、37……排他的
論理ゲート、C1,C2……コンデンサ、R2……整
合用抵抗、R3,R4……抵抗、X……整合端、Y
……開放端。

Claims (1)

  1. 【特許請求の範囲】 1 入力信号が伝達される端子に整合用の抵抗を
    介在して一端が接続されるとともに他端が開放状
    態である遅延素子と、この遅延素子の両端の電圧
    を比較する比較回路を具備する2値化回路であつ
    て、 前記比較回路が、 前記遅延素子の一端に負入力側が接続されると
    ともに正入力側が前記遅延素子の他端に接続され
    ている比較器と、抵抗とコンデンサからなる時定
    数回路を有する第1の比較回路と、 前記遅延素子の一端に正入力側が接続されると
    ともに負入力側が前記遅延素子の他端に接続され
    ている比較器と、抵抗とコンデンサからなる時定
    数回路を有する第2の比較回路から構成され、 かつ、前記比較回路に排他的論理和ゲートが接
    続されていることを特徴とする2値化回路。
JP26804785A 1985-11-28 1985-11-28 2値化回路 Granted JPS62128610A (ja)

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JP26804785A JPS62128610A (ja) 1985-11-28 1985-11-28 2値化回路

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JPS62128610A JPS62128610A (ja) 1987-06-10
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