JPH0391307A - 平均光電力検出ａｇｃ回路 - Google Patents
平均光電力検出ａｇｃ回路Info
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- JPH0391307A JPH0391307A JP22749889A JP22749889A JPH0391307A JP H0391307 A JPH0391307 A JP H0391307A JP 22749889 A JP22749889 A JP 22749889A JP 22749889 A JP22749889 A JP 22749889A JP H0391307 A JPH0391307 A JP H0391307A
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- Japan
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- 238000001514 detection method Methods 0.000 title claims description 8
- 230000003287 optical effect Effects 0.000 claims description 17
- 239000003990 capacitor Substances 0.000 abstract description 4
- 230000010354 integration Effects 0.000 abstract description 3
- 230000003321 amplification Effects 0.000 abstract description 2
- 238000003199 nucleic acid amplification method Methods 0.000 abstract description 2
- 238000010586 diagram Methods 0.000 description 4
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- 238000005516 engineering process Methods 0.000 description 1
Landscapes
- Control Of Amplification And Gain Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
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Description
【発明の詳細な説明】
〔概 要〕
光通信の受信モジュール、光センサ等において、（１）
フォトダイオード（ＰＩＮフォトダイオード、アバラン
シェフォトダイオード）を受光素子として光信号を電気
信号に変換し、その出力レベルを一定にする平均光電力
検出ＡＧＣ回路に関し、利得変動が少なく且つ装置コス
トが低く、ＡＧＣ回路を提供することを目的とし、 光信号を受光素子により電気信号に変換し、該電気信号
の出力レベルを一定とする平均光電力検出ＡＧＣ回路に
おいて、前記受光素子と電源端子との間に直列接続され
た抵抗と、前記受光素子の出力を増幅して出力とする並
列ＦＥＴ帰還型増幅器と、前記受光素子と前記抵抗との
接続ノードの電位を基準電圧と比較し、該比較結果に応
じて前記ＦＥＴ帰還型増幅器の帰還ＦＥＴの導通率を制
御する比較回路とを具備するように構成する。
シェフォトダイオード）を受光素子として光信号を電気
信号に変換し、その出力レベルを一定にする平均光電力
検出ＡＧＣ回路に関し、利得変動が少なく且つ装置コス
トが低く、ＡＧＣ回路を提供することを目的とし、 光信号を受光素子により電気信号に変換し、該電気信号
の出力レベルを一定とする平均光電力検出ＡＧＣ回路に
おいて、前記受光素子と電源端子との間に直列接続され
た抵抗と、前記受光素子の出力を増幅して出力とする並
列ＦＥＴ帰還型増幅器と、前記受光素子と前記抵抗との
接続ノードの電位を基準電圧と比較し、該比較結果に応
じて前記ＦＥＴ帰還型増幅器の帰還ＦＥＴの導通率を制
御する比較回路とを具備するように構成する。
本発明は、光通信の受信モジューノペ光センサ等におい
て、フォトダイオード（Ｐ Ｉ Ｎフォトダイオード、
アバランシェフォトダイオード）を受（２） 光素子として光信号を電気信号に変換し、その出力レベ
ルを一定にする平均光電力検出Ａ Ｃ，Ｃ回路に関する
。
て、フォトダイオード（Ｐ Ｉ Ｎフォトダイオード、
アバランシェフォトダイオード）を受（２） 光素子として光信号を電気信号に変換し、その出力レベ
ルを一定にする平均光電力検出Ａ Ｃ，Ｃ回路に関する
。
受信した光信号のレベル変動に対して、電気信号の出力
レベルが一定となるＡＧＣ回路として、可変利得回路を
設け、その出力電圧をＡＧＣ電圧として第３図に示す負
帰還する方式がある。第３図において、１は受光素子（
ＰＩＮダイオード、アバランシェダイオード）、２，４
，５．７は増幅器、３は可変利得回路、６は出力端子、
８は包路線検波器、９は直流増幅器である。包絡線検波
器８には、通常、ダイオードが用いられ、このダイオー
ドの特性ばらつきや温度特性が検波出力電圧に影響を防
ぐために、増幅器７を用いる。このようにして第３図に
示す可変利得回路３の利得を制御するために、増幅器４
．７を通過した信号を包絡線検波器８により包絡線検波
し、これにより高周波成分を除去した後、直流増幅器９
で増幅して得た（３） ＡＧＣ電圧を、可変利得回路３の制御端子に負帰還する
。
レベルが一定となるＡＧＣ回路として、可変利得回路を
設け、その出力電圧をＡＧＣ電圧として第３図に示す負
帰還する方式がある。第３図において、１は受光素子（
ＰＩＮダイオード、アバランシェダイオード）、２，４
，５．７は増幅器、３は可変利得回路、６は出力端子、
８は包路線検波器、９は直流増幅器である。包絡線検波
器８には、通常、ダイオードが用いられ、このダイオー
ドの特性ばらつきや温度特性が検波出力電圧に影響を防
ぐために、増幅器７を用いる。このようにして第３図に
示す可変利得回路３の利得を制御するために、増幅器４
．７を通過した信号を包絡線検波器８により包絡線検波
し、これにより高周波成分を除去した後、直流増幅器９
で増幅して得た（３） ＡＧＣ電圧を、可変利得回路３の制御端子に負帰還する
。
しかしながら、光通信の受信モジュールのように、特に
、高周波数を用いる場合、第３図における増幅器は、利
得のばらつき及び温度ドリフトの影響が大きく、従って
、増幅器５．７は、特性の同じ増幅器を用いなければな
らないという課題がある。また、第３図においては、回
路が複雑となり、個別部品点数が増加し、この結果、装
置コストが高くなるという課題もある。
、高周波数を用いる場合、第３図における増幅器は、利
得のばらつき及び温度ドリフトの影響が大きく、従って
、増幅器５．７は、特性の同じ増幅器を用いなければな
らないという課題がある。また、第３図においては、回
路が複雑となり、個別部品点数が増加し、この結果、装
置コストが高くなるという課題もある。
従って、本発明の目的は、利得変動が少なく且つ装置コ
ストが低いＡＧＣ回路を提供することにある。
ストが低いＡＧＣ回路を提供することにある。
上述の課題を解決するための手段は第１図に示される。
すなわち、光信号を受光素子１１により電気信号に変換
し、この電気信号の出力レベルを−（４） 定とする平均光電力検出ＡＧＣ回路において、抵抗１２
を受光素子１１と電源端子との間に直列接続し、また、
並列ＦＥＴ帰還型増幅器１６を受光素子１１の出力に接
続し、これを増幅する。比較回路１５は受光素子１１と
抵抗１２との接続ノードの電位Ｖｐを基準電圧Ｖ、と比
較し、該比較結果に応じてＦＥＴ帰還型増幅器１６の帰
還ＦＢＴ１（３ａの導通率を制御するものである。
し、この電気信号の出力レベルを−（４） 定とする平均光電力検出ＡＧＣ回路において、抵抗１２
を受光素子１１と電源端子との間に直列接続し、また、
並列ＦＥＴ帰還型増幅器１６を受光素子１１の出力に接
続し、これを増幅する。比較回路１５は受光素子１１と
抵抗１２との接続ノードの電位Ｖｐを基準電圧Ｖ、と比
較し、該比較結果に応じてＦＥＴ帰還型増幅器１６の帰
還ＦＢＴ１（３ａの導通率を制御するものである。
上述の手段によれば、受光素子１１の受光電力の変動が
あっても、比較回路１５は受光素子１１の電位Ｖ、が基
準電圧Ｖ、となるようにＦＥＴ帰還型増幅器１６の帰還
ＦＥＴの導通率を可変とするので、増幅器１６の出力は
所定レベルとなる。
あっても、比較回路１５は受光素子１１の電位Ｖ、が基
準電圧Ｖ、となるようにＦＥＴ帰還型増幅器１６の帰還
ＦＥＴの導通率を可変とするので、増幅器１６の出力は
所定レベルとなる。
第２図は本発明に係る平均光電力検出ＡＧＣ回路の一実
施例を示す回路図である。第２図において、１２はフォ
トダイオード１１に直列に接続された（５） 抵抗、１３．１４は基準電圧Ｖ、を発生する抵抗である
。受光素子１１の電位（受光素子１１と抵抗１２との接
続ノード電位）■、及び基準電圧ＶＲは伸張増幅器１５
に入力される。伸張増幅器１５は、オペアンプ１５１、
抵抗１５２． １５３．１５４． １５５、キャパシタ
１５６より構成された実用積分回路あるいは比較回路で
ある。なお、抵抗１５５は低周波補償用のシャント抵抗
である。また、ＶＣＣは電源電圧である。
施例を示す回路図である。第２図において、１２はフォ
トダイオード１１に直列に接続された（５） 抵抗、１３．１４は基準電圧Ｖ、を発生する抵抗である
。受光素子１１の電位（受光素子１１と抵抗１２との接
続ノード電位）■、及び基準電圧ＶＲは伸張増幅器１５
に入力される。伸張増幅器１５は、オペアンプ１５１、
抵抗１５２． １５３．１５４． １５５、キャパシタ
１５６より構成された実用積分回路あるいは比較回路で
ある。なお、抵抗１５５は低周波補償用のシャント抵抗
である。また、ＶＣＣは電源電圧である。
伸張増幅器１５においては、受光素子１１の電位Ｖ。
は電源電圧ＶＣＣに対して抵抗１５２．１５３により分
圧されてオペアンプ１５１の十入力端子に入力され、他
方、基準電圧ＶＲは抵抗１５４を介してオペアンプ１５
１の一入力端子に人力される。
圧されてオペアンプ１５１の十入力端子に入力され、他
方、基準電圧ＶＲは抵抗１５４を介してオペアンプ１５
１の一入力端子に人力される。
伸張増幅器１５の出力はＡＧＣ電圧として並列ＦＥＴ帰
還型前置増幅器１６の帰還ＦＢＴ１５ａのゲートに印加
される。
還型前置増幅器１６の帰還ＦＢＴ１５ａのゲートに印加
される。
並列ＦＥＴ帰還型前置増幅器１６の出力はキャパシタ１
７、増幅器１８を介して後段へ送出される。
７、増幅器１８を介して後段へ送出される。
第２図において、もし受光素子１１の受光電力の変動が
生じると、伸張増幅器１５において、係る＋（６） 入力側と基準電圧ＶＲの一入力端の両型位差に応じて制
御電圧Ｖ Ａ Ｇ Ｃが変化し、この結果、この電圧ｖ
ＡｃｃはＦＢＴ１６ａのゲートに印加されることからＦ
ＢＴ１６ａの導電率が変化し、従って、前置増幅器１６
の利得が制御される。つまり、並列ＦＥＴ帰還型前置増
幅器１６の出力が制御され、受光電力の変動が生じても
、一定出力電圧が得られる。これにより、キャパシタ１
７を介して増幅器１８により増幅され、常に所定の電力
が得られることになる。
生じると、伸張増幅器１５において、係る＋（６） 入力側と基準電圧ＶＲの一入力端の両型位差に応じて制
御電圧Ｖ Ａ Ｇ Ｃが変化し、この結果、この電圧ｖ
ＡｃｃはＦＢＴ１６ａのゲートに印加されることからＦ
ＢＴ１６ａの導電率が変化し、従って、前置増幅器１６
の利得が制御される。つまり、並列ＦＥＴ帰還型前置増
幅器１６の出力が制御され、受光電力の変動が生じても
、一定出力電圧が得られる。これにより、キャパシタ１
７を介して増幅器１８により増幅され、常に所定の電力
が得られることになる。
以上説明したように本発明によれば、利得変動を少なく
できると共に、部品数を少なくでき、従って、装置コス
トを低減できる。
できると共に、部品数を少なくでき、従って、装置コス
トを低減できる。
第１図は本発明の基本構成を示す回路図、第２図は本発
明に係る平均光電力検出ＡＧＣ回路の一実施例を示す回
路図、 第３図は従来の平均光電力検出ＡＧＣ回路を示す回路図
である。 （７〉 １１・・・受光素子、 １２・・・抵抗、１３．１４
・・・基準電圧発生用抵抗、１５・・・伸張増幅器（実
用積分回路、比較回路）１６・・・並列ＦＥＴ帰還型前
置増幅器。
明に係る平均光電力検出ＡＧＣ回路の一実施例を示す回
路図、 第３図は従来の平均光電力検出ＡＧＣ回路を示す回路図
である。 （７〉 １１・・・受光素子、 １２・・・抵抗、１３．１４
・・・基準電圧発生用抵抗、１５・・・伸張増幅器（実
用積分回路、比較回路）１６・・・並列ＦＥＴ帰還型前
置増幅器。
Claims (1)
- 【特許請求の範囲】 １、光信号を受光素子（１１）により電気信号に変換し
、該電気信号の出力レベルを一定とする平均光電力検出
ＡＧＣ回路において、 前記受光素子と電源端子との間に直列接続された抵抗（
１２）と、 前記受光素子の出力を増幅して出力とする並列ＦＥＴ帰
還型増幅器（１６）と、 前記受光素子と前記抵抗との接続ノードの電位（Ｖ＿Ｐ
）を基準電圧（Ｖ＿Ｒ）と比較し、該比較結果に応じて
前記ＦＥＴ帰還型増幅器の帰還ＦＥＴの導通率を制御す
る比較回路（１５）と を具備することを特徴とする平均光電力検出ＡＧＣ回路
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22749889A JPH0391307A (ja) | 1989-09-04 | 1989-09-04 | 平均光電力検出ａｇｃ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22749889A JPH0391307A (ja) | 1989-09-04 | 1989-09-04 | 平均光電力検出ａｇｃ回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0391307A true JPH0391307A (ja) | 1991-04-16 |
Family
ID=16861834
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP22749889A Pending JPH0391307A (ja) | 1989-09-04 | 1989-09-04 | 平均光電力検出ａｇｃ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0391307A (ja) |
-
1989
- 1989-09-04 JP JP22749889A patent/JPH0391307A/ja active Pending
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