JPH0363836A - マイクロ命令実行状況トレーサ - Google Patents

マイクロ命令実行状況トレーサ

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JPH0363836A
JPH0363836A JP1201615A JP20161589A JPH0363836A JP H0363836 A JPH0363836 A JP H0363836A JP 1201615 A JP1201615 A JP 1201615A JP 20161589 A JP20161589 A JP 20161589A JP H0363836 A JPH0363836 A JP H0363836A
Authority
JP
Japan
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address
trace
trace memory
data
clock
Prior art date
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Pending
Application number
JP1201615A
Other languages
English (en)
Inventor
Ichirou Shirosaka
白阪 一郎
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
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Publication of JPH0363836A publication Critical patent/JPH0363836A/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明はマイクロプログラムの実行状況トレースを記録
するトレースメモリに関し、特にファームウェアの実行
アドレスの記録及びマイクロプロセッサの動作状況の記
録を行うマイクロ命令実行状況トレーサに関する。
〔従来の技術〕
従来、この種のトレーサはファームウェアの実行アドレ
スの記録のみを行うものであった。このため、トレース
結果から障害解析等を行う場合、マイクロプログラム制
御回路が処理しているデータの値が不明のため、さらに
詳細な調査を行うときには、トラップ等によりマイクロ
プログラムの動作を途中で止めてレジスタの内容等を採
取する必要があり、多くの障害解析時間が必要であった
特にフィールドでの間歇障害等でトラップをかけて再度
データを取るようなことは困難であり、−度の障害で極
力多くの情報を採取する必要がある。
この点でも従来のトレーサでは情報が少なく不便であっ
た。
〔発明が解決しようとする課題〕
上述した従来のトレーサは、ファームウェアの実行アド
レスのみのトレースしか行えない構造となっているため
、障害が発生したときよりさらに詳細な情報が必要とな
っても、トラップ等をがけて再度障害が発生するのを待
つ必要があり、また、情報採取のために何回かの同一の
現象を起こさなければならないため、稀にしか発生しな
い現象の場合、障害原因の解明に多くの時間がかかって
しまうという問題点があった。
〔課題を解決するための手段〕
本発明のマイクロ命令実行状況トレーサは、マイクロプ
ログラム制御回路におけるマイクロ命令の実行状況のト
レースを行うためのマイクロ命令実行状況において、実
行アドレスのトレースを記憶するアドレストレースメモ
リと、前記マイクロプログラム制御回路内の演算部の出
力信号のトレースを記憶するデータトレースメモリと、
前記アドレストレースメモリ及びデータトレースメモリ
への書込みアドレスを指示するためのアドレスカウンタ
と、前記アドレストレースメモリ及びデータトレースメ
モリへの情報書込みを制御するコントロール部とを有し
ている。
〔実施例〕
次に、本発明について図面を参照して説明する。
第1図は本発明の一実施例のブロック図である。
第1図において、アドレストレースメモリ1には、マイ
クロプログラム制御回路(図示せず〉におけるマイクロ
命令の実行状況のトレースを行うために、マイクロプロ
グラム制御回路のマイクロアドレスがアドレス入力5か
ら入力され記憶される。また、データトレースメモリ2
にはマイクロプログラム制御回路の演算部の出力信号が
データ人力6から入力され記憶される。アドレスカウン
タ3は、クロック8によりカウントアツプされ、マイク
ロアドレス及びマイクロプログラム制御回路の演算部の
出力信号をそれぞれアドレストレースメモリ1.データ
トレースメモリ2に書込むためのアドレスを発生する。
書込みコントロール部4はクロック8からアドレストレ
ースメモリ1及びデータトレースメモリの書込み信号を
生成する。
次に、動作について説明する。マイクロプログラム制御
回路が起動し、ファームウェアの実行が開始されると、
本トレーサのクロック8にクロックが供給される。これ
と同時に、アドレス人力5実行中のマイクロアドレスが
供給されデータ人力6にはマイクロプログラム制御回路
の演算部の出力信号が供給される。また、書込コントロ
ール部4はクロック8から書込信号を生成し、この書込
信号によってマイクロアドレスとマイクロプログラム制
御回路の演算部の出力信号を、アドレスカウンタ3でア
ドレスされるアドレストレースメモリ1及びデータトレ
ースメモリ2の領域に書込む。アドレスカウンタ3は、
クロックによってカウントアツプし、次のマイクロアド
レスとマイクロプログラム制御回路の演算部の出力信号
の書込みアドレスを指示する。このような動作をくり返
し、順次2つのトレースメモリの書込みが実行される。
また、アドレストレースメモリ1及びデータトレースメ
モリ2の情報の読取りは、アドレスカウンタを順次カウ
ントアツプすることによってデータ出カフから読出すこ
とが出来る。
このように、アドレストレースメモリ及びデータトレー
スメモリを持ち、命令実行アドレスと命令実行結果を同
時に書込むことによって、命令の実行結果のトレースを
行えるようにする。これによって障害発生時の情報が一
度に取れるようになり、特に間歇障害等の状況を確実に
トレースに残すことが可能となる。
〔発明の効果〕
以上説明したように本発明は、アドレストレースメモリ
及びデータトレースメモリを持ち、命令実行アドレスと
命令実行結果を同時に書込むことによって、命令の実行
結果のトレースを行えるようにする。これによって障害
発生時の情報が一度に取れるようになり、特に間歇生涯
等の状況を確実にトレースに残すことが可能となるとい
う効果がある。
【図面の簡単な説明】
第1図は本発明の一実施例のブロック図である。 1・・・アドレストレースメモリ、2・・・データトレ
ースメモリ、3・・・アドレスカウンタ、4・・・書込
みコントロール部、5・・・アドレス入力、6・・・デ
ータ入力、7・・・データ出力。

Claims (1)

    【特許請求の範囲】
  1.  マイクロプログラム制御回路におけるマイクロ命令の
    実行状況のトレースを行うためのマイクロ命令実行状況
    トレーサにおいて、実行アドレスのトレースを記憶する
    アドレストレースメモリと、前記マイクロプログラム制
    御回路内の演算部の出力信号のトレースを記憶するデー
    タトレースメモリと、前記アドレストレースメモリ及び
    データトレースメモリへの書込みアドレスを指示するた
    めのアドレスカウンタと、前記アドレストレースメモリ
    及びデータトレースメモリへの情報書込みを制御するコ
    ントロール部とを有することを特徴とするマイクロ命令
    実行状況トレーサ。
JP1201615A 1989-08-02 1989-08-02 マイクロ命令実行状況トレーサ Pending JPH0363836A (ja)

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