JPH0361950B2 - - Google Patents

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JPH0361950B2
JPH0361950B2 JP55175468A JP17546880A JPH0361950B2 JP H0361950 B2 JPH0361950 B2 JP H0361950B2 JP 55175468 A JP55175468 A JP 55175468A JP 17546880 A JP17546880 A JP 17546880A JP H0361950 B2 JPH0361950 B2 JP H0361950B2
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voltage
display
signal line
display device
mos transistor
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Kenji Sano
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Description

【発明の詳細な説明】 本発明は１枚の基板上に表示画素数に等しい駆
動回路を並べて、走査信号により順次駆動回路内
のスイツチング素子を開閉し、映像信号に相当す
る電圧をコンデンサに保持させ、表示装置駆動用
スイツチング素子により、前記保持電圧に応じ画
像表示を行う表示装置駆動回路に関するものであ
る。
従来より、EL、LED、液晶等の表示素子及び
螢光表示管を用いた平面画像装置が開発されてお
り、特に螢光表示管を用いた表示装置が発表され
ている。
従来技術による螢光表示管を用いた表示装置駆
動回路の１画素分の等価回路を第１図に示す。
走査信号線３によりMOSトランジスタ２がオ
ン状態となり、映像信号線１の電圧が電圧保持用
コンデンサ４に保持される。コンデンサ４に保持
された電圧は螢光表示管駆動用トランジスタ６の
ゲート電圧となり、ドレイン電極７の電圧を決定
する。上記ドレイン電極７に接続された螢光表示
管のプレートには螢光体が塗布されているため、
上記回路からなるスイツチングアレイの上に構成
されたカソード電極９より放出された電子が、同
じくスイツチングアレイとカソード電極の間に構
成されたグリツド電極８により加速され、前記プ
レートの螢光体の電位に応じたエネルギーで螢光
体に衝突し発光させる。
第１図のようなスイツチングアレイを縦方向及
び横方向にマトリクス状に配列することにより任
意の画素数を持つた平板状の画像表示装置を構成
することができる。このマトリクス状のスイツチ
ングアレイをテレビの水平、垂直信号に相当する
信号で走査すると、選択されたMOSトランジス
タがオンして映像信号に応じた電圧が螢光体とカ
ソードの間に加わる。この時、同時に映像信号電
圧がコンデンサにより保持されるので、非選択時
でも螢光体をカソード間の電圧は維持され、チラ
ツキの少い安定した画像表示が可能となる。
さて、上記のような画像表示装置を製造する場
合の最大の問題点は、LSI技術で作られるスイツ
チングアレイの部分欠陥による表示画面の線状欠
陥や点欠陥であり、これら欠陥の数によつては商
品性を失うことになる。又、従来のスイツチング
アレイをLSIチツプとしてシリコンウエハ上に作
つた場合、ウエハ段階での各チツプのテストが不
可能で、すべての組み立て工程を終つて最終製品
となつた時点で、実際に表示動作をさせることに
より初めて欠陥検査が可能となる。このため最終
製品の歩留がLSIチツプの歩留により決定される
ため製品価格は非常に高くなつてしまう。
本発明は上記欠点を除去するためになされたも
ので、LSIチツプとして半導体基板上に作られた
スイツチングアレイの欠陥検査をウエハ状態で行
い、良品チツプのみを以後の表示装置組み立て工
程に供給することにより、表示装置組立て作業の
効率化を図ることを目的としたものである。
以下図面を用いて本発明を説明する。まず第２
図は上記第１図に対応させて示された本発明によ
る１画素分の等価回路図で、第１図と共通の番号
１〜６が付された各信号ライン、電圧保持用コン
デンサ及びMOSトランジスタの動作については
第１図と同じであるので省略する。第２図では螢
光表示管駆動用トランジスタ６と映像信号線１の
間がテスト用MOSトランジスタ１０により接続
されている。該MOSトランジスタ１０のゲート
端子はテスト用信号線１１に接続されており、テ
スト用信号線１１の信号レベルによつて螢光表示
管駆動用MOSトランジスタ６のドレイン７の電
圧を映像信号ライン１に読み出すことが可能であ
る。
このように走査信号線３により映像信号線１よ
りMOSトランジスタ２を介して、電圧保持用コ
ンデンサ４に印加された電圧は、MOSトランジ
スタ６及びテスト用信号線１１により駆動される
MOSトランジスタ１０を介して再び映像信号線
１に読み出すことができる。当然ながら走査信号
線３とテスト用信号線１１は異なつた時刻に駆動
されるので、MOSトランジスタ２とMOSトラン
ジスタ１０は同時にオンとなることは無く、映像
信号線１は入出力線として動作する。次に上記１
画素分のスイツチング回路が、表示画面に対応す
るべくマトリクスに配列された実施例を第３図を
用いて説明する。第３図では第２図で示された表
示駆動回路がＸ方向に４個C11〜C41、Ｙ方向に３
個C11〜C13のマトリクスとして配列された４×３
個の画素の表示装置駆動回路を構成している。マ
トリクスの各駆動回路の選択は、デイレイフリツ
プフロツプＤ×１〜Ｄ×４で構成されるＸシフト
レジスタと、デイレイフリツプフロツプDY1〜
DY3で構成されるＹシフトレジスタにより実行さ
れる。ＹシフトレジスタDY1〜DY3はＹシフト入
力SYとＹシフトクロツクφYにより順次シフト動
作を行い、テスト入力TEが論理“０”の時は
NANDゲートG1，G3，G5により順次S1，S2，S3
の走査線が選択されていき、テスト入力が論理
“１”の時は同様にNANDゲートG2，G4，G6に
よりテスト用信号線T1，T2，T3が順次選択され
ていく。
今、走査線S1が選択されているとC11，C21，
C31，C41の駆動回路の電圧保持容量への書き込み
が可能となる。S1が選択されている間、Ｙシフト
レジスタと同様Ｘシフト入力SxとＸシフトクロ
ツクφxによりＸシフトレジスタDx1〜Dx4が動作
し、順次MOSトランジスタTr1〜Tr4選択され、
順次C11，C21，C31，C41内の電圧保持コンデンサ
に映像信号入力が書き込まれる。又、テスト入力
TEが論理“１”でT1が選択されているときは順
次C11，C21，C31，C41のコンデンサに保持された
電圧がMOSトランジスタTr1〜Tr4を介して映像
信号線１1〜１4に読み出される。以下走査線S2，
S3及びテスト用信号線T2，T3についても同様の
動作が行われる。
以上述べたように本発明によれば、ウエハーの
状態で全駆動回路の欠陥検査を行うことができ、
欠陥の無い良質の半導体基板を選んで表示装置の
組み立てに供することができ表示装置を安価に製
造することができる。
尚、上記実施例では簡単のためスイツチング素
子としてＰチヤンネルMOSトランジスタを用い
た回路を挙げたが、ＮチヤンネルMOSトランジ
スタ、バイポーラトランジスタその他どのような
スイツチグォ素子でもよい。又スイツチング素子
を形成する基板はシリコン基板以外にどのような
基板を用いてもよい。又、表示装置は螢光表示管
以外、EL、LED、液晶等どのような表示素子を
用いてもよい。又、スイツチング素子を形成する
基板は１つの表示装置１枚又は複数枚使用しても
よい。
【図面の簡単な説明】
第１図は従来の表示装置の１画素を駆動させる
ための等価回路図、第２図は本発明による一実施
例の１画素分の駆動回路の等価回路図、第３図は
同駆動回路をマトリクスに配列した表示装置駆動
回路図である。 １：映像信号線、２：書込み用MOSトランジ
スタ、３：走査線、４：電圧保持コンデンサ、
６：表示画素駆動用MOSトランジスタ、１０：
駆動電圧読み出し用MOSトランジスタ。

Claims (1)

    【特許請求の範囲】
  1. １ 表示画素の夫々に対応して設けられた電圧保
    持用コンデンサと、前記コンデンサへの書き込み
    用スイツチ素子と、前記コンデンサに書き込まれ
    た電圧に応じて表示装置の表示画素を駆動するた
    めのスイツチ素子と、前記駆動用スイツチング素
    子の駆動電圧を読み出すためスイツチ素子を具備
    してなる表示装置駆動回路。
JP55175468A 1980-12-11 1980-12-11 Display driving circuit Granted JPS5799688A (en)

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