JPH0353636B2 - - Google Patents
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- JPH0353636B2 JPH0353636B2 JP56194805A JP19480581A JPH0353636B2 JP H0353636 B2 JPH0353636 B2 JP H0353636B2 JP 56194805 A JP56194805 A JP 56194805A JP 19480581 A JP19480581 A JP 19480581A JP H0353636 B2 JPH0353636 B2 JP H0353636B2
- Authority
- JP
- Japan
- Prior art keywords
- data
- key
- solenoid
- solenoid drive
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
- 238000010586 diagram Methods 0.000 description 7
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 description 5
- 238000005259 measurement Methods 0.000 description 2
- 238000006243 chemical reaction Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000007257 malfunction Effects 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Classifications
-
- G—PHYSICS
- G10—MUSICAL INSTRUMENTS; ACOUSTICS
- G10F—AUTOMATIC MUSICAL INSTRUMENTS
- G10F1/00—Automatic musical instruments
- G10F1/02—Pianofortes with keyboard
Landscapes
- Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Acoustics & Sound (AREA)
- Multimedia (AREA)
- Electrophonic Musical Instruments (AREA)
Description
【発明の詳細な説明】
この発明は、例えばピアノ自動演奏装置等、楽
器を自動的に演奏する楽器自動演奏装置に関す
る。
器を自動的に演奏する楽器自動演奏装置に関す
る。
従来のピアノ自動演奏装置として、予めカセツ
トテープに演奏データを記録させておき、この演
奏データを読出してピアノを自動的に演奏する装
置が知られている。第１図は、この種のピアノ自
動演奏装置におけるカセツトテープのデータ記録
状態を示す図であり、この図において領域R1に
は同期信号SYCが記録され、領域R2には高音域
の各キー（鍵）のオン／オフ状態が“１”／
“０”の信号で記録され、領域R3には高音域の音
量データが記録され、領域R4には低音域の各キ
ーのオン／オフ状態が記録され、また、領域R5
には低音域の音量データが記録されている。そし
てこのカセツトテープに記録された各データはシ
リアルデータとして読出され、一且ラツチ回路に
ラツチされ、このラツチされたデータに基づいて
キーが駆動される。
トテープに演奏データを記録させておき、この演
奏データを読出してピアノを自動的に演奏する装
置が知られている。第１図は、この種のピアノ自
動演奏装置におけるカセツトテープのデータ記録
状態を示す図であり、この図において領域R1に
は同期信号SYCが記録され、領域R2には高音域
の各キー（鍵）のオン／オフ状態が“１”／
“０”の信号で記録され、領域R3には高音域の音
量データが記録され、領域R4には低音域の各キ
ーのオン／オフ状態が記録され、また、領域R5
には低音域の音量データが記録されている。そし
てこのカセツトテープに記録された各データはシ
リアルデータとして読出され、一且ラツチ回路に
ラツチされ、このラツチされたデータに基づいて
キーが駆動される。
このように、従来のピアノ自動演奏装置におい
ては、キーのオン／オフ状態を各キー毎に
“１”／“０”の信号でシリアルに記録し、この
記録された信号をシリアルに読出してキーを指定
するようになつている。しかしながら、このよう
なシリアル転送においては、ピツト落ちが避けら
れず、したがつて、このピツト落ちによる誤動作
を防ぐ何らかの手段が必要となり、回路構成が複
雑になる問題がある。
ては、キーのオン／オフ状態を各キー毎に
“１”／“０”の信号でシリアルに記録し、この
記録された信号をシリアルに読出してキーを指定
するようになつている。しかしながら、このよう
なシリアル転送においては、ピツト落ちが避けら
れず、したがつて、このピツト落ちによる誤動作
を防ぐ何らかの手段が必要となり、回路構成が複
雑になる問題がある。
この発明はこのような事情に鑑み、各キーをキ
ーアドレスによつて指定するようにし、これによ
り、キーを指定するための回路構成の簡略化を図
つたものである。
ーアドレスによつて指定するようにし、これによ
り、キーを指定するための回路構成の簡略化を図
つたものである。
以下、図面を参照しこの発明の一実施例につい
て説明する。
て説明する。
第２図は、この発明によるピアノ自動演奏装置
の構成を示すブロツク図である。この図において
符号１は各キーに各々近接して設けられたキー駆
動用のソレノイドであり、この図に示す回路は、
これらのソレノイド１を記憶部２に記憶されてい
る演奏データに基づいて駆動し、ピアノを自動的
に演奏するものである。
の構成を示すブロツク図である。この図において
符号１は各キーに各々近接して設けられたキー駆
動用のソレノイドであり、この図に示す回路は、
これらのソレノイド１を記憶部２に記憶されてい
る演奏データに基づいて駆動し、ピアノを自動的
に演奏するものである。
すなわち、この図において、符号３はキーを指
定するためのキーアドレスSADおよびソレノイ
ド１を駆動するためのソレノイド駆動データ
SKDを楽曲の進行順に順次出力するデータ出力
回路であり、記憶部２、操作部４および制御回路
５から構成されている。記憶部２は予め各ソレノ
イド１を駆動するための演奏データが楽曲の進行
順に記憶されているメモリである。ここで、記憶
部２に記憶されている演奏データについて説明す
る。まず、キーオンを指定する演奏データED−
１は、第３図イに示すように、オン／オフ識別コ
ード“１”と、キーコードKCと、打鍵強度デー
タSDと、時間データTDとから構成される。この
場合、打鍵強度データSDはキーの打鍵強度、す
なわち、ソレノイド１のプランジヤの駆動速度に
対応するデータであり、また時間データTDはキ
ーを駆動すべき時刻に関するデータである。一
方、キーオフを指定する演奏データED−２は、
第３図ロに示すように、オン／オフ識別コード
“１”と、キーコードKCと、時間データTDとか
ら構成される。そして、記憶部２には、これらの
演奏データEDが順次演奏順に記憶されている。
定するためのキーアドレスSADおよびソレノイ
ド１を駆動するためのソレノイド駆動データ
SKDを楽曲の進行順に順次出力するデータ出力
回路であり、記憶部２、操作部４および制御回路
５から構成されている。記憶部２は予め各ソレノ
イド１を駆動するための演奏データが楽曲の進行
順に記憶されているメモリである。ここで、記憶
部２に記憶されている演奏データについて説明す
る。まず、キーオンを指定する演奏データED−
１は、第３図イに示すように、オン／オフ識別コ
ード“１”と、キーコードKCと、打鍵強度デー
タSDと、時間データTDとから構成される。この
場合、打鍵強度データSDはキーの打鍵強度、す
なわち、ソレノイド１のプランジヤの駆動速度に
対応するデータであり、また時間データTDはキ
ーを駆動すべき時刻に関するデータである。一
方、キーオフを指定する演奏データED−２は、
第３図ロに示すように、オン／オフ識別コード
“１”と、キーコードKCと、時間データTDとか
ら構成される。そして、記憶部２には、これらの
演奏データEDが順次演奏順に記憶されている。
操作部４は、自動演奏のスタートを指示するス
タートスイツチ、自動演奏の停止を指示するスト
ツプスイツチ、音量を指示する音量スイツチ等を
有して構成されるもので、各スイツチの出力は制
御回路５へ供給される。
タートスイツチ、自動演奏の停止を指示するスト
ツプスイツチ、音量を指示する音量スイツチ等を
有して構成されるもので、各スイツチの出力は制
御回路５へ供給される。
制御回路５は記憶部２から演奏データEDを順
次読出し、読出した演奏データEDに基づいてキ
ーアドレスSAD（７ビツト）、ソレノイド駆動デ
ータSKD（８ビツト）およびロード信号LD（１ビ
ツト）を出力する回路である。この場合、ソレノ
イド駆動データSKDは打鍵強度データSDに基づ
いて作成されるデータであり、その最上位ビツト
（MSB）がソレノイド１のオン／オフを指示する
ビツトとなり、他の７ビツトがソレノイド１を駆
動するためのデータとなる。そして、上述したキ
ーアドレスSADがデコーダ７へ供給され、ソレ
ノイド駆動データSKDが各ソレノイド１に対応
して設けられたソレノイド駆動回路９のラツチ回
路１０へそれぞれ供給され、また、ロード信号
LDが各ラツチ回路１０のロード端子Ｌへ供給さ
れる。なお、この制御回路５については後に詳述
する。
次読出し、読出した演奏データEDに基づいてキ
ーアドレスSAD（７ビツト）、ソレノイド駆動デ
ータSKD（８ビツト）およびロード信号LD（１ビ
ツト）を出力する回路である。この場合、ソレノ
イド駆動データSKDは打鍵強度データSDに基づ
いて作成されるデータであり、その最上位ビツト
（MSB）がソレノイド１のオン／オフを指示する
ビツトとなり、他の７ビツトがソレノイド１を駆
動するためのデータとなる。そして、上述したキ
ーアドレスSADがデコーダ７へ供給され、ソレ
ノイド駆動データSKDが各ソレノイド１に対応
して設けられたソレノイド駆動回路９のラツチ回
路１０へそれぞれ供給され、また、ロード信号
LDが各ラツチ回路１０のロード端子Ｌへ供給さ
れる。なお、この制御回路５については後に詳述
する。
デコーダ７は制御回路５から出力されるキーア
ドレスSADをデコードするもので、このデコー
ダ７の各出力は各々、対応するソレノイド駆動回
路９のラツチ回路１０のエネーブル端子Ｅへ供給
される。
ドレスSADをデコードするもので、このデコー
ダ７の各出力は各々、対応するソレノイド駆動回
路９のラツチ回路１０のエネーブル端子Ｅへ供給
される。
ソレノイド駆動回路９はラツチ回路１０、駆動
信号発生回路１１、アンドゲート１２、バツフア
アンプ１３から構成されるもので、バツフアアン
プ１３の出力がソレノイド１へ供給される。ラツ
チ回路１０はそのエネーブル端子Ｅへ“１”信号
が供給されると、データラツチ可能状態となり、
この状態においてそのロード端子Ｌへ“０”信号
が供給されると、ソレノイド駆動データSKDを
ラツチする。そして、ラツチしたデータSKDの
MSBをアンドゲート１２の一方の入力端へ供給
し、また、他の７ビツトを駆動信号発生回路１１
へ供給する。駆動信号発生回路１１は、ラツチ回
路１０から供給されるソレノイド駆動データ
SKDに対応するパルス幅を有する一定周期のソ
レノイド駆動信号を作成し、アンドゲート１２お
よびバツフアアンプ１３を介してソレノイド１へ
供給する。これにより、ソレノイド１が駆動され
る。
信号発生回路１１、アンドゲート１２、バツフア
アンプ１３から構成されるもので、バツフアアン
プ１３の出力がソレノイド１へ供給される。ラツ
チ回路１０はそのエネーブル端子Ｅへ“１”信号
が供給されると、データラツチ可能状態となり、
この状態においてそのロード端子Ｌへ“０”信号
が供給されると、ソレノイド駆動データSKDを
ラツチする。そして、ラツチしたデータSKDの
MSBをアンドゲート１２の一方の入力端へ供給
し、また、他の７ビツトを駆動信号発生回路１１
へ供給する。駆動信号発生回路１１は、ラツチ回
路１０から供給されるソレノイド駆動データ
SKDに対応するパルス幅を有する一定周期のソ
レノイド駆動信号を作成し、アンドゲート１２お
よびバツフアアンプ１３を介してソレノイド１へ
供給する。これにより、ソレノイド１が駆動され
る。
次に、上記構成による回路の動作を説明する。
操作者が操作部４のスタートスイツチを押す
と、制御回路５が、まず記憶部２の先頭番地に記
憶されている演奏データEDを読出す。ここで、
読出された演奏データEDが第３図イに示す演奏
データED−１であるとし、また、この演奏デー
タED−１のキーコードKCがキーF3（第３オクタ
ーブＦ音のキー）のアドレスSADであるとする。
以後、制御回路５はクロツクパルスに基づいて演
奏データED−１の時間データTDに対応する時
間を計測する。そして、時間データTDに対応す
る時間が経過した時点で、次の演奏データEDを
読出す。ここで、読出された演奏データEDが第
３図ロに示す演奏データED−２であるとし、ま
た、この演奏データED−２のキーコードKCがキ
ーF3のキーアドレスSADであるとする。以後、
制御回路５は上記演奏データED−２の時間デー
タTDに対応する時間を計測すると共に、時間計
測が終了した演奏データED−１のキーコードKC
および打鍵強度データSDの処理を行う。すなわ
ち、まず打鍵強度データSDをソレノイド１の特
性に応じて変換し、MSBが“１”のソレノイド
駆動データSKDを得る。次に、変換によつて得
られたソレノイド駆動データSKDを、キーF3の
キーアドレスSADと共に、第４図に示す一定時
間Ｔの間出力する。また、上記時間Ｔの略中間に
おいて第４図ハに示すロード信号LD（“０”信号）
を出力する。F3のキーアドレスSADが制御回路
５から出力されると、デコーダ７がこのキーアド
レスSADをデコードし、キーF3に対応するソレ
ノイド駆動回路９のラツチ回路１０へ“１”信号
を出力する。これにより、同ラツチ回路１０がエ
ネーブル状態となる。次いで、ロード信号LDが
同ラツチ回路１０へ供給されると、同ラツチ回路
１０がソレノイド駆動データSKDをラツチし、
ラツチしたデータSKDのMSB（“１”信号）をア
ンドゲート１２へ、他の７ビツトを駆動信号発生
回路１１へ各々出力する。駆動信号発生回路１１
は供給されたソレノイド駆動データSKDに対応
するパルス幅を有する一定周期のソレノイド駆動
信号を作成し、アンドゲート１２の他方の入力端
へ供給する。この時、アンドゲート１２は、その
一方の入力端へ“１”信号が供給されていること
から開状態にある。したがつて、アンドゲート１
２の他方の入力端へ供給されたソレノイド駆動信
号は同アンドゲート１２およびバツフアアンプ１
３を介して、キーF3に設けられたソレノイド１
へ供給される。これにより、キーF3のソレノイ
ド１が駆動され、キーF3が駆動される。
と、制御回路５が、まず記憶部２の先頭番地に記
憶されている演奏データEDを読出す。ここで、
読出された演奏データEDが第３図イに示す演奏
データED−１であるとし、また、この演奏デー
タED−１のキーコードKCがキーF3（第３オクタ
ーブＦ音のキー）のアドレスSADであるとする。
以後、制御回路５はクロツクパルスに基づいて演
奏データED−１の時間データTDに対応する時
間を計測する。そして、時間データTDに対応す
る時間が経過した時点で、次の演奏データEDを
読出す。ここで、読出された演奏データEDが第
３図ロに示す演奏データED−２であるとし、ま
た、この演奏データED−２のキーコードKCがキ
ーF3のキーアドレスSADであるとする。以後、
制御回路５は上記演奏データED−２の時間デー
タTDに対応する時間を計測すると共に、時間計
測が終了した演奏データED−１のキーコードKC
および打鍵強度データSDの処理を行う。すなわ
ち、まず打鍵強度データSDをソレノイド１の特
性に応じて変換し、MSBが“１”のソレノイド
駆動データSKDを得る。次に、変換によつて得
られたソレノイド駆動データSKDを、キーF3の
キーアドレスSADと共に、第４図に示す一定時
間Ｔの間出力する。また、上記時間Ｔの略中間に
おいて第４図ハに示すロード信号LD（“０”信号）
を出力する。F3のキーアドレスSADが制御回路
５から出力されると、デコーダ７がこのキーアド
レスSADをデコードし、キーF3に対応するソレ
ノイド駆動回路９のラツチ回路１０へ“１”信号
を出力する。これにより、同ラツチ回路１０がエ
ネーブル状態となる。次いで、ロード信号LDが
同ラツチ回路１０へ供給されると、同ラツチ回路
１０がソレノイド駆動データSKDをラツチし、
ラツチしたデータSKDのMSB（“１”信号）をア
ンドゲート１２へ、他の７ビツトを駆動信号発生
回路１１へ各々出力する。駆動信号発生回路１１
は供給されたソレノイド駆動データSKDに対応
するパルス幅を有する一定周期のソレノイド駆動
信号を作成し、アンドゲート１２の他方の入力端
へ供給する。この時、アンドゲート１２は、その
一方の入力端へ“１”信号が供給されていること
から開状態にある。したがつて、アンドゲート１
２の他方の入力端へ供給されたソレノイド駆動信
号は同アンドゲート１２およびバツフアアンプ１
３を介して、キーF3に設けられたソレノイド１
へ供給される。これにより、キーF3のソレノイ
ド１が駆動され、キーF3が駆動される。
次に、記憶部２から読出された演奏データED
−２の時間データTDに対応する時間が経過する
と、制御回路５が次の演奏データEDを記憶部２
から読出す。以後、制御回路５は読出した演奏デ
ータEDの時間データTDに対応する時間を計測
すると共に、時間計測が終了した演奏データED
−２の処理を行う。すなわち、オン／オフ識別コ
ード“１”に基づいてキーオフを検知し、MSB
が“０”のソレノイド駆動データSKDを作成す
る。そして、このソレノイド駆動データSKDを
演奏データED−２のキーF3のキーアドレスSAD
と共に、一定時間Ｔの間出力する。また、一定時
間Ｔの略中間においてロード信号LDを出力する。
これにより、キーF3に対応するソレノイド駆動
回路９のラツチ回路１０へ、MSBが“０”のソ
レノイド駆動信号SKDが読込まれ、この結果、
同ソレノイド駆動回路９のアンドゲート１２がオ
フとされ、キーF3の駆動状態が解除される。以
下、上述した動作が繰り返えされ、ピアノが自動
的に演奏される。
−２の時間データTDに対応する時間が経過する
と、制御回路５が次の演奏データEDを記憶部２
から読出す。以後、制御回路５は読出した演奏デ
ータEDの時間データTDに対応する時間を計測
すると共に、時間計測が終了した演奏データED
−２の処理を行う。すなわち、オン／オフ識別コ
ード“１”に基づいてキーオフを検知し、MSB
が“０”のソレノイド駆動データSKDを作成す
る。そして、このソレノイド駆動データSKDを
演奏データED−２のキーF3のキーアドレスSAD
と共に、一定時間Ｔの間出力する。また、一定時
間Ｔの略中間においてロード信号LDを出力する。
これにより、キーF3に対応するソレノイド駆動
回路９のラツチ回路１０へ、MSBが“０”のソ
レノイド駆動信号SKDが読込まれ、この結果、
同ソレノイド駆動回路９のアンドゲート１２がオ
フとされ、キーF3の駆動状態が解除される。以
下、上述した動作が繰り返えされ、ピアノが自動
的に演奏される。
なお、この発明は上述したピアノ自動演奏装置
に限らず、他の鍵盤楽器の自動演奏装置にも適用
し得ることは勿論である。
に限らず、他の鍵盤楽器の自動演奏装置にも適用
し得ることは勿論である。
以上説明したように、この発明によれば、駆動
すべきキーをキーアドレスによつて指定するよう
にしたので、キーを指定するための回路構成を簡
略化することができ、かつ、信頼性の高い自動演
奏を行うことができる効果がある。
すべきキーをキーアドレスによつて指定するよう
にしたので、キーを指定するための回路構成を簡
略化することができ、かつ、信頼性の高い自動演
奏を行うことができる効果がある。
第１図は従来のピアノ自動演奏装置における演
奏データの記録状態を示す図、第２図はこの発明
の一実施例の構成を示す図、第３図イ，ロは各々
同実施例において用いられる演奏データの形式を
示す図、第４図イ〜ハは各々、キーアドレス
SAD、ソレノイド駆動データSKD、ロード信号
LDが制御回路５から出力されるタイミングを示
す図である。 １……ソレノイド、３……データ出力回路、７
……デコーダ、９……ソレノイド駆動回路。
奏データの記録状態を示す図、第２図はこの発明
の一実施例の構成を示す図、第３図イ，ロは各々
同実施例において用いられる演奏データの形式を
示す図、第４図イ〜ハは各々、キーアドレス
SAD、ソレノイド駆動データSKD、ロード信号
LDが制御回路５から出力されるタイミングを示
す図である。 １……ソレノイド、３……データ出力回路、７
……デコーダ、９……ソレノイド駆動回路。
Claims (1)
- 【特許請求の範囲】 １ キー駆動用の複数のソレノイドと、 駆動すべきキーに対応するキーアドレスおよび
キーを駆動する強度を示す強度データを楽曲の進
行順に順次出力するデータ出力回路と、 このデータ出力回路から出力されたキーアドレ
スをデコードし、そのデコード結果を選択信号と
して出力するデコーダと、 前記複数のキーに各々対応して設けられたソレ
ノイド駆動回路であつて、前記データ出力回路か
ら出力された強度データを前記選択信号入力時に
読み込み、この強度データに対応する電流で前記
ソレノイドを駆動するソレノイド駆動回路と、 を具備してなる楽器自動演奏装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56194805A JPS5897175A (ja) | 1981-12-03 | 1981-12-03 | 楽器自動演奏装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56194805A JPS5897175A (ja) | 1981-12-03 | 1981-12-03 | 楽器自動演奏装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5897175A JPS5897175A (ja) | 1983-06-09 |
| JPH0353636B2 true JPH0353636B2 (ja) | 1991-08-15 |
Family
ID=16330545
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56194805A Granted JPS5897175A (ja) | 1981-12-03 | 1981-12-03 | 楽器自動演奏装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5897175A (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62299994A (ja) * | 1986-06-20 | 1987-12-26 | ヤマハ株式会社 | 自動演奏ピアノ |
| JPH05289658A (ja) * | 1992-04-07 | 1993-11-05 | Kawai Musical Instr Mfg Co Ltd | ピアノの自動演奏装置 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5034931A (ja) * | 1973-06-29 | 1975-04-03 | ||
| JPS5039534A (ja) * | 1973-08-13 | 1975-04-11 |
-
1981
- 1981-12-03 JP JP56194805A patent/JPS5897175A/ja active Granted
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5034931A (ja) * | 1973-06-29 | 1975-04-03 | ||
| JPS5039534A (ja) * | 1973-08-13 | 1975-04-11 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5897175A (ja) | 1983-06-09 |
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