JPH0350865A - 定電流回路 - Google Patents

定電流回路

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JPH0350865A
JPH0350865A JP1186610A JP18661089A JPH0350865A JP H0350865 A JPH0350865 A JP H0350865A JP 1186610 A JP1186610 A JP 1186610A JP 18661089 A JP18661089 A JP 18661089A JP H0350865 A JPH0350865 A JP H0350865A
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JP
Japan
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circuit
bpt
jfet
region
constant
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Pending
Application number
JP1186610A
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English (en)
Inventor
Shuichi Katao
片尾 周一
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Canon Inc
Original Assignee
Canon Inc
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Publication date
Application filed by Canon Inc filed Critical Canon Inc
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Priority to US07/552,704 priority patent/US5091689A/en
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Priority to DE69029488T priority patent/DE69029488T2/de
Publication of JPH0350865A publication Critical patent/JPH0350865A/ja
Pending legal-status Critical Current

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    • GPHYSICS
    • G05CONTROLLING; REGULATING
    • G05FSYSTEMS FOR REGULATING ELECTRIC OR MAGNETIC VARIABLES
    • G05F3/00Non-retroactive systems for regulating electric variables by using an uncontrolled element, or an uncontrolled combination of elements, such element or such combination having self-regulating properties
    • G05F3/02Regulating voltage or current
    • G05F3/08Regulating voltage or current wherein the variable is dc
    • G05F3/10Regulating voltage or current wherein the variable is dc using uncontrolled devices with non-linear characteristics
    • G05F3/16Regulating voltage or current wherein the variable is dc using uncontrolled devices with non-linear characteristics being semiconductor devices
    • G05F3/20Regulating voltage or current wherein the variable is dc using uncontrolled devices with non-linear characteristics being semiconductor devices using diode- transistor combinations

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  • General Physics & Mathematics (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Automation & Control Theory (AREA)
  • Bipolar Integrated Circuits (AREA)
  • Control Of Electrical Variables (AREA)
  • Amplifiers (AREA)
  • Bipolar Transistors (AREA)
  • Junction Field-Effect Transistors (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [産業上の利用分野] 本発明は、定電流回路に関し、特に、アナログ集積回路
において使用される定電流回路に関するものである。
[従来技術] 従来、アナログ集積回路において使用される定電流回路
としては、様々な回路が提案されている。
第3図は、従来の定電流回路の一例を示す回路図である
0図において、T、、 Tb 、Tl〜T。
はトランジスタを示し、21〜Z、は負荷を示す。また
、■1〜I、は本回路において得られる定電流である。
このような定電流回路は、負荷21〜Z、が変動した場
合に、■1〜I、の増加または減少に応じてIoが増加
または減少することにより、■1〜I、の値を一定に保
つものである。
また、第4図は、従来の定電流回路の他の例を示す回路
図である0図において、T−、Tb。
TI、T2はそれぞれトランジスタを示し、Z。
およびZ2はそれぞれ負荷であり、■1および■2はそ
れぞれ本回路において得られる定電流である。このよう
な定電流回路においても、■。が増加または減少するこ
とにより、11および■2の値を一定に保つことができ
る。
[発明が解決しようとする課題] しかしながら、上述のような従来の定電流回路は、以下
のような課題を有していた。
(1)第3図に示した定電流回路においては、トランジ
スタの特性のバラツキ等によって電流値の誤差が生じ、
所望の定電流を精度良く得ることができない場合がある
(2)第4図に示した定電流回路においては、バンドギ
ャップ回路およびアンプ回路を必要とするため、回路規
模が大きく、かつ、複雑となる。
本発明は、このような従来の定電流回路の有する課題に
鑑みてなされたものであり、回路構成が簡単で集積回路
内における占有面積が少なく、かつ、電流値の誤差の少
ない定電流回路を提供することを目的とする。
[課題を解決するための手段] 本発明の定電流回路は、 集積回路内に形成された接合型電界効果トランジスタと
バイポーラトランジスタとを有し、当該接合型電界効果
トランジスタと当該バイポーラトランジスタとが同一ア
イソレーション内に形成され、かつ、当該接合型電界効
果トランジスタのチャネル形成領域と当該バイポーラト
ランジスタのベース領域とが共通化されていることを特
徴とする。
上記特徴においては、接合型電界効果トランジスタのゲ
ート領域とバイポーラトランジスタのコレクタ領域とが
、さらに共通化されていることが望ましい。
[作用] 本発明は、接合型電界効果トランジスタ(以下、JFE
Tと記す)のチャネル形成領域とバイポーラトランジス
タ(以下、BPTと記す)のベース領域とを共通化する
ことにより、BPTのベースの幅(JFETにおいては
チャネル形成領域の幅)のバラツキによるBPTのコレ
クタ電流のバラツキをJFETのドレイン電流によって
補い、これによりBPTのコレクタ電流を一定に保つよ
うにしたものである。従って、本発明の定電流回路によ
れば、BPTのベース幅のバラツキに起因する電流値の
バラツキを排除することができる。
また、本発明の定電流回路は、JFETとBPTとを同
一アイソレーション内で形成し、さらには、JPETの
チャネル形成領域とBPTのベース領域とを共通化した
ので、回路構成を簡略化し、集積回路内における占有面
積を少なくすることが可能である。ここで、JFETの
ゲート領域とBPTのコレクタ領域とを共通化すれば、
いっそうの簡略化、小面積化が可能である。
[実施例] 以下、本発明の1実施例について、図を用いて説明する
第1図(a)は、本実施例に係わる定電流回路の要部を
示す模式的上面図であり、NPN型BPT(以下、単に
BPTと記す)とPチャネルのJFET(以下、単にJ
FETと記す)が形成されている。なお、BPTおよび
JFETは、第3図および第4図のトランジスタT1お
よびT。
に相当する。また、第1図(b)は、第1図(a)に示
した回路のx−x’断面を示す模式的断面図である。第
1図(a)および第1図(b)において、1はアイソレ
ーション、2はBPTのコレクタ兼JFETのゲート、
2°はBPTのコレクタ兼JFETのゲート2のコンタ
クト部、3はJFETのソース(またはドレイン)、4
はBPTのベース兼JFETのドレイン(またはソース
)、4゛はBPTのベース兼JFETのドレイン4のコ
ンタクト部、5はBPTのエミッタ、5°はBPTのエ
ミッタ5のコンタクト部、6はBPTのベース兼JFE
Tのチャネル形成領域である。
また、第2図は、第1図(a)および第1図(b)に示
した回路の等価回路を示す回路図である。図において、
端子A、B、Cは、それぞれ、第1図(b)に示した端
子A、B、Cに対応している。
このような回路を用いて、第3図に示したような構成の
定電流回路を構成することにより、電流値の誤差の少な
い定電流回路を得ることができた。
以下、第1図(a)および第1図(b)に示した構成に
よってBPTのコレクタ電流のバラツキを小さくおさえ
ることができる理由について、第1図(b)を用いて説
明する。
第1図(b)において、Wは、BPTのベースの幅であ
ると共にJFETのチャネル形成領域の幅である。
ここで、Wが大きくなった時、BPTのベース幅が大き
くなることにより当該BPTの増幅率βは小さくなる。
しかし、同時にJFETのチャネル形成領域の幅が大き
くなるため、当該JFETのドレイン電流、すなわちB
PTのベース電流は大きくなり、増幅率βの減少分を補
い、BPTのコレクタ電流は一定となる。
逆にWが小さくなった時は、BPTの増幅率βが大きく
なるが、JFETのドレイン電流は小さくなるため、コ
レクタ電流を一定とできる。
以上説明したように、第1図(a)および第1図(b)
に示した回路は、製造時のWのバラツキによってBPT
のコレクタ電流値が変ることがないので、当該コレクタ
電流値を一定とすることができる。
また、本実施例では、JFETのチャネル形成領域とB
PTのベースおよびJFETのゲートとBPTのコレク
タをそれぞれ共通化したため、定電流回路の構成を簡略
化することができ、かつ、面積を小さくすることができ
た。
[発明の効果] 以上、詳細に説明したように、本発明によれば、集積回
路内における占有面積が少なく、かつ、精度の良い定電
流回路を提供することができる。
従って、本発明によれば、チップサイズが小さく、かつ
、信顆性の高いアナログ集積回路を提供することができ
る。
【図面の簡単な説明】
第1図(a)は本実施例に係わる定電流回路の要部を示
す模式的上面図、第1図(b)は第1図(a)に示した
回路のx−x’断面を示す模式的断面図、第2図は第1
図(a)および第1図(b)に示した回路の等価回路を
示す回路図、第3図は従来の定電流回路の一例を示す回
路図、第4図は従来の定電流回路の他の例を示す回路図
である。 (符号の説明) 1・・・アイソレーション、2・・・BPTのコレクタ
兼JFETのゲート、2°・・・BPTのコレクタ兼J
FETのゲート2のコンタクト部、3・・・JFETの
ソース(またはドレイン)、3゛・・・JFETのソー
ス3のコンタクト部、4・・・BPTのベース兼JFE
Tのドレイン(またはソース)4°・・・BPTのベー
ス兼JFETのドレイン4のコンタクト部、5・・・B
PTのエミッタ、5°・・・BPTのエミッタ5のコン
タクト部、6・・・BPTのベース兼JFETのチャネ
ル形成領域。 第 図 第 2 図 第 図 第 図

Claims (2)

    【特許請求の範囲】
  1. (1)集積回路内に形成された接合型電界効果トランジ
    スタとバイポーラトランジスタとを有し、当該接合型電
    界効果トランジスタと当該バイポーラトランジスタとが
    同一アイソレーション内に形成され、かつ、当該接合型
    電界効果トランジスタのチャネル形成領域と当該バイポ
    ーラトランジスタのベース領域とが共通化されているこ
    とを特徴とする定電流回路
  2. (2)接合型電界効果トランジスタのゲート領域とバイ
    ポーラトランジスタのコレクタ領域とが共通化されてい
    ることを特徴とする請求項1記載の定電流回路。
JP1186610A 1989-07-19 1989-07-19 定電流回路 Pending JPH0350865A (ja)

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US07/552,704 US5091689A (en) 1989-07-19 1990-07-16 Constant current circuit and integrated circuit having said circuit
EP90307813A EP0409571B1 (en) 1989-07-19 1990-07-17 Integrated constant current circuit with a BJT and a JFET
DE69029488T DE69029488T2 (de) 1989-07-19 1990-07-17 Integrierte Konstantstromschaltung mit einem BJT und einem JFET

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EP0409571A2 (en) 1991-01-23
DE69029488T2 (de) 1997-04-24
EP0409571A3 (en) 1992-01-22
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