JPH0334684B2 - - Google Patents
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- JPH0334684B2 JPH0334684B2 JP59142724A JP14272484A JPH0334684B2 JP H0334684 B2 JPH0334684 B2 JP H0334684B2 JP 59142724 A JP59142724 A JP 59142724A JP 14272484 A JP14272484 A JP 14272484A JP H0334684 B2 JPH0334684 B2 JP H0334684B2
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- inductor
- pattern
- frequency
- capacitor
- circuit
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- 239000003990 capacitor Substances 0.000 claims abstract description 31
- 239000000758 substrate Substances 0.000 claims description 20
- 230000008878 coupling Effects 0.000 claims description 2
- 238000010168 coupling process Methods 0.000 claims description 2
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- 238000010586 diagram Methods 0.000 description 9
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- 238000006243 chemical reaction Methods 0.000 description 1
- 238000010276 construction Methods 0.000 description 1
- 230000003247 decreasing effect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03H—IMPEDANCE NETWORKS, e.g. RESONANT CIRCUITS; RESONATORS
- H03H7/00—Multiple-port networks comprising only passive electrical elements as network components
- H03H7/01—Frequency selective two-port networks
- H03H7/0115—Frequency selective two-port networks comprising only inductors and capacitors
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03H—IMPEDANCE NETWORKS, e.g. RESONANT CIRCUITS; RESONATORS
- H03H7/00—Multiple-port networks comprising only passive electrical elements as network components
- H03H7/01—Frequency selective two-port networks
- H03H7/17—Structural details of sub-circuits of frequency selective networks
- H03H7/1708—Comprising bridging elements, i.e. elements in a series path without own reference to ground and spanning branching nodes of another series path
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03H—IMPEDANCE NETWORKS, e.g. RESONANT CIRCUITS; RESONATORS
- H03H7/00—Multiple-port networks comprising only passive electrical elements as network components
- H03H7/01—Frequency selective two-port networks
- H03H7/17—Structural details of sub-circuits of frequency selective networks
- H03H7/1741—Comprising typical LC combinations, irrespective of presence and location of additional resistors
- H03H7/1775—Parallel LC in shunt or branch path
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03H—IMPEDANCE NETWORKS, e.g. RESONANT CIRCUITS; RESONATORS
- H03H7/00—Multiple-port networks comprising only passive electrical elements as network components
- H03H7/01—Frequency selective two-port networks
- H03H7/17—Structural details of sub-circuits of frequency selective networks
- H03H7/1741—Comprising typical LC combinations, irrespective of presence and location of additional resistors
- H03H7/1783—Combined LC in series path
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03H—IMPEDANCE NETWORKS, e.g. RESONANT CIRCUITS; RESONATORS
- H03H1/00—Constructional details of impedance networks whose electrical mode of operation is not specified or applicable to more than one type of network
- H03H2001/0021—Constructional details
- H03H2001/0078—Constructional details comprising spiral inductor on a substrate
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Coils Or Transformers For Communication (AREA)
- Fixed Capacitors And Capacitor Manufacturing Machines (AREA)
- Filters And Equalizers (AREA)
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、FMラジオ受信機のアンテナとチユ
ーナとの間に挿入するバンドパスフイルタに用い
られるプリントフイルタに関するものである。
ーナとの間に挿入するバンドパスフイルタに用い
られるプリントフイルタに関するものである。
従来例の構成とその問題点
アンテナとチユーナの間に挿入するバンドパス
フイルタの要求特性は、通常帯域で使用される周
波数の約２倍の周波数領域で、減衰量が20〜
30dB程度必要とされる。たとえば、使用される
周波数が76MHz〜108MHzであれば、高域側の要
求される減衰量は、約150MHz〜230MHzの周波
数領域で20〜30dB程度である。したがつて、フ
イルタとしては高域側に減衰極があつて、高域側
カツトオフ周波数2以上の減衰部の傾斜が急なも
のが良い。
フイルタの要求特性は、通常帯域で使用される周
波数の約２倍の周波数領域で、減衰量が20〜
30dB程度必要とされる。たとえば、使用される
周波数が76MHz〜108MHzであれば、高域側の要
求される減衰量は、約150MHz〜230MHzの周波
数領域で20〜30dB程度である。したがつて、フ
イルタとしては高域側に減衰極があつて、高域側
カツトオフ周波数2以上の減衰部の傾斜が急なも
のが良い。
そこで、部品点数が少なく高域側に減衰極があ
るバンドパスフイルタに、第４図に示す回路があ
る。第４図において、１は入力端子、２はアース
端子、３は出力端子である。L1はインダクタ、
C1はコンデンサで第１の並列共振回路を構成し
ている。L2はインダクタ、C2はコンデンサで第
２の並列共振回路を構成している。C3はコンデ
ンサである。
るバンドパスフイルタに、第４図に示す回路があ
る。第４図において、１は入力端子、２はアース
端子、３は出力端子である。L1はインダクタ、
C1はコンデンサで第１の並列共振回路を構成し
ている。L2はインダクタ、C2はコンデンサで第
２の並列共振回路を構成している。C3はコンデ
ンサである。
第５図は、第４図の出力特性を示した特性曲線
図である。1は低域側カツトオフ周波数、′1は
使用される下限の周波数、′2は使用される上限
の周波数、2は高域側カツトオフ周波数、3は高
域側減衰極の周波数を示してある。この特性は、
高域側の2′1（下限使用周波数′1の２倍の周波数
）
から2′2（上限使用周波数′2の２倍の周波数）の
周波数範囲で減衰量が少なく、2′2の周波数にな
るにつれ減衰量が10〜15dB程度になり、上述の
要求特性を満足することができない。
図である。1は低域側カツトオフ周波数、′1は
使用される下限の周波数、′2は使用される上限
の周波数、2は高域側カツトオフ周波数、3は高
域側減衰極の周波数を示してある。この特性は、
高域側の2′1（下限使用周波数′1の２倍の周波数
）
から2′2（上限使用周波数′2の２倍の周波数）の
周波数範囲で減衰量が少なく、2′2の周波数にな
るにつれ減衰量が10〜15dB程度になり、上述の
要求特性を満足することができない。
特性を満足させるためには、バンドパスフイル
タを複数段縦続接続をすれば良いが、部品点数が
大巾に多くなるので、価格が高くなると共に小形
化ができないという問題が生じる。
タを複数段縦続接続をすれば良いが、部品点数が
大巾に多くなるので、価格が高くなると共に小形
化ができないという問題が生じる。
発明の目的
本発明は簡単な回路にて前記問題点を解決する
ことを目的とする。
ことを目的とする。
発明の構成
本発明は、前記目的達成の為、誘電体基板上
に、入力端子パターンと出力端子パターンとの間
に直列に第２のインダクタを電体基板の両面に亙
つて線条パターンをヘリカル状に被着形成する事
によつて構成するとともに、両面の線条パターン
の一部を重合させて並列関係の第２のコンデンサ
を設ける事によつて第２の並列共振回路を構成
し、第２のインダクタを構成するための線条パタ
ーン中で、誘電体基板の一方の面に形成された部
分の一部区間が同インダクタを構成するための線
条パターン中の他方の面に形成された部分に重な
らないようにし、誘電体基板の上記一方の面に対
して反対側の面に、上記線条パターンの一部区間
と斜めに重合する線条のアースパターンを設け、
このアースパターンと前記線条パターンとの静電
結合によつて第２のインダクタとアース端子間に
コンデンサを形成したものである。
に、入力端子パターンと出力端子パターンとの間
に直列に第２のインダクタを電体基板の両面に亙
つて線条パターンをヘリカル状に被着形成する事
によつて構成するとともに、両面の線条パターン
の一部を重合させて並列関係の第２のコンデンサ
を設ける事によつて第２の並列共振回路を構成
し、第２のインダクタを構成するための線条パタ
ーン中で、誘電体基板の一方の面に形成された部
分の一部区間が同インダクタを構成するための線
条パターン中の他方の面に形成された部分に重な
らないようにし、誘電体基板の上記一方の面に対
して反対側の面に、上記線条パターンの一部区間
と斜めに重合する線条のアースパターンを設け、
このアースパターンと前記線条パターンとの静電
結合によつて第２のインダクタとアース端子間に
コンデンサを形成したものである。
実施例の説明
以下第１図〜第３図を参照して本発明の一実施
例を説明する。
例を説明する。
第１図は本発明一実施例のプリントフイルタの
回路図であり、本回路は、従来例で示した第４図
回路中の入出力端子１に直列に挿入された第２の
並列共振回路のインダクタL2にタツプ５を設け
このタツプ５とアース２間にコンデンサC4を付
加して、通過帯域の高域側カツトオフ周波数2の
約1.2倍から1.6倍程度の周波数範囲に第１の減衰
極を、更に、カツトオフ周波数2の約1.9倍から
３倍程度の周波数範囲に第２の減衰極が生じるよ
うに、インダクタL2、コンデンサC2，C4の値を
選択して構成し、第１の減衰極と第２の減衰極の
間の周波数帯を阻止帯域にしたものである。この
ことにより、2′1〜2′2の周波数範囲の減衰量を
20〜35dBにすることができるものである。
回路図であり、本回路は、従来例で示した第４図
回路中の入出力端子１に直列に挿入された第２の
並列共振回路のインダクタL2にタツプ５を設け
このタツプ５とアース２間にコンデンサC4を付
加して、通過帯域の高域側カツトオフ周波数2の
約1.2倍から1.6倍程度の周波数範囲に第１の減衰
極を、更に、カツトオフ周波数2の約1.9倍から
３倍程度の周波数範囲に第２の減衰極が生じるよ
うに、インダクタL2、コンデンサC2，C4の値を
選択して構成し、第１の減衰極と第２の減衰極の
間の周波数帯を阻止帯域にしたものである。この
ことにより、2′1〜2′2の周波数範囲の減衰量を
20〜35dBにすることができるものである。
但し2′1は、下限使用周波数′1の２倍の周波数
で、2′2は上限使用周波数′2の２倍の周波数を示
している。
で、2′2は上限使用周波数′2の２倍の周波数を示
している。
以後、1，2，′1，′2の前に添付された数字
は1，2，′1，′2の何倍であるかを表すものと
する。
は1，2，′1，′2の何倍であるかを表すものと
する。
以下、破線にて囲んだ枠４内の回路について詳
細に説明する。第１図のL3，L4，C4をＹ−Δ変
換して６−７間の直列アームのインピーダンスZ〓
を求めると Z〓＝iωC4Σ／１−ω2C4C2Σ （但し、ω＝2π，は周波数、Σ＝L3＋L4／C4− ω2L3L4） と表わすことができる。
細に説明する。第１図のL3，L4，C4をＹ−Δ変
換して６−７間の直列アームのインピーダンスZ〓
を求めると Z〓＝iωC4Σ／１−ω2C4C2Σ （但し、ω＝2π，は周波数、Σ＝L3＋L4／C4− ω2L3L4） と表わすことができる。
減衰極はインビーダンスZ〓＝が最大になる周波
数で生じるのであるから、この周波数を求めると １−ω2C4C2Σ＝０ より （但し、簡単化の為にL3＝L4＝Ｌと置く） となる。4は第１の減衰極を生じる周波数で、5
は第２の減衰極を生じる周波数である。
数で生じるのであるから、この周波数を求めると １−ω2C4C2Σ＝０ より （但し、簡単化の為にL3＝L4＝Ｌと置く） となる。4は第１の減衰極を生じる周波数で、5
は第２の減衰極を生じる周波数である。
そこで、所望の特性を得るために、周波数4が
約1.22〜1.62程度の周波数範囲に、また、周波
数5を約1.92〜32程度の周波数範囲になるよう
に、コンデンサC4，C2の値をC2＞C4（L3＝L4の場
合）の条件で選択する。そして、必要に応じてイ
ンダクタL3，L4を調整すると良い。
約1.22〜1.62程度の周波数範囲に、また、周波
数5を約1.92〜32程度の周波数範囲になるよう
に、コンデンサC4，C2の値をC2＞C4（L3＝L4の場
合）の条件で選択する。そして、必要に応じてイ
ンダクタL3，L4を調整すると良い。
第１の減衰極と第２の減衰極の間は阻止帯域に
なるので、その帯域巾をせまくすると減衰量は多
くなる。たとえば、通過帯域の周波数が70〜
120MHz程度のフイルタであれば、周波数4は140
〜190MHz程度に、周波数5を230〜350MHz程度
に設定すると、4と5の間が阻止帯域になり第２
図に示す出力特性が実現でき、上述の要求特性を
満足することができる。
なるので、その帯域巾をせまくすると減衰量は多
くなる。たとえば、通過帯域の周波数が70〜
120MHz程度のフイルタであれば、周波数4は140
〜190MHz程度に、周波数5を230〜350MHz程度
に設定すると、4と5の間が阻止帯域になり第２
図に示す出力特性が実現でき、上述の要求特性を
満足することができる。
次に、第１図の回路を平面回路で構成すると、
コンデンサC4は等価的に構成できる。平面回路
の構成を第３図に平面図で示した。
コンデンサC4は等価的に構成できる。平面回路
の構成を第３図に平面図で示した。
第３図は、誘電体基板８の両面にインダクタや
コンデンサ等の回路パターンを被着形成して構成
されている。
コンデンサ等の回路パターンを被着形成して構成
されている。
第３図の実線は、誘電体基板８のＡ面側に、点
線はＢ面側に被着形成した回路パターンを示して
ある。
線はＢ面側に被着形成した回路パターンを示して
ある。
第３図において、９は第１図の入力端子１に相
当する入力端子パターンであり、誘電体基板８の
Ａ面に被着形成されている。１０は第１図のアー
ス端子２に相当するアース端子パターンであり、
入力端子パターン９と対向するように誘電体基板
８のＢ面に被着形成されている。コンデンサＣ１
は主に入力端子パターン９とアース端子パターン
１０との重合部で形成される。１１は誘電体基板
８のＡ面に被着形成されたコイルパターン、１２
はコイルパターン１１に対向するように誘電体基
板８のＢ面に被着形成されたコイルパターンであ
る。コイルパターン１１の一端は入力端子パター
ン９と接続され、他端はスノーホール１３を介し
てコイルパターン１２の一端と接続されており、
コイルパターン１２の他端がアース端子パターン
１０に接続されている。そしてこれらコイルパタ
ーン１１とコイルパターン１２によつてインダク
タンスＬ１が構成されている。１４は誘電体基板
８のＡ面に被着形成されたコイルパターンであ
り、第１図のインダクタＬ３に相当している。１
５はコイルパターン１４に対向するように誘電体
基板８のＢ面に被着形成されたコイルパターン
で、第１図のインダクタＬ４に相当している。コ
イルパターン１４の一端はコイルパターン１１の
途中の部分に接続され、コイルパターン１４の他
端はスノーホール１８を介してコイルパターン１
５の一端と接続されており、これらによつて第２
の共振回路が構成されている。
当する入力端子パターンであり、誘電体基板８の
Ａ面に被着形成されている。１０は第１図のアー
ス端子２に相当するアース端子パターンであり、
入力端子パターン９と対向するように誘電体基板
８のＢ面に被着形成されている。コンデンサＣ１
は主に入力端子パターン９とアース端子パターン
１０との重合部で形成される。１１は誘電体基板
８のＡ面に被着形成されたコイルパターン、１２
はコイルパターン１１に対向するように誘電体基
板８のＢ面に被着形成されたコイルパターンであ
る。コイルパターン１１の一端は入力端子パター
ン９と接続され、他端はスノーホール１３を介し
てコイルパターン１２の一端と接続されており、
コイルパターン１２の他端がアース端子パターン
１０に接続されている。そしてこれらコイルパタ
ーン１１とコイルパターン１２によつてインダク
タンスＬ１が構成されている。１４は誘電体基板
８のＡ面に被着形成されたコイルパターンであ
り、第１図のインダクタＬ３に相当している。１
５はコイルパターン１４に対向するように誘電体
基板８のＢ面に被着形成されたコイルパターン
で、第１図のインダクタＬ４に相当している。コ
イルパターン１４の一端はコイルパターン１１の
途中の部分に接続され、コイルパターン１４の他
端はスノーホール１８を介してコイルパターン１
５の一端と接続されており、これらによつて第２
の共振回路が構成されている。
さらにコイルパターン１５の他端は誘電体基板
８のＢ面のコンデンパターン１７と接続されてい
る。
８のＢ面のコンデンパターン１７と接続されてい
る。
また第１図のコンデンサＣ２は比較的小さな容
量でよいので、専用のコンデンサパターンは設け
られておらず、主にコイルパターン１４とコイル
パターン１５の重合部分によつて等価的に構成さ
れている。
量でよいので、専用のコンデンサパターンは設け
られておらず、主にコイルパターン１４とコイル
パターン１５の重合部分によつて等価的に構成さ
れている。
コイルパターン１４の中でコイルパターン１１
と隣接した一部区間１９ａ，１９ｂは同インダク
タを構成するためのコイルパターン１５に重なら
ないようになつている。２０は誘電体基板８のＢ
面に形成され、アース端子パターン１０に接続さ
れたアースパターンである。
と隣接した一部区間１９ａ，１９ｂは同インダク
タを構成するためのコイルパターン１５に重なら
ないようになつている。２０は誘電体基板８のＢ
面に形成され、アース端子パターン１０に接続さ
れたアースパターンである。
第６図は中央部を拡大して示すものである。第
１図のコンデンサＣ４は、コイルパターン１４と
アースパターン２０およびコイルパターン１２の
縦部１２ａの重合部分で等価的に構成されてい
る。しかもコイルパターン１２の縦部１２ａとア
ースパターン２０は右上がりに傾斜しており、そ
れに対してコイルパターン１４の一部区間１９
ａ，１９ｂは左上がりに傾斜し、アースパターン
２０と一部区間１９ａ，１９ｂは斜めに重合した
状態になつている コンデンサＣ４の静電容量は、アースパターン
２０およびコイルパターン１２と一部区間１９
ａ，１９ｂとの重合部Ｅ，Ｆ，Ｇによつて設定さ
れる。ここで製造上のばらつきによつてアースパ
ターン２０およびコイルパターン１２（破線）と
コイルパターン１４とがずれた場合について説明
する。第７図は第６図のものに対してアースパタ
ーン２０およびコイルパターン１２がいくらか図
面下方へずれた状態を示す。第７図において、重
合部E′と重合部F′の面積は第６図の重合部Ｅ，Ｆ
の面積よりも幾らか小さくなつているものの、最
も大きな重合部G′の面積は第６図の重合部Ｇに
対してほとんど変化しておらず、結果的にコンデ
ンサＣ４の静電容量の変化は比較的小さくて済
む。
１図のコンデンサＣ４は、コイルパターン１４と
アースパターン２０およびコイルパターン１２の
縦部１２ａの重合部分で等価的に構成されてい
る。しかもコイルパターン１２の縦部１２ａとア
ースパターン２０は右上がりに傾斜しており、そ
れに対してコイルパターン１４の一部区間１９
ａ，１９ｂは左上がりに傾斜し、アースパターン
２０と一部区間１９ａ，１９ｂは斜めに重合した
状態になつている コンデンサＣ４の静電容量は、アースパターン
２０およびコイルパターン１２と一部区間１９
ａ，１９ｂとの重合部Ｅ，Ｆ，Ｇによつて設定さ
れる。ここで製造上のばらつきによつてアースパ
ターン２０およびコイルパターン１２（破線）と
コイルパターン１４とがずれた場合について説明
する。第７図は第６図のものに対してアースパタ
ーン２０およびコイルパターン１２がいくらか図
面下方へずれた状態を示す。第７図において、重
合部E′と重合部F′の面積は第６図の重合部Ｅ，Ｆ
の面積よりも幾らか小さくなつているものの、最
も大きな重合部G′の面積は第６図の重合部Ｇに
対してほとんど変化しておらず、結果的にコンデ
ンサＣ４の静電容量の変化は比較的小さくて済
む。
また、本プリントフイルタの設計においてコン
デンサＣ４の大きさを決定する場合には、アース
パターン２０の角度を変える事によつてアースパ
ターン２０と一部区間１９ａ，１９ｂとの角度を
変えながら重合面積を調整し、所望の特性が得ら
れたところでアースパターン２０の角度を決定す
る。例えば第６図の場合に対してコンデンサＣ４
の値を小さくしたい場合には、第６図に示すアー
スパターン２０の角度Ｈを小さくする。すると例
えば第８図に示すようになり、重合部E″の面積
が第６図の場合の重合部Ｅの面積に対して小さく
なり、従つてコンデンサＣ４の容量も小さくな
る。またその反対にコンデンサＣ４の値を大きく
したい場合には、アースパターン２０の角度Ｈを
大きくする。
デンサＣ４の大きさを決定する場合には、アース
パターン２０の角度を変える事によつてアースパ
ターン２０と一部区間１９ａ，１９ｂとの角度を
変えながら重合面積を調整し、所望の特性が得ら
れたところでアースパターン２０の角度を決定す
る。例えば第６図の場合に対してコンデンサＣ４
の値を小さくしたい場合には、第６図に示すアー
スパターン２０の角度Ｈを小さくする。すると例
えば第８図に示すようになり、重合部E″の面積
が第６図の場合の重合部Ｅの面積に対して小さく
なり、従つてコンデンサＣ４の容量も小さくな
る。またその反対にコンデンサＣ４の値を大きく
したい場合には、アースパターン２０の角度Ｈを
大きくする。
第３図の１６は第１図の出力端子３のパターン
である。コンデンサＣ３はパターン１６，１７の
対向部分で形成されている。
である。コンデンサＣ３はパターン１６，１７の
対向部分で形成されている。
このように、第１図の回路は容易に平面回路で
構成できる利点がある。
構成できる利点がある。
発明の効果
以上説明したように本願発明は、第２のインダ
クタを構成するための線条パターン中で、誘電体
基板の一方の面に形成された部分の一部区間が同
インダクタを構成するための線条パターン中の他
の面に形成された部分に重ならないようにし、誘
電体基板の一方の面に対して反対側の面に、前記
線条パターンの一部区間と斜めに重合する線条の
アースパターンを設けることによつて前記アース
パターンと前記一部区間の線条パターンとの間に
コンデンサ形成した事により、製造段階で両方の
面のパターンが互いにずれた場合でも、このよう
に二つの線条パターンの交差によつて構成されと
コンデンサの容量の変化幅は比較的小さいもので
あり、従つてこのように構成する事によつて製造
上のばらつきが低減す。
クタを構成するための線条パターン中で、誘電体
基板の一方の面に形成された部分の一部区間が同
インダクタを構成するための線条パターン中の他
の面に形成された部分に重ならないようにし、誘
電体基板の一方の面に対して反対側の面に、前記
線条パターンの一部区間と斜めに重合する線条の
アースパターンを設けることによつて前記アース
パターンと前記一部区間の線条パターンとの間に
コンデンサ形成した事により、製造段階で両方の
面のパターンが互いにずれた場合でも、このよう
に二つの線条パターンの交差によつて構成されと
コンデンサの容量の変化幅は比較的小さいもので
あり、従つてこのように構成する事によつて製造
上のばらつきが低減す。
また、設計段階では第２のインダクタとアース
端子間のコンデンサの大きさを上記アースパター
ンの角度によつて変えるという方法を用いる事に
より、他のインダクタ等の値をほとんど変えずに
ほぼコンデンサＣ４値のみを変更する事が出来、
比較的簡単に所望の特性を得る事が出来る。
端子間のコンデンサの大きさを上記アースパター
ンの角度によつて変えるという方法を用いる事に
より、他のインダクタ等の値をほとんど変えずに
ほぼコンデンサＣ４値のみを変更する事が出来、
比較的簡単に所望の特性を得る事が出来る。
第１図は本発明の一実施例を示す回路図、第２
図は第１図の出力特性図、第３図は第１図を平面
回路で実施したパターン図、第４図は従来のバン
ドパスフイルタの回路図、第５図は第４図の出力
特性図である。第６図は同実施例におけるプリン
トフイルターの腰部拡大平面図、第７図は製造段
階で両面のパターンが互いにずれた状態を示す説
明図、第８図は同プリントフイルターの設計段階
においてアースパターンの角度を変更する場合を
示す説明図である。 １……入出力端子、２……アース、５……タツ
プ、８……誘電体基板、９……入出力端子パター
ン、１０……アース端子パターン、１１，１２，
１４，１５……コイルパターン、１３，１８……
スルーホール、１６……出力端子パターン。
図は第１図の出力特性図、第３図は第１図を平面
回路で実施したパターン図、第４図は従来のバン
ドパスフイルタの回路図、第５図は第４図の出力
特性図である。第６図は同実施例におけるプリン
トフイルターの腰部拡大平面図、第７図は製造段
階で両面のパターンが互いにずれた状態を示す説
明図、第８図は同プリントフイルターの設計段階
においてアースパターンの角度を変更する場合を
示す説明図である。 １……入出力端子、２……アース、５……タツ
プ、８……誘電体基板、９……入出力端子パター
ン、１０……アース端子パターン、１１，１２，
１４，１５……コイルパターン、１３，１８……
スルーホール、１６……出力端子パターン。
Claims (1)
- 【特許請求の範囲】 １ 誘電体基板上の一方の面またはその裏側の他
方の面に、入力端子、出力端子、アース端子を設
け、すくなくとも前記アース端子は前記誘電体基
板の裏側の面に設けるとともに、 前記入力端子と並列に第１のインダクタと第１
のコンデンサからなる第１の並列共振回路を被着
形成し、 前記入力端子と直列に第２のインダクタと第２
のコンデンサから成る第２の並列共振回路を被着
形成し、 前記第２のインダクタは前記誘電体基板の表面
に形成されたヘリカル状の線条パターンによつて
構成され、 前記誘電体基板の裏面に、前記アース端子に接
続されるとともに前記第２のインダクタを構成す
る線条パターンの一部と斜めに重合する線条のア
ースパターンを設け、 前記線状のアースパターンと前記線条パターン
との静電結合によつて前記第２のインダクタとア
ース端子間にコンデンサを形成した事を特徴とす
るプリントフイルタ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59142724A JPS6121608A (ja) | 1984-07-10 | 1984-07-10 | プリントフィルタ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59142724A JPS6121608A (ja) | 1984-07-10 | 1984-07-10 | プリントフィルタ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6121608A JPS6121608A (ja) | 1986-01-30 |
| JPH0334684B2 true JPH0334684B2 (ja) | 1991-05-23 |
Family
ID=15322105
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59142724A Granted JPS6121608A (ja) | 1984-07-10 | 1984-07-10 | プリントフィルタ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6121608A (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62128111A (ja) * | 1985-11-28 | 1987-06-10 | 株式会社村田製作所 | Ｌｃ複合部品 |
| JP3516951B2 (ja) * | 1991-09-09 | 2004-04-05 | 日立建機株式会社 | 作業車両の懸架装置 |
| TWI656731B (zh) * | 2016-12-04 | 2019-04-11 | 日商村田製作所股份有限公司 | Multilayer LC filter |
-
1984
- 1984-07-10 JP JP59142724A patent/JPS6121608A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6121608A (ja) | 1986-01-30 |
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