JPH03294916A - 周期関数発生回路 - Google Patents
周期関数発生回路Info
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- JPH03294916A JPH03294916A JP9716690A JP9716690A JPH03294916A JP H03294916 A JPH03294916 A JP H03294916A JP 9716690 A JP9716690 A JP 9716690A JP 9716690 A JP9716690 A JP 9716690A JP H03294916 A JPH03294916 A JP H03294916A
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- 230000000737 periodic effect Effects 0.000 title claims abstract description 20
- 238000005070 sampling Methods 0.000 claims description 16
- 238000000034 method Methods 0.000 claims description 6
- 238000006243 chemical reaction Methods 0.000 claims description 3
- 230000005428 wave function Effects 0.000 abstract description 7
- 101150065817 ROM2 gene Proteins 0.000 description 6
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 230000005236 sound signal Effects 0.000 description 1
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- Digital Transmission Methods That Use Modulated Carrier Waves (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明Ｃ友 正弦波等の周期関数の符号化サンプリン
グ値系列を直接デジタル的に発生するものであり、デジ
タル電話での可聴音信号 ＤＴＭＦ信号 周波数シンセ
サイザ等の応用として利用可能である。
グ値系列を直接デジタル的に発生するものであり、デジ
タル電話での可聴音信号 ＤＴＭＦ信号 周波数シンセ
サイザ等の応用として利用可能である。
従来の技術
正弦波等の周期関数の符号化サンプリング値系列を得る
方法として、アナログ関数波形をそのままＡ／Ｄ変換し
て求める方法がある力叉 精度や安定性を考えると、直
接デジタル的に発生するほう力丈 効率的であも 一般にデジタル的に多種の周波数の正弦波関数のサンプ
リング値系列を発生さする方法として、ＲＯＭテーブル
変換方式として知られべ 第３図に示す方法が広く用い
られていも 第３図において、 １はアドレスカラン久 ２は関数Ｒ
ＯＭである。アドレスカウンタ１ζ戴 レジスタ３、加
算器４、アキュムレータ５により構成されている。加算
器４（瓜 設定されたレジスタ３の値と、アキュムレー
タ５の値とを加算すも アキュムレータ５は 加算結果
をサンプリング周期でラッチする。関数ＲＯＭ２には１
周期分の正弦波関数値が格納されており、アドレスカウ
ンタ１からのアドレスに対応するＲＯＭ値が読み出され
７）。 １周期分の正弦波関数値が２’（Ｐは正数値）
個からなる場合、アドレスカウンタ１ｉｉｐビットの加
算ｔｐビットのアキュムレータによって構成できも レ
ジスタ３は外部から設定可能なレジスタであり、このレ
ジスタ３の値を書き換えることにより、さまざまな周波
数の正弦波を発生することができも サンプリング周波数 ｆ６ ＲＯＭのアドレス ｐビット 設定レジスタの値 ｎ とすると、関数ＲＯＭ２より出力される周波数（よ出力
周波数＝ｎｆｅ／２’ となる。第４図を用いて、もう少し詳しく説明する。第
４図（ａ）は正弦波の１周期を、アドレス０から１５ま
での１６点で表したもので、各アドレスに対応する振幅
値が関数ＲＯＭのデータとして納められていも この場
合アドレスカウンタは４ビットで良く、つまり加算ａ
アキュムレータは４ビットで構成できも 仮にサンプリ
ング周波数を１６ Ｈｚ、 設定レジスタ３の値を１
としたとすると、関数ＲＯＭ２の値は０アドレスから順
番に読み出され 出力周波数＝１ ｘｉ ６Ｈｚ／１６＝ＩＨｚとなる。
方法として、アナログ関数波形をそのままＡ／Ｄ変換し
て求める方法がある力叉 精度や安定性を考えると、直
接デジタル的に発生するほう力丈 効率的であも 一般にデジタル的に多種の周波数の正弦波関数のサンプ
リング値系列を発生さする方法として、ＲＯＭテーブル
変換方式として知られべ 第３図に示す方法が広く用い
られていも 第３図において、 １はアドレスカラン久 ２は関数Ｒ
ＯＭである。アドレスカウンタ１ζ戴 レジスタ３、加
算器４、アキュムレータ５により構成されている。加算
器４（瓜 設定されたレジスタ３の値と、アキュムレー
タ５の値とを加算すも アキュムレータ５は 加算結果
をサンプリング周期でラッチする。関数ＲＯＭ２には１
周期分の正弦波関数値が格納されており、アドレスカウ
ンタ１からのアドレスに対応するＲＯＭ値が読み出され
７）。 １周期分の正弦波関数値が２’（Ｐは正数値）
個からなる場合、アドレスカウンタ１ｉｉｐビットの加
算ｔｐビットのアキュムレータによって構成できも レ
ジスタ３は外部から設定可能なレジスタであり、このレ
ジスタ３の値を書き換えることにより、さまざまな周波
数の正弦波を発生することができも サンプリング周波数 ｆ６ ＲＯＭのアドレス ｐビット 設定レジスタの値 ｎ とすると、関数ＲＯＭ２より出力される周波数（よ出力
周波数＝ｎｆｅ／２’ となる。第４図を用いて、もう少し詳しく説明する。第
４図（ａ）は正弦波の１周期を、アドレス０から１５ま
での１６点で表したもので、各アドレスに対応する振幅
値が関数ＲＯＭのデータとして納められていも この場
合アドレスカウンタは４ビットで良く、つまり加算ａ
アキュムレータは４ビットで構成できも 仮にサンプリ
ング周波数を１６ Ｈｚ、 設定レジスタ３の値を１
としたとすると、関数ＲＯＭ２の値は０アドレスから順
番に読み出され 出力周波数＝１ ｘｉ ６Ｈｚ／１６＝ＩＨｚとなる。
この回路動作を表１に示す。但しここでは簡単のた数
初期設定として、アキュムレータ５の値がリセットされ
ているものとすム（以下余白） 表１ となａ 設定レジスタ３の値を２とした時へ この回路
動作を表２に示も ここでも簡単のた取初期設定として
、アキュムレータ５の値がリセットされているものとす
４ 表２ アキュムレータ５の値をアドレスとするＲＯＭによる振
幅値が順番に読みだされ 正弦波のサンプリング値系列
を形成する。
初期設定として、アキュムレータ５の値がリセットされ
ているものとすム（以下余白） 表１ となａ 設定レジスタ３の値を２とした時へ この回路
動作を表２に示も ここでも簡単のた取初期設定として
、アキュムレータ５の値がリセットされているものとす
４ 表２ アキュムレータ５の値をアドレスとするＲＯＭによる振
幅値が順番に読みだされ 正弦波のサンプリング値系列
を形成する。
設定レジスタ３の値を２としたとすると、関数ＲＯＭ２
の値は０アドレスから２個置きに読み出され 出力周波数＝２ Ｘ １６Ｈｚ／１６＝２８ｚ第４図（
ｂ）にこの場合の関数ＲＯＭ２のアドレスと出力振幅値
の関係を示す。
の値は０アドレスから２個置きに読み出され 出力周波数＝２ Ｘ １６Ｈｚ／１６＝２８ｚ第４図（
ｂ）にこの場合の関数ＲＯＭ２のアドレスと出力振幅値
の関係を示す。
設定レジスタの値を３としたとすると、関数ＲＯＭ２の
値は０アドレスから３個置きに読み出さ出力周波数＝
３ ｘ １６ Ｈｚ ／ １６ ＝ ３ Ｈｚとなム
このよう！ミ 設定レジスタ３の値ｎを変化させること
により、出力周波数をサンプリング周波数ｆ＠のｎ ／
２−倍に自由に設定できも発明が解決しようとする課
題 従来例による構成で多種の出力周波数を得ようとすれば
ＲＯＭの容量が著しく増大すも 本発明Ｃａｔ、、
従来例に見られるＲＯＭ容量の増大に対する問題に鑑へ
多種の周波数の正弦波関数のサンプリング値系列をよ
り少ないＲＯＭ容量で発生できる周期関数発生回路を提
供する事を目的とすも課題を解決するための手段 本発明は上記問題を解決するたべ 周期関数の符号化サ
ンプリング値系列をＲＯＭテーブル変換方式によってデ
ジタル的に発生する回路において、周期関数の１周期の
１／４周期分の振幅値を格納するＲＯＭと、このＲＯＭ
のアドレスを発生するアドレス発生部を有し 前記アド
レス発生部（友アキュムレータと外部より任意に設定可
能な第１のレジスタとの加算を行う加算器と、前記加算
器の出力結果の上位２ビット以外のビット反転の制御を
行うビット反転制御回路と、前記ビット反転制御回路の
出力結果を納める第２のレジスタとを有し 前記第２の
レジスタの値を前記ＲＯＭのアドレスとし 前記ＲＯＭ
から読みだされた値と前記アキュムレータの最上位ビッ
トとを符号化サンプリング値系列とする事を特徴とする
周期関数発生回路である。
値は０アドレスから３個置きに読み出さ出力周波数＝
３ ｘ １６ Ｈｚ ／ １６ ＝ ３ Ｈｚとなム
このよう！ミ 設定レジスタ３の値ｎを変化させること
により、出力周波数をサンプリング周波数ｆ＠のｎ ／
２−倍に自由に設定できも発明が解決しようとする課
題 従来例による構成で多種の出力周波数を得ようとすれば
ＲＯＭの容量が著しく増大すも 本発明Ｃａｔ、、
従来例に見られるＲＯＭ容量の増大に対する問題に鑑へ
多種の周波数の正弦波関数のサンプリング値系列をよ
り少ないＲＯＭ容量で発生できる周期関数発生回路を提
供する事を目的とすも課題を解決するための手段 本発明は上記問題を解決するたべ 周期関数の符号化サ
ンプリング値系列をＲＯＭテーブル変換方式によってデ
ジタル的に発生する回路において、周期関数の１周期の
１／４周期分の振幅値を格納するＲＯＭと、このＲＯＭ
のアドレスを発生するアドレス発生部を有し 前記アド
レス発生部（友アキュムレータと外部より任意に設定可
能な第１のレジスタとの加算を行う加算器と、前記加算
器の出力結果の上位２ビット以外のビット反転の制御を
行うビット反転制御回路と、前記ビット反転制御回路の
出力結果を納める第２のレジスタとを有し 前記第２の
レジスタの値を前記ＲＯＭのアドレスとし 前記ＲＯＭ
から読みだされた値と前記アキュムレータの最上位ビッ
トとを符号化サンプリング値系列とする事を特徴とする
周期関数発生回路である。
作用
本発明（よ 上述の構成により、従来のデジタル的な周
期関数発生回路に必要としたＲＯＭ容量に対し、、
１／４以下のＲＯＭ容量容量間機能のものを実現するも
のであも 実施例 本発明の実施例を第１図を用いて説明すも 第１図にお
いて、 １はアドレスカラン久 ２は関数ＲＯＭである
。アドレスカウンタ１は 従来例と同様のレジスタ３、
加算器４、アキュムレータ５及び、本発明特有のビット
反転回路６、レジスタ７により構成されていも 加算器
４は 従来例と同様へ 設定されたレジスタ３の値と、
アキュムレータ５の値とを加算し アキュムレータ５１
よ加算結果をサンプリング周期でラッチすａビット反転
制御回路θは、 加算器４の出力結果の上位２ビット以
外のビットが入力され 最上位から２番目のビットの制
御により、データのスルーか反転か、を切り換える。ビ
ット反転制御回路６の出力結果（友 アキュムレータ５
と同様にレジスタ７にサンプリング周期でラッチされる
。
期関数発生回路に必要としたＲＯＭ容量に対し、、
１／４以下のＲＯＭ容量容量間機能のものを実現するも
のであも 実施例 本発明の実施例を第１図を用いて説明すも 第１図にお
いて、 １はアドレスカラン久 ２は関数ＲＯＭである
。アドレスカウンタ１は 従来例と同様のレジスタ３、
加算器４、アキュムレータ５及び、本発明特有のビット
反転回路６、レジスタ７により構成されていも 加算器
４は 従来例と同様へ 設定されたレジスタ３の値と、
アキュムレータ５の値とを加算し アキュムレータ５１
よ加算結果をサンプリング周期でラッチすａビット反転
制御回路θは、 加算器４の出力結果の上位２ビット以
外のビットが入力され 最上位から２番目のビットの制
御により、データのスルーか反転か、を切り換える。ビ
ット反転制御回路６の出力結果（友 アキュムレータ５
と同様にレジスタ７にサンプリング周期でラッチされる
。
関数ＲＯＭ２には１／４周期分の正弦波関数値が格納さ
れており、アドレスカウンタ１によって演算されたレジ
スタ７の値をアドレスとして関数ＲＯＭ２に与えること
により、ＲＯＭ値が読み出される。出力振幅データとし
て（よ 上述ＲＯＭ値と、アキュムレータ５の最上位ビ
ットが符号ビットとして与えられも 第２図を用いて、もう少し詳しく説明すも 第２図（ａ
）は正弦波の１／４周期分の振幅値を、アドレス０から
３までの４点で表したもので、各アドレスに対応する振
幅値が関数ＲＯＭ２のデータとして納められている。こ
の場合、アドレスカウンタ部ｌの加算器４、アキュムレ
ータ５は４ビット帳 ビット反転回路６、レジスタ７は
２ビット幅で構成できる。設定レジスタ３の値を１とし
た時α この回路動作を表３に示す。但しここでは簡単
のた八 初期設定として、アキュムレータ５の値がリセ
ットされているものとす４ 表３ 上述したようへ この例では アキュムレータ５の最上
位から２番目のビットが１ （ハイ）の時に下位２ビッ
トが反転する制御となっていも この制御により、アキ
ュムレータ５の値が４から７．１２から１５でζ；Ｌ
ＲＯＭ２のアドレスが上位アドレスから読みだされる
こととなり、出力波形として正弦波が得られも この制
御を逆にすれ（′Ｌつまり、アキュムレータ５の最上位
から２番目のビットが０ （ロウ）の時に下位２ビット
が反転する制御とすれば 出力波形は余弦波となａアキ
ュムレータ５の最上位ビット（よ 符号ビットとして与
えられ ０ （ロウ）は正の値を、 １ （ハイ）は負
の値を表わも 設定レジスタ３の値を２とした時へ こ
の回路動作を表４に示す。ここでも簡単のた数 初期設
定として、アキュムレータ５の値がリセットされている
ものとすム（以下余白） 表４ 第２図（ｂ）にこの場合の関数ＲＯＭ２のアドレスと出
力振幅値の関係を示す。一般に サンプリング周波数 ｆ。
れており、アドレスカウンタ１によって演算されたレジ
スタ７の値をアドレスとして関数ＲＯＭ２に与えること
により、ＲＯＭ値が読み出される。出力振幅データとし
て（よ 上述ＲＯＭ値と、アキュムレータ５の最上位ビ
ットが符号ビットとして与えられも 第２図を用いて、もう少し詳しく説明すも 第２図（ａ
）は正弦波の１／４周期分の振幅値を、アドレス０から
３までの４点で表したもので、各アドレスに対応する振
幅値が関数ＲＯＭ２のデータとして納められている。こ
の場合、アドレスカウンタ部ｌの加算器４、アキュムレ
ータ５は４ビット帳 ビット反転回路６、レジスタ７は
２ビット幅で構成できる。設定レジスタ３の値を１とし
た時α この回路動作を表３に示す。但しここでは簡単
のた八 初期設定として、アキュムレータ５の値がリセ
ットされているものとす４ 表３ 上述したようへ この例では アキュムレータ５の最上
位から２番目のビットが１ （ハイ）の時に下位２ビッ
トが反転する制御となっていも この制御により、アキ
ュムレータ５の値が４から７．１２から１５でζ；Ｌ
ＲＯＭ２のアドレスが上位アドレスから読みだされる
こととなり、出力波形として正弦波が得られも この制
御を逆にすれ（′Ｌつまり、アキュムレータ５の最上位
から２番目のビットが０ （ロウ）の時に下位２ビット
が反転する制御とすれば 出力波形は余弦波となａアキ
ュムレータ５の最上位ビット（よ 符号ビットとして与
えられ ０ （ロウ）は正の値を、 １ （ハイ）は負
の値を表わも 設定レジスタ３の値を２とした時へ こ
の回路動作を表４に示す。ここでも簡単のた数 初期設
定として、アキュムレータ５の値がリセットされている
ものとすム（以下余白） 表４ 第２図（ｂ）にこの場合の関数ＲＯＭ２のアドレスと出
力振幅値の関係を示す。一般に サンプリング周波数 ｆ。
ＲＯＭのアドレス ｐビット
設定レジスタの値 ｎ
とすると、関数ＲＯＭより出力される周波数は出力周波
数＝ｎｆｓ／２’″２ となる。このように 設定レジスタの値ｎを変化させる
ことにより、出力周波数をサンプリング周波数ｆ、のｎ
／２’″２倍に自由に設定できもつまり、従来例と同じ
精度の出力周波数を得る周期関数発生回路を実現しよう
としたＩＩ、 ＲＯＭの容量は１／４ですむことにな
ム さらに本実施例において、アキュムレータ５の最上
位ビットを符号ビットとして、直接出力するようにすれ
ば関数ＲＯＭ２に格納する出力ビット幅は、 １ビット
分少なくてすむ。
数＝ｎｆｓ／２’″２ となる。このように 設定レジスタの値ｎを変化させる
ことにより、出力周波数をサンプリング周波数ｆ、のｎ
／２’″２倍に自由に設定できもつまり、従来例と同じ
精度の出力周波数を得る周期関数発生回路を実現しよう
としたＩＩ、 ＲＯＭの容量は１／４ですむことにな
ム さらに本実施例において、アキュムレータ５の最上
位ビットを符号ビットとして、直接出力するようにすれ
ば関数ＲＯＭ２に格納する出力ビット幅は、 １ビット
分少なくてすむ。
以上のよう＋’ｗ 従来のアドレスカウンタにミ
簡単なビット反転制御回路６とレジスタ７を付加するだ
けで、従来必要であったＲＯＭ容量の１／４以下で同じ
機能の周期関数発生回路を実現できもなおここでは、
正弦波のサンプリング値系列を発生させる方法について
述べた力丈 本発明で関数ＲＯＭに格納する振幅値とし
て、周期波形の１周期が点対称で１／２周期が線対称の
もへ あるいは１周期が線対称で１／２周期が点対称の
ものであれば 全て同様の方法で実現可能であ本発明の
詳細 な説明したよう艮 本発明を用いれは 従来のアドレス
カウンタく 簡単なビット反転制御回路とレジスタを付
加するだけで、従来と同じ機能の周期関数発生回路を、
従来必要としたＲＯＭ容量の１／４以下で実現できａ
本発明（よ 周波数精度が必要とされ 大容量のＲＯＭ
を必要とする周期関数発生回路において（よ 特に効果
が顕著に現ｈ ＬＳＩ化する際の素子数削減や低消費
電力化に効果を発挿すも
簡単なビット反転制御回路６とレジスタ７を付加するだ
けで、従来必要であったＲＯＭ容量の１／４以下で同じ
機能の周期関数発生回路を実現できもなおここでは、
正弦波のサンプリング値系列を発生させる方法について
述べた力丈 本発明で関数ＲＯＭに格納する振幅値とし
て、周期波形の１周期が点対称で１／２周期が線対称の
もへ あるいは１周期が線対称で１／２周期が点対称の
ものであれば 全て同様の方法で実現可能であ本発明の
詳細 な説明したよう艮 本発明を用いれは 従来のアドレス
カウンタく 簡単なビット反転制御回路とレジスタを付
加するだけで、従来と同じ機能の周期関数発生回路を、
従来必要としたＲＯＭ容量の１／４以下で実現できａ
本発明（よ 周波数精度が必要とされ 大容量のＲＯＭ
を必要とする周期関数発生回路において（よ 特に効果
が顕著に現ｈ ＬＳＩ化する際の素子数削減や低消費
電力化に効果を発挿すも
第１図は本発明の第１の実施例における周期関数発生回
路の構成阻 第２図（ａ）は正弦波関数をＲＯＭにもつ
場合のＲＯＭのアドレスと振幅データの関係医 同図（
ｂ）は本発明の動作説明＠ 第３図は従来の周期関数発
生回路の構成医 第４図（ａ）は従来例による正弦波関
数をＲＯＭにもつ場合のＲＯＭのアドレスと振幅データ
の関係諷 同図（ｂ）は従来例の動作説明図であ４ １ ・アドレスカラン久 ２・・・関数ＲＯＭ、 ３
・・・レジス久 ４・・・加算器 ５・・アキュムレー
久 ６ ピッ ト反転制御回廠 第 図 レジスタ。
路の構成阻 第２図（ａ）は正弦波関数をＲＯＭにもつ
場合のＲＯＭのアドレスと振幅データの関係医 同図（
ｂ）は本発明の動作説明＠ 第３図は従来の周期関数発
生回路の構成医 第４図（ａ）は従来例による正弦波関
数をＲＯＭにもつ場合のＲＯＭのアドレスと振幅データ
の関係諷 同図（ｂ）は従来例の動作説明図であ４ １ ・アドレスカラン久 ２・・・関数ＲＯＭ、 ３
・・・レジス久 ４・・・加算器 ５・・アキュムレー
久 ６ ピッ ト反転制御回廠 第 図 レジスタ。
Claims (1)
- 周期関数の符号化サンプリング値系列をＲＯＭテーブル
変換方式によってデジタル的に発生する回路において、
周期関数の１周期の１／４周期分の振幅値を格納するＲ
ＯＭと、このＲＯＭのアドレスを発生するアドレス発生
部を有し、前記アドレス発生部は、アキュムレータと外
部より任意に設定可能な第１のレジスタとの加算を行う
加算器と、前記加算器の出力結果の上位２ビット以外の
ビット反転の制御を行うビット反転制御回路と、前記ビ
ット反転制御回路の出力結果を納める第２のレジスタと
を有し、前記第２のレジスタの値を前記ＲＯＭのアドレ
スとし、前記ＲＯＭから読みだされた値と前記アキュム
レータの最上位ビットとを符号化サンプリング値系列と
する事を特徴とする周期関数発生回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2097166A JPH0743620B2 (ja) | 1990-04-12 | 1990-04-12 | 周期関数発生回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2097166A JPH0743620B2 (ja) | 1990-04-12 | 1990-04-12 | 周期関数発生回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH03294916A true JPH03294916A (ja) | 1991-12-26 |
| JPH0743620B2 JPH0743620B2 (ja) | 1995-05-15 |
Family
ID=14184990
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2097166A Expired - Fee Related JPH0743620B2 (ja) | 1990-04-12 | 1990-04-12 | 周期関数発生回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0743620B2 (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1030238A2 (en) * | 1999-01-26 | 2000-08-23 | Nec Corporation | Circuit for generating a periodic function |
| US7069283B2 (en) | 2000-12-14 | 2006-06-27 | Nec Electronics Corporation | Method and circuit for calculating multiple of unit value and generating a periodic function |
| US8392485B2 (en) | 2008-05-29 | 2013-03-05 | Fujitsu Limited | Signal waveform generating circuit and method |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| TWI339049B (en) * | 2006-03-09 | 2011-03-11 | Princeton Technology Corp | Gfsk/fsk modulation circuit and related method implemented in a digital manner |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5586250A (en) * | 1978-12-25 | 1980-06-28 | Fujitsu Ltd | Carrier generator |
| JPS60113556A (ja) * | 1983-11-24 | 1985-06-20 | Fujitsu Ltd | ディジタルｆｓｋ信号発生装置 |
-
1990
- 1990-04-12 JP JP2097166A patent/JPH0743620B2/ja not_active Expired - Fee Related
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5586250A (en) * | 1978-12-25 | 1980-06-28 | Fujitsu Ltd | Carrier generator |
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| US7069283B2 (en) | 2000-12-14 | 2006-06-27 | Nec Electronics Corporation | Method and circuit for calculating multiple of unit value and generating a periodic function |
| US8392485B2 (en) | 2008-05-29 | 2013-03-05 | Fujitsu Limited | Signal waveform generating circuit and method |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0743620B2 (ja) | 1995-05-15 |
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