JPH03268154A - データ転送方法 - Google Patents
データ転送方法Info
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- JPH03268154A JPH03268154A JP6914790A JP6914790A JPH03268154A JP H03268154 A JPH03268154 A JP H03268154A JP 6914790 A JP6914790 A JP 6914790A JP 6914790 A JP6914790 A JP 6914790A JP H03268154 A JPH03268154 A JP H03268154A
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- 238000000034 method Methods 0.000 title claims description 10
- 238000001514 detection method Methods 0.000 description 3
- 239000004065 semiconductor Substances 0.000 description 3
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 244000144992 flock Species 0.000 description 1
- 230000006870 function Effects 0.000 description 1
Landscapes
- Bus Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［概要］
中央処理装置を介さず、内部記憶装置と入出力装置又は
他の外部装置との間でデータを直接転送するＤＭＡ （
Ｄｉｒｅｃｔ Ｍｅｍｏｒｙ Ａｃｃｅｓｓ Ｃｏｎｔ
ｒｏｌｌｅｒ）を使用したデータ転送方法に関し、 ＤＭＡ転送において中央処理装置による作業量の増加を
抑制しつつ、データ転送の効率化を図ることができるＤ
ＭＡ転送方法を提供することを目的とし、 中央処理装置からのデータ転送命令及び転送するデータ
量等の制御信号データに基づき、中央処理装置を介さず
、内部記憶装置と入出力装置又は他の外部装置との間で
データを直接転送するようにしたＤＭＡ転送方法におい
て、データを所定のバイト数でブロック化してブロック
毎に転送するとともに、転送するデータ量をブロック長
及びブロック数にて管理するようにした。
他の外部装置との間でデータを直接転送するＤＭＡ （
Ｄｉｒｅｃｔ Ｍｅｍｏｒｙ Ａｃｃｅｓｓ Ｃｏｎｔ
ｒｏｌｌｅｒ）を使用したデータ転送方法に関し、 ＤＭＡ転送において中央処理装置による作業量の増加を
抑制しつつ、データ転送の効率化を図ることができるＤ
ＭＡ転送方法を提供することを目的とし、 中央処理装置からのデータ転送命令及び転送するデータ
量等の制御信号データに基づき、中央処理装置を介さず
、内部記憶装置と入出力装置又は他の外部装置との間で
データを直接転送するようにしたＤＭＡ転送方法におい
て、データを所定のバイト数でブロック化してブロック
毎に転送するとともに、転送するデータ量をブロック長
及びブロック数にて管理するようにした。
「産業上の利用分野」
本発明は中央処理装置を介さず、内部記憶装置と入出力
装置又は他の外部装置との間でデータを直接転送するＤ
ＭＡ （Ｄｉｒｅｃｔ Ｍｅｍｏｒｙ Ａｃｃｅｓｓ
Ｃｏｎｔｒｏｌｌｅｒ ）を使用したデータ転送方法に
関するものである。
装置又は他の外部装置との間でデータを直接転送するＤ
ＭＡ （Ｄｉｒｅｃｔ Ｍｅｍｏｒｙ Ａｃｃｅｓｓ
Ｃｏｎｔｒｏｌｌｅｒ ）を使用したデータ転送方法に
関するものである。
コンピュータシステムではデータを高速に転送するため
にＤＭＡ転送を行うが、このとき、ＤＭＡコントローラ
に転送するデータ量を指示する必要がある。
にＤＭＡ転送を行うが、このとき、ＤＭＡコントローラ
に転送するデータ量を指示する必要がある。
［従来の技術］
従来のＤＭＡコントローラを第２図に示す。ＤＭＡコン
トローラ１は転送バイトカウンタ２．アドレスカウンタ
７を備え、マイクロプロセッサ（以下、ＭＰＵという）
３から転送バイト数、転送先アドレス等を指示する制御
信号データが出力されると、転送先の初期アドレスをア
ドレスカウンタ７にセットシ、転送バイト数を転送バイ
トカウンタ２にセラ１〜し、ＭＰＵ３からデータ転送命
令が出力されると、半導体メモリ（内部記憶装置）４と
ハードディスク装置（外部装置）５との間で直接データ
転送を行うようになっていた。そして、転送バイトカウ
ンタ２はデータの転送に伴ってカウントダウンし、その
カウント値が「０」になると、ＤＭＡコンＩ・ローラ１
はデータ転送を終了させるようになっていた。
トローラ１は転送バイトカウンタ２．アドレスカウンタ
７を備え、マイクロプロセッサ（以下、ＭＰＵという）
３から転送バイト数、転送先アドレス等を指示する制御
信号データが出力されると、転送先の初期アドレスをア
ドレスカウンタ７にセットシ、転送バイト数を転送バイ
トカウンタ２にセラ１〜し、ＭＰＵ３からデータ転送命
令が出力されると、半導体メモリ（内部記憶装置）４と
ハードディスク装置（外部装置）５との間で直接データ
転送を行うようになっていた。そして、転送バイトカウ
ンタ２はデータの転送に伴ってカウントダウンし、その
カウント値が「０」になると、ＤＭＡコンＩ・ローラ１
はデータ転送を終了させるようになっていた。
［発明が解決しようとする課題］
しかしながら、上記従来のＤＭＡコントローラ１ではデ
ータ転送を転送バイト数で管理しており、転送バイトカ
ンウタ２のカウント値が「０」にならなければデータ転
送が終了しないため、ＭＰＵ３の１度の転送命令でハー
ドディスク装置５の複数のファイル、例えはファイル５
Ａ、５Ｂのデータを連続して転送することはできない。
ータ転送を転送バイト数で管理しており、転送バイトカ
ンウタ２のカウント値が「０」にならなければデータ転
送が終了しないため、ＭＰＵ３の１度の転送命令でハー
ドディスク装置５の複数のファイル、例えはファイル５
Ａ、５Ｂのデータを連続して転送することはできない。
従って、ハードディスク装置５の複数のファイルを転送
しようとすると、ＭＰＵ３はファイル毎にＤＭＡコント
ローラ１に対して転送バイト数を指示しなければならず
、ＭＰＵ３の作業量が増加するとともに、その分だけデ
ータを高速転送できず、システム全体の効率が低下する
という問題点があった。
しようとすると、ＭＰＵ３はファイル毎にＤＭＡコント
ローラ１に対して転送バイト数を指示しなければならず
、ＭＰＵ３の作業量が増加するとともに、その分だけデ
ータを高速転送できず、システム全体の効率が低下する
という問題点があった。
本発明は前記問題点を解消するためになされたものであ
って、その目的はＤＭＡ転送において中央処理装置によ
る作業量の増加を抑制しつつ、データ転送の効率化を図
ることができるＤＭＡ転送方法を提供することにある。
って、その目的はＤＭＡ転送において中央処理装置によ
る作業量の増加を抑制しつつ、データ転送の効率化を図
ることができるＤＭＡ転送方法を提供することにある。
［課題を解決するだめの手段］
本発明は上記目的を達成するために、中央処理装置から
のデータ転送命令及び転送するデータ量等の制御信号デ
ータに基づき、中央処理装置を介さず、内部記憶装置と
入出力装置又は他の外部装置との間でデータを直接転送
するようにしたＤＭＡ転送方法において、データを所定
のバイト数でブロック化してブロック毎に転送する。そ
して、転送するデータ量をブロック長及びブロック数に
て管理する。
のデータ転送命令及び転送するデータ量等の制御信号デ
ータに基づき、中央処理装置を介さず、内部記憶装置と
入出力装置又は他の外部装置との間でデータを直接転送
するようにしたＤＭＡ転送方法において、データを所定
のバイト数でブロック化してブロック毎に転送する。そ
して、転送するデータ量をブロック長及びブロック数に
て管理する。
［作用］
データを所定のバイト数でブロック化してブロック毎に
転送するとともに、転送するデータ量をブロック長及び
ブロック数にて管理しているので、各ブロック間の境界
においてファイルの切替えが可能となる。従って、複数
ファイルのデータを連続して転送する場合、転送するブ
ロック数を複数ファイルの転送するブロック数の合計に
しておけば、中央処理装置の作業量の増加が抑制され、
転送効率が向上することになる。
転送するとともに、転送するデータ量をブロック長及び
ブロック数にて管理しているので、各ブロック間の境界
においてファイルの切替えが可能となる。従って、複数
ファイルのデータを連続して転送する場合、転送するブ
ロック数を複数ファイルの転送するブロック数の合計に
しておけば、中央処理装置の作業量の増加が抑制され、
転送効率が向上することになる。
［実施例］
以下、本発明を具体化した一実施例を第１図に従って詳
細に説明する。
細に説明する。
尚、説明の便宜上、第２図と同様の構成については同一
の符号を付して説明を一部省略する。
の符号を付して説明を一部省略する。
ＤＭＡコントローラＩはセレクタ６、アドレスカウンタ
７、転送ブロック長レジスタ８、転送ブロック数レジス
タ９、及びブロック境界検出回路１０等を備えて構成さ
れ、ブロック境界検出回路１０はブロック長減算カウン
タ１１及びブロック転送許可回路１２等で構成されてい
る。そして、ＤＭＡコントローラ１は、データを所定の
バイト数でブロック化してブロック毎に転送するととも
に、転送するデータ量をブロック長及びブロック数にて
管理するようになっている。
７、転送ブロック長レジスタ８、転送ブロック数レジス
タ９、及びブロック境界検出回路１０等を備えて構成さ
れ、ブロック境界検出回路１０はブロック長減算カウン
タ１１及びブロック転送許可回路１２等で構成されてい
る。そして、ＤＭＡコントローラ１は、データを所定の
バイト数でブロック化してブロック毎に転送するととも
に、転送するデータ量をブロック長及びブロック数にて
管理するようになっている。
即ち、セレクタ６はＭＰＵ３より制御信号データが入力
されると、その制御信号データの内、転送先の初期アド
レスをアドレスカウンタ７にセットし、転送ブロック長
、即ち、ブロックを構成するバイト数を転送フロック長
レジスタ８にセットする。又、転送ブロック数を転送ブ
ロック数レジスタ９にセットする。
されると、その制御信号データの内、転送先の初期アド
レスをアドレスカウンタ７にセットし、転送ブロック長
、即ち、ブロックを構成するバイト数を転送フロック長
レジスタ８にセットする。又、転送ブロック数を転送ブ
ロック数レジスタ９にセットする。
アドレスカウンタ７はそのカウント値をアドレス信号と
して半導体メモリ４に出力するとともｉこ、転送りロッ
クＴ ＣＬが入力される毎にカウントアツプする。尚、
転送りロックＴＣＬはＤＭＡコントローラ１とハードデ
ィスク装置５とのハンドシェーキングにおけるリクエス
ト信号又はアクノリッジ信号に基づいて出力されるもの
である。
して半導体メモリ４に出力するとともｉこ、転送りロッ
クＴ ＣＬが入力される毎にカウントアツプする。尚、
転送りロックＴＣＬはＤＭＡコントローラ１とハードデ
ィスク装置５とのハンドシェーキングにおけるリクエス
ト信号又はアクノリッジ信号に基づいて出力されるもの
である。
転送ブロック数レジスタ９は後記するブロック転送終了
信号ＢＴＥが入力される毎に前記セレクタ６によりセラ
１〜された転送ブロック数をカウントタウンし、そのカ
ウント値が「０」になると転送終了信号ＴＥをブロック
転送許可回路１２に出力するようになっている。
信号ＢＴＥが入力される毎に前記セレクタ６によりセラ
１〜された転送ブロック数をカウントタウンし、そのカ
ウント値が「０」になると転送終了信号ＴＥをブロック
転送許可回路１２に出力するようになっている。
ブロック長減算カウンタ１１は前記転送フロック長レジ
スタ８に保持された転送ブロック長をロードして前記転
送りロックＴＣＬが入力される毎にカウントタウンし、
そのカウント値が「０」になるとブロック転送終了信号
ＢＴＥを前記転送ブロック数レジスタ９及びブロック転
送許可回路１２に出力するようになっている。
スタ８に保持された転送ブロック長をロードして前記転
送りロックＴＣＬが入力される毎にカウントタウンし、
そのカウント値が「０」になるとブロック転送終了信号
ＢＴＥを前記転送ブロック数レジスタ９及びブロック転
送許可回路１２に出力するようになっている。
ブロック転送許可回路１２にはシステムクロックＳＣＬ
が入力されるとともに、前記ＭＰＵ３より転送許可信号
ＴＡが入力されるようになっており、前記ブロック長減
算カウンタ１１のブロック転送終了信号ＢＴＥに基づい
て各ブロック間の境界を検出するようになっている。尚
、ＭＰＵ３の転送許可信号ＴＡはフリップ・フロップ等
の保持手段を介して出力される。
が入力されるとともに、前記ＭＰＵ３より転送許可信号
ＴＡが入力されるようになっており、前記ブロック長減
算カウンタ１１のブロック転送終了信号ＢＴＥに基づい
て各ブロック間の境界を検出するようになっている。尚
、ＭＰＵ３の転送許可信号ＴＡはフリップ・フロップ等
の保持手段を介して出力される。
そして、ブロック転送許可回路１２はブロック転送終了
信号ＢＴＥに基づいてブロックの境界を検出した状態に
おいて、転送終了信号ＴＥが入力されておらず、転送許
可信号ＴＡが入力されていると、システムクロックＳＣ
Ｌに基づいて前記ブロック長減算カウンタ１１にロード
許可信号Ｌ Ａを出力し、同減算カウンタ１１に前記転
送ブロック長レジスタ８より転送ブロック長をロードさ
せて、次のブロックの転送を行わせる。又、ブロック転
送許可回路１２はブロック転送終了信号ＢＴＨに基づい
てブロックの境界を検出した状態においで１転送許可信
号ＴＡが入力されていないと、前記ブロック長減算カウ
ンタ１１にロード許可信号ＬＡを出力しない、即ち、デ
ータ転送をそのブロック境界で一時中断させるようにな
っている。さらに、ブロック転送許可回路１２は転送終
了信号ＴＥが人力されると、データ転送を終了させるよ
うになっている。
信号ＢＴＥに基づいてブロックの境界を検出した状態に
おいて、転送終了信号ＴＥが入力されておらず、転送許
可信号ＴＡが入力されていると、システムクロックＳＣ
Ｌに基づいて前記ブロック長減算カウンタ１１にロード
許可信号Ｌ Ａを出力し、同減算カウンタ１１に前記転
送ブロック長レジスタ８より転送ブロック長をロードさ
せて、次のブロックの転送を行わせる。又、ブロック転
送許可回路１２はブロック転送終了信号ＢＴＨに基づい
てブロックの境界を検出した状態においで１転送許可信
号ＴＡが入力されていないと、前記ブロック長減算カウ
ンタ１１にロード許可信号ＬＡを出力しない、即ち、デ
ータ転送をそのブロック境界で一時中断させるようにな
っている。さらに、ブロック転送許可回路１２は転送終
了信号ＴＥが人力されると、データ転送を終了させるよ
うになっている。
従って、ＭＰＵ３よりハードディスク装置５に対して転
送ファイルデータを複数指示するとともに、ＤＭＡコン
トローラ１に出力する制御信号ブタの転送ブロック数を
、複数ファイルの転送するブロック数の合計にして転送
ブロック数レジスタ９に設定しておけは、ＭＰＵ３から
の１度のデータ転送命令にて複数ファイルのデータを連
続して転送することができる。
送ファイルデータを複数指示するとともに、ＤＭＡコン
トローラ１に出力する制御信号ブタの転送ブロック数を
、複数ファイルの転送するブロック数の合計にして転送
ブロック数レジスタ９に設定しておけは、ＭＰＵ３から
の１度のデータ転送命令にて複数ファイルのデータを連
続して転送することができる。
即ち、例えばハードディスク装置５に対して離間したフ
ァイル５Ａ、、５Ｃを転送ファイルとして指示するとと
もに、ファイル５Ａ、５Ｃについてそれぞれ転送するブ
ロック数の合計を転送ブロック数レジスタ９にセットし
ておき、ファイル５Ａについて転送すべき最終ブロック
の転送終了前に、ＭＰＵ３からの転送許可信号ＴＡの出
力を停止すれば、ファイル５Ａの前記最終ブロックの転
送が終了すると、データ転送が一時中断される。
ァイル５Ａ、、５Ｃを転送ファイルとして指示するとと
もに、ファイル５Ａ、５Ｃについてそれぞれ転送するブ
ロック数の合計を転送ブロック数レジスタ９にセットし
ておき、ファイル５Ａについて転送すべき最終ブロック
の転送終了前に、ＭＰＵ３からの転送許可信号ＴＡの出
力を停止すれば、ファイル５Ａの前記最終ブロックの転
送が終了すると、データ転送が一時中断される。
そして、ハードディスク装置５においてファイル５Ｃの
データの転送が可能になった時、ＭＰＵ３から転送許可
信号ＴＡを出力すればファイル５Ｃについてデータ転送
が開始され、転送ブロック数レジスタ９のカウント値が
「０」になるまでデータ転送が行われる。
データの転送が可能になった時、ＭＰＵ３から転送許可
信号ＴＡを出力すればファイル５Ｃについてデータ転送
が開始され、転送ブロック数レジスタ９のカウント値が
「０」になるまでデータ転送が行われる。
このように、本実施例によれば複数ファイルのデータを
連続して転送する場合、ＭＰＵ’３によるデータ転送命
令の出力及び制御信号データ設定を１度だけにしてＤＭ
Ａコントローラ１に対する作０ 業量の増加を抑制することができ、その分たけ転送効率
を向上させてデータ転送の高速化を図ることができる。
連続して転送する場合、ＭＰＵ’３によるデータ転送命
令の出力及び制御信号データ設定を１度だけにしてＤＭ
Ａコントローラ１に対する作０ 業量の増加を抑制することができ、その分たけ転送効率
を向上させてデータ転送の高速化を図ることができる。
［発明の効果］
以上詳述したように、本発明によればＤＭＡ転送におい
て中央処理装置による作業量の増加を抑制しつつ、デー
タ転送の効率化を図ることができる優れた効果がある。
て中央処理装置による作業量の増加を抑制しつつ、デー
タ転送の効率化を図ることができる優れた効果がある。
第１図は本発明を具体化した一実施例のＤＭＡコントロ
ーラを示す概略構成図、 第２図は従来のＤＭＡコントローラを示す概略図である
。 図において、 １はＤＭＡコントローラ、 ３は中央処理装置としてのＭＰＵ。 ４は内部記憶装置としての半導体メモリ、１ は外部装置としてのハードディスク装置、は転送ブロッ
ク長レジスタ、 は転送ブロック数レジスタ、 ０はブロック境界検出回路である。 ２
ーラを示す概略構成図、 第２図は従来のＤＭＡコントローラを示す概略図である
。 図において、 １はＤＭＡコントローラ、 ３は中央処理装置としてのＭＰＵ。 ４は内部記憶装置としての半導体メモリ、１ は外部装置としてのハードディスク装置、は転送ブロッ
ク長レジスタ、 は転送ブロック数レジスタ、 ０はブロック境界検出回路である。 ２
Claims (1)
- 【特許請求の範囲】 中央処理装置からのデータ転送命令及び転送するデータ
量等の制御信号データに基づき、中央処理装置を介さず
、内部記憶装置と入出力装置又は他の外部装置との間で
データを直接転送するようにしたＤＭＡ転送方法におい
て、 データを所定のバイト数でブロック化してブロック毎に
転送するとともに、転送するデータ量をブロック長及び
ブロック数にて管理するようにしたことを特徴とするＤ
ＭＡ転送方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2069147A JP2604051B2 (ja) | 1990-03-19 | 1990-03-19 | データ転送方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2069147A JP2604051B2 (ja) | 1990-03-19 | 1990-03-19 | データ転送方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH03268154A true JPH03268154A (ja) | 1991-11-28 |
| JP2604051B2 JP2604051B2 (ja) | 1997-04-23 |
Family
ID=13394259
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2069147A Expired - Lifetime JP2604051B2 (ja) | 1990-03-19 | 1990-03-19 | データ転送方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2604051B2 (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59136833A (ja) * | 1983-01-27 | 1984-08-06 | Mitsubishi Electric Corp | デ−タ転送制御装置 |
-
1990
- 1990-03-19 JP JP2069147A patent/JP2604051B2/ja not_active Expired - Lifetime
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59136833A (ja) * | 1983-01-27 | 1984-08-06 | Mitsubishi Electric Corp | デ−タ転送制御装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2604051B2 (ja) | 1997-04-23 |
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Legal Events
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