JPH0326573B2 - - Google Patents
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- Publication number
- JPH0326573B2 JPH0326573B2 JP58221064A JP22106483A JPH0326573B2 JP H0326573 B2 JPH0326573 B2 JP H0326573B2 JP 58221064 A JP58221064 A JP 58221064A JP 22106483 A JP22106483 A JP 22106483A JP H0326573 B2 JPH0326573 B2 JP H0326573B2
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- pulse
- light
- clock pulse
- input terminal
- Prior art date
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- Expired - Lifetime
Links
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- 239000003990 capacitor Substances 0.000 description 6
- 238000010586 diagram Methods 0.000 description 4
- 238000007493 shaping process Methods 0.000 description 4
- 230000003111 delayed effect Effects 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 230000000630 rising effect Effects 0.000 description 2
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- 230000005540 biological transmission Effects 0.000 description 1
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- 238000004088 simulation Methods 0.000 description 1
- 230000001960 triggered effect Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
- H03K5/19—Monitoring patterns of pulse trains
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
- H03K5/153—Arrangements in which a pulse is delivered at the instant when a predetermined characteristic of an input signal is present or at a fixed time interval after this instant
Landscapes
- Physics & Mathematics (AREA)
- Nonlinear Science (AREA)
- Optical Radar Systems And Details Thereof (AREA)
- Electronic Switches (AREA)
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は投光素子からパルス変調光を投光する
光電スイツチ装置に関する。
光電スイツチ装置に関する。
この種の従来の光電スイツチ装置としては、受
光素子が受光したパルス変調光に応じた受光信号
を積分回路によつて積分させ、その積分出力をシ
ユミツト回路により一定レベルでスイツチングさ
せて出力とするものが一般的である。ところが、
上記構成では、積分回路としてコンデンサの充放
電を利用しているので、時定数は抵抗とコンデン
サとによつて決定され、これらの素子のばらつき
による動作時間のばらつきがあり、更に、受光信
号の大きさの変化により所定のシユミレツトレベ
ルに達する時間が異なり、以て、信頼性ち劣る不
具合がある。しかも、積分回路を形成するコンデ
ンサは光電スイツチ装置をIC化する場合に外付
けしなければならず、小形化を図る上で障害とな
つていた。
光素子が受光したパルス変調光に応じた受光信号
を積分回路によつて積分させ、その積分出力をシ
ユミツト回路により一定レベルでスイツチングさ
せて出力とするものが一般的である。ところが、
上記構成では、積分回路としてコンデンサの充放
電を利用しているので、時定数は抵抗とコンデン
サとによつて決定され、これらの素子のばらつき
による動作時間のばらつきがあり、更に、受光信
号の大きさの変化により所定のシユミレツトレベ
ルに達する時間が異なり、以て、信頼性ち劣る不
具合がある。しかも、積分回路を形成するコンデ
ンサは光電スイツチ装置をIC化する場合に外付
けしなければならず、小形化を図る上で障害とな
つていた。
本発明は上記事情に鑑みてなされたもので、そ
の目的は、コンデンサ等のリアクタンス素子を用
いずに遅延検出信号を得ることができ、信頼性に
富み、小形化を図ることができてIC化に好適す
る光電スイツチ装置を提供するにある。
の目的は、コンデンサ等のリアクタンス素子を用
いずに遅延検出信号を得ることができ、信頼性に
富み、小形化を図ることができてIC化に好適す
る光電スイツチ装置を提供するにある。
本発明は、投光素子からのパルス変調光を受光
する受光素子に基づく受光パルスに応じて遅延検
出信号を出力する信号処理回路を、所定周期のク
ロツクパルスをカウントするカウンタと、このカ
ウンタのカウント値が設定値となる毎に出力信号
をハイレベル及びロウレベルに交互に反転する反
転回路と、前記受光パルス及びクロツクパルスを
入力とし前記反転回路の出力信号がロウレベルの
時には前記受光パルスがないことを条件に前記ク
ロツクパルスに同期して前記カウンタをクリアさ
せ前記反転回路の出力信号がハイレベルの時には
前記受光パルスがあることを条件に前記クロツク
パルスに同期して前記カウンタをクリアさせる状
態検出回路とから構成し、前記反転回路の出力信
号を遅延検出信号とするようにしたことを特徴と
するものである。
する受光素子に基づく受光パルスに応じて遅延検
出信号を出力する信号処理回路を、所定周期のク
ロツクパルスをカウントするカウンタと、このカ
ウンタのカウント値が設定値となる毎に出力信号
をハイレベル及びロウレベルに交互に反転する反
転回路と、前記受光パルス及びクロツクパルスを
入力とし前記反転回路の出力信号がロウレベルの
時には前記受光パルスがないことを条件に前記ク
ロツクパルスに同期して前記カウンタをクリアさ
せ前記反転回路の出力信号がハイレベルの時には
前記受光パルスがあることを条件に前記クロツク
パルスに同期して前記カウンタをクリアさせる状
態検出回路とから構成し、前記反転回路の出力信
号を遅延検出信号とするようにしたことを特徴と
するものである。
以下本発明の一実施例につき第１図乃至第３図
を参照しながら説明する。
を参照しながら説明する。
先ず、第１図に従つて全体の概略的構成につい
て述べる。１は赤外線発光ダイオードからなる投
光素子であり、これは発振回路からなるクロツク
パルス発生回路２からの所定周期のクロツクパル
スP2（第３図ｂ参照）が駆動回路３を介して与え
られてパルス変調光を発生するようになつてお
り、そのパルス変調光は図示しない被検知体に向
けて投光されるようになつている。４はフオトト
ランジスタからなる受光素子であり、これは被検
出体から反射されたパルス変調光を受光するよう
になつており、その受光信号は増幅回路５を介し
てシユミツト回路からなる波形整形回路６に与え
られて受光パルスP6（第３図ａ参照）に変換され
るようになつている。従つて、受光パルスP6は
クロツクパルスP2に同期して発生するようにな
る。７は信号処理回路であり、これは、入力端子
８及び９に夫々受光パルスP6及びクロツクパル
スP2が与えられて出力端子１０から後述するよ
うに遅延検出信号S7を出力するようになつてお
り、その遅延検出信号S7はバツフア回路からなる
出力回路１１を介して適宜の作動装置（図示せ
ず）に与えられるようになつている。
て述べる。１は赤外線発光ダイオードからなる投
光素子であり、これは発振回路からなるクロツク
パルス発生回路２からの所定周期のクロツクパル
スP2（第３図ｂ参照）が駆動回路３を介して与え
られてパルス変調光を発生するようになつてお
り、そのパルス変調光は図示しない被検知体に向
けて投光されるようになつている。４はフオトト
ランジスタからなる受光素子であり、これは被検
出体から反射されたパルス変調光を受光するよう
になつており、その受光信号は増幅回路５を介し
てシユミツト回路からなる波形整形回路６に与え
られて受光パルスP6（第３図ａ参照）に変換され
るようになつている。従つて、受光パルスP6は
クロツクパルスP2に同期して発生するようにな
る。７は信号処理回路であり、これは、入力端子
８及び９に夫々受光パルスP6及びクロツクパル
スP2が与えられて出力端子１０から後述するよ
うに遅延検出信号S7を出力するようになつてお
り、その遅延検出信号S7はバツフア回路からなる
出力回路１１を介して適宜の作動装置（図示せ
ず）に与えられるようになつている。
さて、第２図に従つて信号処理回路７について
述べる。１２，１３及び１４は８進のカウンタ１
５を構成するフリツプフロツプ回路であり、その
各セツト出力端子Ｑはアンド回路１６の第１乃至
第３の入力端子に夫々接続されている。更に、フ
リツプフロツプ回路１２，１３及び１４の各デー
タ入力端子Ｄは自己のリセツト出力端子に接続
されており、又、フリツプフロツプ回路１２のク
ロツクパルス入力端子CKは入力端子９に接続さ
れ、そのフリツプフロツプ回路１２のリセツト出
力端子はフリツプフロツプ回路１３のクロツク
パルス入力端子CKに接続され、該フリツプフロ
ツプ回路１３のリセツト出力端子はフリツプフ
ロツプ回路１４のクロツクパルス入力端子CKに
接続されている。１７は反転回路たるフリツプフ
ロツプ回路であり、そのデータ入力端子Ｄはリセ
ツト出力端子に接続され、クロツクパルス入力
端子CKは前記アンド回路１６の出力端子に接続
され、セツト出力端子Ｑは出力端子１０に接続さ
れている。即ち、前記フリツプフロツプ回路１
２，１３，１４及び１７は、データ入力端子Ｄが
自己のリセツト出力端子に接続されてクロツク
パルス入力端子CKに入力されるパルス信号の立
上りで出力が反転されるＤ形フリツプフロツプ回
路によるＴ形フリツプフロツプ回路である。１
８，１９及び２０はナンド回路、２１はインバー
タ回路であり、そのナンド回路１８において、第
１の入力端子は入力端子８に接続され、第２の入
力端子は前記フリツプフロツプ回路回路１７のセ
ツト出力端子Ｑに接続され、第３の入力端子は入
力端子９に接続されており、又、ナンド回路に１
９において、第１の入力端子は前記フリツプフロ
ツプ回路１７のリセツト出力端子に接続され、
第２の入力端子はインバータ回路２１を介して入
力端子８に接続され、第３の入力端子は入力端子
９に接続されており、そして、ナンド回路１８及
び１９の各出力端子はナンド回路２０の第１及び
第２の入力端子に夫々接続されているとともに、
該ナンド回路２０に出力端子は前記フリツプフロ
ツプ回路１２，１３及び１４の各クリア端子CL
に接続されており、以て、状態検出回路２２が構
成されている。
述べる。１２，１３及び１４は８進のカウンタ１
５を構成するフリツプフロツプ回路であり、その
各セツト出力端子Ｑはアンド回路１６の第１乃至
第３の入力端子に夫々接続されている。更に、フ
リツプフロツプ回路１２，１３及び１４の各デー
タ入力端子Ｄは自己のリセツト出力端子に接続
されており、又、フリツプフロツプ回路１２のク
ロツクパルス入力端子CKは入力端子９に接続さ
れ、そのフリツプフロツプ回路１２のリセツト出
力端子はフリツプフロツプ回路１３のクロツク
パルス入力端子CKに接続され、該フリツプフロ
ツプ回路１３のリセツト出力端子はフリツプフ
ロツプ回路１４のクロツクパルス入力端子CKに
接続されている。１７は反転回路たるフリツプフ
ロツプ回路であり、そのデータ入力端子Ｄはリセ
ツト出力端子に接続され、クロツクパルス入力
端子CKは前記アンド回路１６の出力端子に接続
され、セツト出力端子Ｑは出力端子１０に接続さ
れている。即ち、前記フリツプフロツプ回路１
２，１３，１４及び１７は、データ入力端子Ｄが
自己のリセツト出力端子に接続されてクロツク
パルス入力端子CKに入力されるパルス信号の立
上りで出力が反転されるＤ形フリツプフロツプ回
路によるＴ形フリツプフロツプ回路である。１
８，１９及び２０はナンド回路、２１はインバー
タ回路であり、そのナンド回路１８において、第
１の入力端子は入力端子８に接続され、第２の入
力端子は前記フリツプフロツプ回路回路１７のセ
ツト出力端子Ｑに接続され、第３の入力端子は入
力端子９に接続されており、又、ナンド回路に１
９において、第１の入力端子は前記フリツプフロ
ツプ回路１７のリセツト出力端子に接続され、
第２の入力端子はインバータ回路２１を介して入
力端子８に接続され、第３の入力端子は入力端子
９に接続されており、そして、ナンド回路１８及
び１９の各出力端子はナンド回路２０の第１及び
第２の入力端子に夫々接続されているとともに、
該ナンド回路２０に出力端子は前記フリツプフロ
ツプ回路１２，１３及び１４の各クリア端子CL
に接続されており、以て、状態検出回路２２が構
成されている。
次に、本実施例の作用につき第３図をも参照し
ながら説明する。
ながら説明する。
今、フリツプフロツプ回路１２，１３，１４及
び１７が全てクリア状態にあるとすると（時刻
t0）、これらのフリツプフロツプ回路１２，１３，
１４及び１７の各セツト出力信号は第３図ｃ，
ｄ，ｅ及びｇで示すようにロウレベルとなつてい
る。そして、受光素子４が被検出体から反射され
たパルス変調光を受光すると、これに基づいて波
形整形回路６が第３図ａで示すように受光パルス
P6を出力するようになる。又、第３図ｂに示す
クロツクパルスP2がフリツプフロツプ回路１２
のクロツクパルス入力端子CKに与えられるので、
８性のカウンタ１５を構成するフリツプフロツプ
回路１２，１３及び１４のセツト出力信号は第３
図ｃ，ｄ及びｅで示すように順次ハイレベル若し
くはロウレベルに変化し、以て、カウンタ１５が
カウント動作を行なうようになる。そして、時刻
t0以降において７個目のクロツクパルスP2がフリ
ツプフロツプ回路１２のクロツクパルス入力端子
CKに与えられると（時刻t1）、カウンタ１５のカ
ウント値は設定値たる「７」となつてフリツプフ
ロツプ回路１２，１３及び１４のセツト出力信号
は全てハイレベルとなり、従つて、アンド回路１
６がハイレベルの出力信号を発生してフリツプフ
ロツプ回路１７のクロツクパルス入力端子CKに
与えるようになり、該フリツプフロツプ回路１７
はセツト出力信号を第３図ｇで示すようにハイレ
ベルとするように状態を反転する。そして、この
フリツプフロツプ回路１７のハイレベルのセツト
出力信号が遅延検出信号S7として出力端子１０に
出力されることになる。又、フリツプフロツプ回
路１７のセツト出力信号がハイレベルとなると、
これが第２の入力端子に与えられるナンド回路１
８は第１及び第３の入力端子に受光パルスP6及
びクロツクパルスP2が与えられた時点で出力信
号をロウレベルとするので、ナンド回路２０は第
３図ｆで示すようにハイレベルの出力信号たるク
リアパルスP22を出力するようになり、このクリ
アパルスP22はフリツプフロツプ回路１２，１３
及び１４のクリア端子CLに与えられてカウンタ
１５は「０」にクリアされることになる。その
後、カウンタ１５はフリツプフロツプ回路１２の
クロツクパルス入力端子CKにクロツクパルスP2
が与えられる毎にカウント動作するようになる
が、ナンド回路１８の第１及び第３の入力端子に
受光パルスP6及びクロツクパルスP2が与えられ
る毎にナンド回路２０がクリアパルスP22を出力
するので、その都度カウンタ１５はクリアされる
ことになる。即ち、カウンタ１５は、フリツプフ
ロツプ回路１７のセツト出力信号がハイレベル状
態の時には受光パルスP6があることを条件にク
ロツクパルスP2に同期してクリアされることに
なる。その後、受光素子４が被検出体から反射さ
れるパルス変調光を受光しなくなつて波形整形回
路６が受光パルスP6を出力しなくなつた場合に
は、カウンタ１５はクリアされることなくカウン
ト動作を行なうようになり、そして、そのカウン
ト値が設定値たる「７」となると（時刻t2）、フ
リツプフロツプ回路１２，１３及び１４のセツト
出力信号が再び全てハイレベルとなるので、アン
ド回路１６の出力信号が再びハイレベルとなり、
これによつて、フリツプフロツプ回路１７はセツ
ト出力信号をロウレベルとするように再反転する
ようになり、遅延検出信号S7の出力が停止され
る。又、フリツプフロツプ回路１７のセツト出力
信号がロウレベルになると即ちリセツト出力信号
がハイレベルとなると、このハイレベルのリセツ
ト出力信号がナンド回路１９の第１の入力端子に
与えられる。そして、この時には受光パルスP6
はなくなつているので、ナンド回路１９の第２の
入力端子にはインバータ回路２１からのハイレベ
ルの出力信号が与えられており、従つて、ナンド
回路１９は第３の入力端子にクロツクパルスP2
が与えられた時点で出力信号をロウレベルとする
ようになり、ナンド回路２０はクリアパルスP22
を出力してカウンタ１５をクリアさせることにな
る。その後は、ナンド回路１９の第３の入力端子
にクロツクパルスP2が与えられる毎にナンド回
路２０がクリアパルスP22を出力するようになる
ので、カウンタ１５はその都度クリアされること
になつて実質的にカウント動作を行なわないこと
になる。即ち、カウンタ１５は、フリツプフロツ
プ回路１７セツト出力信号がロウレベル状態の時
には受光パルスP6がないことを条件にクロツク
パルスP2に同期してクリアされることになるも
のであり、換言すれば、出力端子１０は、時刻t0
−t1のように当該出力端子１０がロウレベルの時
には受光パルスP6が連続して所定個数（う本実
施例では７個）以上であれば反転し、時刻t0′−t1
のように当該出力端子１０ハイレベルの時には受
光パルスP6が連続して所定個数以上なければ反
転し、以て、検出信号S7を出力するものであり、
その時刻t0−t1間及び時刻t0′−t1間の時間Ｔは同
じであり、更に、カウンタ１５のフリツプフロツ
プ回路及びアンド回路１６の入力端子を増減する
ことにより時間Ｔは自由に変更できる。
び１７が全てクリア状態にあるとすると（時刻
t0）、これらのフリツプフロツプ回路１２，１３，
１４及び１７の各セツト出力信号は第３図ｃ，
ｄ，ｅ及びｇで示すようにロウレベルとなつてい
る。そして、受光素子４が被検出体から反射され
たパルス変調光を受光すると、これに基づいて波
形整形回路６が第３図ａで示すように受光パルス
P6を出力するようになる。又、第３図ｂに示す
クロツクパルスP2がフリツプフロツプ回路１２
のクロツクパルス入力端子CKに与えられるので、
８性のカウンタ１５を構成するフリツプフロツプ
回路１２，１３及び１４のセツト出力信号は第３
図ｃ，ｄ及びｅで示すように順次ハイレベル若し
くはロウレベルに変化し、以て、カウンタ１５が
カウント動作を行なうようになる。そして、時刻
t0以降において７個目のクロツクパルスP2がフリ
ツプフロツプ回路１２のクロツクパルス入力端子
CKに与えられると（時刻t1）、カウンタ１５のカ
ウント値は設定値たる「７」となつてフリツプフ
ロツプ回路１２，１３及び１４のセツト出力信号
は全てハイレベルとなり、従つて、アンド回路１
６がハイレベルの出力信号を発生してフリツプフ
ロツプ回路１７のクロツクパルス入力端子CKに
与えるようになり、該フリツプフロツプ回路１７
はセツト出力信号を第３図ｇで示すようにハイレ
ベルとするように状態を反転する。そして、この
フリツプフロツプ回路１７のハイレベルのセツト
出力信号が遅延検出信号S7として出力端子１０に
出力されることになる。又、フリツプフロツプ回
路１７のセツト出力信号がハイレベルとなると、
これが第２の入力端子に与えられるナンド回路１
８は第１及び第３の入力端子に受光パルスP6及
びクロツクパルスP2が与えられた時点で出力信
号をロウレベルとするので、ナンド回路２０は第
３図ｆで示すようにハイレベルの出力信号たるク
リアパルスP22を出力するようになり、このクリ
アパルスP22はフリツプフロツプ回路１２，１３
及び１４のクリア端子CLに与えられてカウンタ
１５は「０」にクリアされることになる。その
後、カウンタ１５はフリツプフロツプ回路１２の
クロツクパルス入力端子CKにクロツクパルスP2
が与えられる毎にカウント動作するようになる
が、ナンド回路１８の第１及び第３の入力端子に
受光パルスP6及びクロツクパルスP2が与えられ
る毎にナンド回路２０がクリアパルスP22を出力
するので、その都度カウンタ１５はクリアされる
ことになる。即ち、カウンタ１５は、フリツプフ
ロツプ回路１７のセツト出力信号がハイレベル状
態の時には受光パルスP6があることを条件にク
ロツクパルスP2に同期してクリアされることに
なる。その後、受光素子４が被検出体から反射さ
れるパルス変調光を受光しなくなつて波形整形回
路６が受光パルスP6を出力しなくなつた場合に
は、カウンタ１５はクリアされることなくカウン
ト動作を行なうようになり、そして、そのカウン
ト値が設定値たる「７」となると（時刻t2）、フ
リツプフロツプ回路１２，１３及び１４のセツト
出力信号が再び全てハイレベルとなるので、アン
ド回路１６の出力信号が再びハイレベルとなり、
これによつて、フリツプフロツプ回路１７はセツ
ト出力信号をロウレベルとするように再反転する
ようになり、遅延検出信号S7の出力が停止され
る。又、フリツプフロツプ回路１７のセツト出力
信号がロウレベルになると即ちリセツト出力信号
がハイレベルとなると、このハイレベルのリセツ
ト出力信号がナンド回路１９の第１の入力端子に
与えられる。そして、この時には受光パルスP6
はなくなつているので、ナンド回路１９の第２の
入力端子にはインバータ回路２１からのハイレベ
ルの出力信号が与えられており、従つて、ナンド
回路１９は第３の入力端子にクロツクパルスP2
が与えられた時点で出力信号をロウレベルとする
ようになり、ナンド回路２０はクリアパルスP22
を出力してカウンタ１５をクリアさせることにな
る。その後は、ナンド回路１９の第３の入力端子
にクロツクパルスP2が与えられる毎にナンド回
路２０がクリアパルスP22を出力するようになる
ので、カウンタ１５はその都度クリアされること
になつて実質的にカウント動作を行なわないこと
になる。即ち、カウンタ１５は、フリツプフロツ
プ回路１７セツト出力信号がロウレベル状態の時
には受光パルスP6がないことを条件にクロツク
パルスP2に同期してクリアされることになるも
のであり、換言すれば、出力端子１０は、時刻t0
−t1のように当該出力端子１０がロウレベルの時
には受光パルスP6が連続して所定個数（う本実
施例では７個）以上であれば反転し、時刻t0′−t1
のように当該出力端子１０ハイレベルの時には受
光パルスP6が連続して所定個数以上なければ反
転し、以て、検出信号S7を出力するものであり、
その時刻t0−t1間及び時刻t0′−t1間の時間Ｔは同
じであり、更に、カウンタ１５のフリツプフロツ
プ回路及びアンド回路１６の入力端子を増減する
ことにより時間Ｔは自由に変更できる。
このように本実施例によれば、信号処理回路７
によつて受光パルスP6をデジタル的に処理して
遅延検出信号S7を得るようにしたので、従来の積
分回路とは異なりコンデンサ等のリアクタンス素
子を用いる必要がなく、それだけ小形化を図り得
てIC化に好適するものであり、しかも、動作に
ばらつきがなくて信頼性に富む利点がある。
によつて受光パルスP6をデジタル的に処理して
遅延検出信号S7を得るようにしたので、従来の積
分回路とは異なりコンデンサ等のリアクタンス素
子を用いる必要がなく、それだけ小形化を図り得
てIC化に好適するものであり、しかも、動作に
ばらつきがなくて信頼性に富む利点がある。
第４図乃至第６図は本発明の第２の実施例であ
り、前記実施例と同一部分には同一符号を付して
示し、以下異なる部分についてのみ説明する。即
ち、前記実施例は反射形を対称としたものである
が、この第２の実施例では透過形を対象とするも
のである。反射形のものは同一のケースに投光素
子１及び受光素子４を取付けることができるの
で、クロツクパルス発生回路２を投光素子１用と
信号処理回路７用として兼用してクロツクパルス
P2の受光パルスP6とを同期関係にすることがで
きるが、透過形のものは投光素子１及び受光素子
４は夫々専用のケースに取付けられるので、信号
処理回路７用として専用のクロツクパルス発生回
路２３を設ける必要があり、これにともなつて信
号処理回路７としては以下述べるように構成が変
更される。即ち、２４はフリツプフロツプ回路で
あり、そのデータ入力端子Ｄはアースされ、クロ
ツクパルス入力端子CKはインバータ回路２５を
介して入力端子９に接続され、プリセツト入力端
子PRは入力端子８に接続され、セツト出力端子
Ｑはインバータ回路２１の入力端子に接続されて
いるとともにナンド回路１８の第１の入力端子に
接続され、以て、状態検出回路２２に代る状態検
出回路２６が構成されている。
り、前記実施例と同一部分には同一符号を付して
示し、以下異なる部分についてのみ説明する。即
ち、前記実施例は反射形を対称としたものである
が、この第２の実施例では透過形を対象とするも
のである。反射形のものは同一のケースに投光素
子１及び受光素子４を取付けることができるの
で、クロツクパルス発生回路２を投光素子１用と
信号処理回路７用として兼用してクロツクパルス
P2の受光パルスP6とを同期関係にすることがで
きるが、透過形のものは投光素子１及び受光素子
４は夫々専用のケースに取付けられるので、信号
処理回路７用として専用のクロツクパルス発生回
路２３を設ける必要があり、これにともなつて信
号処理回路７としては以下述べるように構成が変
更される。即ち、２４はフリツプフロツプ回路で
あり、そのデータ入力端子Ｄはアースされ、クロ
ツクパルス入力端子CKはインバータ回路２５を
介して入力端子９に接続され、プリセツト入力端
子PRは入力端子８に接続され、セツト出力端子
Ｑはインバータ回路２１の入力端子に接続されて
いるとともにナンド回路１８の第１の入力端子に
接続され、以て、状態検出回路２２に代る状態検
出回路２６が構成されている。
而して、信号処理回路７を入力端子９にはクロ
ツクパルス発生回路２３からの第６図ｂで示す如
きクロツクパルスP23が与えられるようになつて
おり、従つて、例えば時刻t0以降に波形整形回路
６が第６図ａで示すように受光パルスP6を出力
すると、カウンタ１５はこのクロツクパルスP23
をカウント動作するようになり、フリツプフロツ
プ回路１２，１３及び１４の各セツト出力信号は
第６図ｄ，ｅ及びｆで示すようになる。又、フリ
ツプフロツプ回路２４は、プリセツト入力端子
PRに受光パルスP6が与えられるとその立上りに
よつてプリセツトされてセツト出力信号をハイレ
ベルとし、クロツクパルス入力端子CKにインバ
ータ回路２５を介してクロツクパルスP23が与え
られるとその立下りによつてトリガされてセツト
出力信号をロウレベルとするようになり、従つ
て、フリツプフロツプ回路２４のハイレベルのセ
ツト出力信号はクロツクパルスP23と同期関係の
取り易い受光パルスP24となるものである。これ
により、以後の処理では受光パルスP6の代りに
受光パルスP24が用いられるもので、前述同様に
して、ナンド回路２０は第６図ｇで示すようにク
リアパルスP26を出力し、フリツプフロツプ回路
１７は第６図ｈで示すように遅延検出信号S7を出
力する。
ツクパルス発生回路２３からの第６図ｂで示す如
きクロツクパルスP23が与えられるようになつて
おり、従つて、例えば時刻t0以降に波形整形回路
６が第６図ａで示すように受光パルスP6を出力
すると、カウンタ１５はこのクロツクパルスP23
をカウント動作するようになり、フリツプフロツ
プ回路１２，１３及び１４の各セツト出力信号は
第６図ｄ，ｅ及びｆで示すようになる。又、フリ
ツプフロツプ回路２４は、プリセツト入力端子
PRに受光パルスP6が与えられるとその立上りに
よつてプリセツトされてセツト出力信号をハイレ
ベルとし、クロツクパルス入力端子CKにインバ
ータ回路２５を介してクロツクパルスP23が与え
られるとその立下りによつてトリガされてセツト
出力信号をロウレベルとするようになり、従つ
て、フリツプフロツプ回路２４のハイレベルのセ
ツト出力信号はクロツクパルスP23と同期関係の
取り易い受光パルスP24となるものである。これ
により、以後の処理では受光パルスP6の代りに
受光パルスP24が用いられるもので、前述同様に
して、ナンド回路２０は第６図ｇで示すようにク
リアパルスP26を出力し、フリツプフロツプ回路
１７は第６図ｈで示すように遅延検出信号S7を出
力する。
尚、本発明は上記し且つ図面に示す実施例にの
み限定されるものではなく、要旨を逸脱しない範
囲内で適宜変形して実施し得ることは勿論であ
る。
み限定されるものではなく、要旨を逸脱しない範
囲内で適宜変形して実施し得ることは勿論であ
る。
本発明の光電スイツチ装置は以上説明したよう
に、コンデンサ等のリアクタンス素子の用いなく
ても受光パルスから遅延検出信号を得ることがで
き、信頼性に富み、小形化を図ることができて
IC化に好適するという優れた効果を奏するもの
である。
に、コンデンサ等のリアクタンス素子の用いなく
ても受光パルスから遅延検出信号を得ることがで
き、信頼性に富み、小形化を図ることができて
IC化に好適するという優れた効果を奏するもの
である。
第１図乃至第３図は本発明の第１の実施例を示
し、第１図は全体の構成を示すブロツク線図、第
２図は信号処理回路の電気的構成図、第３図は作
用説明用の各部の波形図であり、第４図乃至第６
図は本発明の第２の実施例を示す第１図乃至第３
図相当図である。 図面中、１は投光素子、２はクロツクパルス発
生回路、４は受光素子、６は波形整形回路、７は
信号処理回路、１５はカウンタ、１７はフリツプ
フロツプ回路（反転回路）、２２及び２６は状態
検出回路を示す。
し、第１図は全体の構成を示すブロツク線図、第
２図は信号処理回路の電気的構成図、第３図は作
用説明用の各部の波形図であり、第４図乃至第６
図は本発明の第２の実施例を示す第１図乃至第３
図相当図である。 図面中、１は投光素子、２はクロツクパルス発
生回路、４は受光素子、６は波形整形回路、７は
信号処理回路、１５はカウンタ、１７はフリツプ
フロツプ回路（反転回路）、２２及び２６は状態
検出回路を示す。
Claims (1)
- １ パルス変調光を投光する投光素子と、この投
光素子からの投光を受光する受光素子と、この受
光素子の受光に基づく受光パルスに応じて遅延検
出信号を出力する信号処理回路とを具備し、前記
信号処理回路は、所定周期のクロツクパルスをカ
ウントするカウンタと、このカウンタのカウント
値が設定値となる毎に出力信号をハイレベル及び
ロウレベルに交互に反転する反転回路と、前記受
光パルス及びクロツクパルスを入力とし前記反転
回路の出力信号がロウレベルの時には前記受光パ
ルスがないことを条件に前記クロツクパルスに同
期して前記カウンタをクリアさせ前記反転回路の
出力信号がハイレベルの時には前記受光パルスが
あることを条件に前記クロツクパルスに同期して
前記カウンタをクリアさせる状態検出回路とから
構成し、前記反転回路の出力信号を遅延検出信号
とするようにしてなる光電スイツチ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58221064A JPS60112319A (ja) | 1983-11-22 | 1983-11-22 | 光電スイッチ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58221064A JPS60112319A (ja) | 1983-11-22 | 1983-11-22 | 光電スイッチ装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60112319A JPS60112319A (ja) | 1985-06-18 |
| JPH0326573B2 true JPH0326573B2 (ja) | 1991-04-11 |
Family
ID=16760921
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58221064A Granted JPS60112319A (ja) | 1983-11-22 | 1983-11-22 | 光電スイッチ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60112319A (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61139776A (ja) * | 1984-12-11 | 1986-06-27 | Riide Denki Kk | 光電スイツチ |
| JPS62126A (ja) * | 1985-06-26 | 1987-01-06 | Kiiensu:Kk | 光電スイツチ |
| JPS62136920A (ja) * | 1985-12-10 | 1987-06-19 | Sharp Corp | 光変調形検出装置 |
| JP2858686B2 (ja) * | 1994-01-28 | 1999-02-17 | 東陶機器株式会社 | 便器洗浄装置 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5628049A (en) * | 1979-08-17 | 1981-03-19 | Daifuku Machinery Works | Carrying device with carrying truck arrival display |
-
1983
- 1983-11-22 JP JP58221064A patent/JPS60112319A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5628049A (en) * | 1979-08-17 | 1981-03-19 | Daifuku Machinery Works | Carrying device with carrying truck arrival display |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS60112319A (ja) | 1985-06-18 |
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