JPH03263896A - 多層配線基板の製造方法 - Google Patents
多層配線基板の製造方法Info
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- JPH03263896A JPH03263896A JP6095690A JP6095690A JPH03263896A JP H03263896 A JPH03263896 A JP H03263896A JP 6095690 A JP6095690 A JP 6095690A JP 6095690 A JP6095690 A JP 6095690A JP H03263896 A JPH03263896 A JP H03263896A
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Landscapes
- Production Of Multi-Layered Print Wiring Board (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、高集積LSIなどを実装する多層配線基板の
製造方法に関する。
製造方法に関する。
従来の配線に銅、絶縁層にポリイミドを用いた多層配線
基板の構成とその製造工程図を第1図(a)〜(f)に
示す。
基板の構成とその製造工程図を第1図(a)〜(f)に
示す。
第1図(a)に示すようにセラミック基板あるいは下層
配線が形成された多層配線基板1の上に形成されている
第1層の配線導体層2の上に絶縁層としてポリイミド樹
脂のような高分子樹脂層3を形成する。さらに第1図(
b)に示すようにフオドレジストを用いてマスク4を形
成し、ホトエツチング法によりマスクの所望の部分を選
択的に除去して該樹脂膜が露出するように窓5を設ける
。
配線が形成された多層配線基板1の上に形成されている
第1層の配線導体層2の上に絶縁層としてポリイミド樹
脂のような高分子樹脂層3を形成する。さらに第1図(
b)に示すようにフオドレジストを用いてマスク4を形
成し、ホトエツチング法によりマスクの所望の部分を選
択的に除去して該樹脂膜が露出するように窓5を設ける
。
次に第1図(c)に示すようにエツチング液(例えばヒ
ドラジことエチレンジアミンの混合液)に浸して化学的
なエツチング手法を用いて該樹脂層3を選択的に除去し
て孔6を形成する。この方法で第1層の配線導体層2の
表面が露出される(第1図(d))。しかるのちにマス
ク材4を除去する。
ドラジことエチレンジアミンの混合液)に浸して化学的
なエツチング手法を用いて該樹脂層3を選択的に除去し
て孔6を形成する。この方法で第1層の配線導体層2の
表面が露出される(第1図(d))。しかるのちにマス
ク材4を除去する。
次いで、蒸着法、スパッタリング法等の金属膜形成技術
およびフォトエツチング法を用いて第1図(e)に示す
ように第1層の配線導体層2と電気的に接続した第2層
の配線導体層7を形成する。
およびフォトエツチング法を用いて第1図(e)に示す
ように第1層の配線導体層2と電気的に接続した第2層
の配線導体層7を形成する。
3層以上の配線導体を有する多層配線基板を形成する場
合には上記した方法を繰り返す。
合には上記した方法を繰り返す。
〔発明が解決しようとする課題〕
上記従来技術では、銅配線を含む面上にポリイミドを塗
布した後、ベークするため、ポリアミック酸が銅と反応
してボイドを発生し、上層配線の形成においてフォト工
程を高精度に行なうことができないという問題があった
。
布した後、ベークするため、ポリアミック酸が銅と反応
してボイドを発生し、上層配線の形成においてフォト工
程を高精度に行なうことができないという問題があった
。
本発明は、前記従来技術の問題を解決し、ポリイミド成
膜におけるボイド発生を防止するとともに、高精度に上
層配線を形成する多層配線基板の製造方法を提供するこ
とにある。
膜におけるボイド発生を防止するとともに、高精度に上
層配線を形成する多層配線基板の製造方法を提供するこ
とにある。
前記の目的は、無電解めっきで形成した銅配線上に、ポ
リイミド絶縁層を形成する前、あらかじめ銅配線上のみ
クロムまたはニッケル膜を形成することにより達成され
る。
リイミド絶縁層を形成する前、あらかじめ銅配線上のみ
クロムまたはニッケル膜を形成することにより達成され
る。
導体配線に銅、絶縁層にポリイミドを用いた多層配線基
板において第2層目の配線を形成する場合、まず第1層
目の銅配線上にポリイミド成膜スをスピンコータまたは
ロールコータを用いて塗布した後300〜350℃で加
熱硬化して形成する。
板において第2層目の配線を形成する場合、まず第1層
目の銅配線上にポリイミド成膜スをスピンコータまたは
ロールコータを用いて塗布した後300〜350℃で加
熱硬化して形成する。
このとき熱硬化過程でポリイミドワニス中のポリアミッ
ク酸が銅と反応してH2OやCo2を発生するため、熱
硬化後、ポリイミド膜中にボイド発生する。しかしニッ
ケルあるいはクロムは熱硬化過程でポリアミック酸と反
応しない。
ク酸が銅と反応してH2OやCo2を発生するため、熱
硬化後、ポリイミド膜中にボイド発生する。しかしニッ
ケルあるいはクロムは熱硬化過程でポリアミック酸と反
応しない。
本発明では、第1層目の銅配線を形成した後、ポリイミ
ド膜を形成する前に銅配線上のみニッケルあるいはクロ
ム膜を形成している。それによって該配線上にポリイミ
ドからなる絶縁層を形成する場合熱硬化過程でポリアミ
ック酸と反応しないニッケルあるいはクロム膜が銅配線
をおおっているので、銅とポリアミック酸が直接接触し
てH2OやCO2を発生するのを防いでいる。
ド膜を形成する前に銅配線上のみニッケルあるいはクロ
ム膜を形成している。それによって該配線上にポリイミ
ドからなる絶縁層を形成する場合熱硬化過程でポリアミ
ック酸と反応しないニッケルあるいはクロム膜が銅配線
をおおっているので、銅とポリアミック酸が直接接触し
てH2OやCO2を発生するのを防いでいる。
以下、本発明の一実施例を第2図により説明する。第2
図(a)に示すようにアルミナ基板12上にスパッタデ
ポジションにより厚さ100mmのクロム層12し、そ
の上にスパッタデポジションによって厚さ300〜40
0mmの銅層13、さらにその上にスパッタデポジショ
ンによって100mmのクロム層14を形成した。
図(a)に示すようにアルミナ基板12上にスパッタデ
ポジションにより厚さ100mmのクロム層12し、そ
の上にスパッタデポジションによって厚さ300〜40
0mmの銅層13、さらにその上にスパッタデポジショ
ンによって100mmのクロム層14を形成した。
つぎに、第2図(b)に示すようにクロム層14上に感
光性レジストをスピンナ塗布し、これを80〜100°
Cで30分加熱してフォトレジスト層15を形成した。
光性レジストをスピンナ塗布し、これを80〜100°
Cで30分加熱してフォトレジスト層15を形成した。
続いて第2図(c)に示すように周知のフォトリソグラ
フィー技術により、フォトレジストパターン16を形成
した。ついで、銅は(塩化第2銅)/(塩酸)/(グリ
セリン)溶液を用いて、クロムは(フェリシアン化カリ
)/水酸化カリ溶液を用いて選択的にエツチングし、第
2図(cl)に示すようにめっきシード層17を形成し
た。
フィー技術により、フォトレジストパターン16を形成
した。ついで、銅は(塩化第2銅)/(塩酸)/(グリ
セリン)溶液を用いて、クロムは(フェリシアン化カリ
)/水酸化カリ溶液を用いて選択的にエツチングし、第
2図(cl)に示すようにめっきシード層17を形成し
た。
ついで、第2図(e)に示すようにめっきシート層17
を含むアルミナ基板上に粘度1〜1OOcpsのポリイ
ミド前駆体ワンスを回転数2000〜6000rpmで
スピンナ塗布してポリイミド前即体ワニス層を形成した
。このワニス層を200℃で30分加熱し、さらに35
0℃で30分加熱して硬化させ、ポリイミド絶縁層18
を得た。
を含むアルミナ基板上に粘度1〜1OOcpsのポリイ
ミド前駆体ワンスを回転数2000〜6000rpmで
スピンナ塗布してポリイミド前即体ワニス層を形成した
。このワニス層を200℃で30分加熱し、さらに35
0℃で30分加熱して硬化させ、ポリイミド絶縁層18
を得た。
つぎに第2図(F)に示すようにポリイミド絶縁層18
上全面にスパッタデポジションにより厚さ1μmのAQ
層19を形成した。その上に感光性レジストをスピンナ
塗布し、これを80〜100℃で30分加熱してフォト
レジスト層20を形成した。
上全面にスパッタデポジションにより厚さ1μmのAQ
層19を形成した。その上に感光性レジストをスピンナ
塗布し、これを80〜100℃で30分加熱してフォト
レジスト層20を形成した。
続いて第2図(G)に示すように周知のフォトリソグラ
フィー技術により、フォトレジスト層20を形成した。
フィー技術により、フォトレジスト層20を形成した。
ついで(リン酸)/(硝酸)/(酢酸)溶液でアルミを
選択的にエツチングし、酸素プラスムドライエッチング
に用いるマスク21を形成した。
選択的にエツチングし、酸素プラスムドライエッチング
に用いるマスク21を形成した。
ついで酸素プラズマにさらしてパターン部に露出してい
るポリイミド絶縁層18を酸素プラズマによって除去し
、第2図(H)に示すような壁面が呈直な配線溝22を
形成しかつ、めっき下地層17を露出させた。また、こ
の工程でAQからなるドライエッチマスクの形成に用い
て感光性レジスト20も除去された。
るポリイミド絶縁層18を酸素プラズマによって除去し
、第2図(H)に示すような壁面が呈直な配線溝22を
形成しかつ、めっき下地層17を露出させた。また、こ
の工程でAQからなるドライエッチマスクの形成に用い
て感光性レジスト20も除去された。
続いて第2図(I)に示すように(フェリシアン化カリ
)/(水酸化カリ)溶液で配線構内のクロム層をエツチ
ングし、銅のスパッタ膜からなるめっきのシード層17
を露出させると同時に、ドライエツチングに用いたアル
ミマスク19も除去した。
)/(水酸化カリ)溶液で配線構内のクロム層をエツチ
ングし、銅のスパッタ膜からなるめっきのシード層17
を露出させると同時に、ドライエツチングに用いたアル
ミマスク19も除去した。
続いて第2図(J)に示すように配線溝内の網スパッタ
膜からなるめっきシード層17に無電解めっきによって
銅を析出させ、配線溝22に銅層23を充填した。さら
に、第2図(K)に示すように銅層23を含むポリイミ
ド絶縁層18上全面にスパッタデポジションにより厚さ
100mmのクロム層24を形成した後、第2図(L)
に示すようにクロム層24上に感光性レジストをスピン
ナ塗布し、これを80から100℃で30分加熱してフ
ォトレジスト層25を形成した。
膜からなるめっきシード層17に無電解めっきによって
銅を析出させ、配線溝22に銅層23を充填した。さら
に、第2図(K)に示すように銅層23を含むポリイミ
ド絶縁層18上全面にスパッタデポジションにより厚さ
100mmのクロム層24を形成した後、第2図(L)
に示すようにクロム層24上に感光性レジストをスピン
ナ塗布し、これを80から100℃で30分加熱してフ
ォトレジスト層25を形成した。
続いて第2図(M)に示すように周知のフォトリソグラ
フィー技術によりフォトレジスト層25をパターニング
した後、クロム層24を前記エツチング液で選択的に除
去して銅配線上のみクロム層24を形成した。
フィー技術によりフォトレジスト層25をパターニング
した後、クロム層24を前記エツチング液で選択的に除
去して銅配線上のみクロム層24を形成した。
最後に第2図(N)に示すように該銅配線をこのように
して第1層目の配線層を形成した絶縁層18上に前記ポ
リイミド前踵体ワニスをスピンナ塗布してポリイミドワ
ニス層を形成した。このワニス層を200℃で30分加
熱し、さらに350℃で3o分加熱し、ワニス層を硬化
させポリイミド絶縁層26を得た。
して第1層目の配線層を形成した絶縁層18上に前記ポ
リイミド前踵体ワニスをスピンナ塗布してポリイミドワ
ニス層を形成した。このワニス層を200℃で30分加
熱し、さらに350℃で3o分加熱し、ワニス層を硬化
させポリイミド絶縁層26を得た。
第2層目の配線層を形成する場合には、上記第1層配線
と同様な方法でまず第1層目と第2層目の配線を接続す
るための接続層を形成した。
と同様な方法でまず第1層目と第2層目の配線を接続す
るための接続層を形成した。
すなわち第2図(○)に示すように絶縁層26上に全面
にスパタデポジションによりAQ層27を形成した後、
周知のフォトリソグラフィー技術によりAQ層にマスク
28を形成した。続いて第2図(P)に示すように前記
AQエツチング液を用いてマスクの所望の部分を選択的
に除去して該ポリイミド絶縁層が露出するように窓29
を設ける。ついで酸素プラズマドライエツチングにさら
して露出しているポリイミド絶縁ffJ 26を除去し
、第2図(Q)に示すように壁面が垂直な孔30を形成
する。この方法で第1Mの配線導体層23のクロム表面
層14が露出される。
にスパタデポジションによりAQ層27を形成した後、
周知のフォトリソグラフィー技術によりAQ層にマスク
28を形成した。続いて第2図(P)に示すように前記
AQエツチング液を用いてマスクの所望の部分を選択的
に除去して該ポリイミド絶縁層が露出するように窓29
を設ける。ついで酸素プラズマドライエツチングにさら
して露出しているポリイミド絶縁ffJ 26を除去し
、第2図(Q)に示すように壁面が垂直な孔30を形成
する。この方法で第1Mの配線導体層23のクロム表面
層14が露出される。
続いて第2図(R)に示すように前記クロムエツチング
液で孔30内のクロム層24を選択的にエツチングし、
無電解銅めっきからなる第1層の配線導体層23の表面
を霧出させた。このとき第1層の配線層を形成する場合
と同様にドライエツチングに用いたアルミマスク27も
除去した。
液で孔30内のクロム層24を選択的にエツチングし、
無電解銅めっきからなる第1層の配線導体層23の表面
を霧出させた。このとき第1層の配線層を形成する場合
と同様にドライエツチングに用いたアルミマスク27も
除去した。
さらに第2図(S)に示すように孔30内第1層の配線
層13の銅めっき面に無電解めっきによって銅を析出さ
せ、孔内に網接続層31を充填した。
層13の銅めっき面に無電解めっきによって銅を析出さ
せ、孔内に網接続層31を充填した。
この上に第1層目に導体配線と全く同じ方法で第2層目
の導体配線を形成した。3層以上の配線導体を有する多
層配線基板を形成する場合には上記した方法を繰り返し
て行なう。
の導体配線を形成した。3層以上の配線導体を有する多
層配線基板を形成する場合には上記した方法を繰り返し
て行なう。
本発明によれば、絶縁層にポリイミド、導体配線にポリ
イミドを用いて配線板の製造において、銅とポリイミド
の反応にもとづくボイドを発生をなくすことができるた
め、上層配線のフォトリソグラフィーを高精度に行うこ
とができ、またボイドに起因する導体配線の断線、線間
や眉間のショートをなくすことができる。
イミドを用いて配線板の製造において、銅とポリイミド
の反応にもとづくボイドを発生をなくすことができるた
め、上層配線のフォトリソグラフィーを高精度に行うこ
とができ、またボイドに起因する導体配線の断線、線間
や眉間のショートをなくすことができる。
第1図は(a)〜(f)は従来法を説明する工程図、第
2図(a)〜(S)は本発明を説明する工程図である。 1−−一基板または多層配線基板、2−m−絶縁層、3
−m−接続孔、4−m−下層配線、5−m−上層配線、
6一−−絶縁層、11−m−アルミナ基板、12−m−
クロム層、13−m−鋼層、14−m−クロム層、15
−−−フォトレジスト層、16−−−フオトレジストパ
ターン、 17−−−めっきシード層、 18−m−ポリイミド絶縁層。 19−m−アルミマスク、20−一一フォトレジスト層
、21−−−マスク、22−−一配線溝、23−−一網
層、24−−−クロム層、25−−−フォトレジスト層
、26−−−ポIJイミドMa層、27−−−A、 Q
it、28−−−マスク、29−一一窓、30−m−
孔、31−m−接続層
2図(a)〜(S)は本発明を説明する工程図である。 1−−一基板または多層配線基板、2−m−絶縁層、3
−m−接続孔、4−m−下層配線、5−m−上層配線、
6一−−絶縁層、11−m−アルミナ基板、12−m−
クロム層、13−m−鋼層、14−m−クロム層、15
−−−フォトレジスト層、16−−−フオトレジストパ
ターン、 17−−−めっきシード層、 18−m−ポリイミド絶縁層。 19−m−アルミマスク、20−一一フォトレジスト層
、21−−−マスク、22−−一配線溝、23−−一網
層、24−−−クロム層、25−−−フォトレジスト層
、26−−−ポIJイミドMa層、27−−−A、 Q
it、28−−−マスク、29−一一窓、30−m−
孔、31−m−接続層
Claims (3)
- 1.基板上に銅からなる導体層とポリイミドからなる絶
縁層とを交互に積層して多層配線基板の導体配線を形成
する多層配線基板の製造方法において、前記導体配線を
形成すべき面に所望の配線パターン形状と同形状にパタ
ーニングされた下地金属層以外に絶縁層を形成する工程
と、前記絶縁層をめっきレジストとして前記下地金属層
上に無電解めっきを行なって前記導体配線を形成する工
程と、前記導体配線上にニッケルまたはクロムを形成す
る工程とからなることを特徴とする多層配線基板の製造
方法 - 2.前記のパターニングされた下地金属層以外に絶縁層
を形成する工程を、該パターニングされた下地金属層を
含む導体配線を形成すべき面上に絶縁層を形成する工程
と、該下地金属層上の絶縁層をRIE(リアリティブイ
オンエッチング)で除去する工程とからなることを特徴
とする特許請求の範囲第1項記載の多層配線基板の製造
方法。 - 3.前記の導体配線上にニッケルを形成する工程を無電
解ニッケルめっきで行なうことを特徴とする特許請求の
範囲第1項記載の多層配線基板の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP6095690A JPH03263896A (ja) | 1990-03-14 | 1990-03-14 | 多層配線基板の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP6095690A JPH03263896A (ja) | 1990-03-14 | 1990-03-14 | 多層配線基板の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH03263896A true JPH03263896A (ja) | 1991-11-25 |
Family
ID=13157358
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP6095690A Pending JPH03263896A (ja) | 1990-03-14 | 1990-03-14 | 多層配線基板の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH03263896A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6391774B1 (en) | 1999-04-21 | 2002-05-21 | Nec Corporation | Fabrication process of semiconductor device |
-
1990
- 1990-03-14 JP JP6095690A patent/JPH03263896A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6391774B1 (en) | 1999-04-21 | 2002-05-21 | Nec Corporation | Fabrication process of semiconductor device |
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