JPH03165026A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPH03165026A JPH03165026A JP30335989A JP30335989A JPH03165026A JP H03165026 A JPH03165026 A JP H03165026A JP 30335989 A JP30335989 A JP 30335989A JP 30335989 A JP30335989 A JP 30335989A JP H03165026 A JPH03165026 A JP H03165026A
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Landscapes
- Electrodes Of Semiconductors (AREA)
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(産業上の利用分野)
この発明は半導体装置の製造方法に関するもので、特に
微細化された半導体集積回路装置における半導体基板内
の不純物拡散領域と配線とのコンタクトに係わるもので
ある。
微細化された半導体集積回路装置における半導体基板内
の不純物拡散領域と配線とのコンタクトに係わるもので
ある。
(従来の技術)
近年、半導体集積回路装置において、半導体基板内の不
純物拡散領域と配線とのコンタクトをとる場合には、第
2図に示すように、上記拡散領域と同一導電型の不純物
を含む半導体層でコンタクトホールを埋込む構造にして
いる。
純物拡散領域と配線とのコンタクトをとる場合には、第
2図に示すように、上記拡散領域と同一導電型の不純物
を含む半導体層でコンタクトホールを埋込む構造にして
いる。
すなわち、まず第2図(e)に示すように、シリコン基
板1の表面に素子分離技術により素子骨HH域2を形成
した後、該素子分離領域2をマスクとして不純物をイオ
ン注入して高濃度不純物拡散領域3を基板1内に形成す
る。
板1の表面に素子分離技術により素子骨HH域2を形成
した後、該素子分離領域2をマスクとして不純物をイオ
ン注入して高濃度不純物拡散領域3を基板1内に形成す
る。
次に第2図(blに示すように全面に層間絶縁膜として
化学気相成長(cV D)法によりシリコン酸化II(
Sin、膜)4を形成した後、同図に示すように通常の
ホトリソ・エツチング技術でこのシリコン酸化II!4
に前記高濃度不純物拡散領域3上でコンタクトホール5
を開ける。
化学気相成長(cV D)法によりシリコン酸化II(
Sin、膜)4を形成した後、同図に示すように通常の
ホトリソ・エツチング技術でこのシリコン酸化II!4
に前記高濃度不純物拡散領域3上でコンタクトホール5
を開ける。
続いて、コンタクトホール5を含む全面に第2図(e)
に示すように減圧CVD法で半導体層としてのポリシリ
コン層6を形成する。
に示すように減圧CVD法で半導体層としてのポリシリ
コン層6を形成する。
その後、このポリシリコン層6を異方性エツチングでエ
ツチングして第2図(dlに示すようにコンタクトホー
ル5内にのみ残し、コンタクトホール5を埋込む。
ツチングして第2図(dlに示すようにコンタクトホー
ル5内にのみ残し、コンタクトホール5を埋込む。
その後、この埋込まれたポリシリコン層6に第2図1e
tに示すように高濃度の不純物をイオン注入する。その
後熱処理を行うことにより、前記不純物を活性化させる
とともに、ポリシリコン層6の表面から高濃度不純物拡
散領域3とポリシリコン層6の界面に向けて不純物を拡
散させ、埋込まれたポリシリコン層6の全体を低抵抗化
する。
tに示すように高濃度の不純物をイオン注入する。その
後熱処理を行うことにより、前記不純物を活性化させる
とともに、ポリシリコン層6の表面から高濃度不純物拡
散領域3とポリシリコン層6の界面に向けて不純物を拡
散させ、埋込まれたポリシリコン層6の全体を低抵抗化
する。
続いて全面に配線となるA1層を形成し、通常のホトリ
ソ・エツチング技術でこのA1層をパターニングするこ
とにより、第2図1etに示すように配線7を形成する
。この配線7は、コンタクトホール5内のポリシリコン
層6に接続されるように形成され、このポリシリコン層
6を通して基板l内の高濃度不純物拡散領域3に電気的
に接続される。
ソ・エツチング技術でこのA1層をパターニングするこ
とにより、第2図1etに示すように配線7を形成する
。この配線7は、コンタクトホール5内のポリシリコン
層6に接続されるように形成され、このポリシリコン層
6を通して基板l内の高濃度不純物拡散領域3に電気的
に接続される。
(発明が解決しようとする課題)
しかるに、上記のような従来の埋込みコンタクト部の製
造方法では次のような問題点があった。
造方法では次のような問題点があった。
■ 埋込みポリシリコン層6の全体に高濃度に不純物を
拡散させるために非常に多くの不純物を第2図(e)の
工程でイオン注入しなければならず、そのため、装置上
の制約から時間がかかり、生産性が悪い。
拡散させるために非常に多くの不純物を第2図(e)の
工程でイオン注入しなければならず、そのため、装置上
の制約から時間がかかり、生産性が悪い。
■ 埋込みポリシリコン層6の表面にイオン注入した不
純物をポリシリコン層6の全体に拡散させるために高温
の熱処理が必要となるが、微細化された半導体集積回路
装置ではプロセス上で制約があり、充分な熱処理ができ
なくなる場合がある。
純物をポリシリコン層6の全体に拡散させるために高温
の熱処理が必要となるが、微細化された半導体集積回路
装置ではプロセス上で制約があり、充分な熱処理ができ
なくなる場合がある。
■ 層間絶縁膜であるシリコン酸化膜4の厚さが厚く、
コンタクトホール5に埋込まれたポリシリコン層6の高
さが高いと、充分な熱処理を行っても、不純物がポリシ
リコン層6と高濃度不純物拡散領域3の界面近傍まで充
分に拡散せず、界面近傍のポリシリコン層6の抵抗が上
がり、コンタクト抵抗が上昇する。
コンタクトホール5に埋込まれたポリシリコン層6の高
さが高いと、充分な熱処理を行っても、不純物がポリシ
リコン層6と高濃度不純物拡散領域3の界面近傍まで充
分に拡散せず、界面近傍のポリシリコン層6の抵抗が上
がり、コンタクト抵抗が上昇する。
この発明は上記の点に鑑みなされたもので、上記従来の
問題点を一掃できる埋込みコンタクト部の形成法を有す
る半導体装置の製造方法を提供することを目的とする。
問題点を一掃できる埋込みコンタクト部の形成法を有す
る半導体装置の製造方法を提供することを目的とする。
(課題を解決するための手段)
この発明では、半導体基板上の層間絶縁膜に開けたコン
タクトホール内を半導体層で埋込み、さらにその半導体
層内に、該半導体層より不純物の拡散速度の速い導電層
を埋込んだ構造とし、その埋込み半導体層および導電層
の表面に不純物を導入し、さらに不純物拡散のための熱
処理を行う。
タクトホール内を半導体層で埋込み、さらにその半導体
層内に、該半導体層より不純物の拡散速度の速い導電層
を埋込んだ構造とし、その埋込み半導体層および導電層
の表面に不純物を導入し、さらに不純物拡散のための熱
処理を行う。
(作 用)
上記不純物拡散のための熱処理を行った時、埋込み半導
体層内に、該半導体層より不純物の拡散速度の速い導電
層が埋込まれていると、該導電層を通して半導体層の底
部側に低温かつ短時間で不純物が拡散する。したがって
、導入時の不純物量(イオン注入のドーズ量)を減少さ
せて半導体層の全体を均一に高濃度とすることが可能と
なるとともに、熱処理温度を低温化でき、さらには層間
絶縁膜が厚くて埋込み半導体層の高さが高い場合でも、
半導体層の底部側すなわち基板との界面近傍まで充分に
不純物を拡散させることができる。
体層内に、該半導体層より不純物の拡散速度の速い導電
層が埋込まれていると、該導電層を通して半導体層の底
部側に低温かつ短時間で不純物が拡散する。したがって
、導入時の不純物量(イオン注入のドーズ量)を減少さ
せて半導体層の全体を均一に高濃度とすることが可能と
なるとともに、熱処理温度を低温化でき、さらには層間
絶縁膜が厚くて埋込み半導体層の高さが高い場合でも、
半導体層の底部側すなわち基板との界面近傍まで充分に
不純物を拡散させることができる。
(実施例)
以下この発明の一実施例を図面を参照して説明する。第
1図はこの発明の一実施例を示す工程断面図である。
1図はこの発明の一実施例を示す工程断面図である。
この第1図の(alに示すように、まずP型シリコン基
板11の表面に素子分離技術により素子分離領域12を
形成する0次に、その素子分離領域12をマスクとして
不純物例えばヒ素をドーズ量5 XIQ”cm−”、加
速電圧50)teVの条件でイオン注入してN型の高濃
度不純物拡散領域13を基板11の素子領域に形成する
0次いで、基板11上の全面にCVD法で層間絶縁膜と
してシリコン酸化膜(SiO□膜)14を堆積させ、こ
のシリコン酸化III!14に通常のホトリソエツチン
グ技術で前記高濃度不純物拡散領域13上でコンタクト
ホール15を開ける。
板11の表面に素子分離技術により素子分離領域12を
形成する0次に、その素子分離領域12をマスクとして
不純物例えばヒ素をドーズ量5 XIQ”cm−”、加
速電圧50)teVの条件でイオン注入してN型の高濃
度不純物拡散領域13を基板11の素子領域に形成する
0次いで、基板11上の全面にCVD法で層間絶縁膜と
してシリコン酸化膜(SiO□膜)14を堆積させ、こ
のシリコン酸化III!14に通常のホトリソエツチン
グ技術で前記高濃度不純物拡散領域13上でコンタクト
ホール15を開ける。
次に、コンタクトホール15内を含むシリコン酸化膜1
4上の全面に第1図山)に示すように半導体層としてポ
リシリコン層16を5000人程度堆積させる。さらに
その上に、ポリシリコン層より不純物の拡散速度が速い
導電層としてタングステンシリサイド層(WSix、
xI=12) 17を3000人程度堆積させる。
4上の全面に第1図山)に示すように半導体層としてポ
リシリコン層16を5000人程度堆積させる。さらに
その上に、ポリシリコン層より不純物の拡散速度が速い
導電層としてタングステンシリサイド層(WSix、
xI=12) 17を3000人程度堆積させる。
その後、このタングステンシリサイド層17とポリシリ
コン層16の2層を連続して、前記シリコン酸化膜14
の表面が露出するまで異方性エツチングでエツチングす
ることにより、第1図(clに示すようにこのタングス
テンシリサイド層17とポリシリコン層16をコンタク
トホール15内にのみ残す、これにより、コンタクトホ
ール15内がポリシリコン層16で埋込まれ、さらにそ
のポリシリコン層16内にタングステンシリサイド層1
7が埋込まれた構造が得られる。
コン層16の2層を連続して、前記シリコン酸化膜14
の表面が露出するまで異方性エツチングでエツチングす
ることにより、第1図(clに示すようにこのタングス
テンシリサイド層17とポリシリコン層16をコンタク
トホール15内にのみ残す、これにより、コンタクトホ
ール15内がポリシリコン層16で埋込まれ、さらにそ
のポリシリコン層16内にタングステンシリサイド層1
7が埋込まれた構造が得られる。
次に、その埋込みポリシリコン層16およびタングステ
ンシリサイド層17の表面にN型不純物としてリン(P
)を加速電圧50KeV、ドーズ量5xIQ1Sas−
”の条件でイオン注入する。
ンシリサイド層17の表面にN型不純物としてリン(P
)を加速電圧50KeV、ドーズ量5xIQ1Sas−
”の条件でイオン注入する。
その後、窒素雰囲気中で900℃、30分程度の熱処理
を行い、N型不純物であるリンを埋込みポリシリコン層
16およびタングステンシリサイド層17の全体に拡散
させる。この時、タングステンシリサイド層17中をリ
ンが速く拡散するので、第1図(d)に矢印で示すよう
にリンがタングステンシリサイド層17を通してポリシ
リコン層16の底部側に短時間で拡散する。したがって
、この実施例によれば、イオン注入のドーズ量を前記の
ように5X10”ca−”に減少させて、かつ熱処理温
度を前記のように900℃に下げて埋込みポリシリコン
層16の全体に均一にN型不純物(リン)を高濃度に拡
散させることができる。さらにシリコン酸化膜14が厚
くて、コンタクトホール15内に埋込まれるポリシリコ
ン層16の高さが高くても、該ポリシリコン層16の底
部側まで充分に不純物を拡散させることができる。
を行い、N型不純物であるリンを埋込みポリシリコン層
16およびタングステンシリサイド層17の全体に拡散
させる。この時、タングステンシリサイド層17中をリ
ンが速く拡散するので、第1図(d)に矢印で示すよう
にリンがタングステンシリサイド層17を通してポリシ
リコン層16の底部側に短時間で拡散する。したがって
、この実施例によれば、イオン注入のドーズ量を前記の
ように5X10”ca−”に減少させて、かつ熱処理温
度を前記のように900℃に下げて埋込みポリシリコン
層16の全体に均一にN型不純物(リン)を高濃度に拡
散させることができる。さらにシリコン酸化膜14が厚
くて、コンタクトホール15内に埋込まれるポリシリコ
ン層16の高さが高くても、該ポリシリコン層16の底
部側まで充分に不純物を拡散させることができる。
しかる後、コンタクトホール部を含むシリコン酸化膜1
4上の全面にアルミニウム層あるいはシリコンを含むア
ルミニウム層をスパッタ法でIImの厚さに形成し、こ
れをホトリソ・エツチング法でバターニングすることに
より、第1図(elに示すように埋込みポリシリコン層
16およびタングステンシリサイド層17に接続される
配線18を形成する。
4上の全面にアルミニウム層あるいはシリコンを含むア
ルミニウム層をスパッタ法でIImの厚さに形成し、こ
れをホトリソ・エツチング法でバターニングすることに
より、第1図(elに示すように埋込みポリシリコン層
16およびタングステンシリサイド層17に接続される
配線18を形成する。
なお、上記一実施例では、半導体層より不純物の拡散速
度が速い導電層としてタングステンシリサイドを用いた
が、他の材料としてチタンシリサイド、モリブデンシリ
サイド、プラチナシリサイド、または、チタン、モリブ
デン、プラチナ、タングステンなども使用することがで
きるi(発明の効果) 以上詳細に説明したように、この発明の製造方法によれ
ば、コンタクトホール内に半導体層を埋込み、その半導
体層内に該半導体層より不純物の拡散速度の速い導電層
を埋込んだ構造としたので、それらの表面に不純物を導
入した後、全体に不純物を拡散させるために熱処理を行
った時に、前記導電層を通して埋込み半導体層の底部側
に低温かつ短時間で不純物を拡散させることができる。
度が速い導電層としてタングステンシリサイドを用いた
が、他の材料としてチタンシリサイド、モリブデンシリ
サイド、プラチナシリサイド、または、チタン、モリブ
デン、プラチナ、タングステンなども使用することがで
きるi(発明の効果) 以上詳細に説明したように、この発明の製造方法によれ
ば、コンタクトホール内に半導体層を埋込み、その半導
体層内に該半導体層より不純物の拡散速度の速い導電層
を埋込んだ構造としたので、それらの表面に不純物を導
入した後、全体に不純物を拡散させるために熱処理を行
った時に、前記導電層を通して埋込み半導体層の底部側
に低温かつ短時間で不純物を拡散させることができる。
したがって、表面への不純物の導入量(イオン注入のド
ーズ量)を減少させて、埋込み半導体層の全体を均一に
高濃度とすることができ、イオン注入のドーズ量の減少
から生産性を上げることができる。また、不純物を拡散
させる時の熱処理温度を低温化できるので、より微細化
された半導体集積回路装置に適用して良好な埋込みコン
タクト部を得ることができる。さらに、層間絶縁膜が厚
くて埋込み半導体層の高さが高くなった場合でも、半導
体層の底部側すなわち不純物拡散領域との界面近傍まで
充分に不純物を拡散させてコンタクト抵抗を下げること
が可能となる。
ーズ量)を減少させて、埋込み半導体層の全体を均一に
高濃度とすることができ、イオン注入のドーズ量の減少
から生産性を上げることができる。また、不純物を拡散
させる時の熱処理温度を低温化できるので、より微細化
された半導体集積回路装置に適用して良好な埋込みコン
タクト部を得ることができる。さらに、層間絶縁膜が厚
くて埋込み半導体層の高さが高くなった場合でも、半導
体層の底部側すなわち不純物拡散領域との界面近傍まで
充分に不純物を拡散させてコンタクト抵抗を下げること
が可能となる。
第1図はこの発明の半導体装置の製造方法の一実施例を
示す工程断面図、第2図は従来の埋込みコンタクト部の
製造方法を示す工程断面図である。 11・・・P型シリコン基板、13・・・高濃度不純物
拡散領域、14・・・シリコン酸化膜、15・・・コン
タクトホール、16・・・ポリシリコン層、17・・・
タングステンシリサイド層、18・・・配線。 本発明の一実施例 第1図 従来の方法 慎2 図 従来の方法
示す工程断面図、第2図は従来の埋込みコンタクト部の
製造方法を示す工程断面図である。 11・・・P型シリコン基板、13・・・高濃度不純物
拡散領域、14・・・シリコン酸化膜、15・・・コン
タクトホール、16・・・ポリシリコン層、17・・・
タングステンシリサイド層、18・・・配線。 本発明の一実施例 第1図 従来の方法 慎2 図 従来の方法
Claims (1)
- 【特許請求の範囲】 (a)一部に不純物拡散領域が形成された半導体基板上
に層間絶縁膜を形成する工程と、 (b)その層間絶縁膜に前記不純物拡散領域上でコンタ
クトホールを開ける工程と、 (c)そのコンタクトホール内を含む層間絶縁膜上の全
面に半導体層を形成し、さらにその上に該半導体層より
不純物の拡散速度の速い導電層を形成し、この2層を異
方性エッチングして前記コンタクトホール内にのみ残す
ことにより、このコンタクトホールが前記半導体層で埋
込まれ、さらにその半導体層内に前記導電層が埋込まれ
た構造を得る工程と、 (d)その埋込み半導体層および導電層の表面に不純物
を導入し、さらに熱処理を行って半導体層および導電層
の全体に不純物を拡散させる工程と、(e)その後、埋
込み半導体層および導電層に接続して配線を形成する工
程とを具備してなる半導体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP30335989A JP2773938B2 (ja) | 1989-11-24 | 1989-11-24 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP30335989A JP2773938B2 (ja) | 1989-11-24 | 1989-11-24 | 半導体装置の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH03165026A true JPH03165026A (ja) | 1991-07-17 |
JP2773938B2 JP2773938B2 (ja) | 1998-07-09 |
Family
ID=17920035
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP30335989A Expired - Lifetime JP2773938B2 (ja) | 1989-11-24 | 1989-11-24 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2773938B2 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6022586A (en) * | 1997-03-04 | 2000-02-08 | Tokyo Electron Limited | Method and apparatus for forming laminated thin films or layers |
-
1989
- 1989-11-24 JP JP30335989A patent/JP2773938B2/ja not_active Expired - Lifetime
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6022586A (en) * | 1997-03-04 | 2000-02-08 | Tokyo Electron Limited | Method and apparatus for forming laminated thin films or layers |
Also Published As
Publication number | Publication date |
---|---|
JP2773938B2 (ja) | 1998-07-09 |
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