JPH03101256A - 半導体装置 - Google Patents

半導体装置

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Publication number
JPH03101256A
JPH03101256A JP1238915A JP23891589A JPH03101256A JP H03101256 A JPH03101256 A JP H03101256A JP 1238915 A JP1238915 A JP 1238915A JP 23891589 A JP23891589 A JP 23891589A JP H03101256 A JPH03101256 A JP H03101256A
Authority
JP
Japan
Prior art keywords
heat radiator
semiconductor element
heat
semiconductor device
insulating material
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP1238915A
Other languages
English (en)
Inventor
Kazunari Michii
一成 道井
Katsunao Takehara
克尚 竹原
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP1238915A priority Critical patent/JPH03101256A/ja
Publication of JPH03101256A publication Critical patent/JPH03101256A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/50Tape automated bonding [TAB] connectors, i.e. film carriers; Manufacturing methods related thereto
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181Encapsulation

Landscapes

  • Cooling Or The Like Of Semiconductors Or Solid State Devices (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 乙の発明は、半導体装置に係り、特に多ビン構造の半導
体装置に関するものである。
〔従来の技術〕
安価な超多ピンパッケージ構造の半導体装置として、T
ABと呼ばれるテープキャリア形の半導体装置が1吏用
されている。
この種の半導体装置の構造を第3図、第4図に基づいて
説明する。
半導体素子1の表面上に形成された複数の電極2が、絶
縁テープ3の上に形成されたり一部4のインナリード5
に電気的に接合され、リード4のアウタリード6のみが
外部に導出するように半導体素子1.インナリード5が
樹脂8からなるパ・ソケージ本体7により封止されてい
る。
このような半導体装置の動作時には半導体素子1から熱
が発生するが、この熱はリード4およびパッケージ本体
7を通して外部へ拡散される(特開昭63−24685
1号公報参照) 〔発明が解決しようとする課題〕 半導体素子1の高集積度化に伴い、発熱量は大キくする
が、パッケージ本体7を構成するエポキシ等の樹脂8は
熱伝導率が低いので、半導体素子1で発生した熱は効率
よく半導体装置の外部へ放出されずに、半導体装置内に
残ってしまう。
このため、発i@量の大きい半導体素子1を用いると、
半導体素子1が昇温して誤動作を起こす等、半導体装置
の信頼性が低下するという問題点かあった。
また、放熱性を改善するため、半導体素子1を放熱体に
取り付ける方法があるが、半導体素子1の裏面電位が放
熱体にかかるため、半導体装置を基板実装する際、放熱
体が基板や他部品に接触しないように注意しなけらばな
らなかった。
また、樹脂8よりも熱伝導性が優れているセラミック材
でパッケージ本体7を形成すれば、放熱性を向上させる
ことができるが、セラミック材は著しく高価なため、製
造コストが高くなる等、多くの問題点があった。
この発明は、このような問題点を解消するためになされ
たもので、取り扱いが容易で、かつ放熱性に優れた安価
な半導体装置を得ることを目的としている。
〔課題を解決するための手段〕
この発明に係る半導体装置は、高熱伝導材からなる放熱
体上に絶縁材を介して導体板を形成し、この導体板上に
表面に設けられた複数の電極とそれに対応して配置され
たリードとを直接もしくは金属細線によって電気的に接
続した半導体素子を取り付け、さらに、放熱体の一部を
外部に露出せしめて樹脂封止したものである。
〔作用〕
この発明においては、半導体素子を絶縁材を介して放熱
体上に取付け、この放熱体の一部を露出せしめてパッケ
ージしたことから、半導体素子で発生した熱が半導体素
子から放熱体に伝導し、放熱体から半導体装置の外部に
放出される。
また、半導体素子と放熱体は絶縁材によって絶縁されて
いるため、放熱体が他部品に接触しても問題は生じない
〔実施例〕
以下、この発明の一実施例を図面に基づいて説−明する
第1図および第2図はこの発明の一実施例を示す半導体
装置の平面図および断面図である。これらの図において
、1〜8は第3図、第4図と同一構成部分を示し、9は
熱伝導性の高いCu材からなる放熱体で、この上にエポ
キシ樹脂からなる絶縁材10を介してCu箔からなる導
体板11が形成されている。乙の導体板11上に、イン
ナリF 5に接合された半導体素子1が取り付けられて
おり、この半導体素子1およびインナリード5が樹’I
t’J 8からなるパッケージ本体7で封止されている
。なお、放熱体9の一部、例えば底面はパラケン本体7
の外部に露出している。
乙のような半導体装置の動作時においては、半導体素子
1で発生した熱は、主として放熱性の大きい放熱体9へ
伝導され、半導体装置の外部へ放出される。
また、放熱体9と導体板11は絶縁材1oによって絶縁
されているため、放熱体9には半導体素子1の裏面電位
がかからない。このため、半導体装置を基板実装する際
、放熱体9が他部品や基板等に接触しても、問題が発生
することはない。
さらに、放熱体9の一部がパ・ソケージ本体7に露出し
ているため、1i4i熱体9上に外部放熱フィンを容易
に取り付けることができるので、消費電力の極めて大き
い半導体装置を適用することが可能となる。
〔発明の効果〕
以上説明したように、この発明は、高熱伝導材からなる
放熱体上に絶縁材を介して導体板を形成し、この導体板
上に表面に設けられた複数の電極とそれに対応して配置
されたリードとを直接もしくは金属細線によって電気的
に接続した半導体素子を取り付け、さらに、放熱体の一
部を外部に露出せしめて樹脂封止したので、安価で取り
扱い易く、かつ放熱性の優れた半導体装置を得ることが
できる。
【図面の簡単な説明】 第1図および第2図はこの発明の一実施例を示す半導体
装置の平面図および断面図、第3図および第4図は従来
の半導体装置を示す平面図および断面図である。 図において、1は半導体素子、2は電極、3は絶縁テー
プ、4はリード、5はインナリード、6はアウタリード
、7はバ・ソヶージ本体、8は樹脂、9は放熱体、1o
は絶縁材、11は導体板である。 なお、 各図中の同一符号は同一または相当部分を示ず。

Claims (1)

    【特許請求の範囲】
  1. 高熱伝導材からなる放熱体上に絶縁材を介して導体板を
    形成し、この導体板上に、表面に設けられた複数の電極
    とそれに対応して配置されたリードとを直接もしくは金
    属細線によって電気的に接続した半導体素子を取り付け
    、さらに、前記放熱体の一部を外部に露出せしめて樹脂
    封止したことを特徴とする半導体装置。
JP1238915A 1989-09-14 1989-09-14 半導体装置 Pending JPH03101256A (ja)

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JP1238915A JPH03101256A (ja) 1989-09-14 1989-09-14 半導体装置

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JP1238915A JPH03101256A (ja) 1989-09-14 1989-09-14 半導体装置

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JPH03101256A true JPH03101256A (ja) 1991-04-26

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ID=17037165

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JP1238915A Pending JPH03101256A (ja) 1989-09-14 1989-09-14 半導体装置

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5434449A (en) * 1992-02-06 1995-07-18 Mitsubishi Denki Kabushiki Kaisha Semiconductor device in a single package with high wiring density and a heat sink
US5656864A (en) * 1993-09-09 1997-08-12 Fujitsu Limited Semiconductor device having upper and lower package bodies and manufacturing method thereof
KR100548012B1 (ko) * 1998-09-17 2006-04-21 삼성테크윈 주식회사 반도체패키지

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5434449A (en) * 1992-02-06 1995-07-18 Mitsubishi Denki Kabushiki Kaisha Semiconductor device in a single package with high wiring density and a heat sink
US5656864A (en) * 1993-09-09 1997-08-12 Fujitsu Limited Semiconductor device having upper and lower package bodies and manufacturing method thereof
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