JPH02299024A - マイクロプログラム制御装置 - Google Patents
マイクロプログラム制御装置Info
- Publication number
- JPH02299024A JPH02299024A JP12065689A JP12065689A JPH02299024A JP H02299024 A JPH02299024 A JP H02299024A JP 12065689 A JP12065689 A JP 12065689A JP 12065689 A JP12065689 A JP 12065689A JP H02299024 A JPH02299024 A JP H02299024A
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- JP
- Japan
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- microprogram
- control
- control device
- controller
- setting
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 230000002035 prolonged effect Effects 0.000 abstract 1
- 230000010365 information processing Effects 0.000 description 8
- 238000000034 method Methods 0.000 description 3
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 238000007796 conventional method Methods 0.000 description 1
- 230000006870 function Effects 0.000 description 1
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[産業上の利用分野]
この発明は階層構造を有するマイクロプログラム制御装
置に関する。
置に関する。
[従来の技術]
近年、情報処理システムの処理能力に対する要求の増大
とともに情報処理装置に接続される入出力装置の台数の
増加および入出力装置の性能の向上に応じて、入出力処
理装置に接続されるチャネルの数および1チヤネル当た
りの処理能力の向上が計られてきている。このような状
況にあっては、従来のように1台の入出力処理装置に接
続された全チャネルへのサービスを上記入出力処理装置
内の単一のマイクロプログラム制御装置で行うためにこ
のマイクロプログラム制御装置の能力を従来に比較して
飛躍的に高める必要がある。
とともに情報処理装置に接続される入出力装置の台数の
増加および入出力装置の性能の向上に応じて、入出力処
理装置に接続されるチャネルの数および1チヤネル当た
りの処理能力の向上が計られてきている。このような状
況にあっては、従来のように1台の入出力処理装置に接
続された全チャネルへのサービスを上記入出力処理装置
内の単一のマイクロプログラム制御装置で行うためにこ
のマイクロプログラム制御装置の能力を従来に比較して
飛躍的に高める必要がある。
しかし、情報処理システムによっては必ずしも入出力処
理装置に接続可能な最大数のチャネル装置が接続される
わけではなく、情報処理システムが比較的小規模なシス
テム構成となった場合を考え合わせると、上述したよう
にマイクロプログラム制御装置の能力を従来に比較して
飛躍的に高めるということは非常に無駄が多い方法とい
える。
理装置に接続可能な最大数のチャネル装置が接続される
わけではなく、情報処理システムが比較的小規模なシス
テム構成となった場合を考え合わせると、上述したよう
にマイクロプログラム制御装置の能力を従来に比較して
飛躍的に高めるということは非常に無駄が多い方法とい
える。
このような欠点を解消するために、最近では入出力処理
装置の内部を複数の階層に分割して、その各々をマイク
ロプログラム制御として、情報処理システムが大規模な
構成になるに従って下位層のマイクロプログラム制御装
置を増設する方法がとられるようになってきている。
装置の内部を複数の階層に分割して、その各々をマイク
ロプログラム制御として、情報処理システムが大規模な
構成になるに従って下位層のマイクロプログラム制御装
置を増設する方法がとられるようになってきている。
また、従来、情報処理システムにおいて情報処理装置を
構成するマイクロプログラム制御装置の揮発性制御記憶
手段に対するマイクロプログラムの設定は、情報処理シ
ステム内の診断装置の制御の下で特別な経路を使用して
行われている。
構成するマイクロプログラム制御装置の揮発性制御記憶
手段に対するマイクロプログラムの設定は、情報処理シ
ステム内の診断装置の制御の下で特別な経路を使用して
行われている。
[発明が解決しようとする課題]
しかし、上述したような入出力処理装置の構成では、マ
イクロプログラム制御装置の台数が増大するため、従来
のように診断装置の制御の下に各階層のマイクロプログ
ラム制御装置の制御記憶手段に対してマイクロプログラ
ムの設定を行う方法では、マイクロプログラムの設定に
要する時間が増大することになり、ひいてはシステムの
立ち上げに要する時間が増大してしまうという欠点かあ
った。
イクロプログラム制御装置の台数が増大するため、従来
のように診断装置の制御の下に各階層のマイクロプログ
ラム制御装置の制御記憶手段に対してマイクロプログラ
ムの設定を行う方法では、マイクロプログラムの設定に
要する時間が増大することになり、ひいてはシステムの
立ち上げに要する時間が増大してしまうという欠点かあ
った。
[課題を解決するための手段]
この発明のマイクロプログラム制御装置においては、上
位の階層のマイクロプログラム制御装置には、このマイ
クロプログラム制御装置直下の下位の階層のマイクロプ
ログラム制御装置の一部に設定マイクロプログラムを設
定する第1の設定手段を設け、下位の階層のマイクロプ
ログラム制御装置には、設定マイクロプログラムに従っ
て主記憶装置から所定のマイクロ命令を読み出すととも
に、そのマイクロ命令を下位の階層のマイクロプログラ
ム制御装置の制御記憶手段で設定マイクロプログラムが
設定された以外の部分に設定する第2の設定手段を設け
ている。
位の階層のマイクロプログラム制御装置には、このマイ
クロプログラム制御装置直下の下位の階層のマイクロプ
ログラム制御装置の一部に設定マイクロプログラムを設
定する第1の設定手段を設け、下位の階層のマイクロプ
ログラム制御装置には、設定マイクロプログラムに従っ
て主記憶装置から所定のマイクロ命令を読み出すととも
に、そのマイクロ命令を下位の階層のマイクロプログラ
ム制御装置の制御記憶手段で設定マイクロプログラムが
設定された以外の部分に設定する第2の設定手段を設け
ている。
[作用]
第1の設定手段によって上位の階層のマイクロプログラ
ム制御装置から下位の階層のマイクロプログラム制御装
置の制御記憶手段の一部に設定マイクロプログラムが設
定される。そして、この設定プログラムに従った第2の
設定手段によって、主記憶装置から所定のマイクロ命令
が読み出され、その読み出されたマイクロ命令は下位の
階層のマイクロプログラム制御装置の制御記憶手段で設
定マイクロプログラムが設定された以外の部分に設定さ
れる。すなわち、下位の階層のマイクロプログラム制御
装置の制御記憶手段で設定マイクロプログラムが設定さ
れた以外の部分の設定は、下位の階層のマイクロプログ
ラム制御装置で独立してなされる。
ム制御装置から下位の階層のマイクロプログラム制御装
置の制御記憶手段の一部に設定マイクロプログラムが設
定される。そして、この設定プログラムに従った第2の
設定手段によって、主記憶装置から所定のマイクロ命令
が読み出され、その読み出されたマイクロ命令は下位の
階層のマイクロプログラム制御装置の制御記憶手段で設
定マイクロプログラムが設定された以外の部分に設定さ
れる。すなわち、下位の階層のマイクロプログラム制御
装置の制御記憶手段で設定マイクロプログラムが設定さ
れた以外の部分の設定は、下位の階層のマイクロプログ
ラム制御装置で独立してなされる。
[実施例]
次にこの発明について図面を参照して説明する。
図は、入出力処理装置(図示せず)を構成するマイクロ
プログラム制御装置の一実施例を示すブロック図である
。
プログラム制御装置の一実施例を示すブロック図である
。
マイクロプログラム制御装置は、上位階層マイクロプロ
グラム制御装置1と下位階層マイクロプログラム制御装
置2とから構成されている。
グラム制御装置1と下位階層マイクロプログラム制御装
置2とから構成されている。
下位階層マイクロプログラム制御装置2において、21
はマイクロプログラムを記憶する揮発性の制御記憶、2
2はこの制御記憶21のアドレスを指示する制御記憶ア
ドレスレジスタ、23は制御記憶21に書き込むための
データを保持する書き込みデータレジスタ、24は制御
記憶21からの読み出しデータを保持するための読み出
しデータレジスタである。25は制御記憶アドレスレジ
スタ22からのアドレスに「1」を加算するアドレス加
算回路、26はこのアドレス加算回路25から供給され
るアドレスを保持する戻りアドレスレジスタ、27は図
示しない主記憶装置から読み出されたアドレスが設定さ
れる汎用レジスタである。28は書き込み制御回路であ
って、読み出しデータレジスタ24から送出された書き
込み指示に従って、書き込みデータレジスタ23から出
力されるデータを制御記憶21に書き込むようになって
いる。
はマイクロプログラムを記憶する揮発性の制御記憶、2
2はこの制御記憶21のアドレスを指示する制御記憶ア
ドレスレジスタ、23は制御記憶21に書き込むための
データを保持する書き込みデータレジスタ、24は制御
記憶21からの読み出しデータを保持するための読み出
しデータレジスタである。25は制御記憶アドレスレジ
スタ22からのアドレスに「1」を加算するアドレス加
算回路、26はこのアドレス加算回路25から供給され
るアドレスを保持する戻りアドレスレジスタ、27は図
示しない主記憶装置から読み出されたアドレスが設定さ
れる汎用レジスタである。28は書き込み制御回路であ
って、読み出しデータレジスタ24から送出された書き
込み指示に従って、書き込みデータレジスタ23から出
力されるデータを制御記憶21に書き込むようになって
いる。
次に下位階層マイクロプログラム制御装置2の動作につ
いて説明する。
いて説明する。
(1)下位階層マイクロプログラム制御装置の動作上位
階層マイクロプログラム制御装置1から信号線10]、
を介して制御記憶アドレスレジスタ22にアドレスが設
定され、この制御記憶アドレスレジスタ22に設定され
たアドレスに従って制御記憶21の内容、すなわち、マ
イクロ命令1ステツプが読み出されて制御記憶読み出し
レジスタ24に設定される。この制御記憶読み出しレジ
スタ24に設定されたマイクロ命令は次の2種類のフィ
ールドを含んでいる。
階層マイクロプログラム制御装置1から信号線10]、
を介して制御記憶アドレスレジスタ22にアドレスが設
定され、この制御記憶アドレスレジスタ22に設定され
たアドレスに従って制御記憶21の内容、すなわち、マ
イクロ命令1ステツプが読み出されて制御記憶読み出し
レジスタ24に設定される。この制御記憶読み出しレジ
スタ24に設定されたマイクロ命令は次の2種類のフィ
ールドを含んでいる。
■読み出されたマイクロ命令の当該ステップでの動作を
指定する動作指定フィールド、 ■この当該ステップの次ステツプのアドレスを指定する
次制御記憶アドレス制御フィールド。
指定する動作指定フィールド、 ■この当該ステップの次ステツプのアドレスを指定する
次制御記憶アドレス制御フィールド。
ここで、次制御記憶アドレス制御フィールドの内容が、
読み出しデータレジスタ24から制御記憶アドレスレジ
スタ22に転送されて設定されることによって次に読み
出されるマイクロプログラムのステップのアドレスが決
定される。
読み出しデータレジスタ24から制御記憶アドレスレジ
スタ22に転送されて設定されることによって次に読み
出されるマイクロプログラムのステップのアドレスが決
定される。
また、制御記憶読み出しレジスタ24に読み出されたマ
イクロ命令の内容がサブルーチンコールを行うことを示
していた場合には、その時点でのマイクロ命令のアドレ
スである制御記憶アドレスレジスタ22に保持されてい
るアドレスにアドレス加算回路25によって「1」が加
算される。この「1」が加算されたアドレス、すなわち
、サブルーチン実行終了後にもとのマイクロプログラム
のステップに戻るための戻りアドレスは、戻りアドレス
レジスタ26に設定される。一方、上記サブルーチンコ
ールを示すマイクロ命令によって指示されたサブルーチ
ンの先頭アドレスは、制御記憶読み出しレジスタ24か
ら制御記憶アドレスレジスタ22に設定される。そして
、上記サブルーチンの実行終了後、マイクロプログラム
の次ステツプのアドレス、すなわち、戻りアドレスは戻
りレジスタ26から制御記憶アドレスレジスタ22に設
定される。したがって、この場合、読み出しデータレジ
スタ24から制御記憶アドレスレジスタ22に次ステツ
プのアドレスは設定されない。
イクロ命令の内容がサブルーチンコールを行うことを示
していた場合には、その時点でのマイクロ命令のアドレ
スである制御記憶アドレスレジスタ22に保持されてい
るアドレスにアドレス加算回路25によって「1」が加
算される。この「1」が加算されたアドレス、すなわち
、サブルーチン実行終了後にもとのマイクロプログラム
のステップに戻るための戻りアドレスは、戻りアドレス
レジスタ26に設定される。一方、上記サブルーチンコ
ールを示すマイクロ命令によって指示されたサブルーチ
ンの先頭アドレスは、制御記憶読み出しレジスタ24か
ら制御記憶アドレスレジスタ22に設定される。そして
、上記サブルーチンの実行終了後、マイクロプログラム
の次ステツプのアドレス、すなわち、戻りアドレスは戻
りレジスタ26から制御記憶アドレスレジスタ22に設
定される。したがって、この場合、読み出しデータレジ
スタ24から制御記憶アドレスレジスタ22に次ステツ
プのアドレスは設定されない。
(2)下位階層マイクロプログラム制御装置へのマイク
ロプログラム設定動作 下位階層マイクロプログラム制御装置2の動作が停止し
ているときに、上位階層マイクロプログラム制御装置1
から信号線101を介して書き込みデータレジスタ23
および制御記憶アドレスレジスタ22にマイクロ命令お
よびこのマイクロ命令を書き込むためのアドレスを設定
する。
ロプログラム設定動作 下位階層マイクロプログラム制御装置2の動作が停止し
ているときに、上位階層マイクロプログラム制御装置1
から信号線101を介して書き込みデータレジスタ23
および制御記憶アドレスレジスタ22にマイクロ命令お
よびこのマイクロ命令を書き込むためのアドレスを設定
する。
その後、上位階層マイクロプログラム制御装置1がら信
号線101を介して書き込み制御回路28に書き込み指
示を行うことによって制御記憶アドレスレジスタ22が
示すアドレスに書き込みデータレジスタ23の内容が書
き込まれる。
号線101を介して書き込み制御回路28に書き込み指
示を行うことによって制御記憶アドレスレジスタ22が
示すアドレスに書き込みデータレジスタ23の内容が書
き込まれる。
このような動作を繰り返すことによって、上位階層マイ
クロプログラム制御装置1は、下位階層マイクロプログ
ラム制御装置2の制御記憶21の一部にマイクロプログ
ラムを設定することができる。なお、上位階層マイクロ
プログラム制御装置1によって設定される制御記憶21
内のマイクロプログラムは、下位階層マイクロプログラ
ム制御装置2の制御記憶21の残りの部分を設定するた
めのマイクロ命令で構成されたマイクロプログラムく以
下、設定マイクロプログラムという〉になっている。
クロプログラム制御装置1は、下位階層マイクロプログ
ラム制御装置2の制御記憶21の一部にマイクロプログ
ラムを設定することができる。なお、上位階層マイクロ
プログラム制御装置1によって設定される制御記憶21
内のマイクロプログラムは、下位階層マイクロプログラ
ム制御装置2の制御記憶21の残りの部分を設定するた
めのマイクロ命令で構成されたマイクロプログラムく以
下、設定マイクロプログラムという〉になっている。
このように上位階層マイクロプログラム制御装置1によ
って、下位階層マイクロプログラム制御装置2の制御記
憶21の一部に設定マイクロプログラムを設定した後に
、上位階層マイクロプログラム制御装置1は下位階層マ
イクロプログラム制御装置2に対して動作開始を指示す
る。
って、下位階層マイクロプログラム制御装置2の制御記
憶21の一部に設定マイクロプログラムを設定した後に
、上位階層マイクロプログラム制御装置1は下位階層マ
イクロプログラム制御装置2に対して動作開始を指示す
る。
このため、下位階層マイクロプログラム制御装置2は、
この設定プログラムを上位階層マイクロプログラム制御
装置1の主記憶装置から下位階層マイクロプログラム制
御装置2に転送したときと同様に上位階層マイクロプロ
グラム制御装置1の主記憶装置へのアクセスを行い、制
御記憶21に設定すべき残りのマイクロ命令とこのマイ
クロ命令を設定すべきアドレスとを読み出してくる。こ
のようにして、主記憶装置から読み出された2種類のデ
ータは、所定の信号線(図示せず)を介して汎用レジス
タ27に設定された後、それぞれ、書き込みデータアド
レスレジスタ23および制御記憶アドレスレジスタ22
に設定される。すなわち、上記設定マイクロプログラム
に従って、制御記憶21に設定すべきマイクロ命令は、
汎用レジスタ27に設定された後、書き込みデータレジ
スタ23に設定される。これに続いて、上記マイクロ命
令を書き込む対象である制御記憶21のアドレスは、汎
用レジスタ27に設定された後、制御記憶アドレスレジ
スタ22に設定される。
この設定プログラムを上位階層マイクロプログラム制御
装置1の主記憶装置から下位階層マイクロプログラム制
御装置2に転送したときと同様に上位階層マイクロプロ
グラム制御装置1の主記憶装置へのアクセスを行い、制
御記憶21に設定すべき残りのマイクロ命令とこのマイ
クロ命令を設定すべきアドレスとを読み出してくる。こ
のようにして、主記憶装置から読み出された2種類のデ
ータは、所定の信号線(図示せず)を介して汎用レジス
タ27に設定された後、それぞれ、書き込みデータアド
レスレジスタ23および制御記憶アドレスレジスタ22
に設定される。すなわち、上記設定マイクロプログラム
に従って、制御記憶21に設定すべきマイクロ命令は、
汎用レジスタ27に設定された後、書き込みデータレジ
スタ23に設定される。これに続いて、上記マイクロ命
令を書き込む対象である制御記憶21のアドレスは、汎
用レジスタ27に設定された後、制御記憶アドレスレジ
スタ22に設定される。
そして、上記設定マイクロプログラムの制御記憶書き込
み命令が実行される。すなわち、書き込み指示が読み出
しレジスタ24から書き込み制御回路28に与えられる
ことにより、書き込みデータレジスタ23の内容が制御
記憶アドレスレジスタ22の示すアドレスに書き込まれ
る。
み命令が実行される。すなわち、書き込み指示が読み出
しレジスタ24から書き込み制御回路28に与えられる
ことにより、書き込みデータレジスタ23の内容が制御
記憶アドレスレジスタ22の示すアドレスに書き込まれ
る。
また、上記制御記憶書き込み命令の実行時の次制御記憶
アドレス制御フィールドには、サブルーチンと類似のコ
ードが格納されており、制御記憶アドレスレジスタ22
の内容にアドレス加算回路25でrl、を加算したアド
レス値が、戻りアドレスレジスタ26に設定されように
なっている。
アドレス制御フィールドには、サブルーチンと類似のコ
ードが格納されており、制御記憶アドレスレジスタ22
の内容にアドレス加算回路25でrl、を加算したアド
レス値が、戻りアドレスレジスタ26に設定されように
なっている。
書き込みデータレジスタ23の内容が制御記憶アドレス
レジスタ22の示すアドレスに書き込まれる書き込み動
作が完了することにより、戻りアドレスレジスタ26の
内容は制御記憶アドレスレジスタ22に移送される。こ
の動作は次のように考えることができる。すなわち、制
御記憶21に対する書き込み動作がなされるため、制御
記憶アドレスレジスタ22には書き込むべき制御記憶2
1のアドレスが設定されてしまう。したがって、書き込
み動作の実行中、次に実行されるべきマイクロ命令のア
ドレスは、一時的に戻りアドレスレジスタ26に待避さ
れるようになっている。
レジスタ22の示すアドレスに書き込まれる書き込み動
作が完了することにより、戻りアドレスレジスタ26の
内容は制御記憶アドレスレジスタ22に移送される。こ
の動作は次のように考えることができる。すなわち、制
御記憶21に対する書き込み動作がなされるため、制御
記憶アドレスレジスタ22には書き込むべき制御記憶2
1のアドレスが設定されてしまう。したがって、書き込
み動作の実行中、次に実行されるべきマイクロ命令のア
ドレスは、一時的に戻りアドレスレジスタ26に待避さ
れるようになっている。
上述したような一連の動作、すなわち、主記憶装置から
の書き込みアドレスおよび書き込みデータの読み出し動
作、ならびに制御記憶21への書き込み動作を必要回数
繰り返すことによって、下位階層のマイクロプログラム
制御装置2は制御記憶21の残りの部分にマイクロプロ
グラムを設定することができる。
の書き込みアドレスおよび書き込みデータの読み出し動
作、ならびに制御記憶21への書き込み動作を必要回数
繰り返すことによって、下位階層のマイクロプログラム
制御装置2は制御記憶21の残りの部分にマイクロプロ
グラムを設定することができる。
[発明の効果]
上述したようにこの発明のマイクロプログラム制御装置
によれば、下位の階層のマイクロプログラム制御装置の
制御記憶手段の一部に設定された設定マイクロプログラ
ムに従った第2の設定手段によって、主記憶装置から所
定のマイクロ命令が読み出され、その読み出されたマイ
クロ命令は下位の階層のマイクロプログラム制御装置の
制御記憶手段で設定マイクロプログラムが設定された以
外の部分に設定される。すなわち、下位の階層のマイク
ロプログラム制御装置の制御記憶手段で設定マイクロプ
ログラムが設定された以外の部分の設定は、下位の階層
のマイクロプログラム制御装置で独立してなされる。
によれば、下位の階層のマイクロプログラム制御装置の
制御記憶手段の一部に設定された設定マイクロプログラ
ムに従った第2の設定手段によって、主記憶装置から所
定のマイクロ命令が読み出され、その読み出されたマイ
クロ命令は下位の階層のマイクロプログラム制御装置の
制御記憶手段で設定マイクロプログラムが設定された以
外の部分に設定される。すなわち、下位の階層のマイク
ロプログラム制御装置の制御記憶手段で設定マイクロプ
ログラムが設定された以外の部分の設定は、下位の階層
のマイクロプログラム制御装置で独立してなされる。
したがって、マイクロプログラム制御袋・置の台数が増
加した場合でも、診断装置から最上層のマイクロプログ
ラム制御装置の制御記憶手段にだけマイクロプログラム
を設定すればよい。そして、この最上層のマイクロプロ
グラム制御装置は、この最上層のマイクロプログラム制
御装置の直下の下位の階層のマイクロプログラム制御装
置の制御記憶手段の一部に設定マイクロプログラムを設
定すればよい。この下位の階層のマイクロプログラム制
御装置の制御記憶手段の残りの部分の設定は、上位の階
層のマイクロプログラム制御装置から設定された設定マ
イクロプログラムの制御の下において下位の階層のマイ
クロプログラム制御装置装置で独立して行われるので、
制御記憶手段の内容を設定すべきマイクロプログラム制
御装置の台数が増加してマイクロプログラム制御装置の
階層が増加した場合でも、従来と違って、マイクロプロ
グラムの設定に要する時間は増大せず、ひいてはシステ
ムの立ち上げに要する時間も増大しないという効果があ
る。
加した場合でも、診断装置から最上層のマイクロプログ
ラム制御装置の制御記憶手段にだけマイクロプログラム
を設定すればよい。そして、この最上層のマイクロプロ
グラム制御装置は、この最上層のマイクロプログラム制
御装置の直下の下位の階層のマイクロプログラム制御装
置の制御記憶手段の一部に設定マイクロプログラムを設
定すればよい。この下位の階層のマイクロプログラム制
御装置の制御記憶手段の残りの部分の設定は、上位の階
層のマイクロプログラム制御装置から設定された設定マ
イクロプログラムの制御の下において下位の階層のマイ
クロプログラム制御装置装置で独立して行われるので、
制御記憶手段の内容を設定すべきマイクロプログラム制
御装置の台数が増加してマイクロプログラム制御装置の
階層が増加した場合でも、従来と違って、マイクロプロ
グラムの設定に要する時間は増大せず、ひいてはシステ
ムの立ち上げに要する時間も増大しないという効果があ
る。
図はこの発明のマイクロプログラム制御装置の一実施例
を示すブロック図である。 1・・・上位階層マイクロプログラム制御装置、2・・
・下位階層マイクロプログラム制御装置、21・・・制
御記憶、22・・・制御記憶アドレスレジスタ、23・
・・書き込みデータレジスタ、24・・・読み出しデー
タレジスタ、25・・・アドレス加算回路、26・・・
戻りアドレスレジスタ、27・・・汎用レジスタ、28
・・−書き込み制御回路。
を示すブロック図である。 1・・・上位階層マイクロプログラム制御装置、2・・
・下位階層マイクロプログラム制御装置、21・・・制
御記憶、22・・・制御記憶アドレスレジスタ、23・
・・書き込みデータレジスタ、24・・・読み出しデー
タレジスタ、25・・・アドレス加算回路、26・・・
戻りアドレスレジスタ、27・・・汎用レジスタ、28
・・−書き込み制御回路。
Claims (1)
- 【特許請求の範囲】 マイクロプログラムを記憶した制御記憶手段を有しこの
マイクロプログラムを実行する少なくとも2つの階層か
らなるマイクロプログラム制御装置において、 上位の階層のマイクロプログラム制御装置には、このマ
イクロプログラム制御装置直下の下位の階層のマイクロ
プログラム制御装置の一部に設定マイクロプログラムを
設定する第1の設定手段を設け、下位の階層のマイクロ
プログラム制御装置には、設定マイクロプログラムに従
って主記憶装置から所定のマイクロ命令を読み出すとと
もに、そのマイクロ命令を下位の階層のマイクロプログ
ラム制御装置の制御記憶手段で設定マイクロプログラム
が設定された以外の部分に設定する第2の設定手段を設
けたことを特徴とするマイクロプログラム制御装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP12065689A JPH02299024A (ja) | 1989-05-15 | 1989-05-15 | マイクロプログラム制御装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP12065689A JPH02299024A (ja) | 1989-05-15 | 1989-05-15 | マイクロプログラム制御装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH02299024A true JPH02299024A (ja) | 1990-12-11 |
Family
ID=14791635
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP12065689A Pending JPH02299024A (ja) | 1989-05-15 | 1989-05-15 | マイクロプログラム制御装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH02299024A (ja) |
-
1989
- 1989-05-15 JP JP12065689A patent/JPH02299024A/ja active Pending
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