JPH02164055A - 半導体装置 - Google Patents

半導体装置

Info

Publication number
JPH02164055A
JPH02164055A JP32125588A JP32125588A JPH02164055A JP H02164055 A JPH02164055 A JP H02164055A JP 32125588 A JP32125588 A JP 32125588A JP 32125588 A JP32125588 A JP 32125588A JP H02164055 A JPH02164055 A JP H02164055A
Authority
JP
Japan
Prior art keywords
heat sink
substrate
plating
connection
outer lead
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP32125588A
Other languages
English (en)
Inventor
Yasuhisa Kobayashi
小林 安久
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP32125588A priority Critical patent/JPH02164055A/ja
Publication of JPH02164055A publication Critical patent/JPH02164055A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched

Landscapes

  • Cooling Or The Like Of Semiconductors Or Solid State Devices (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は放熱板を有する樹脂封止型の半導体装置に関す
るものである。
〔従来の技術〕
従来、この種の半導体装置の放熱板は、その製造工程の
都合上第3図に示されるように、半導体素子5が搭載さ
れた基板1と外部リード2が金属細線で接続されている
ものは、接着剤11で放熱板13が接続され、又第4図
のように、基板1と外部リード2が金属バンプ12で接
続されているものは、バンプ12で絶縁性の放熱板3が
外部リード2をもつ基板1に接続されるのが一般的であ
った。なお、7はこれらを包む封止樹脂である。
〔発明が解決しようとする課題〕
上述した従来の半導体装置の中で、第3図で示すように
接着剤を用いる方法は、接着剤の中に含まれる塩素イオ
ンやナトリウムイオン等の不純物の為に、内部の半導体
素子が破壊されやすく高信頼度を要求する半導体装置に
は使用することが出来ない。又接着剤は弱い為に、樹脂
封止の時にしばしば脱離してしまい歩留を下げるという
問題がある。また、第4図に示すように接続バンプを使
用した構造のものは、バンプの高さが揃っていないと接
続した時に放熱板が傾いて接続したり、或いは放熱板が
変形するという問題が起る為、バンプの高さ管理が非常
に難しく、歩留りを落とす原因となっている。
〔課題を解決するための手段〕
上記課題に対し本発明では、放熱板の取りつけを、半導
体素子の搭載前にメッキにて接続している。
〔実施例〕
つぎに本発明を実施例により説明する。
第1図は本発明の第1実施例の断面図である。
第1図において、絶縁基板1と外部リード2および絶縁
性の放熱板3を位置合せして重ねてメッキを施す。これ
により、基板1と外部リード2および放熱板3が重ねら
れた揉一部では、接触する両者に渡る接続メッキ4が形
成される。しかして、この接続メッキ4により基板と外
部リード、および外部リードと放熱板は十分の強度で接
続される。
その後基板lの上に半導体素子5を搭載し金属細線6で
基板を素子との間を接続した後、樹脂7にてこれらを包
み外部雰囲気から保護されている。
第2図は本発明の第2実施例を示す断面図である。第2
図において、絶縁基板1と外部リード2および放熱板3
とは貫通孔9を共通にして重ねられ、この貫通孔8の内
部メッキ9を行ない電気的接続を行なっている。これに
より、基板、外部リード、放熱板は貫通孔8の内部メッ
キにより互いに接続される。放熱板3の接続は基板と外
部リードとの接続の穴と同じ穴でかつ同じ時に接続して
も、又別の穴を使用しリードの別の部分につけることも
可能である。この接続メッキの後、第1実施例と同じよ
うに半導体素子5を搭載し、樹脂7で封止されている。
なお、基板、放熱板の接続メッキ部分は、予じめ部分メ
ッキを施しておくことは当然である。
〔発明の効果〕
以上説明したように本発明は、メッキを用いて放熱板を
取付ける事により従来問題となっていた不純物による信
頼性の低下を防ぐことが出来ることは勿論、半導体装置
製造工程中に放熱板が離脱することもなく、歩留りの向
上を計ることが出来る。又この放熱板の取付けは材料の
段階で行える為に、取付は作業による素子への悪影響は
全くなく、この点でも品質の向上が期待出来る。さらに
バンプを使用した従来の方法と比べても材料の管理が非
常に容易であり、この点でコストダウンが行える。
【図面の簡単な説明】
第1図は本発明の第1実施例の断面図、第2図は本発明
の第2実施例の断面図、第3図および第4図は従来の半
導体装置の一例および他の一例の断面図である。 1・・・・・・絶縁基板、2・・・・・・外部リード、
3゜13・・・・・・放熱板、4・・・・・・接続メッ
キ、訃・・・・・半導体素子、6・・・・・・金属細線
、7・・・・・・封止樹脂、8・・・・・・貫通孔、9
・・・・・・内部メッキ。 代理人 弁理士  内 原   晋

Claims (1)

    【特許請求の範囲】
  1. プリント基板上に1ケ以上の半導体素子が搭載され、基
    板と素子及び基板と外部リードとが電気的に接続されか
    つ放熱板を有する樹脂封止型半導体装置において、前記
    放熱板がメッキにて取付けられていることを特徴とする
    樹脂封止型半導体装置。
JP32125588A 1988-12-19 1988-12-19 半導体装置 Pending JPH02164055A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP32125588A JPH02164055A (ja) 1988-12-19 1988-12-19 半導体装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP32125588A JPH02164055A (ja) 1988-12-19 1988-12-19 半導体装置

Publications (1)

Publication Number Publication Date
JPH02164055A true JPH02164055A (ja) 1990-06-25

Family

ID=18130538

Family Applications (1)

Application Number Title Priority Date Filing Date
JP32125588A Pending JPH02164055A (ja) 1988-12-19 1988-12-19 半導体装置

Country Status (1)

Country Link
JP (1) JPH02164055A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US8102045B2 (en) 2007-08-08 2012-01-24 Infineon Technologies Ag Integrated circuit with galvanically bonded heat sink

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6142853B2 (ja) * 1977-12-28 1986-09-24 Matsushita Electric Ind Co Ltd

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6142853B2 (ja) * 1977-12-28 1986-09-24 Matsushita Electric Ind Co Ltd

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US8102045B2 (en) 2007-08-08 2012-01-24 Infineon Technologies Ag Integrated circuit with galvanically bonded heat sink
DE102008036285B4 (de) * 2007-08-08 2013-07-18 Infineon Technologies Ag Integrierte Schaltung mit einer durch einen galvanischen Prozess erzeugten Verbindung mit einem Kühlkörper und Verfahren dazu

Similar Documents

Publication Publication Date Title
US6495909B2 (en) Low-pin-count chip package and manufacturing method thereof
JPH06209054A (ja) 半導体装置
KR100397539B1 (ko) 수지밀봉형 반도체 장치 및 그 제조방법
JPH11214606A (ja) 樹脂封止型半導体装置及びリードフレーム
US8330258B2 (en) System and method for improving solder joint reliability in an integrated circuit package
KR0185247B1 (ko) 수지 밀봉형 반도체 소자의 제조 방법
JPH11168169A (ja) リードフレームおよびそれを用いた半導体装置ならびにその製造方法
JPH08250835A (ja) 金属バンプを有するlsiパッケージの実装方法
JPH02164055A (ja) 半導体装置
KR20000006433A (ko) 비지에이형반도체장치의제조방법,비지에이형반도체장치용티에이비테이프,및비지에이형반도체장치
JP3150560B2 (ja) 半導体装置
JPH03161958A (ja) プラスチックピングリッドアレイ型半導体パッケージ構造
JPH0974158A (ja) 高電力混成集積回路用パッケージ
JP2001118951A (ja) 半導体装置
JPH11330343A (ja) 樹脂封止型半導体装置
JPH09199631A (ja) 半導体装置の構造と製造方法
JPH04247645A (ja) 金属基板の実装構造
KR100209592B1 (ko) 반도체 패키지
JPH03231435A (ja) 半導体集積回路装置
JP2005150693A (ja) チップパッケージ構造
JPH11150208A (ja) 半導体素子の実装方法
JPH02244746A (ja) 樹脂封止型半導体装置
JP3164084B2 (ja) 半導体装置のフレーム
JP3063733B2 (ja) 半導体パッケージ
JPH09116080A (ja) リード端子及びそれに用いるリードフレーム