JPH02145816U - - Google Patents

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JPH02145816U
JPH02145816U JP1989056300U JP5630089U JPH02145816U JP H02145816 U JPH02145816 U JP H02145816U JP 1989056300 U JP1989056300 U JP 1989056300U JP 5630089 U JP5630089 U JP 5630089U JP H02145816 U JPH02145816 U JP H02145816U
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delay
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Description

【図面の簡単な説明】
第１図はこの出願の第１考案の実施例を示す接
続図、第２図はこの出願の第２考案の実施例を示
す接続図、第３図乃至第５図は第２考案の動作を
説明するためのグラフ、第６図は従来の技術を説
明するための接続図である。 １Ａ〜１Ｎ……マルチプレクサ、２Ａ〜２Ｎ…
…遅延素子、３，４……メモリ。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) Ａ 重み付けされた遅延量を持つ複数の遅
    延素子を選択的に直列接続し、所望の遅延時間を
    得るように構成される遅延発生回路において、 Ｂ 少なくとも最小遅延量を与える遅延素子を
    複数設け、この複数の遅延素子と他の遅延量を与
    える遅延素子の遅延時間の組合せを記憶する記憶
    器を設け、この記憶器に記憶した遅延時間の組合
    せに従つて所望の遅延時間を得るように構成した
    遅延発生回路。 (2) Ａ アナログ電圧が与えられ、このアナロ
    グ電圧の値に応じて遅延時間が変化する遅延発生
    回路において、 Ｂ 上記遅延発生回路にアナログ電圧を与える
    ＤＡ変換器と、 Ｃ このＤＡ変換器にデイジタル信号を与え、
    上記遅延発生回路に与えるアナログ電圧を規定す
    るレジスタと、 Ｄ このレジスタと上記ＤＡ変換器の間に挿入
    され、上記遅延発生回路の非直線特性に従つて直
    線化補正するための補正データを記憶し、この補
    正データによつて上記レジスタからＤＡ変換器に
    与えるデイジタル値を補正する記憶器と、 を具備して成る遅延発生回路。
JP1989056300U 1989-05-15 1989-05-15 遅延発生回路 Expired - Lifetime JPH0728735Y2 (ja)

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JPH0728735Y2 JPH0728735Y2 (ja) 1995-06-28

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