JPS6217249U - - Google Patents
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- Publication number
- JPS6217249U JPS6217249U JP10910685U JP10910685U JPS6217249U JP S6217249 U JPS6217249 U JP S6217249U JP 10910685 U JP10910685 U JP 10910685U JP 10910685 U JP10910685 U JP 10910685U JP S6217249 U JPS6217249 U JP S6217249U
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- JP
- Japan
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- 238000006243 chemical reaction Methods 0.000 claims description 4
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Analogue/Digital Conversion (AREA)
Description
第１図は本考案のＡ／Ｄ変換回路の一実施例を
示す図、第２図はその動作説明のための図である
。 １，２，３…第１比較器、４…第２比較器、５
…アナログスイツチ、６…シリアル・パラレル変
換回路、１４…デコーダ、１５…第１基準比較電
圧作成回路、１６…第２基準比較電圧作成回路。
示す図、第２図はその動作説明のための図である
。 １，２，３…第１比較器、４…第２比較器、５
…アナログスイツチ、６…シリアル・パラレル変
換回路、１４…デコーダ、１５…第１基準比較電
圧作成回路、１６…第２基準比較電圧作成回路。
Claims (1)
- 一方の入力端子に入力アナログ信号が共通に与
えられる複数個の第１比較器及び少なくとも１個
の第２の比較器と、前記第１比較器の他方の入力
端子にそれぞれ異なる基準比較電圧を同時に与え
る第１の基準比較電圧作成手段と、前記第２比較
器の他方の入力端子に所定の循環周期で異なる基
準比較電圧を時分割で与える第２の基準比較電圧
作成手段と、前記第２比較器から出力されるシリ
アルデータをパラレルデータに変換する手段と、
このシリアル・パラレル変換手段の出力と前記第
１比較器の出力とをデコードして所定ビツト数の
デジタル信号を得るデコーダを備えたＡ／Ｄ変換
回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10910685U JPS6217249U (ja) | 1985-07-17 | 1985-07-17 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10910685U JPS6217249U (ja) | 1985-07-17 | 1985-07-17 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6217249U true JPS6217249U (ja) | 1987-02-02 |
Family
ID=30986908
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10910685U Pending JPS6217249U (ja) | 1985-07-17 | 1985-07-17 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6217249U (ja) |
-
1985
- 1985-07-17 JP JP10910685U patent/JPS6217249U/ja active Pending
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