JPH0339929U - - Google Patents
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- JPH0339929U JPH0339929U JP10084689U JP10084689U JPH0339929U JP H0339929 U JPH0339929 U JP H0339929U JP 10084689 U JP10084689 U JP 10084689U JP 10084689 U JP10084689 U JP 10084689U JP H0339929 U JPH0339929 U JP H0339929U
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- JP
- Japan
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- converter
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- 238000006243 chemical reaction Methods 0.000 claims 1
- 239000000284 extract Substances 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Analogue/Digital Conversion (AREA)
Description
第１図はこの考案の一実施例を示す装置の構成
図、第２図は従来の装置を示す構成図である。 図において、２１〜２ｎ及び１４１〜１４ｎは
基準電圧発生回路、４１〜４ｎ及び１６１〜１６
ｎは電圧比較型コンパレータ、６及び８は優先度
付き符号化回路、８はＤ／Ａ変換器、１０は差分
回路、１２は増幅器である。なお、図中同一符号
は同一または相当部分を示す。
図、第２図は従来の装置を示す構成図である。 図において、２１〜２ｎ及び１４１〜１４ｎは
基準電圧発生回路、４１〜４ｎ及び１６１〜１６
ｎは電圧比較型コンパレータ、６及び８は優先度
付き符号化回路、８はＤ／Ａ変換器、１０は差分
回路、１２は増幅器である。なお、図中同一符号
は同一または相当部分を示す。
Claims (1)
- ２ｎ（Ｎは正整流）段階の異なるレベルを発生
する２ｎ個の基準電圧発生回路と、上記２ｎ個の
基準電圧発生回路の対応する出力及び共通の入力
アナログ信号を分岐して入力される２ｎ個の電圧
比較型コンパレータと、上記電圧比較型コンパレ
ータの２ｎ個の出力を供給されてこれをＮビツト
に符号化する優先度付き符号化回路からなる第１
のフラツシユ型Ａ／Ｄ変換器と、上記第１のフラ
ツシユ型Ａ／Ｄ変換器の出力をＤ／Ａ変換するＤ
／Ａ変換器と、Ｄ／Ａ変換器の出力と上記入力ア
ナログ信号の差分を抽出する差分回路と、上記差
分回路の出力を２ｎ倍する増幅器と、上記増幅器
の出力を入力されてこれをＮビツトに符号化する
第１のフラツシユ型Ａ／Ｄ変換器と同一構成の第
２のフラツシユ型Ａ／Ｄ変換器とを備えたことを
特徴とするＡ／Ｄ変換装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10084689U JPH0339929U (ja) | 1989-08-29 | 1989-08-29 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10084689U JPH0339929U (ja) | 1989-08-29 | 1989-08-29 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0339929U true JPH0339929U (ja) | 1991-04-17 |
Family
ID=31649830
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10084689U Pending JPH0339929U (ja) | 1989-08-29 | 1989-08-29 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0339929U (ja) |
-
1989
- 1989-08-29 JP JP10084689U patent/JPH0339929U/ja active Pending
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