JPS6433218U - - Google Patents

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JPS6433218U
JPS6433218U JP12748987U JP12748987U JPS6433218U JP S6433218 U JPS6433218 U JP S6433218U JP 12748987 U JP12748987 U JP 12748987U JP 12748987 U JP12748987 U JP 12748987U JP S6433218 U JPS6433218 U JP S6433218U
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JP
Japan
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converter
input signal
level
digital level
limiting circuit
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JP12748987U
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  • Tone Control, Compression And Expansion, Limiting Amplitude (AREA)

Description

【図面の簡単な説明】
第１図乃至第４図は、この考案に係る振幅制限
回路の実施例を示すものであつて、第１図は全体
構成を示すブロツク図、第２図は第１図に示す振
幅制限回路の入出力特性（振幅制限特性）図、第
３図はデジタルレベル変換器の変換特性の一例を
示す説明図、第４図は第１図に示す振幅制限回路
の応用例を示すブロツク図である。第５図乃至第
８図は、従来例を示すものであつて、第５図は回
路図、第６図は第５図に示す振幅制限回路の入出
力特性図、第７図はブロツク図、第８図は第７図
に示す振幅制限回路の入出力特性図である。 主な図番の説明、１０：Ｄ／Ａコンバータ、１
１：デジタルレベル検出器、１２：デジタルレベ
ル変換器。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) 入力信号をＡ／Ｄ変換するＡ／Ｄコンバー
    タと、このＡ／Ｄコンバータの出力レベルを検出
    するデジタルレベル検出器と、このデジタルレベ
    ル検出器の検出信号に応じて制御されるデジタル
    レベル変換器とを備え、入力信号レベルに応じて
    、任意の関数で入力信号をデジタル的に変換する
    ことにより、信号の振幅を制限するように構成し
    たことを特徴とする振幅制限回路。 (2) 前記デジタルレベル変換器の出力に、Ｄ／
    Ａコンバータを備えたことを特徴とする実用新案
    登録請求の範囲第１項記載の振幅制限回路。
JP12748987U 1987-08-24 1987-08-24 Pending JPS6433218U (ja)

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JP12748987U JPS6433218U (ja) 1987-08-24 1987-08-24

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JPS6433218U true JPS6433218U (ja) 1989-03-01

Family

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JP12748987U Pending JPS6433218U (ja) 1987-08-24 1987-08-24

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2006043465A1 (ja) * 2004-10-19 2006-04-27 Advantest Corporation 波形変換装置、波形変換方法、及び試験装置

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61143844A (ja) * 1984-12-17 1986-07-01 Matsushita Electric Ind Co Ltd ディジタル演算回路

Patent Citations (1)

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