JPH02134006A - 増幅回路 - Google Patents

増幅回路

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JPH02134006A
JPH02134006A JP63288589A JP28858988A JPH02134006A JP H02134006 A JPH02134006 A JP H02134006A JP 63288589 A JP63288589 A JP 63288589A JP 28858988 A JP28858988 A JP 28858988A JP H02134006 A JPH02134006 A JP H02134006A
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JP
Japan
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channel
circuit
output
voltage
channels
Prior art date
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Pending
Application number
JP63288589A
Other languages
English (en)
Inventor
Mitsutoshi Sugawara
光俊 菅原
Shinji Nozawa
野沢　真二
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NEC Corp
NEC IC Microcomputer Systems Co Ltd
Original Assignee
NEC Corp
NEC IC Microcomputer Systems Co Ltd
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Publication date
Application filed by NEC Corp, NEC IC Microcomputer Systems Co Ltd filed Critical NEC Corp
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Priority to US07/436,449 priority patent/US5045804A/en
Publication of JPH02134006A publication Critical patent/JPH02134006A/ja
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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03G—CONTROL OF AMPLIFICATION
    • H03G3/00—Gain control in amplifiers or frequency changers
    • H03G3/20—Automatic control
    • H03G3/30—Automatic control in amplifiers having semiconductor devices
    • H03G3/34—Muting amplifier when no signal is present or when only weak signals are present, or caused by the presence of noise signals, e.g. squelch systems
    • H03G3/348—Muting in response to a mechanical action or to power supply variations, e.g. during tuning; Click removal circuits
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03F—AMPLIFIERS
    • H03F3/00—Amplifiers with only discharge tubes or only semiconductor devices as amplifying elements
    • H03F3/72—Gated amplifiers, i.e. amplifiers which are rendered operative or inoperative by means of a control signal

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  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Amplifiers (AREA)
  • Electronic Switches (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は増幅回路の構成に関し、特に多チヤンネル入力
および単出力の増幅回路に関する。
〔従来の技術〕
従来、この種の増幅回路は、多チヤンネル入力、単出力
であるがため、特定のチャンネルを選定する場合、選定
されたチャンネルのみをバイアスし、他の選定されてい
ないチャンネルはバイアスしない要か回路構成となって
いた。
図面を用いて詳述すると、第４図は従来の構成図で第５
図は第４図の回路図、第６図は第５図における切替タイ
ミングチャートである。第５図において、最初にＡチャ
ンネルが選定されていて、次にＢチャンネルに切替えら
れた場合において、Ｔｒ５とＴｒ６のベース電位をそれ
ぞれＶＡ、ＶヨとするとｖＡ、ＶＢの立上り、立下りの
タイミングは第５図の様になっている。この時、第６図
中のＴｄの区間はＴｒ９のコレクタ電位が低下する為、
Ｔｒ９のコレクタ電流が減少する為、出力回路内の負荷
抵抗Ｒ３，Ｒ４に流れる電流が減少し、過渡的なノイズ
が発生する。
〔発明が解決しようとする課題〕
上述した従来の多チヤンネル入力、単出力の増幅回路は
、特定のチャンネルを選定する場合、選定されたチャン
ネルのみを引を左置し、他のチャンネルは引せキ象しな
い様な回路構成となっているので、チャンネル切替時に
切替える前に選定されていたチャンネルが先に動作しな
くなり、次に、新しく選定されたチャンネルが動作する
という時間的遅れがあり、すべてのチャンネルが動作し
ていないという瞬間が発生していた。その結果として、
出力端に過渡的なノイズが発生し、増幅回路の次段に接
続される回路に悪影響を及ぼすという欠点があった。
〔課題を解決するための手段〕
本発明の増幅回路は、入力端を固定電位に接続し、出力
端を他のチャンネルの出力端と共通に接続し、すべての
チャンネルがチャンネル切替時に動作しなくなる時に、
選定される様に設定されたダミーチャンネルを有してい
る。
〔実施例〕
次に、本発明について、図面を参照して説明する。
第１図は本発明の一実施例のブロック図で、第２図はそ
の回路図である。第１図、第２図中、破線で囲んだ部分
１が本発明に従って設けられたダミーチャンネルである
。第２図中点線の部分は従来回路のＡチャンネル入力回
路、Ｂチャンネル入力回路、Ｃチャンネル入力回路、Ｄ
チャンネル入力回路、及び切替回路と同じ構成であり、
各チャンネル入力回路における電流源トランジスタＴｒ
５、Ｔｒ６．Ｔｒ７．Ｔｒ８のベースには活性時にはベ
ースバイアス電圧ＶＡ、Ｖ、、Ｖ。、Ｖｎがそれぞれ供
給される。これらバイアス電圧ＶＡ乃至ＶＤはそれぞれ
同一の構成のバイアス回路が発生されるので互いに同じ
値をもつように設定されている。なお、各チャンネル入
力に最適なバイアス値をとってもよい。そして、ダミー
チャンネル１における電流源トランジスタＴｒ４のベー
スバイアス電圧ｖ　２ハバイアス電圧ＶＡ、　ＶＢ、　
ＶＣ，ＶＤのいずれよりも低い値に設定されている。し
たがって、第３図の切替タイミングの様にＡチャンネル
からＢチャンネルに切替える時に、■Ａの立上り途中で
Ｔｒ４が動作し、ＶＢが立上ってからＴｒ４が動作しな
くなる。この結果、バイアス電流源１０におけるトラン
ジスタＴｒ９のコレクタ電圧の低下が抑えられ、同トラ
ンジスタＴｒ９のコレクタ電流の変動がなくなる。その
結果として出力回路の負荷抵抗Ｒ，，Ｒ７に流れる電流
が変化しない為、過渡的なノイズの発生が低減できる。
〔発明の効果〕
以上説明したように本発明は、多チヤンネル入力、単出
力の増幅回路にダミーチャンネルを設ける事により、チ
ャンネル切替時に発生する過渡的なノイズを低減できる
効果がある。
【図面の簡単な説明】
第１図は本発明の実施例のブロック図、第２図は第１図
の回路図、第３図は第２図の回路図におけるチャンネル
切替のタイミングチャート、第４図は従来例の構成図、
第５図は従来例の回路図、第６図は第５図の回路図にお
けるチャンネル切替のタイミングである。 代理人　弁理士　　内　原　　　音 第３図

Claims (1)

    【特許請求の範囲】
  1. 　複数チャンネル入力のための複数の第一の信号入力回
    路と、これら信号入力回路の出力が共通に供給された信
    号出力回路と、前記複数の第一の信号入力回路の一つを
    選択する切換回路とを有する増幅回路に於て、入力端が
    固定電位に接続され出力端は前記信号出力回路に接続さ
    れた第二の信号入力回路であって前記第一の信号入力回
    路の選択過渡期間中に動作する第二の信号入力回路を設
    けたことを特徴とする増幅回路。
JP63288589A 1988-11-14 1988-11-14 増幅回路 Pending JPH02134006A (ja)

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