JPH0151221B2 - - Google Patents
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- JPH0151221B2 JPH0151221B2 JP56104483A JP10448381A JPH0151221B2 JP H0151221 B2 JPH0151221 B2 JP H0151221B2 JP 56104483 A JP56104483 A JP 56104483A JP 10448381 A JP10448381 A JP 10448381A JP H0151221 B2 JPH0151221 B2 JP H0151221B2
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- Expired
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- 238000000034 method Methods 0.000 claims description 16
- 238000011144 upstream manufacturing Methods 0.000 claims description 8
- 230000005540 biological transmission Effects 0.000 description 32
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L12/00—Data switching networks
- H04L12/28—Data switching networks characterised by path configuration, e.g. LAN [Local Area Networks] or WAN [Wide Area Networks]
- H04L12/42—Loop networks
- H04L12/427—Loop networks with decentralised control
- H04L12/433—Loop networks with decentralised control with asynchronous transmission, e.g. token ring, register insertion
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Small-Scale Networks (AREA)
Description
本発明は、計算機や各種端末装置が接続される
複数個のステーシヨンをループ状に1つの回線に
より縦続接続し、任意のステーシヨン間でデータ
伝送を行うことが可能なループ式データウエイシ
ステムの回線制御方法に関する。 このようなループ式データウエイシステムで
は、同時には1つのステーシヨンしか送信できな
いので、データの送信を行う場合には、各ステー
シヨンは、まず回線の占有権を獲得し、その後デ
ータの送信を行い、送信終了後、占有権を他のス
テーシヨンにあけ渡す制御が必要である。 このような、回線の占有権の獲得、解放に関す
る一切の制御を、ここでは回線制御と呼んでい
る。回線制御を特定のステーシヨンだけが行うコ
ントロールステーシヨン固定方式では、残りの各
ステーシヨンに回線制御機能を付加する必要がな
いという意味で効果があるが、各ステーシヨン
は、送信終了後、送信が完了したことを、このコ
ントロールステーシヨンに連絡する必要があり、
データの伝送効率の面では、優れていなかつた。 この点を改善したものとして、例えば特願昭51
−31312号(特開昭52−115105)はコントロール
ステーシヨンを固定せず、データの送信を終了し
たものが、順次コントロールステーシヨンとなる
コントロールステーシヨン持廻り方式を提案して
いる。従来の方式は、いずれもコントロールステ
ーシヨンが出力する、他のステーシヨンの占有要
求を問合せする為の問合せフレーム(以下POL
フレームと称す)を、各ステーシヨンが受信し、
これに対応する形式となつているため、各ステー
シヨンでは、少なくともPOLフレームを受信す
る時間の中継遅れが生じていた。 この点を図面を参照して、更に詳細に説明す
る。 第1図は、本発明が対象とするループ式データ
ウエイシステムを示し、これは公知のものであ
る。 ここでは、4つのステーシヨン1〜4が、それ
ぞれ回線100a〜100dによりループ状に縦
続接続された構成を示している。 ステーシヨン1〜4には、それぞれ計算機5或
いは端末装置6〜8が接続され、任意のステーシ
ヨン間でデータ伝送が行なわれる。 ここでは説明の都合上、4つのステーシヨンの
みを示しているが、実際は、数10台のステーシヨ
ンが、ループ状に接続されて利用される場合が多
い。 このようなループ構成では、前述の如く、デー
タの送信が出来るのは、同時には1つのステーシ
ヨンのみであり、複数個のステーシヨンに同時
に、送信要求が発生する場合には、その中の1つ
を決定してやる必要がある。 コントロールステーシヨン持廻り方式における
従来の伝送手順の一例を第2図に示している。 第2図においては、ステーシヨン1(以下ステ
ーシヨンをSTと略称する)が、データの送信を
終了し、他のステーシヨンに回線の占有要求を問
合せするPOLフレームを送出する場合であり、
ST3,ST4に占有要求がある例である。 ST1が送出したPOLパターンは(正確には
POLフレームの内容)、回線100aを介してま
ずST2に受信される。 ST2では時間t0において、POLパターンの先
頭ビツトを受信するが、この時点では、これが
POLパターンかどうかの伴断は出来ない。 時間t1において、初めてPOLパターンであるこ
とを認識するが、ST2は占有要求がないので、
このPOLパターンは下流の線100bに送出す
る。 同様にして、ST3は、時間t2において、POL
パターンであることを認識する。 ST3は、占有要求があるので、POLパターン
をRSVパターンに書換え、下流の回線100c
に送出する。 ここで、RSVパターンとは、占有権を獲得た
ことを宣言するパターンである。ST3はRSVパ
ターンを送出すると同時に、これに引続いて送信
データ(DATA)を送る。 DATAのフレーム構成は、例えば第3図に示
すように、ハイレベルデータリンク制御手順
(HDLC手順)に準拠したもので、フレームの開
始、終結を示すフラグF、受信STアドレスDA、
制御コードC、送信STアドレスSA、データI1,
I2,……Io、誤り制御コードFCSで構成される。 ST4は、時間t3において、ST3が送出した
RSVパターンを受信し、上流のステーシヨンに
おいて回線の占有があつたことを知る。 この為、ST4に占有要求があるが、ST4は、
RSVパターン故、占有権を獲得できず中継動作
をする。 POLパターンを送出したST1へRSVパターン
が戻ると、ST1は、他のSTが占有したことを知
り、自STのデータを送信するモードから、ST3
がRSVパターンに続き送信するDATAを、次の
STへ中継するモードとなる。 ST3は、自分が送信したDATAが戻つてくる
と、伝送が終了したことを知り、時間t4におい
て、回線の占有権を放棄し、他STに占有を問合
せするPOLパターンを送信し始める。 図示の如く、POLパターン発生からDATA伝
送を終了し、次のPOLパターンを発生させる1
情報転送サイクルは、POLパターンの長さX1と、
DATA長Yおよび伝送路、STの中継遅れに起因
するZ1、Z2の時間からなる。 各ST間の有効なDATAを送る伝送効率Eは、
以下の関係式のようになる。 E=Y/X1+Y+Z1+Z2×100〔%〕 ここで、問題なのは、占有要求のあるSTが、
POLパターンを検知し、これをRSVパターンに
書き換える為に、各STでPOLパターン分だけ遅
らせなければならないことである。 占有要求のあるSTのみがPOLパターンを遅ら
せ、占有要求のないSTはPOLパターンをそのま
ま中継遅れなく下流回線に送る方式をとると、伝
送中のデータに混乱が生ずるため、これは実現で
きない。この為、各STでの中継遅れは、それぞ
れ累積されるので、Z1、Z2が大きく、これが伝
送効率を悪くする原因となつている。 これらは、ビツト伝送速度が遅く、データ長が
短く、且つST数が多い場合に、顕著となる。 本発明の目的は、STでの中継遅れをなくし、
伝導効率の高いループ式データウエイシステムの
回線制御方法を提供するにある。 本発明の特徴は、他のSTの占有要求を問合せ
する為の問合せフレームを、問合せ部と宣言部で
構成し、各STは、上流回線から入力する問合せ
部のビツトパターンを受信しながら、順次遅延な
く下流回線に再生中継し、占有要求のあるSTは、
問合せ部を受信したあと、該宣言部の位置に占有
の宣言パターン(RSV)を先行書込みして下流
回線に送出し、問合せ部に続いて上流回線から入
力する宣言部の内容により優先制御を行うように
していることである。 占有の宣言を先行書込みしたSTは、宣言部の
受信データが、未占有であれば占有権を獲得した
と判断し、又既に占有済みであれば占有権を獲得
できなかつたと判断する。 この場合、占有権を獲得したと判断したSTは、
RSVパターンに続いてDATAの送信を行う。 本発明による回線制御方法を実現するSTの一
実施例ブロツク図を第4図に、そのタイムチヤー
トを第5図に示している。 第4図において、受信回路9は、上流回線(伝
送路)からのデータを入力し、その出力7aを復
調回路11、クロツク再生回路12に入力させ
る。同時に、出力7aは、同期回路20で同期が
とられ、セレクタ21、送信回路10を介して下
流回線に送出される。 この為、上流回線からのデータは、ほとんど遅
延なく下流回線に送出される。 復調回路11の出力7c、及びクロツク再生回
路12の出力受信クロツク7bはシフトレジスタ
22へ入力される。 受信データ7aにPOLパターンが来てシフト
レジスタ22へ所定ビツト数入力されると比較器
24はこれを検出する。送信要求があれば、制御
回路27は、制御回路29からの送信要求7eに
よつて、オアゲート30を介してセレクタ21を
切り換え、又RSVパターンジエネレータ32を
イネーブル(EN)とし、セレクタ31、変調回
路13を介してRSVパターンを順次送出する。 これは、受信データのPOLパターンを遅れな
く再生中継し、その後引き続き、自STにて発生
させたRSVパターンを挿入したことになる。 更にPOLパターンは、シフトレジスタ23へ
シフトされ、比較器26にてPOLパターンが検
出され、この時、比較器25にてRSVの空きパ
ターンが検出されると、占有権を獲得したと判断
し、制御回路28によりセレクタ21を自ST送
信モードへ切り換え、且つセレクタ31により自
STの送信DATAを変調回路13へ入力し、下流
回線へ送出する。 比較器25にて検出したパターンが、既に占有
済みのパターン(RSV)であれば、占有権を獲
得できなかつたものと判断し、制御回路28によ
りセレクタ21を同期回路20の出力を選ぶ中継
モードとなる。 第5図のタイムチヤートから明らかな様に、受
信データaから送信データ7i迄の中継遅れ時間
は、同期回路20による再同期のための遅れだけ
であり(1ビツト間隔以内)、POLパターン分
(第5図では8ビツト間隔分)の遅延が必要な従
来例に比べ大幅に短縮されている。 従来例を示す第2図に対応する本発明の図面を
第6図に示している。 第2図と第6図を比較すると、従来の問合せフ
レーム(POL)が本発明では、問合せ部P(POL
パターン)と宣言部Sから構成されていること
と、本発明においては、問合せ部Pおよび宣言部
Sは、それぞれ各STを特別に遅らせることなく
再生中継されていることである。 本発明においては問合せフレームが問合せ部P
と宣言部Sから構成されるため、X2のごとく第
2図のX1に比べ長くなつているが、再生中継遅
れがなくなつているので、Z3、Z4の部分が小さ
くなり、データの伝送効率が向上していることが
理解できる。 尚第6図の実施例では、ST3は、DATAの送
信終了後、一巡して来たDATAを受信してから
POLパターンを送出している例を示しているが、
DATAの送信終了後直ちにPOLパターンを送出
しても良い。 第7図は、本発明になる回線制御手順のフロー
チヤートを整理して示している。 前回の送信STは、データ送信終了後、POLパ
ターン、未占有パターン(宣言部Sのパターン)
を送出し、回線を解放するが、通常、各STは、
これを単に再生中継し、POLパターンを検出し
たならば、送信要求(回線の占有要求と同じ意
味)があるかどうかを判断し、要求のないSTは
単に受信データリピートモードへ移行する。 送信要求のあるSTは、当該宣言部Sの位置に、
RSVパターンを先行書込みし、その後受信する
上流STの占有表示が、既に占有済みかを検出し、
占有されていれば回線を占有できないとして受信
データリピートモードへ移行する。 未だ占有されていない場合だけ、自STのデー
タの送信を始め、終了したならばPOL、未占有
パターンを送出し回線の占有権を解放する。 本発明による回線制御方法と従来例の回線制御
方法を次のような条件下で比較すると、伝送効率
は次表の通りとなる。 (1) 伝送速度 1Mbps (2) ループ長全長 500m (3) データ長 64〜512バイト (4) ST台数 最大64台
複数個のステーシヨンをループ状に1つの回線に
より縦続接続し、任意のステーシヨン間でデータ
伝送を行うことが可能なループ式データウエイシ
ステムの回線制御方法に関する。 このようなループ式データウエイシステムで
は、同時には1つのステーシヨンしか送信できな
いので、データの送信を行う場合には、各ステー
シヨンは、まず回線の占有権を獲得し、その後デ
ータの送信を行い、送信終了後、占有権を他のス
テーシヨンにあけ渡す制御が必要である。 このような、回線の占有権の獲得、解放に関す
る一切の制御を、ここでは回線制御と呼んでい
る。回線制御を特定のステーシヨンだけが行うコ
ントロールステーシヨン固定方式では、残りの各
ステーシヨンに回線制御機能を付加する必要がな
いという意味で効果があるが、各ステーシヨン
は、送信終了後、送信が完了したことを、このコ
ントロールステーシヨンに連絡する必要があり、
データの伝送効率の面では、優れていなかつた。 この点を改善したものとして、例えば特願昭51
−31312号(特開昭52−115105)はコントロール
ステーシヨンを固定せず、データの送信を終了し
たものが、順次コントロールステーシヨンとなる
コントロールステーシヨン持廻り方式を提案して
いる。従来の方式は、いずれもコントロールステ
ーシヨンが出力する、他のステーシヨンの占有要
求を問合せする為の問合せフレーム(以下POL
フレームと称す)を、各ステーシヨンが受信し、
これに対応する形式となつているため、各ステー
シヨンでは、少なくともPOLフレームを受信す
る時間の中継遅れが生じていた。 この点を図面を参照して、更に詳細に説明す
る。 第1図は、本発明が対象とするループ式データ
ウエイシステムを示し、これは公知のものであ
る。 ここでは、4つのステーシヨン1〜4が、それ
ぞれ回線100a〜100dによりループ状に縦
続接続された構成を示している。 ステーシヨン1〜4には、それぞれ計算機5或
いは端末装置6〜8が接続され、任意のステーシ
ヨン間でデータ伝送が行なわれる。 ここでは説明の都合上、4つのステーシヨンの
みを示しているが、実際は、数10台のステーシヨ
ンが、ループ状に接続されて利用される場合が多
い。 このようなループ構成では、前述の如く、デー
タの送信が出来るのは、同時には1つのステーシ
ヨンのみであり、複数個のステーシヨンに同時
に、送信要求が発生する場合には、その中の1つ
を決定してやる必要がある。 コントロールステーシヨン持廻り方式における
従来の伝送手順の一例を第2図に示している。 第2図においては、ステーシヨン1(以下ステ
ーシヨンをSTと略称する)が、データの送信を
終了し、他のステーシヨンに回線の占有要求を問
合せするPOLフレームを送出する場合であり、
ST3,ST4に占有要求がある例である。 ST1が送出したPOLパターンは(正確には
POLフレームの内容)、回線100aを介してま
ずST2に受信される。 ST2では時間t0において、POLパターンの先
頭ビツトを受信するが、この時点では、これが
POLパターンかどうかの伴断は出来ない。 時間t1において、初めてPOLパターンであるこ
とを認識するが、ST2は占有要求がないので、
このPOLパターンは下流の線100bに送出す
る。 同様にして、ST3は、時間t2において、POL
パターンであることを認識する。 ST3は、占有要求があるので、POLパターン
をRSVパターンに書換え、下流の回線100c
に送出する。 ここで、RSVパターンとは、占有権を獲得た
ことを宣言するパターンである。ST3はRSVパ
ターンを送出すると同時に、これに引続いて送信
データ(DATA)を送る。 DATAのフレーム構成は、例えば第3図に示
すように、ハイレベルデータリンク制御手順
(HDLC手順)に準拠したもので、フレームの開
始、終結を示すフラグF、受信STアドレスDA、
制御コードC、送信STアドレスSA、データI1,
I2,……Io、誤り制御コードFCSで構成される。 ST4は、時間t3において、ST3が送出した
RSVパターンを受信し、上流のステーシヨンに
おいて回線の占有があつたことを知る。 この為、ST4に占有要求があるが、ST4は、
RSVパターン故、占有権を獲得できず中継動作
をする。 POLパターンを送出したST1へRSVパターン
が戻ると、ST1は、他のSTが占有したことを知
り、自STのデータを送信するモードから、ST3
がRSVパターンに続き送信するDATAを、次の
STへ中継するモードとなる。 ST3は、自分が送信したDATAが戻つてくる
と、伝送が終了したことを知り、時間t4におい
て、回線の占有権を放棄し、他STに占有を問合
せするPOLパターンを送信し始める。 図示の如く、POLパターン発生からDATA伝
送を終了し、次のPOLパターンを発生させる1
情報転送サイクルは、POLパターンの長さX1と、
DATA長Yおよび伝送路、STの中継遅れに起因
するZ1、Z2の時間からなる。 各ST間の有効なDATAを送る伝送効率Eは、
以下の関係式のようになる。 E=Y/X1+Y+Z1+Z2×100〔%〕 ここで、問題なのは、占有要求のあるSTが、
POLパターンを検知し、これをRSVパターンに
書き換える為に、各STでPOLパターン分だけ遅
らせなければならないことである。 占有要求のあるSTのみがPOLパターンを遅ら
せ、占有要求のないSTはPOLパターンをそのま
ま中継遅れなく下流回線に送る方式をとると、伝
送中のデータに混乱が生ずるため、これは実現で
きない。この為、各STでの中継遅れは、それぞ
れ累積されるので、Z1、Z2が大きく、これが伝
送効率を悪くする原因となつている。 これらは、ビツト伝送速度が遅く、データ長が
短く、且つST数が多い場合に、顕著となる。 本発明の目的は、STでの中継遅れをなくし、
伝導効率の高いループ式データウエイシステムの
回線制御方法を提供するにある。 本発明の特徴は、他のSTの占有要求を問合せ
する為の問合せフレームを、問合せ部と宣言部で
構成し、各STは、上流回線から入力する問合せ
部のビツトパターンを受信しながら、順次遅延な
く下流回線に再生中継し、占有要求のあるSTは、
問合せ部を受信したあと、該宣言部の位置に占有
の宣言パターン(RSV)を先行書込みして下流
回線に送出し、問合せ部に続いて上流回線から入
力する宣言部の内容により優先制御を行うように
していることである。 占有の宣言を先行書込みしたSTは、宣言部の
受信データが、未占有であれば占有権を獲得した
と判断し、又既に占有済みであれば占有権を獲得
できなかつたと判断する。 この場合、占有権を獲得したと判断したSTは、
RSVパターンに続いてDATAの送信を行う。 本発明による回線制御方法を実現するSTの一
実施例ブロツク図を第4図に、そのタイムチヤー
トを第5図に示している。 第4図において、受信回路9は、上流回線(伝
送路)からのデータを入力し、その出力7aを復
調回路11、クロツク再生回路12に入力させ
る。同時に、出力7aは、同期回路20で同期が
とられ、セレクタ21、送信回路10を介して下
流回線に送出される。 この為、上流回線からのデータは、ほとんど遅
延なく下流回線に送出される。 復調回路11の出力7c、及びクロツク再生回
路12の出力受信クロツク7bはシフトレジスタ
22へ入力される。 受信データ7aにPOLパターンが来てシフト
レジスタ22へ所定ビツト数入力されると比較器
24はこれを検出する。送信要求があれば、制御
回路27は、制御回路29からの送信要求7eに
よつて、オアゲート30を介してセレクタ21を
切り換え、又RSVパターンジエネレータ32を
イネーブル(EN)とし、セレクタ31、変調回
路13を介してRSVパターンを順次送出する。 これは、受信データのPOLパターンを遅れな
く再生中継し、その後引き続き、自STにて発生
させたRSVパターンを挿入したことになる。 更にPOLパターンは、シフトレジスタ23へ
シフトされ、比較器26にてPOLパターンが検
出され、この時、比較器25にてRSVの空きパ
ターンが検出されると、占有権を獲得したと判断
し、制御回路28によりセレクタ21を自ST送
信モードへ切り換え、且つセレクタ31により自
STの送信DATAを変調回路13へ入力し、下流
回線へ送出する。 比較器25にて検出したパターンが、既に占有
済みのパターン(RSV)であれば、占有権を獲
得できなかつたものと判断し、制御回路28によ
りセレクタ21を同期回路20の出力を選ぶ中継
モードとなる。 第5図のタイムチヤートから明らかな様に、受
信データaから送信データ7i迄の中継遅れ時間
は、同期回路20による再同期のための遅れだけ
であり(1ビツト間隔以内)、POLパターン分
(第5図では8ビツト間隔分)の遅延が必要な従
来例に比べ大幅に短縮されている。 従来例を示す第2図に対応する本発明の図面を
第6図に示している。 第2図と第6図を比較すると、従来の問合せフ
レーム(POL)が本発明では、問合せ部P(POL
パターン)と宣言部Sから構成されていること
と、本発明においては、問合せ部Pおよび宣言部
Sは、それぞれ各STを特別に遅らせることなく
再生中継されていることである。 本発明においては問合せフレームが問合せ部P
と宣言部Sから構成されるため、X2のごとく第
2図のX1に比べ長くなつているが、再生中継遅
れがなくなつているので、Z3、Z4の部分が小さ
くなり、データの伝送効率が向上していることが
理解できる。 尚第6図の実施例では、ST3は、DATAの送
信終了後、一巡して来たDATAを受信してから
POLパターンを送出している例を示しているが、
DATAの送信終了後直ちにPOLパターンを送出
しても良い。 第7図は、本発明になる回線制御手順のフロー
チヤートを整理して示している。 前回の送信STは、データ送信終了後、POLパ
ターン、未占有パターン(宣言部Sのパターン)
を送出し、回線を解放するが、通常、各STは、
これを単に再生中継し、POLパターンを検出し
たならば、送信要求(回線の占有要求と同じ意
味)があるかどうかを判断し、要求のないSTは
単に受信データリピートモードへ移行する。 送信要求のあるSTは、当該宣言部Sの位置に、
RSVパターンを先行書込みし、その後受信する
上流STの占有表示が、既に占有済みかを検出し、
占有されていれば回線を占有できないとして受信
データリピートモードへ移行する。 未だ占有されていない場合だけ、自STのデー
タの送信を始め、終了したならばPOL、未占有
パターンを送出し回線の占有権を解放する。 本発明による回線制御方法と従来例の回線制御
方法を次のような条件下で比較すると、伝送効率
は次表の通りとなる。 (1) 伝送速度 1Mbps (2) ループ長全長 500m (3) データ長 64〜512バイト (4) ST台数 最大64台
【表】
このように、従来例では、ST台数を30台から
64台に増加させると伝送効率は54%から40%に大
幅低下するが、本発明では各STでの中継遅れが
ほとんどないので、同一条件では、74%から72%
へ、わずか2%低下するのみである。 また本発明によれば、同じST台数、データ長
の場合、従来例に比べ大幅に伝送効率を向上させ
ることができる。
64台に増加させると伝送効率は54%から40%に大
幅低下するが、本発明では各STでの中継遅れが
ほとんどないので、同一条件では、74%から72%
へ、わずか2%低下するのみである。 また本発明によれば、同じST台数、データ長
の場合、従来例に比べ大幅に伝送効率を向上させ
ることができる。
第1図は、本発明が適用される一般的なループ
式データウエイシステムの一実施例図、第2図
は、従来例の伝送手順の1つを示すタイムチヤー
ト、第3図は、一般的なDATAのフレーム構成
を示す図、第4図は、本発明の回線制御方法を実
現するステーシヨンの一実施例ブロツク図、第5
図は、第4図の動作説明用のタイムチヤート、第
6図は、本発明による伝送手順を第2図に対応さ
せて示した図、第7図は、本発明による回線制御
手順のフローを整理して示した図である。 9……受信回路、10……送信回路、11……
復調回路、12……クロツク再生回路、13……
変調回路、20……同期回路、21,31……セ
レクタ、22,23……シフトレジスタ、24〜
26……比較器、27〜29……制御回路、32
……RSVパターンジエネレータ。
式データウエイシステムの一実施例図、第2図
は、従来例の伝送手順の1つを示すタイムチヤー
ト、第3図は、一般的なDATAのフレーム構成
を示す図、第4図は、本発明の回線制御方法を実
現するステーシヨンの一実施例ブロツク図、第5
図は、第4図の動作説明用のタイムチヤート、第
6図は、本発明による伝送手順を第2図に対応さ
せて示した図、第7図は、本発明による回線制御
手順のフローを整理して示した図である。 9……受信回路、10……送信回路、11……
復調回路、12……クロツク再生回路、13……
変調回路、20……同期回路、21,31……セ
レクタ、22,23……シフトレジスタ、24〜
26……比較器、27〜29……制御回路、32
……RSVパターンジエネレータ。
Claims (1)
- 1 それぞれ計算機や各種端末装置が接続されて
なる複数個のステーシヨンと、該複数個のステー
シヨンをループ状に縦続接続させる回線とを備
え、各ステーシヨンは、回線の占有要求を問合せ
する問合せフレームに応答するループ式データウ
エイシステムの回線制御方法において、該問合せ
フレームを問合せ部と宣言部で構成し、占有要求
のない各ステーシヨンは、上流回線から入力する
ビツトパターンを下流回線に中継し、占有要求の
あるステーシヨンは、問合せ部の中継後、中継動
作をやめて、該宣言部の位置に占有の宣言パター
ンを書き込んで下流回線に送出し、占有の宣言パ
ターンを送出したステーシヨンのうち、問合せ部
に続いて上流回線から入力する宣言部の内容が、
回線の未占有状態のパターンを受けたステーシヨ
ンのみが、自ステーシヨンのデータを引きつづき
送出する動作を行うことを特徴とするループ式デ
ータウエイシステムの回線制御方法。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56104483A JPS586637A (ja) | 1981-07-06 | 1981-07-06 | ル−プ式デ−タウエイシステムの回線制御方法 |
EP82106006A EP0069382B1 (en) | 1981-07-06 | 1982-07-05 | Loop type data highway system |
DE8282106006T DE3267151D1 (en) | 1981-07-06 | 1982-07-05 | Loop type data highway system |
US06/395,327 US4510494A (en) | 1981-07-06 | 1982-07-06 | Loop type data highway system |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56104483A JPS586637A (ja) | 1981-07-06 | 1981-07-06 | ル−プ式デ−タウエイシステムの回線制御方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS586637A JPS586637A (ja) | 1983-01-14 |
JPH0151221B2 true JPH0151221B2 (ja) | 1989-11-02 |
Family
ID=14381801
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP56104483A Granted JPS586637A (ja) | 1981-07-06 | 1981-07-06 | ル−プ式デ−タウエイシステムの回線制御方法 |
Country Status (4)
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- 1981-07-06 JP JP56104483A patent/JPS586637A/ja active Granted
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1982
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- 1982-07-06 US US06/395,327 patent/US4510494A/en not_active Expired - Lifetime
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Also Published As
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US4510494A (en) | 1985-04-09 |
JPS586637A (ja) | 1983-01-14 |
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EP0069382A1 (en) | 1983-01-12 |
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