JPS5848925B2 - スロット・アクセス・デ−タ転送方式 - Google Patents
スロット・アクセス・デ−タ転送方式Info
- Publication number
- JPS5848925B2 JPS5848925B2 JP9505176A JP9505176A JPS5848925B2 JP S5848925 B2 JPS5848925 B2 JP S5848925B2 JP 9505176 A JP9505176 A JP 9505176A JP 9505176 A JP9505176 A JP 9505176A JP S5848925 B2 JPS5848925 B2 JP S5848925B2
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- Japan
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- transmission line
- frame
- data
- loop
- circuit
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Description
【発明の詳細な説明】
この発明は複数の計算機と端末装置を伝送線路とのイン
タフェース回路を介して環状（ループ状）に接続し、こ
のインタフェース回路の制御により計算機および端末装
置が一定長に分割されたタイムスロットを使用してデー
タ通信を行うループ伝送システムのデータ転送方式に関
するものである。
タフェース回路を介して環状（ループ状）に接続し、こ
のインタフェース回路の制御により計算機および端末装
置が一定長に分割されたタイムスロットを使用してデー
タ通信を行うループ伝送システムのデータ転送方式に関
するものである。
従来からループ伝送システムには、その制御形態から
（イ） １つの中央計算機の制御のもとに複数端末装置
とのデータ通信を行う中央集中制御方式（口）任意の計
算機間で対等にデータ通信を行う分散制御方式 があり、そのデータ転送方式には ←→ 送信すべきデータをブロックに分散しそのブロッ
クの区切りを識別するコードを付加して転送するブロッ
ク転送方式 （ニ）時間を一定長に分割したタイムスロットを使用し
てデータの転送を行うスロット・アクセス方式 があり、このスロット・アクセス方式にはタイムスロッ
トを特定の計算機または端末装置ごとに固定的に割付け
他の計算機および端末装置からは使用できない固定アク
セス方式と空きのタイムスロットはいずれの計算機また
は端末装置からも自由に使用しデータ転送を行うランダ
ム・アクセス方式がある。
とのデータ通信を行う中央集中制御方式（口）任意の計
算機間で対等にデータ通信を行う分散制御方式 があり、そのデータ転送方式には ←→ 送信すべきデータをブロックに分散しそのブロッ
クの区切りを識別するコードを付加して転送するブロッ
ク転送方式 （ニ）時間を一定長に分割したタイムスロットを使用し
てデータの転送を行うスロット・アクセス方式 があり、このスロット・アクセス方式にはタイムスロッ
トを特定の計算機または端末装置ごとに固定的に割付け
他の計算機および端末装置からは使用できない固定アク
セス方式と空きのタイムスロットはいずれの計算機また
は端末装置からも自由に使用しデータ転送を行うランダ
ム・アクセス方式がある。
フロック転送方式は転送効率は優れているが制御が複雑
になる欠点があり、スロット・アクセス方式は制御が比
較的簡単ではあるが特に固定スロット方式においては転
送効率が悪くなる欠点がある。
になる欠点があり、スロット・アクセス方式は制御が比
較的簡単ではあるが特に固定スロット方式においては転
送効率が悪くなる欠点がある。
また計算機または端末装置が伝送線路に接続される中継
点での中継方式には （力 磁気的結合により信号抽出する無再生中継方式 （ハ）信号の波形、レベルなどの整形や整形された信号
をシフトレジスタへ挿入する再生中継方式がある。
点での中継方式には （力 磁気的結合により信号抽出する無再生中継方式 （ハ）信号の波形、レベルなどの整形や整形された信号
をシフトレジスタへ挿入する再生中継方式がある。
しかし信号再生中継方式は伝送線路長を大きくすること
が可能であるが、中継点での信号の遅延が生じる欠点が
ある。
が可能であるが、中継点での信号の遅延が生じる欠点が
ある。
また無再生中継方式は中継点での信号の遅延は無いが信
号の減衰により線路長を大きくできない。
号の減衰により線路長を大きくできない。
従来からループ伝送システムに対する諸要求、諸条件か
らこれらの方式を組み合わせているか、スロットアクセ
ス方式に対してはスロットの制御、管理が必要なためシ
ステム中の計算機および端末装置の総数に応じてタイム
スロット数およびフレーム長を設定しなげればならない
欠点があった。
らこれらの方式を組み合わせているか、スロットアクセ
ス方式に対してはスロットの制御、管理が必要なためシ
ステム中の計算機および端末装置の総数に応じてタイム
スロット数およびフレーム長を設定しなげればならない
欠点があった。
この発明はスロット・アクセス方式において伝送線路に
計算機および端末装置を接続する場合、各計算機・端末
装置がテータの転送に使用する複数の連続したタイムス
ロットで構成されるフレーム長をその総数応じて自動的
に変え効率的なデータ転送を行うものである。
計算機および端末装置を接続する場合、各計算機・端末
装置がテータの転送に使用する複数の連続したタイムス
ロットで構成されるフレーム長をその総数応じて自動的
に変え効率的なデータ転送を行うものである。
以下では説明を簡単にするために、集中制御方式、固定
アクセス方式について詳細を説明する。
アクセス方式について詳細を説明する。
第１図はループ伝送システムの構成図で、１は中央計算
機、２はループシステムの制御を行うループ・コントロ
ール・ユニット（以下ＬＣＵと呼ぶ）、３は計算機１と
ＬＣＵ２を結合しデータ転送のための情報交換を行うチ
ャネル、４は伝送線路上の信号に符号化および復号化す
るための回路、５は計算機および端末装置をループ状に
接続する伝送線路、６はＬＣＵ２から送られて来た情報
により端末装置を制御するためのステーション・ユニッ
ト（以下ＳＵと呼ぶ）、７は端末装置である。
機、２はループシステムの制御を行うループ・コントロ
ール・ユニット（以下ＬＣＵと呼ぶ）、３は計算機１と
ＬＣＵ２を結合しデータ転送のための情報交換を行うチ
ャネル、４は伝送線路上の信号に符号化および復号化す
るための回路、５は計算機および端末装置をループ状に
接続する伝送線路、６はＬＣＵ２から送られて来た情報
により端末装置を制御するためのステーション・ユニッ
ト（以下ＳＵと呼ぶ）、７は端末装置である。
第２図はＬＣＵ２の構成要素を示したもので、８はＬＣ
Ｕ２が計算機１のチャネルを介してデータおよびステー
タスの転送を行うための制御回路、９は各端末装置７に
対するデータ入出力制御を行うための制御語が格納され
ている記憶回路、１０はＬＣＵ２を制御する回路（以下
ＬＣＷと呼ぶ）でＬＣＵ２の中枢部であり、記憶回路９
に格納された各ＬＣＷを参照し計算機１と端末装置７と
の間で行われるデータ転送制御とループシステムの管理
を行い、１１はＳＵ６にデータを転送するために送信デ
ータの並列一直列変換を行う送信制御回路、１２はＳＵ
６から転送されて来た受信データの直列一並列変換を行
う受信制御回路である。
Ｕ２が計算機１のチャネルを介してデータおよびステー
タスの転送を行うための制御回路、９は各端末装置７に
対するデータ入出力制御を行うための制御語が格納され
ている記憶回路、１０はＬＣＵ２を制御する回路（以下
ＬＣＷと呼ぶ）でＬＣＵ２の中枢部であり、記憶回路９
に格納された各ＬＣＷを参照し計算機１と端末装置７と
の間で行われるデータ転送制御とループシステムの管理
を行い、１１はＳＵ６にデータを転送するために送信デ
ータの並列一直列変換を行う送信制御回路、１２はＳＵ
６から転送されて来た受信データの直列一並列変換を行
う受信制御回路である。
第３図は端末装置７とループとのインタフェースである
ＳＵ６の構成図で、１３は上位のＳＵ６から送られて来
たデータを復号化した信号を直列一並列変換および下位
のＳＵ６へ送るデータの並列一直列変換を行う回路、１
４はＳＵ６と端末装置７とのデータ転送を制御する回路
、１５は直列並列変換回路１３で得られたデータのうち
自局宛てのデータを取り込む回路、１６は受信したデー
タの誤り検出を行いＬＣＵ２に返送する受信データに対
するステータスを作成する回路、１７は端末装置７との
データ転送のインタフェースで、１８は端末装置７ヘデ
ータを送信する回路、１９は端末装置７からデータを受
信する回路である。
ＳＵ６の構成図で、１３は上位のＳＵ６から送られて来
たデータを復号化した信号を直列一並列変換および下位
のＳＵ６へ送るデータの並列一直列変換を行う回路、１
４はＳＵ６と端末装置７とのデータ転送を制御する回路
、１５は直列並列変換回路１３で得られたデータのうち
自局宛てのデータを取り込む回路、１６は受信したデー
タの誤り検出を行いＬＣＵ２に返送する受信データに対
するステータスを作成する回路、１７は端末装置７との
データ転送のインタフェースで、１８は端末装置７ヘデ
ータを送信する回路、１９は端末装置７からデータを受
信する回路である。
第４図はＬＣＵ２とＳＵＧ間のデータ転送および制御情
報を転送するために各ＳＵ６ごとに固定的に割り付けら
れたタイムスロットの構成図で、２０はタイムスロット
、２１はタイムスロットの種類の指示やその他ＳＵ６や
端末装置７を制御するコントロール・フィールド、２２
はテータヤステータスの転送に用いられるデータ・フィ
ールドである。
報を転送するために各ＳＵ６ごとに固定的に割り付けら
れたタイムスロットの構成図で、２０はタイムスロット
、２１はタイムスロットの種類の指示やその他ＳＵ６や
端末装置７を制御するコントロール・フィールド、２２
はテータヤステータスの転送に用いられるデータ・フィ
ールドである。
第５図はＬＣＵ２で制御・管理されるフレームの構或で
、２２は各端末装置に固定的に割付けられたタイムスロ
ット列のフレームで２４はフレームの開始を識別するた
めの１タイムスロット長からなる同期信号である。
、２２は各端末装置に固定的に割付けられたタイムスロ
ット列のフレームで２４はフレームの開始を識別するた
めの１タイムスロット長からなる同期信号である。
ＬＣＵ２から送出されたフレームは各ＳＵ６で同期信号
を検出し、自ＳＵに割り付けられたタイムスロットにつ
いてのみスロットをアクセスする。
を検出し、自ＳＵに割り付けられたタイムスロットにつ
いてのみスロットをアクセスする。
第６図はＬＣＵ２から送出されたフレームが各ＳＵ５を
経由してループ状の伝送線路を一周し再びＬＣＵ２に到
着するまでのタイムチャートを示しており、各ＳＵ６で
は直列一並列変換回路１３にシフトレジスタを用いて再
生中継を行いシフトレジスタのビット数分の時間だけ遅
延して送出される。
経由してループ状の伝送線路を一周し再びＬＣＵ２に到
着するまでのタイムチャートを示しており、各ＳＵ６で
は直列一並列変換回路１３にシフトレジスタを用いて再
生中継を行いシフトレジスタのビット数分の時間だけ遅
延して送出される。
この直列一並列変換回路１３において遅延時間と１タイ
ムスロット長を一致させておくと、ＬＣＵの送信制御回
路１１から送出された同期信号２４が再び受信制御回路
１２に到着する時刻と送信制御回路１１からフレームの
最後のタイムスロット２０を送出する時刻が一致し、同
期信号を完全に受信終了した時刻には１フレームの送出
も完了しているためこの時刻に次のフレーム送出の起動
をかげる。
ムスロット長を一致させておくと、ＬＣＵの送信制御回
路１１から送出された同期信号２４が再び受信制御回路
１２に到着する時刻と送信制御回路１１からフレームの
最後のタイムスロット２０を送出する時刻が一致し、同
期信号を完全に受信終了した時刻には１フレームの送出
も完了しているためこの時刻に次のフレーム送出の起動
をかげる。
一般には伝送線路における信号の伝送遅延と符号・復号
化回路４における信号抽出による遅延のため第６図ｄよ
り少し時間の遅れた同図ｅとなるが、フレーム間でこの
遅延時間分の時間補正を行うことにより次のフレームの
送出時刻がこの補正時間だけ遅れるだけで何んら問題と
はならない。
化回路４における信号抽出による遅延のため第６図ｄよ
り少し時間の遅れた同図ｅとなるが、フレーム間でこの
遅延時間分の時間補正を行うことにより次のフレームの
送出時刻がこの補正時間だけ遅れるだけで何んら問題と
はならない。
ＬＣＵ２においてフレーム長および次のフレームの送出
時刻をカウンタあるいはタイマーにより認識する方法も
考えられるが、この方法では端末装置の総数に応じてカ
ウンタやタイマーの値をそのたびに設定しフレーム長や
送信時刻を制御しなげればならない。
時刻をカウンタあるいはタイマーにより認識する方法も
考えられるが、この方法では端末装置の総数に応じてカ
ウンタやタイマーの値をそのたびに設定しフレーム長や
送信時刻を制御しなげればならない。
また端末装置の総数に関係なくフレーム長を固定値に設
定しておくと各端末装置とのデータ転送は非効率的であ
り、この発明によるＬＣＵ２の受信制御回路１２で同期
信号を検出後ただちに送信制御回路１１にフレーム送出
開始の起動をかげることにより冗長度の少い制御回路が
構成され効率的なデータ伝送システムが実現できる。
定しておくと各端末装置とのデータ転送は非効率的であ
り、この発明によるＬＣＵ２の受信制御回路１２で同期
信号を検出後ただちに送信制御回路１１にフレーム送出
開始の起動をかげることにより冗長度の少い制御回路が
構成され効率的なデータ伝送システムが実現できる。
以上のように、この発明による伝送線路に接続された中
継点で生じる遅延時間を利用し、ループ状線路を一周し
た同期信号を受信制御回路で検知した後、次のフレーム
の送出を開始する方式によれば、ループ伝送システム中
の計算機、端末装置の総数に応じて自動的にフレーム長
を変え効率のよいデータ転送が実現される。
継点で生じる遅延時間を利用し、ループ状線路を一周し
た同期信号を受信制御回路で検知した後、次のフレーム
の送出を開始する方式によれば、ループ伝送システム中
の計算機、端末装置の総数に応じて自動的にフレーム長
を変え効率のよいデータ転送が実現される。
【図面の簡単な説明】
第１図はループ伝送システム構成図、第２図はループ・
コントロール・ユニットの構成図、第３図はステーショ
ン・ユニットの構成図、第４図はタイムスロットの形式
図、第５図はフレームの構或図、第６図は送出されたフ
レームが伝送線路を一周して再び到着するまでのタイム
チャート図である。 図中、１は中央計算機、２はループ・コントロール・ユ
ニツ｝ＬＣＵ，３はチャネル、４は符号・復号化回路、
５は伝送線路、６はステーション・ユニツ｝ＳＵ、７は
端末装置、８はチャネル制御回路、９は記憶回路、１０
はＬＣＵ制御回路、１１は送信制御回路、１２は受信制
御回路、１３は直一並列変換回路、１４はＳＵ制御回路
、１５は並列データ取込み回路、１６は誤り検出回路、
１７は端末装置インタフェース回路、１８はデータ送出
回路、１９はデータ受信回路、２０はタイムスロット、
２１はコントロール・フィールド、２２はデータ・フィ
ールド、２３はフレーム、２４は同期信号である。 なお図中、同一あるいは相当部分には同一符号を付して
示してある。
コントロール・ユニットの構成図、第３図はステーショ
ン・ユニットの構成図、第４図はタイムスロットの形式
図、第５図はフレームの構或図、第６図は送出されたフ
レームが伝送線路を一周して再び到着するまでのタイム
チャート図である。 図中、１は中央計算機、２はループ・コントロール・ユ
ニツ｝ＬＣＵ，３はチャネル、４は符号・復号化回路、
５は伝送線路、６はステーション・ユニツ｝ＳＵ、７は
端末装置、８はチャネル制御回路、９は記憶回路、１０
はＬＣＵ制御回路、１１は送信制御回路、１２は受信制
御回路、１３は直一並列変換回路、１４はＳＵ制御回路
、１５は並列データ取込み回路、１６は誤り検出回路、
１７は端末装置インタフェース回路、１８はデータ送出
回路、１９はデータ受信回路、２０はタイムスロット、
２１はコントロール・フィールド、２２はデータ・フィ
ールド、２３はフレーム、２４は同期信号である。 なお図中、同一あるいは相当部分には同一符号を付して
示してある。
Claims (1)
- １ 複数の計算機および端末装置を伝送線路とのインタ
フェース回路を介して環状に接続し、固定長に分割され
たタイムスロットを利用し、伝送線路を共有してデータ
転送を行うループ伝送システムにおいて、一定長に分割
し複数個連続したタイムスロットとその開始情報として
同期信号を付加したフレームを、伝送線路に計算機およ
び端末装置を接続するための中継装置で１タイムスロッ
ト分の時間を遅延させて、ループ状線路を一周し戻って
来た同期信号を検知した後、次のフレームの送出を開始
することにより、ループ状伝送線路に接続された計算機
および端末装置の総数に応じて自動的にフレーム長を設
定することを特徴とするスロット・アクセス・データ転
送方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9505176A JPS5848925B2 (ja) | 1976-08-10 | 1976-08-10 | スロット・アクセス・デ−タ転送方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9505176A JPS5848925B2 (ja) | 1976-08-10 | 1976-08-10 | スロット・アクセス・デ−タ転送方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5320744A JPS5320744A (en) | 1978-02-25 |
| JPS5848925B2 true JPS5848925B2 (ja) | 1983-11-01 |
Family
ID=14127247
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9505176A Expired JPS5848925B2 (ja) | 1976-08-10 | 1976-08-10 | スロット・アクセス・デ−タ転送方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5848925B2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE3201401A1 (de) * | 1982-01-19 | 1983-07-28 | Otto Bihler Maschinenfabrik GmbH & Co KG, 8959 Trauchgau | Verfahren zum bilden eines pakets von stanzplatinen, insbesondere fuer funkenloeschzwecke und bandstanz- und stanzplatinenpaketierungsmaschine zur durchfuehrung dieses verfahrens |
| JPS62257239A (ja) * | 1986-05-01 | 1987-11-09 | Toyota Central Res & Dev Lab Inc | 車両用デ−タ伝送システム |
-
1976
- 1976-08-10 JP JP9505176A patent/JPS5848925B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5320744A (en) | 1978-02-25 |
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