JPH01286046A - マイクロコンピュータ及びマイクロコンピュータを内蔵したicカード - Google Patents
マイクロコンピュータ及びマイクロコンピュータを内蔵したicカードInfo
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- JPH01286046A JPH01286046A JP63114709A JP11470988A JPH01286046A JP H01286046 A JPH01286046 A JP H01286046A JP 63114709 A JP63114709 A JP 63114709A JP 11470988 A JP11470988 A JP 11470988A JP H01286046 A JPH01286046 A JP H01286046A
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- 238000010586 diagram Methods 0.000 description 5
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
- G06K19/00—Record carriers for use with machines and with at least a part designed to carry digital markings
- G06K19/06—Record carriers for use with machines and with at least a part designed to carry digital markings characterised by the kind of the digital marking, e.g. shape, nature, code
- G06K19/067—Record carriers with conductive marks, printed circuits or semiconductor circuit elements, e.g. credit or identity cards also with resonating or responding marks without active components
- G06K19/07—Record carriers with conductive marks, printed circuits or semiconductor circuit elements, e.g. credit or identity cards also with resonating or responding marks without active components with integrated circuit chips
- G06K19/0701—Record carriers with conductive marks, printed circuits or semiconductor circuit elements, e.g. credit or identity cards also with resonating or responding marks without active components with integrated circuit chips at least one of the integrated circuit chips comprising an arrangement for power management
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- G06K19/07—Record carriers with conductive marks, printed circuits or semiconductor circuit elements, e.g. credit or identity cards also with resonating or responding marks without active components with integrated circuit chips
- G06K19/073—Special arrangements for circuits, e.g. for protecting identification code in memory
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(産業上の利用分野)
この発明はICカードに搭載されるマイクロコンピュー
タに関する。特にICカードをカードリーグに挿入して
データの伝達を行う際に、電源・又はグランド端子の浮
きによって生じるマイクロコンピュータの異常動作を防
止することにある。
タに関する。特にICカードをカードリーグに挿入して
データの伝達を行う際に、電源・又はグランド端子の浮
きによって生じるマイクロコンピュータの異常動作を防
止することにある。
(従来の技術)
ICカードは、ICチップを内蔵したカードであシ、そ
の表面には、通常数個の端子パッドが設けられている。
の表面には、通常数個の端子パッドが設けられている。
ICカードはカードリーダを介して、ICチップ内のマ
イクロコンピュータと情報の伝達が行なわれるが、これ
は、一般にICカード表面の端子が、カードリーダの端
子と機械的に接触することによって行なわれる。第2図
は従来のICカード用マイクロコン、ピユータの入力回
路の回路図である。VDDI 、 RES 2 、 C
LK 3 、5IO4゜GND 5はICカード表面に
設けられた端子である。
イクロコンピュータと情報の伝達が行なわれるが、これ
は、一般にICカード表面の端子が、カードリーダの端
子と機械的に接触することによって行なわれる。第2図
は従来のICカード用マイクロコン、ピユータの入力回
路の回路図である。VDDI 、 RES 2 、 C
LK 3 、5IO4゜GND 5はICカード表面に
設けられた端子である。
vDDlは、電源端子であり、カードリーダより +5
Vの電源をICチップに供給するものである。RES
2は、マイクロコンピュータをリセットする信号の入力
端子である。この信号によシマイクロコンピュータは停
止する。CLK 3は、カートリーグよりマイクロコン
ピュータにクロック信号を供給する端子である。SIO
4は、ICカードのマイクロコンピュータとカードリー
ダの間で情報を授受するシリアル入出力端子である。G
ND 5は、カードリーダよりOv即ち、グランドをI
Cチップに供給する端子である。保護抵抗6は、ダイオ
ード7とあいまって、ICチップを静電破壊より保護す
る保護回路を形成する。このような、0MO8で構成さ
れたICカード用マイクロコンピュータの入力保護回路
は広く知られた極めて一般的なものである(例えば、特
公昭48−30189号公報参照)。
Vの電源をICチップに供給するものである。RES
2は、マイクロコンピュータをリセットする信号の入力
端子である。この信号によシマイクロコンピュータは停
止する。CLK 3は、カートリーグよりマイクロコン
ピュータにクロック信号を供給する端子である。SIO
4は、ICカードのマイクロコンピュータとカードリー
ダの間で情報を授受するシリアル入出力端子である。G
ND 5は、カードリーダよりOv即ち、グランドをI
Cチップに供給する端子である。保護抵抗6は、ダイオ
ード7とあいまって、ICチップを静電破壊より保護す
る保護回路を形成する。このような、0MO8で構成さ
れたICカード用マイクロコンピュータの入力保護回路
は広く知られた極めて一般的なものである(例えば、特
公昭48−30189号公報参照)。
(発明が解決しようとする課題)
xc−h−rにおいては、VDDI 、 GND 5の
電源及びグランド端子には、ICカードをカードリーグ
に挿入することにより、カードリーグの端子と機械的に
接触して電源及びグランド電位がICチップに供給され
、マイクロコンピュータが本来動作可能となる。しかし
ながら、ICチップが0MO8で構成されている場合に
は、ICカードがカードリーグに挿入されて、VDDI
又はGND 5の端子がカードリーグの端子と接触せず
浮いた状態になった場合に、即ち、電源の供給が不完全
な状態ではICチップのマイクロコンピュータが暴走し
、重要なEEPROM 、 KPROM等のデータを破
壊する現象がある。何故ならば、vDDl、GND5の
端子が浮いていても、RES 2 、 CLK 3 、
SIO4の端子が、カードリーグの端子と接触してい
れば、これらの端子を介して、カードリーグより+5V
、OVの電圧がICチップに与えられ、保護抵抗6、ダ
イオード7を通して、vDDlには高電圧が、GND
5には低電圧が与えられる。これによりマイコンが一応
動作可能となる。しかし、このような状態で印加される
電源電圧は、保護抵抗・6、保護ダイオード7で電圧が
低下したものであり、且つ不安定な状態であり、マイク
ロコンピュータを暴走させICチップ内のF:、EPR
OM 等のデータを誤書込み、誤読出しを引起すことが
ある。
電源及びグランド端子には、ICカードをカードリーグ
に挿入することにより、カードリーグの端子と機械的に
接触して電源及びグランド電位がICチップに供給され
、マイクロコンピュータが本来動作可能となる。しかし
ながら、ICチップが0MO8で構成されている場合に
は、ICカードがカードリーグに挿入されて、VDDI
又はGND 5の端子がカードリーグの端子と接触せず
浮いた状態になった場合に、即ち、電源の供給が不完全
な状態ではICチップのマイクロコンピュータが暴走し
、重要なEEPROM 、 KPROM等のデータを破
壊する現象がある。何故ならば、vDDl、GND5の
端子が浮いていても、RES 2 、 CLK 3 、
SIO4の端子が、カードリーグの端子と接触してい
れば、これらの端子を介して、カードリーグより+5V
、OVの電圧がICチップに与えられ、保護抵抗6、ダ
イオード7を通して、vDDlには高電圧が、GND
5には低電圧が与えられる。これによりマイコンが一応
動作可能となる。しかし、このような状態で印加される
電源電圧は、保護抵抗・6、保護ダイオード7で電圧が
低下したものであり、且つ不安定な状態であり、マイク
ロコンピュータを暴走させICチップ内のF:、EPR
OM 等のデータを誤書込み、誤読出しを引起すことが
ある。
(課題を解決するだめの手段)
以上の課題を解決するために、ICカードをカードリー
グに挿入して信号の伝達を行うに際して、ICカードの
電源端子又はグランド端子が浮いていることを検出する
手段と、マイクロコンピュータをリセットする手段とを
ICカード知内蔵されたマイクロコンピュータに設けた
ものである。
グに挿入して信号の伝達を行うに際して、ICカードの
電源端子又はグランド端子が浮いていることを検出する
手段と、マイクロコンピュータをリセットする手段とを
ICカード知内蔵されたマイクロコンピュータに設けた
ものである。
(作用)
ICカードをカードリーグに挿入して、電源端子又はグ
ランド端子のコンタクトが不十分な場合には、その他の
端子から電圧が印加されることにより、電源又はグラン
ドの浮きが検出され、マイクロコンピュータにリセット
信号が印加される。
ランド端子のコンタクトが不十分な場合には、その他の
端子から電圧が印加されることにより、電源又はグラン
ドの浮きが検出され、マイクロコンピュータにリセット
信号が印加される。
これによりマイクロコンピュータは動作が停止するので
、マイクロコンピュータの暴走、EEPROM。
、マイクロコンピュータの暴走、EEPROM。
EPROM等のデータの破壊等を未然に防止するもので
ある。
ある。
(実施例)
第1図は、本発明の一実施例のマイクロコンピュータの
入力回路の回路図である。電源端子又はグランド端子の
浮きを検出する手段は、以下の回路要素より構成される
。第1図において、8゜10.12は2段直列接続のダ
イオードである。
入力回路の回路図である。電源端子又はグランド端子の
浮きを検出する手段は、以下の回路要素より構成される
。第1図において、8゜10.12は2段直列接続のダ
イオードである。
ダイオードの電位低下は1段当シ約0.5 Vであシ、
2段で約1.OVとなる。今、vDDlが浮いており、
RES 2 、 GND 5は、完全にコンタクトして
おり、各々+5V 、 OVであるとする。Pチャネル
トランジスタTRIのソースの電位は、リセット線21
より +5Vであり、電源線20の電位は約+4vであ
るので、f−)の電位は4vとなシ、Pチャネルトラン
ジスタTRIは、ON状態となる。尚R1,Tlは静電
気に対する保護回路を形成する。このようにTRJがO
N状態となることは、vDDlの電位が少なくともRE
S 2の電位よりも、ダイオード−段分、約0.5 V
低いことを意味し、VDDIの端子の浮きが検出された
ことになる・。
2段で約1.OVとなる。今、vDDlが浮いており、
RES 2 、 GND 5は、完全にコンタクトして
おり、各々+5V 、 OVであるとする。Pチャネル
トランジスタTRIのソースの電位は、リセット線21
より +5Vであり、電源線20の電位は約+4vであ
るので、f−)の電位は4vとなシ、Pチャネルトラン
ジスタTRIは、ON状態となる。尚R1,Tlは静電
気に対する保護回路を形成する。このようにTRJがO
N状態となることは、vDDlの電位が少なくともRE
S 2の電位よりも、ダイオード−段分、約0.5 V
低いことを意味し、VDDIの端子の浮きが検出された
ことになる・。
また、この回路は、電源およびグランド端子が完全に接
続されているときに、vDDlの電位がREs 2の電
位よりもTR1のスレッショルド電位分低下した場合に
も、TRIがON状態となシ、VDDlの電位低下を検
出することができる。
続されているときに、vDDlの電位がREs 2の電
位よりもTR1のスレッショルド電位分低下した場合に
も、TRIがON状態となシ、VDDlの電位低下を検
出することができる。
次に、グランド端子の浮きの検出は、TR,?によって
行う。GND 5が完全に浮いており、CLK 3には
、正常にカードリーグの端子よ、9+5V、OVの電位
がクロックとして入っているものとする。
行う。GND 5が完全に浮いており、CLK 3には
、正常にカードリーグの端子よ、9+5V、OVの電位
がクロックとして入っているものとする。
vDDlも正常に、+5Vの電位が入っていると仮定す
る。NチャネルトランジスタTR2のドレインには、v
DDlよシ、+5Vの電位が与えられ、ソースには、C
LK 3より、クロックがOvの時にOvの電位が与え
られる。グランド線22の電位は、CLK 3がOv−
の時、ダイオード11の一段分約0.5Vとなる。従っ
て、TR2の基板電位は、0.5v程度となる。TR2
のダート線23の電位は、抵抗R2,R3の分圧比で決
まり、 R2:R3キ9:1 とすると、グランド線22より約O,S Vとなる。
る。NチャネルトランジスタTR2のドレインには、v
DDlよシ、+5Vの電位が与えられ、ソースには、C
LK 3より、クロックがOvの時にOvの電位が与え
られる。グランド線22の電位は、CLK 3がOv−
の時、ダイオード11の一段分約0.5Vとなる。従っ
て、TR2の基板電位は、0.5v程度となる。TR2
のダート線23の電位は、抵抗R2,R3の分圧比で決
まり、 R2:R3キ9:1 とすると、グランド線22より約O,S Vとなる。
グランド線22は、前述より、クロック線24に対して
、約0.5 V高いので、TR2のダート電位は、ソー
スに対して、約+1vとなシ、TR2は導通状態となる
。即ち、GND 5の浮きが検出される。尚、GND
5の端子が正常にカードリーグにコンタクトしており、
Ovであるときは、f−)線23の電位は概略+0.5
であシ、TR15はOFF状態である。
、約0.5 V高いので、TR2のダート電位は、ソー
スに対して、約+1vとなシ、TR2は導通状態となる
。即ち、GND 5の浮きが検出される。尚、GND
5の端子が正常にカードリーグにコンタクトしており、
Ovであるときは、f−)線23の電位は概略+0.5
であシ、TR15はOFF状態である。
尚、キャパシターC1はレベル安定用コンデンサーであ
り、抵抗R4,R5はレベル安定用抵抗である。
り、抵抗R4,R5はレベル安定用抵抗である。
インバータINVは、TR2がON状態となった時に@
1#を出力し、NORデート16によシTRJの出力と
NOR論理をとり、この出力でフリップフロップ17を
セットすることによりリセット信号が生じ。
1#を出力し、NORデート16によシTRJの出力と
NOR論理をとり、この出力でフリップフロップ17を
セットすることによりリセット信号が生じ。
これによシ、マイクロコンピュータの動作が停止する。
即ち、TRI又はTR,?、あるいはその双方がON状
態になったことによシ、電源端子vDD1又はグランド
端子GND 5のいずれか、あるいはその双方の浮きが
検出され、RESET信号が生じる。
態になったことによシ、電源端子vDD1又はグランド
端子GND 5のいずれか、あるいはその双方の浮きが
検出され、RESET信号が生じる。
(発明の効果)
ICカード用マイクロコン・ピユータにはJ2PROM
。
。
EPROMやRAMが内蔵されておシ、これらは、正常
な電源が与えられないと、読出し又は書込の際に誤動作
を生じることがある。本発明によれば、ICカードをカ
ードリーグに挿入して、情報の授受を行うに際して、電
源の浮きを検出して、リセット信号を生成することによ
り、マイクロコンビ、ユータの動作を停止するものであ
る。従って、ICカードのマイクロコンピュータの暴走
、EEPROM等のデータの誤書込、誤読出しを防止す
ることができる。
な電源が与えられないと、読出し又は書込の際に誤動作
を生じることがある。本発明によれば、ICカードをカ
ードリーグに挿入して、情報の授受を行うに際して、電
源の浮きを検出して、リセット信号を生成することによ
り、マイクロコンビ、ユータの動作を停止するものであ
る。従って、ICカードのマイクロコンピュータの暴走
、EEPROM等のデータの誤書込、誤読出しを防止す
ることができる。
第1図は本発明の一実施例のICカード用マイクロコン
ピュータの入力回路の回路図、第2図は従来のICカー
ド用マイクロコンピュータの入力回路の回路図である。 1−VDD端子、2 ・RES端子、3−CLK端子、
4・・・SIO端子、5・・・GND端子、8,10.
12・・・2段直列接続ダイオード、9,11.13・
・・1段のダイオード、16・・・NORダート、17
・・・RSフリップフロップ、20・・・電源線、21
・・・リセット線、22・・・グランド線、23・・・
r−ト線、24・・・クロック線、TR1・・・Pチャ
ネルトランジスタ、TR,?・・・Nチャネルトランジ
スタ、TRj・・・保護用トランジスタ。 特許出願人 沖電気工業株式会社 棧禾。入77回路 第2図
ピュータの入力回路の回路図、第2図は従来のICカー
ド用マイクロコンピュータの入力回路の回路図である。 1−VDD端子、2 ・RES端子、3−CLK端子、
4・・・SIO端子、5・・・GND端子、8,10.
12・・・2段直列接続ダイオード、9,11.13・
・・1段のダイオード、16・・・NORダート、17
・・・RSフリップフロップ、20・・・電源線、21
・・・リセット線、22・・・グランド線、23・・・
r−ト線、24・・・クロック線、TR1・・・Pチャ
ネルトランジスタ、TR,?・・・Nチャネルトランジ
スタ、TRj・・・保護用トランジスタ。 特許出願人 沖電気工業株式会社 棧禾。入77回路 第2図
Claims (1)
- ICカードをカードリーダに挿入して信号の伝達を行
うに際して、ICカードの電源端子又はグランド端子が
浮いていることを検出する手段と、該検出によってマイ
クロコンピュータをリセットする手段とを具備したこと
を特徴とするICカード用マイクロコンピュータ。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63114709A JP2563475B2 (ja) | 1988-05-13 | 1988-05-13 | マイクロコンピュータ及びマイクロコンピュータを内蔵したicカード |
US07/347,390 US4990760A (en) | 1988-05-13 | 1989-05-04 | IC card having means for protecting erroneous operation |
DE68918747T DE68918747T2 (de) | 1988-05-13 | 1989-05-11 | IC-Karte mit Sicherungsmitteln gegen fehlerhaften Betrieb. |
EP89108481A EP0341712B1 (en) | 1988-05-13 | 1989-05-11 | IC card having means for protecting erroneous operation |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63114709A JP2563475B2 (ja) | 1988-05-13 | 1988-05-13 | マイクロコンピュータ及びマイクロコンピュータを内蔵したicカード |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH01286046A true JPH01286046A (ja) | 1989-11-17 |
JP2563475B2 JP2563475B2 (ja) | 1996-12-11 |
Family
ID=14644660
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63114709A Expired - Lifetime JP2563475B2 (ja) | 1988-05-13 | 1988-05-13 | マイクロコンピュータ及びマイクロコンピュータを内蔵したicカード |
Country Status (4)
Country | Link |
---|---|
US (1) | US4990760A (ja) |
EP (1) | EP0341712B1 (ja) |
JP (1) | JP2563475B2 (ja) |
DE (1) | DE68918747T2 (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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US8983421B2 (en) | 2005-11-25 | 2015-03-17 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor device and operating method thereof |
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JPH0366420U (ja) * | 1989-10-31 | 1991-06-27 | ||
FR2654235B1 (fr) * | 1989-11-07 | 1992-01-17 | Europ Rech Electr Lab | Lecteur de carte a circuit integre a contacts. |
US5625593A (en) * | 1990-03-28 | 1997-04-29 | Mitsubishi Denki Kabushiki Kaisha | Memory card circuit with separate buffer chips |
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