JPH0127325Y2 - - Google Patents
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- Publication number
- JPH0127325Y2 JPH0127325Y2 JP11691083U JP11691083U JPH0127325Y2 JP H0127325 Y2 JPH0127325 Y2 JP H0127325Y2 JP 11691083 U JP11691083 U JP 11691083U JP 11691083 U JP11691083 U JP 11691083U JP H0127325 Y2 JPH0127325 Y2 JP H0127325Y2
- Authority
- JP
- Japan
- Prior art keywords
- flip
- flop
- frequency
- horizontal
- output
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 claims description 8
- 230000010355 oscillation Effects 0.000 claims description 8
- 238000010586 diagram Methods 0.000 description 2
- TVEXGJYMHHTVKP-UHFFFAOYSA-N 6-oxabicyclo[3.2.1]oct-3-en-7-one Chemical compound C1C2C(=O)OC1C=CC2 TVEXGJYMHHTVKP-UHFFFAOYSA-N 0.000 description 1
- 238000000926 separation method Methods 0.000 description 1
Landscapes
- Synchronizing For Television (AREA)
- Pulse Circuits (AREA)
- Manipulation Of Pulses (AREA)
Description
【考案の詳細な説明】
(イ) 産業上の利用分野
本考案は、テレビ受像機又はCRTデイスプレ
イに最適な水平発振回路に関する。
イに最適な水平発振回路に関する。
(ロ) 従来例
通常ブラウン管（CRT）を用いた表示装置と
してのテレビ受像機又はキヤラクタデイスプレイ
等の水平偏向回路は、同期分離回路によつて同期
分離された水平同期信号とフライバツクパルスを
AFC回路に印加し次段の水平発振回路を動作さ
せ、所定の周波数即ち水平発振周波数（H＝
15.734KHz）を生成している。斯る水平信号を水
平駆動回路を介して水平出力回路に加え、水平出
力トランス（フライバツクトランス）及び水平偏
向コイルに前記Hなる周波数の水平電流を供給す
る。
してのテレビ受像機又はキヤラクタデイスプレイ
等の水平偏向回路は、同期分離回路によつて同期
分離された水平同期信号とフライバツクパルスを
AFC回路に印加し次段の水平発振回路を動作さ
せ、所定の周波数即ち水平発振周波数（H＝
15.734KHz）を生成している。斯る水平信号を水
平駆動回路を介して水平出力回路に加え、水平出
力トランス（フライバツクトランス）及び水平偏
向コイルに前記Hなる周波数の水平電流を供給す
る。
ところが近年集積回路（IC）化が進み、各種
偏向回路においてもバイポーラICで、更にIIL
（I2Lとも呼ばれる）の技術が採用され始め、これ
にデイジタル技術が応用されている。
偏向回路においてもバイポーラICで、更にIIL
（I2Lとも呼ばれる）の技術が採用され始め、これ
にデイジタル技術が応用されている。
そこで第１図に示す如く、水平周波数Hの32倍
即ち32Hなる周波数の信号を発生する基準信号発
生回路１の出力を分周回路２初段のＴフリツプフ
ロツプ３に加え、Ｔフリツプフロツプ４，５，
６，７で次々に1/32分周する構成が提案されてい
る。これによれば、前記分周回路２をＴフリツプ
フロツプ（Ｆ−Ｆ）を５段縦接続し、基準信号発
生回路１のO（＝32H第３図イから順次Q1，Q2，
Q3，Q4，Q5にて1/2づつ分周（第３図ロ〜ヘ）さ
れ、基本周波数Hが得られる。
即ち32Hなる周波数の信号を発生する基準信号発
生回路１の出力を分周回路２初段のＴフリツプフ
ロツプ３に加え、Ｔフリツプフロツプ４，５，
６，７で次々に1/32分周する構成が提案されてい
る。これによれば、前記分周回路２をＴフリツプ
フロツプ（Ｆ−Ｆ）を５段縦接続し、基準信号発
生回路１のO（＝32H第３図イから順次Q1，Q2，
Q3，Q4，Q5にて1/2づつ分周（第３図ロ〜ヘ）さ
れ、基本周波数Hが得られる。
ところが前記第１図に示す従来例では、単に1/
２分周を繰返す構成であり、第３図ヘに示される
ように、デユーテイが50％になつているので、第
５段目のフリツプフロツプQ5に水平駆動段を介
して接続された水平出力段が、ダンパー期間から
切換わるタイミングで正確にその切換が行われな
い欠点が生じた。
２分周を繰返す構成であり、第３図ヘに示される
ように、デユーテイが50％になつているので、第
５段目のフリツプフロツプQ5に水平駆動段を介
して接続された水平出力段が、ダンパー期間から
切換わるタイミングで正確にその切換が行われな
い欠点が生じた。
(ハ) 考案の目的
本考案は、前記欠点を除いた新規な水平発振回
路を提供するもので、特に基準信号発生回路から
生成した水平同期信号Hのデユーテイを50％より
小に規制することを目的とする。
路を提供するもので、特に基準信号発生回路から
生成した水平同期信号Hのデユーテイを50％より
小に規制することを目的とする。
(ニ) 考案の構成
本考案は、水平周波数Hの32倍の周波数の信号
を発生する基準信号発生回路と、該基準信号発生
回路の出力信号を1/32分周する複数の縦続接続さ
れたＴフリツプフロツプから成る1/32分周回路
と、該1/32分周回路の最終段のＴフリツプフロツ
プの３段前のＴフリツプフロツプの出力端がクロ
ツク入力端子に接続されかつ前記1/32分周回路の
最終段のＴフリツプフロツプの出力端がデータ入
力端子に接続されたＤフリツプフロツプと、該Ｄ
フリツプフロツプ及び前記1/32分周回路の最終段
のＴフリツプフロツプの出力端がその入力端に接
続されたANDゲートより成る構成である。
を発生する基準信号発生回路と、該基準信号発生
回路の出力信号を1/32分周する複数の縦続接続さ
れたＴフリツプフロツプから成る1/32分周回路
と、該1/32分周回路の最終段のＴフリツプフロツ
プの３段前のＴフリツプフロツプの出力端がクロ
ツク入力端子に接続されかつ前記1/32分周回路の
最終段のＴフリツプフロツプの出力端がデータ入
力端子に接続されたＤフリツプフロツプと、該Ｄ
フリツプフロツプ及び前記1/32分周回路の最終段
のＴフリツプフロツプの出力端がその入力端に接
続されたANDゲートより成る構成である。
(ホ) 実施例
図面に従つて本考案を説明すると、第２図が本
考案の一実施例を示し、第１図と同一素子につい
ては、同一図番を用いてあり、本考案は第１図と
異なり、第２段目のFF４の出力端Q2を第６段目
のDFF８のクロツク入力端Ｃに接続すると共に
前記第５段目の出力端Q5及び第６段目の出力端
Q6をANDゲート用トランジスタ９のベースに接
続する。このとき第５段目の出力端Q5は、第６
段目に接続したDFF８のデータ入力端Ｄに接続
されており、その出力端Q6は第３図ハの第２段
目Q2のQ2出力をクロツクとし、タイミングt1の
次のタイミングt2にて立上り、タイミングt3の次
のタイミングt4にて立下る。
考案の一実施例を示し、第１図と同一素子につい
ては、同一図番を用いてあり、本考案は第１図と
異なり、第２段目のFF４の出力端Q2を第６段目
のDFF８のクロツク入力端Ｃに接続すると共に
前記第５段目の出力端Q5及び第６段目の出力端
Q6をANDゲート用トランジスタ９のベースに接
続する。このとき第５段目の出力端Q5は、第６
段目に接続したDFF８のデータ入力端Ｄに接続
されており、その出力端Q6は第３図ハの第２段
目Q2のQ2出力をクロツクとし、タイミングt1の
次のタイミングt2にて立上り、タイミングt3の次
のタイミングt4にて立下る。
従つて第３図ヘ及びトより、Q5出力とQ6出力
は前記ANDゲート用トランジスタ９のベースに
加わり、タイミングt2で立上り、タイミングt3で
立下る波形（第３図チVOが前記トランジスタ９
のコレクタより得られ、駆動及び出力段１０に加
わり、水平偏向回路として所定の動作が行われ
る。
は前記ANDゲート用トランジスタ９のベースに
加わり、タイミングt2で立上り、タイミングt3で
立下る波形（第３図チVOが前記トランジスタ９
のコレクタより得られ、駆動及び出力段１０に加
わり、水平偏向回路として所定の動作が行われ
る。
ここで水平同期信号の周波数をHとし、前記基
準信号発生回路１の発振周波数を32Hとし、その
周期をT32 Hとすると T32 H＝1/32H Q1出力の周期TQ1は TQ1＝2T32 H＝１／16H となり、同様にQ2出力の周期TQ2は TQ2＝2TQ1＝１／8H となる。又Q5出力の正パルス幅はQ5出力の周期
TQ5の1/2となり TQ5／２＝１／２・32T32 H＝１／2H 従つて出力VOのパルス幅TVOを求めると、 TVO＝TQ5／２−TQ2 ＝１／2H−１／8H ＝３／8H となる。
準信号発生回路１の発振周波数を32Hとし、その
周期をT32 Hとすると T32 H＝1/32H Q1出力の周期TQ1は TQ1＝2T32 H＝１／16H となり、同様にQ2出力の周期TQ2は TQ2＝2TQ1＝１／8H となる。又Q5出力の正パルス幅はQ5出力の周期
TQ5の1/2となり TQ5／２＝１／２・32T32 H＝１／2H 従つて出力VOのパルス幅TVOを求めると、 TVO＝TQ5／２−TQ2 ＝１／2H−１／8H ＝３／8H となる。
いまH＝15.734KHzに設定すると（32H≒
503.5KHz）、 ｛TQ5／２＝１／2H＝31.8μs TVO＝３／8H＝23.8μs｝ となつて第３図チに示す出力VOのデユーテイは TVO／TQ5＝23.8／63.6 ＝37.4％ から37.4％になつて、50％より小とすることが
できる。
503.5KHz）、 ｛TQ5／２＝１／2H＝31.8μs TVO＝３／8H＝23.8μs｝ となつて第３図チに示す出力VOのデユーテイは TVO／TQ5＝23.8／63.6 ＝37.4％ から37.4％になつて、50％より小とすることが
できる。
(ヘ) 考案の効果
本考案の水平発振回路によれば、従来の様に基
準信号発生回路からの基準信号を1/32分周すると
き、水平同期信号として得たHなる信号のデユー
テイを前述の様に37.4％＜50％に設定することが
でき、ダンパー期間から水平出力トランジスタの
切換が正確に行われ難い欠点を除去でき、本考案
はテレビ受像機、CRTデイスプレイ装置に極め
て有用である。
準信号発生回路からの基準信号を1/32分周すると
き、水平同期信号として得たHなる信号のデユー
テイを前述の様に37.4％＜50％に設定することが
でき、ダンパー期間から水平出力トランジスタの
切換が正確に行われ難い欠点を除去でき、本考案
はテレビ受像機、CRTデイスプレイ装置に極め
て有用である。
第１図は従来の水平発振回路、第２図は本考案
の同回路、第３図は本考案回路の説明波形図を示
す。 主な図番の説明、１……基準信号発生回路、２
……分周回路、３，４，５，６，７……Ｔフリツ
プフロツプ、８……Ｄフリツプフロツプ、９……
ANDゲート用トランジスタ、１０……水平駆動
及び出力段。
の同回路、第３図は本考案回路の説明波形図を示
す。 主な図番の説明、１……基準信号発生回路、２
……分周回路、３，４，５，６，７……Ｔフリツ
プフロツプ、８……Ｄフリツプフロツプ、９……
ANDゲート用トランジスタ、１０……水平駆動
及び出力段。
Claims (1)
- 水平周波数Hの32倍の周波数の信号を発生する
基準信号発生回路と、該基準信号発生回路の出力
信号を1/32分周する複数の縦続接続されたＴフリ
ツプフロツプから成る1/32分周回路と、該1/32分
周回路の最終段のＴフリツプフロツプの３段前の
Ｔフリツプフロツプの出力端がクロツク入力端子
に接続されかつ前記1/32分周回路の最終段のＴフ
リツプフロツプの出力端がデータ入力端子に接続
されたＤフリツプフロツプと、該Ｄフリツプフロ
ツプ及び前記1/32分周回路の最終段のＴフリツプ
フロツプの出力端がその入力端に接続された
ANDゲートより成り、該ANDゲートの出力端よ
りデユーテイが50％より小の水平周波数Hなる信
号を導出することを特徴とした水平発振回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11691083U JPS6025278U (ja) | 1983-07-26 | 1983-07-26 | 水平発振回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11691083U JPS6025278U (ja) | 1983-07-26 | 1983-07-26 | 水平発振回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6025278U JPS6025278U (ja) | 1985-02-20 |
| JPH0127325Y2 true JPH0127325Y2 (ja) | 1989-08-15 |
Family
ID=30269322
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11691083U Granted JPS6025278U (ja) | 1983-07-26 | 1983-07-26 | 水平発振回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6025278U (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63284922A (ja) * | 1987-05-15 | 1988-11-22 | Fujitsu Ltd | パルス発生回路 |
-
1983
- 1983-07-26 JP JP11691083U patent/JPS6025278U/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6025278U (ja) | 1985-02-20 |
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