JPH01241988A - ディジタルａｇｃ回路 - Google Patents
ディジタルａｇｃ回路Info
- Publication number
- JPH01241988A JPH01241988A JP7039488A JP7039488A JPH01241988A JP H01241988 A JPH01241988 A JP H01241988A JP 7039488 A JP7039488 A JP 7039488A JP 7039488 A JP7039488 A JP 7039488A JP H01241988 A JPH01241988 A JP H01241988A
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- JP
- Japan
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- multiplier
- output
- input
- selector
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- Prior art date
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- Pending
Links
- 238000001514 detection method Methods 0.000 description 11
- 238000010586 diagram Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 2
- 238000000034 method Methods 0.000 description 1
Landscapes
- Television Receiver Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〈産業上の利用分野〉
本発明はディジタルＡＧＣ回路に関し、特にはビデオ信
号をディジタル処理する時のＡＧＣ回路構成に関するも
のである。
号をディジタル処理する時のＡＧＣ回路構成に関するも
のである。
〈従来の技術〉
ビデオ信号を処理する回路としていわゆるＡＧＣ回路な
るものがあることはよく知られている。従来この回路と
しては一般的に第３図の示すように乗算器１の出力をレ
ベル検出器２で検出して乗算器１にフィードバックする
構成がよく用いられる。
るものがあることはよく知られている。従来この回路と
しては一般的に第３図の示すように乗算器１の出力をレ
ベル検出器２で検出して乗算器１にフィードバックする
構成がよく用いられる。
〈発明が解決しようとする問題点〉
ここで、フィルタが配置される場合には第３図の乗算器
１の規模を小さくすることが可能である。
１の規模を小さくすることが可能である。
一般にディジタル信号処理では、その回路の大きさがア
ナログ回路に比べてきわめて大きくなるため少しでも回
路を小さくする工夫が必要不可欠である。
ナログ回路に比べてきわめて大きくなるため少しでも回
路を小さくする工夫が必要不可欠である。
本発明は、以上の点にかんがみ、ＡＧＣ回路のＩ）、
乗算器の規模をトさくしようとするものである。
〈問題点を解決するための手段〉
ＡＧＣ回路の前又は後にディジタルフィルタを配置し、
該ディジタルフィルタの出力端にセレクタを設け、ＡＧ
Ｃの倍率が２以上になった時、セレクタによりビットシ
フトを行なうことにより乗算器の倍率が２以下でもＡＧ
Ｃ動作を可能として、上記乗算器の回路規模を小さくす
る。
該ディジタルフィルタの出力端にセレクタを設け、ＡＧ
Ｃの倍率が２以上になった時、セレクタによりビットシ
フトを行なうことにより乗算器の倍率が２以下でもＡＧ
Ｃ動作を可能として、上記乗算器の回路規模を小さくす
る。
〈発明の作用〉
乗算器への入力信号をビットシフトさせることにより最
大２倍迄の小規模の乗算器で所期のＡＧＣ特性を得るこ
とができる。
大２倍迄の小規模の乗算器で所期のＡＧＣ特性を得るこ
とができる。
〈実施例〉
本発明の基本構成の一例を第１図に示す。入力はディジ
タルフィルタ（以下ＬＰＦと称す）３に加えられると同
時に、第ルベル検出４にも加えられる。ＬＰＦ３は例え
ばデータ８ビツト、係数８ビツト、出力２０ビツトであ
るとする。ＬＰＦ３の出力はセレクタ５に入力される。
タルフィルタ（以下ＬＰＦと称す）３に加えられると同
時に、第ルベル検出４にも加えられる。ＬＰＦ３は例え
ばデータ８ビツト、係数８ビツト、出力２０ビツトであ
るとする。ＬＰＦ３の出力はセレクタ５に入力される。
セレクタ５は第２レベル検出７により、セレクタ５の出
力のＭＳＢ（最上位桁）が空でないように入力レベルの
大きさに合わせてＬＰＦ３の出力を選択する。
力のＭＳＢ（最上位桁）が空でないように入力レベルの
大きさに合わせてＬＰＦ３の出力を選択する。
これにより、セレクタ５の出力では伝送される全ビット
が有効に利用されることになる。これを乗算器６に入力
する。乗算器６のもう一方の入力には、乗算器６の出力
レベルを第２レベル検出７にて検出したデータが加えら
れる。これによりセレクタ５よりの入力が小さくなって
も第２レベル検出７まりの信号が大きくなり、出力は一
定になる。
が有効に利用されることになる。これを乗算器６に入力
する。乗算器６のもう一方の入力には、乗算器６の出力
レベルを第２レベル検出７にて検出したデータが加えら
れる。これによりセレクタ５よりの入力が小さくなって
も第２レベル検出７まりの信号が大きくなり、出力は一
定になる。
本実施例では、入力のレベルが２分の１以下となった時
、２ｎ倍の動作（ｎ＝１．２．ｊ・・・）を第ルベル検
出４とセレクタ５で行ない、その後１〜２−％１倍の動
作（ｍは第２レベル検出７の出力データピット数）を行
なって出力のレベルを一定に保っている。
、２ｎ倍の動作（ｎ＝１．２．ｊ・・・）を第ルベル検
出４とセレクタ５で行ない、その後１〜２−％１倍の動
作（ｍは第２レベル検出７の出力データピット数）を行
なって出力のレベルを一定に保っている。
上記実施例を第４図に示す如く乗算器１の前段に単にＬ
ＰＦを設けただけのＡＧＣ回路の例と比べると、ＡＧＣ
１８倍の場合、乗算器６は本実施例では１０×８ビツト
構成で済むのに対して第４図では１０Ｘ１３ビツトが必
要になり、第２レベル検出７は、本実施例では入力１８
ビツト出力８ビツトなのに対して第４図では入力１８ビ
ツトが必要になる。
ＰＦを設けただけのＡＧＣ回路の例と比べると、ＡＧＣ
１８倍の場合、乗算器６は本実施例では１０×８ビツト
構成で済むのに対して第４図では１０Ｘ１３ビツトが必
要になり、第２レベル検出７は、本実施例では入力１８
ビツト出力８ビツトなのに対して第４図では入力１８ビ
ツトが必要になる。
一方、本実施例ではセレクタ５と第ルベル検出４が増加
するがセレクタ５は単なるゲートであり、又第ルベル検
出４は入力８ビツト、出力３ビツトで良く、これによる
回路増はわずかである。
するがセレクタ５は単なるゲートであり、又第ルベル検
出４は入力８ビツト、出力３ビツトで良く、これによる
回路増はわずかである。
従って、上記構成では回路をかなり小さくでき、その効
果は大である。
果は大である。
上記ＡＧＣ回路を通用したディジタルビデオカメラの構
成の一例を第２図に示す。これは、白黒ビデオカメラの
構成の一例を示すものでＣＣＤｌ０より出力された映像
信号ばＣＤＳ・アンプ１１でＣＤＳ処ＢＩＩびＡＤコン
バータ１２の入力に合うようにレベル調整され、ＡＤコ
ンバータ１２によりディジタル信号に変換される。
成の一例を第２図に示す。これは、白黒ビデオカメラの
構成の一例を示すものでＣＣＤｌ０より出力された映像
信号ばＣＤＳ・アンプ１１でＣＤＳ処ＢＩＩびＡＤコン
バータ１２の入力に合うようにレベル調整され、ＡＤコ
ンバータ１２によりディジタル信号に変換される。
そして、ＬＰＦ３、セレクタ５、第ルベル検出４、第２
レベル検出７乗算器６から成るＡＧＣ回路により、ＡＧ
Ｃ特性を得てガンマ１３に入力される。ディジタル信号
はガンマ１３によりレベル特性を補正後、アパーチャ１
４により輪郭成分を強調しＤＡコンバータ１５によりア
ナログ信号に変換されてカメラ出力信号が形成される。
レベル検出７乗算器６から成るＡＧＣ回路により、ＡＧ
Ｃ特性を得てガンマ１３に入力される。ディジタル信号
はガンマ１３によりレベル特性を補正後、アパーチャ１
４により輪郭成分を強調しＤＡコンバータ１５によりア
ナログ信号に変換されてカメラ出力信号が形成される。
〈効 果〉
以上本発明によれば、簡単な構成を付加するのみで、デ
ィジタル信号処理におけるＡＧＣ回路を構成することが
でき、映像信号等におけるディジタル回路設計を容易に
することができ、各種機器のディジタル信号処理化を促
進することができる。
ィジタル信号処理におけるＡＧＣ回路を構成することが
でき、映像信号等におけるディジタル回路設計を容易に
することができ、各種機器のディジタル信号処理化を促
進することができる。
第１図は本発明によるＡＧＣ回路の一大施例を示す図、
第２図は同実施例をビデオカメラに適用した例を示す図
、第３図及び第４図は従来のＡＧＣ回路を示す図である
。 ３：ＬＰＦ、 ４：第２レベル検出７、 ５：セレク
タ、 ６：乗算器、 ７：第２レベル検出器。
第２図は同実施例をビデオカメラに適用した例を示す図
、第３図及び第４図は従来のＡＧＣ回路を示す図である
。 ３：ＬＰＦ、 ４：第２レベル検出７、 ５：セレク
タ、 ６：乗算器、 ７：第２レベル検出器。
Claims (1)
- １、ＡＧＣ特性を与える回路の入力側又は出力側の少な
くとも一方にディジタルフィルタを設け、該ディジタル
フィルタの出力に対してビットシフトを施こすセレクタ
を設けてなることを特徴とするディジタルＡＧＣ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7039488A JPH01241988A (ja) | 1988-03-23 | 1988-03-23 | ディジタルａｇｃ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7039488A JPH01241988A (ja) | 1988-03-23 | 1988-03-23 | ディジタルａｇｃ回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01241988A true JPH01241988A (ja) | 1989-09-26 |
Family
ID=13430186
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7039488A Pending JPH01241988A (ja) | 1988-03-23 | 1988-03-23 | ディジタルａｇｃ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01241988A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5394194A (en) * | 1992-02-07 | 1995-02-28 | Matsushita Electric Industrial Co., Ltd. | Gain control circuit and gradation correcting apparatus |
-
1988
- 1988-03-23 JP JP7039488A patent/JPH01241988A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5394194A (en) * | 1992-02-07 | 1995-02-28 | Matsushita Electric Industrial Co., Ltd. | Gain control circuit and gradation correcting apparatus |
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