JPH01235341A - 半導体部品の実装方法 - Google Patents
半導体部品の実装方法Info
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- JPH01235341A JPH01235341A JP6231088A JP6231088A JPH01235341A JP H01235341 A JPH01235341 A JP H01235341A JP 6231088 A JP6231088 A JP 6231088A JP 6231088 A JP6231088 A JP 6231088A JP H01235341 A JPH01235341 A JP H01235341A
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- Japan
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- semiconductor component
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 53
- 238000000034 method Methods 0.000 claims abstract description 13
- 238000005476 soldering Methods 0.000 claims description 5
- 238000004026 adhesive bonding Methods 0.000 claims 1
- 229910000679 solder Inorganic materials 0.000 description 16
- 238000010586 diagram Methods 0.000 description 6
- 230000012447 hatching Effects 0.000 description 2
- 244000171726 Scotch broom Species 0.000 description 1
- 238000009933 burial Methods 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 238000006073 displacement reaction Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 239000000463 material Substances 0.000 description 1
- 230000001105 regulatory effect Effects 0.000 description 1
- 230000000007 visual effect Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/30—Assembling printed circuits with electric components, e.g. with resistor
- H05K3/303—Surface mounted components, e.g. affixing before soldering, aligning means, spacing means
Landscapes
- Wire Bonding (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
CIA要〕
半導体部品等をフェイスダウンではんだ付けして実装す
る場合に半導体部品等を位置決めする方法に関し、 実装の際の半導体部品の位置決めを作業性良く、しかも
精度良く行なえるようにすることを目的とし、 半導体部品をフェイスダウンではんだ付けして実装する
方法において、複数のルーティングガイドを、プリント
板上の半導体部品実装予定部を囲む位置に接着固定して
先付けし、上記半導体部品を上記先付けされたルーティ
ングガイドの間にはめ込んで位置決めするように構成す
る。
る場合に半導体部品等を位置決めする方法に関し、 実装の際の半導体部品の位置決めを作業性良く、しかも
精度良く行なえるようにすることを目的とし、 半導体部品をフェイスダウンではんだ付けして実装する
方法において、複数のルーティングガイドを、プリント
板上の半導体部品実装予定部を囲む位置に接着固定して
先付けし、上記半導体部品を上記先付けされたルーティ
ングガイドの間にはめ込んで位置決めするように構成す
る。
本発明11半導体部品等をフェイスダウンではんだ付け
して実装する場合に半導体部品等を位置決めする方法に
関する。
して実装する場合に半導体部品等を位置決めする方法に
関する。
下面にはんだバンブを有する半導体装置は、はんだバン
ブをプリント板上のパッドとフェイスダウンではんだ付
けされて実装される。従って半導体装置を載置するとき
に、フェイスダウンの状態にありはんだバンブ及びパッ
ドが共に見にくい状態にあるが、各はんだバンブがパッ
ドに対向するように精度良く位置合せする必要がある。
ブをプリント板上のパッドとフェイスダウンではんだ付
けされて実装される。従って半導体装置を載置するとき
に、フェイスダウンの状態にありはんだバンブ及びパッ
ドが共に見にくい状態にあるが、各はんだバンブがパッ
ドに対向するように精度良く位置合せする必要がある。
(111来の技術〕
第6図は従来の実装方法を示す図である。
1は半導体部品であり、矩形板状のパッケージ2の下面
にはんだバンブ3を複数設けてなる構成である。
にはんだバンブ3を複数設けてなる構成である。
4はプリント板であり、この上面のうら実装部分に複数
のパッド5が形成しである。
のパッド5が形成しである。
はんだバンブ3とパッド5とは同じ配列である。
6は位置合せ用の鏡枠であり、4枚の細長状の鎮7−1
〜7−4を略45度に傾斜させて、上記パッケージ2よ
り−まわり大きい枠状としたものである。
〜7−4を略45度に傾斜させて、上記パッケージ2よ
り−まわり大きい枠状としたものである。
半導体部品1を実装する場合には、第1図に示寸ように
、鏡枠6を装置1を実装しようとする場所を囲むように
プリント板4上に載置し、この状態で部品1を載置する
。
、鏡枠6を装置1を実装しようとする場所を囲むように
プリント板4上に載置し、この状態で部品1を載置する
。
このとき、第7図に示すように、鏡7−I〜7−4を利
用して、はんだバンブ3及びパッド5をtIg認し、各
はんだバンブ3がパッド5に対応するように位置合ゼし
て部品1を載置する。
用して、はんだバンブ3及びパッド5をtIg認し、各
はんだバンブ3がパッド5に対応するように位置合ゼし
て部品1を載置する。
この後、リフロー炉を通して部品1は半田付けされて実
装される。
装される。
(発明が解決しようとする課題)
位置合ゼは、鏡7−1〜7−4をのぞき込んで目視で行
なっているため、時間がかかり過ぎ、作業性が悪い。
なっているため、時間がかかり過ぎ、作業性が悪い。
また各部品1について位置決めのばらつきが生じてしま
う。
う。
史には、載置した後、半田付けされるまでの間に部品1
が位置ずれを起こす虞れもあった。
が位置ずれを起こす虞れもあった。
本発明は実装の際の半導体部品の位置決めを作業性良く
、しかも精度良く行なうことのできる半導体部品の実装
方法を提供することを目的とする。
、しかも精度良く行なうことのできる半導体部品の実装
方法を提供することを目的とする。
本発明は、半導体部品をフェイスダウンではんだ付けし
て実装する方法において、 複数のルーティングガイドを、プリント板上の半導体部
品実装予定部を囲む位置に接着固定して先付けし、 上記半導体部品を上記先付けされたルーティングガイド
の間にはめ込んで位置決めする構成としたものである。
て実装する方法において、 複数のルーティングガイドを、プリント板上の半導体部
品実装予定部を囲む位置に接着固定して先付けし、 上記半導体部品を上記先付けされたルーティングガイド
の間にはめ込んで位置決めする構成としたものである。
(作用〕
半導体部品をルーティングガイド間にはめ込む作業は簡
単であり、半導体部品のプリント基板上における位置決
めは作業性良く行なわれる。
単であり、半導体部品のプリント基板上における位置決
めは作業性良く行なわれる。
しかも位置決め精度のばらつきは少なく、位置決め精度
は一定となる。
は一定となる。
次に本発明の一実施例になる半導体部品の実装り法につ
いて、第1図乃〒第4図を参照して説明する。各図中、
第6図に示す構成部分と同一構成部分には同一符号を何
す。
いて、第1図乃〒第4図を参照して説明する。各図中、
第6図に示す構成部分と同一構成部分には同一符号を何
す。
まず、第4図に示すように、プリント板4上に位置決め
用治具板10を位置合せして載置し、これを利用してル
ーティングガイド11−1〜11−4を先付けする。
用治具板10を位置合せして載置し、これを利用してル
ーティングガイド11−1〜11−4を先付けする。
ガイド11−1は、半導体部品の」−すの位置決めに適
するように、四方に腕部11−+a〜11−+dを有す
るクロス形状である。隣り合う腕部が開き角が90度の
1字状をなし、後述するように、この部分が半導体部品
の・−のコーナを位置決めする。
するように、四方に腕部11−+a〜11−+dを有す
るクロス形状である。隣り合う腕部が開き角が90度の
1字状をなし、後述するように、この部分が半導体部品
の・−のコーナを位置決めする。
各腕部11−+ a 〜11−+ dには満12が形成
してあり、1512はクロス状をなし、ワイヤを配線す
る場合にワイヤをガイドする。
してあり、1512はクロス状をなし、ワイヤを配線す
る場合にワイヤをガイドする。
他のガイド11−2〜11−4も上記のガイド11−1
と同じ寸法形状を有する。
と同じ寸法形状を有する。
また、ガイド11−1〜11−4は、はんだのりフロー
炉内の温度に耐えうる耐熱性を有する材料製である。
炉内の温度に耐えうる耐熱性を有する材料製である。
治具板10には、上記のガイドに対応するクロス状の孔
13−1〜13−4が形成しである。孔13−1〜13
−4の位置は、8孔13−1〜13−4を通る線により
囲まれるハツチングを付して示す部分14が上記部品1
のパッケージ2と同じサイズとなるように定めである。
13−1〜13−4が形成しである。孔13−1〜13
−4の位置は、8孔13−1〜13−4を通る線により
囲まれるハツチングを付して示す部分14が上記部品1
のパッケージ2と同じサイズとなるように定めである。
治具板10は、プリント板4に対しては、上記部分14
がプリント板4上の半導体部品実装予定部15(第1図
中ハツチングを付して示す)と−致するように位置合せ
する。
がプリント板4上の半導体部品実装予定部15(第1図
中ハツチングを付して示す)と−致するように位置合せ
する。
次に、第4図に示すように、ガイド11−1〜11−4
を夫々孔13−1〜13−4内に嵌合させて、プリント
板4上に接着固定して先付けする。
を夫々孔13−1〜13−4内に嵌合させて、プリント
板4上に接着固定して先付けする。
ガイド11−1〜11−4は夫々孔13−1〜13−4
に嵌合して位置決めされているため、ガイド11−1〜
11−4はプリント板4上の所定位置に精度良く固定さ
れる。
に嵌合して位置決めされているため、ガイド11−1〜
11−4はプリント板4上の所定位置に精度良く固定さ
れる。
なお、位置決めは、ガイド11−1〜11−4を孔13
−1〜13−4に嵌合させるだけで足りるため、作業性
は良い。
−1〜13−4に嵌合させるだけで足りるため、作業性
は良い。
ガイド11−1〜11−4を接着固定した後、治具板1
0を取り外す。
0を取り外す。
治具板10を取り外すと、第1図に示すようにガイド1
1−1〜11−7が基板4上、部品実装予定部15を囲
む位置に配設された状態となる。
1−1〜11−7が基板4上、部品実装予定部15を囲
む位置に配設された状態となる。
この状態で、半導体部品1を上方よりフェイスダウンの
姿勢で上りより降ろし、第2図及び第3図に示すように
、パッケージ2の各]−ノーを先付けしであるガイド1
1−1〜11−4の間にはめ込んで、実装予定部15に
@置する1゜パッケージ2がガイド111〜11−4の
間にはめ込まれることにより、半導体部品1のプリント
板4に対する位置決めがなされ、各はんだバンブ3がパ
ッド5に正しく対向する状態とされる。
姿勢で上りより降ろし、第2図及び第3図に示すように
、パッケージ2の各]−ノーを先付けしであるガイド1
1−1〜11−4の間にはめ込んで、実装予定部15に
@置する1゜パッケージ2がガイド111〜11−4の
間にはめ込まれることにより、半導体部品1のプリント
板4に対する位置決めがなされ、各はんだバンブ3がパ
ッド5に正しく対向する状態とされる。
半導体部品1は、第2図及び第3図に示すように、各は
んだバンブ3が対応するパッド5に正しく当接し、且つ
パッケージ2が側面2aをガイド11−1〜11−4に
より押えられて位置規制され位置ずれを制限された状態
となる。
んだバンブ3が対応するパッド5に正しく当接し、且つ
パッケージ2が側面2aをガイド11−1〜11−4に
より押えられて位置規制され位置ずれを制限された状態
となる。
作業者はパッケージ2をガイド11−+”1l−4の間
に単にはめ込むだけでよく、はんだバンブ3とパッド5
との両方を見て両者を一致させるように調整する位置合
せ作業は不要であり、半導体部品1をプリント板4上に
載置する作業は、従来に比べて短い時間で作業性良く行
なわれる。
に単にはめ込むだけでよく、はんだバンブ3とパッド5
との両方を見て両者を一致させるように調整する位置合
せ作業は不要であり、半導体部品1をプリント板4上に
載置する作業は、従来に比べて短い時間で作業性良く行
なわれる。
しかも、半導体部品1は位@1度良く載置され、各部品
間での位置精度のばらつきも無い。
間での位置精度のばらつきも無い。
次いで、プリント板4を半導体部品1及びガイド11−
1〜11−4と共にリフロー炉を通す。
1〜11−4と共にリフロー炉を通す。
これにより、はんだバンブ3が溶融して凝固し、半導体
部品1はフェイスダウンではんだ付けされて実装される
。
部品1はフェイスダウンではんだ付けされて実装される
。
半導体部品1は載置された状態でガイド11−1〜11
−4により位置規制されているため、リフロー炉を通す
過程で半導体部品1が位置ずれを起こす虞れは全くなく
、半導体部品1は各はんだバンブ3を対応するパッド5
に正しく半田付けされて実装される。
−4により位置規制されているため、リフロー炉を通す
過程で半導体部品1が位置ずれを起こす虞れは全くなく
、半導体部品1は各はんだバンブ3を対応するパッド5
に正しく半田付けされて実装される。
その後、必要に応じてワイヤをプリント板4上に配線す
る場合には、上記がイド11−1〜11−4が利用され
、ワイヤは上記ガイド11−1〜11−4の満12内を
通ってガイドされて配線される。
る場合には、上記がイド11−1〜11−4が利用され
、ワイヤは上記ガイド11−1〜11−4の満12内を
通ってガイドされて配線される。
また上記のクロス形のガイドの代わりに、第5図に示す
L字状のルーティングガイド20を使用することもでき
る。
L字状のルーティングガイド20を使用することもでき
る。
(発明の効果)
以上説明した様に、本発明によれば、ルーティングガイ
ドを先付けし、これを利用して半導体部品を位置決めす
る構成であるため、半導体部品を載置するときにパッド
に位置合せする操作は不要であり、甲にルーティングガ
イド閤にはめ込むだけでよく、従来に比べて、実装作業
に要する時間を短縮することが出来、しかも各半導体部
品間での実装位置の精度のばらつきも無く、半導体部品
が実装された製品の¥iJiコストの低減及び品質の均
−化を図ることが出来る。
ドを先付けし、これを利用して半導体部品を位置決めす
る構成であるため、半導体部品を載置するときにパッド
に位置合せする操作は不要であり、甲にルーティングガ
イド閤にはめ込むだけでよく、従来に比べて、実装作業
に要する時間を短縮することが出来、しかも各半導体部
品間での実装位置の精度のばらつきも無く、半導体部品
が実装された製品の¥iJiコストの低減及び品質の均
−化を図ることが出来る。
第1図は本発明の一実施例になる半導体部品の実装方法
の半導体部品をM置するときの状態を丞す図、 第2図は半導体部品が実装された状態を示す斜視図、 第3図は第2図中m−■線に沿う断面矢祝図、第4図は
ルーティングガイドの先付けを説明する図、 第5図は本発明に適用しうるルーティングガイドの別の
例を示す図、 第6図は従来の半導体部品の実装方法を説明する図、 第7図は鏡を利用した目視による位置合せを説明する図
である。 図において、 1は半導体部品、 2はパッケージ、 3ははんだバンプ、 4はプリント板、 5はパッド、 10は位置決め用治具板、 11−1〜11−4.20はルーティングガイド、11
−+ a−11−+ dは腕部、 13−1〜13−4はルーティングガイド位置決め孔、 14は囲繞部分、 15は部品実装予定部 を示す。 q() 奎た朗の半潜びト卸呂の大兼f見41b川亨)目早量目 半導本葬るが裏表3硝状把Sホオ図 @2図 箒2図+E−ユ線1;沿う吋圃矢縄煽 第:1図
の半導体部品をM置するときの状態を丞す図、 第2図は半導体部品が実装された状態を示す斜視図、 第3図は第2図中m−■線に沿う断面矢祝図、第4図は
ルーティングガイドの先付けを説明する図、 第5図は本発明に適用しうるルーティングガイドの別の
例を示す図、 第6図は従来の半導体部品の実装方法を説明する図、 第7図は鏡を利用した目視による位置合せを説明する図
である。 図において、 1は半導体部品、 2はパッケージ、 3ははんだバンプ、 4はプリント板、 5はパッド、 10は位置決め用治具板、 11−1〜11−4.20はルーティングガイド、11
−+ a−11−+ dは腕部、 13−1〜13−4はルーティングガイド位置決め孔、 14は囲繞部分、 15は部品実装予定部 を示す。 q() 奎た朗の半潜びト卸呂の大兼f見41b川亨)目早量目 半導本葬るが裏表3硝状把Sホオ図 @2図 箒2図+E−ユ線1;沿う吋圃矢縄煽 第:1図
Claims (1)
- 【特許請求の範囲】 半導体部品(1)をフェイスダウンではんだ付けして
実装する方法において、 複数のルーティングガイド(11−_1〜11−_4)
を、プリント板(4)上の半導体部品実装予定部(15
)を囲む位置に接着固定して先付けし(第4図)、 上記半導体部品(1)を上記先付けされたルーティング
ガイド(11−_1〜11−_4)の間にはめ込んで位
置決めする(第1図)ことを特徴とする半導体部品の実
装方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63062310A JPH0797595B2 (ja) | 1988-03-16 | 1988-03-16 | 半導体部品の実装方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63062310A JPH0797595B2 (ja) | 1988-03-16 | 1988-03-16 | 半導体部品の実装方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH01235341A true JPH01235341A (ja) | 1989-09-20 |
JPH0797595B2 JPH0797595B2 (ja) | 1995-10-18 |
Family
ID=13196433
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63062310A Expired - Lifetime JPH0797595B2 (ja) | 1988-03-16 | 1988-03-16 | 半導体部品の実装方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0797595B2 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE19526413A1 (de) * | 1995-07-19 | 1997-01-23 | Siemens Ag | Verfahren und Vorrichtung zum Kontaktieren eines vielpoligen elektrischen Bauteils mit einer Leiterplatte |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS538566A (en) * | 1976-07-12 | 1978-01-26 | Citizen Watch Co Ltd | Mounting structure of semiconductor ic circuit |
JPS616833A (ja) * | 1984-06-20 | 1986-01-13 | Matsushita Electric Ind Co Ltd | 実装体の製造方法 |
-
1988
- 1988-03-16 JP JP63062310A patent/JPH0797595B2/ja not_active Expired - Lifetime
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS538566A (en) * | 1976-07-12 | 1978-01-26 | Citizen Watch Co Ltd | Mounting structure of semiconductor ic circuit |
JPS616833A (ja) * | 1984-06-20 | 1986-01-13 | Matsushita Electric Ind Co Ltd | 実装体の製造方法 |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE19526413A1 (de) * | 1995-07-19 | 1997-01-23 | Siemens Ag | Verfahren und Vorrichtung zum Kontaktieren eines vielpoligen elektrischen Bauteils mit einer Leiterplatte |
Also Published As
Publication number | Publication date |
---|---|
JPH0797595B2 (ja) | 1995-10-18 |
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