JPH01157138A - フレーム同期方式 - Google Patents
フレーム同期方式Info
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- JPH01157138A JPH01157138A JP62315821A JP31582187A JPH01157138A JP H01157138 A JPH01157138 A JP H01157138A JP 62315821 A JP62315821 A JP 62315821A JP 31582187 A JP31582187 A JP 31582187A JP H01157138 A JPH01157138 A JP H01157138A
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- 238000001514 detection method Methods 0.000 claims abstract description 30
- 238000006243 chemical reaction Methods 0.000 claims abstract description 6
- 238000000034 method Methods 0.000 claims description 27
- 230000005540 biological transmission Effects 0.000 claims description 16
- 238000010586 diagram Methods 0.000 description 7
- 238000004891 communication Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 238000005516 engineering process Methods 0.000 description 1
- 238000000926 separation method Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04J—MULTIPLEX COMMUNICATION
- H04J3/00—Time-division multiplex systems
- H04J3/02—Details
- H04J3/06—Synchronising arrangements
- H04J3/0602—Systems characterised by the synchronising information used
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04J—MULTIPLEX COMMUNICATION
- H04J3/00—Time-division multiplex systems
- H04J3/02—Details
- H04J3/04—Distributors combined with modulators or demodulators
- H04J3/047—Distributors with transistors or integrated circuits
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- Engineering & Computer Science (AREA)
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- Signal Processing (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
- Time-Division Multiplex Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概要〕
ディジタル伝送におけるフレーム同期方式に係シ、特に
バイト多重化伝送方式において好適なフレーム同期方式
に関し、 多重化信号上に各チャンネルの多重化の11番を示す識
別情報を必要とせず、またパターン検出用回路の規模を
小さく実現できるフレーム同期方式を提供することを目
的とし、 複数バイトからなるフレームパターンを複数チャンネル
からなるブロックごとにバイト多重化して伝送するバイ
ト多重化伝送方式のデータ受信部において、入力信号を
並列データに展開する直並列変換部と、該並列データか
ら前のブロックにおける特定チャンネルのフレームパタ
ーンと後続のブロックにおける特定チャンネルのフレー
ムパターンとを検出するパターン検出部と、該フレーム
パターン検出時該ブロックにおける特定チャンネルの位
置を示す選択信号を発生するフレーム同期部と、該選択
信号に基づいて前記並列データにおける各チャンネルの
信号を所定の信号線に配列して出力するセレクタ部とを
具えて構成される。
バイト多重化伝送方式において好適なフレーム同期方式
に関し、 多重化信号上に各チャンネルの多重化の11番を示す識
別情報を必要とせず、またパターン検出用回路の規模を
小さく実現できるフレーム同期方式を提供することを目
的とし、 複数バイトからなるフレームパターンを複数チャンネル
からなるブロックごとにバイト多重化して伝送するバイ
ト多重化伝送方式のデータ受信部において、入力信号を
並列データに展開する直並列変換部と、該並列データか
ら前のブロックにおける特定チャンネルのフレームパタ
ーンと後続のブロックにおける特定チャンネルのフレー
ムパターンとを検出するパターン検出部と、該フレーム
パターン検出時該ブロックにおける特定チャンネルの位
置を示す選択信号を発生するフレーム同期部と、該選択
信号に基づいて前記並列データにおける各チャンネルの
信号を所定の信号線に配列して出力するセレクタ部とを
具えて構成される。
本発明はディジタル伝送におけるフレーム同期方式に係
り、特にバイト多重化方式において好適なフレーム同期
方式に関するものである。
り、特にバイト多重化方式において好適なフレーム同期
方式に関するものである。
ディジタル通信においては、通信効率を向上するために
伝送路の速、度を上けて、複数チャンネルのデータをバ
イトごと多重化して伝送するバイト多重化伝送方式が採
用される。
伝送路の速、度を上けて、複数チャンネルのデータをバ
イトごと多重化して伝送するバイト多重化伝送方式が採
用される。
第4図はバイト多重化伝送方式における、複数チャンネ
ルの多重化と分離化とを説明するものである。同図にお
いては、送信側にお込て、複数チャンネルナ1〜す4に
おけるそれぞれ8ビツト(1バイト)からなるフレーム
ビットF1を多重化部11において多重化して、4倍速
度のバイト多重化データ12として伝送し、受信側にお
いて分離化部13ヲ経てチャンネルナ1〜÷4のフレー
ムピッ)Flに分離することが示されている。
ルの多重化と分離化とを説明するものである。同図にお
いては、送信側にお込て、複数チャンネルナ1〜す4に
おけるそれぞれ8ビツト(1バイト)からなるフレーム
ビットF1を多重化部11において多重化して、4倍速
度のバイト多重化データ12として伝送し、受信側にお
いて分離化部13ヲ経てチャンネルナ1〜÷4のフレー
ムピッ)Flに分離することが示されている。
このようなバイト多重化伝送方式においては、受信部に
おいて多重化されたデータを分離化する際における、フ
レームパターンの検出および同期のための構成が、方式
的にもハードウェア的にも簡単であって、かつ効率的に
実行できるものであることが要望される。
おいて多重化されたデータを分離化する際における、フ
レームパターンの検出および同期のための構成が、方式
的にもハードウェア的にも簡単であって、かつ効率的に
実行できるものであることが要望される。
第5図はフレームパターンがFl、 F2の2バイト
からなる場合の、伝送路上のフォーマットを示したもの
であって、÷1〜す4はチャンネル番号を示し、IDは
チャンネル番号を識別するための識別ビット、Dはデー
タであって、各バイトは8ビツトからなるものとする。
からなる場合の、伝送路上のフォーマットを示したもの
であって、÷1〜す4はチャンネル番号を示し、IDは
チャンネル番号を識別するための識別ビット、Dはデー
タであって、各バイトは8ビツトからなるものとする。
このような伝送フォーマットをとる場合のフレーム同期
方式としては、次の2つの方法が従来知られている。
方式としては、次の2つの方法が従来知られている。
(1) パターン検出を複数バイトおきに行う方法。
第6図において(a)はこの場合のフレーム同期方式を
説明するものであって、第5図に示されたフォーマット
からチャンネル4P1に対応する↑印のタイミングで4
バイトおきに検出を行うことによって、Fl、 F2の
フレームパターンを検出する。
説明するものであって、第5図に示されたフォーマット
からチャンネル4P1に対応する↑印のタイミングで4
バイトおきに検出を行うことによって、Fl、 F2の
フレームパターンを検出する。
これ忙よってフレーム同期を確立し、その後識別ビット
■Dによってチャンネル番号を識別して多重化以前の順
番に戻す。
■Dによってチャンネル番号を識別して多重化以前の順
番に戻す。
(2)全パターンを同時に検出する方法。
第6図において(b)はこの場合のフレーム同期方式を
説明するものであって、第5図に示されたフォーマット
からチャンネル+1〜+4のFl、F2のフレームパタ
ーンを全部同時に検出することによって、フレーム同期
とチャンネル番号の識別とを同時に行う。
説明するものであって、第5図に示されたフォーマット
からチャンネル+1〜+4のFl、F2のフレームパタ
ーンを全部同時に検出することによって、フレーム同期
とチャンネル番号の識別とを同時に行う。
第6図(a)に示された従来のフレーム同期方式では、
例えばチャンネル≠1のFl、F2の2バイト分だけを
検出すればよいので、7レ一ム同期用回路におけるパタ
ーン検出部の回路規模は比較的小さくて済む。しかしな
がら、その後識別ピッ)IDによって多重の順番(チャ
ンネル番号)を識別する必要があシ、そのためのハード
ウェア量がかなシ大きくなる。
例えばチャンネル≠1のFl、F2の2バイト分だけを
検出すればよいので、7レ一ム同期用回路におけるパタ
ーン検出部の回路規模は比較的小さくて済む。しかしな
がら、その後識別ピッ)IDによって多重の順番(チャ
ンネル番号)を識別する必要があシ、そのためのハード
ウェア量がかなシ大きくなる。
第6図(b)に示された従来のフレーム同期方式では、
多重化されている状態の全部のフレームパターンを検出
するので、第6図(a)で示された方式の場合のように
識別ビットIDの情報を必要とせず、伝送フォーマット
が簡単になる。しかしながらこの場合はパターン検出の
対象となるビット数が非常に多く、例えば第5図に示さ
れたフォーマットの場合8ビツト×8(バイト)=慣ビ
ットの検出を行う必要がある。このため検出回路の回路
規模が著しく大きくなる。
多重化されている状態の全部のフレームパターンを検出
するので、第6図(a)で示された方式の場合のように
識別ビットIDの情報を必要とせず、伝送フォーマット
が簡単になる。しかしながらこの場合はパターン検出の
対象となるビット数が非常に多く、例えば第5図に示さ
れたフォーマットの場合8ビツト×8(バイト)=慣ビ
ットの検出を行う必要がある。このため検出回路の回路
規模が著しく大きくなる。
本発明はこのような従来技術の問題点を解決しようとす
るものであって、多重化信号上に各チャンネルの多重化
の順番を示す識別情報を、必要とせず、またパターン検
出用回路の規模を小さく実現できるフレーム同期方式を
提供することを目的としている。
るものであって、多重化信号上に各チャンネルの多重化
の順番を示す識別情報を、必要とせず、またパターン検
出用回路の規模を小さく実現できるフレーム同期方式を
提供することを目的としている。
第1図は本発明の原理的構成を示したものであって、直
並列変換部1.パターン検出部2.フレーム同期部3.
セレクタ部4とを具えて構成されることが示されている
。
並列変換部1.パターン検出部2.フレーム同期部3.
セレクタ部4とを具えて構成されることが示されている
。
直並列変換部1は、バイト多重化データからなる入力信
号を並列データに展開するものである。
号を並列データに展開するものである。
パターン検出部2は、展開されて生じた並列データから
前のブロックにおける特定チャンネルのフレームパター
ンと、後続のブロックにおける特定チャンネルのフレー
ムパターンとを検出するものである。
前のブロックにおける特定チャンネルのフレームパター
ンと、後続のブロックにおける特定チャンネルのフレー
ムパターンとを検出するものである。
フレーム同期部3は、パターン検出部2においてフレー
ムパターンが検出されたとき、そのブロックにおける特
定のチャンネルの位置を示す選択信号を発生するもので
ある。
ムパターンが検出されたとき、そのブロックにおける特
定のチャンネルの位置を示す選択信号を発生するもので
ある。
セレクタ部4は、フレーム同期部3からの選択信号に基
づいて、直並列変換部1において生じた並列データにお
ける各チャンネルの信号を所定の出力線に配列して出力
する制御を行うものである。
づいて、直並列変換部1において生じた並列データにお
ける各チャンネルの信号を所定の出力線に配列して出力
する制御を行うものである。
バイト多重化データからなる入力信号は並列データに展
開されたのち、パターン検出を行われる。
開されたのち、パターン検出を行われる。
第2図は本発明方式におけるフレームパターンの検出を
説明するものである。第2図において並列に展開された
データ中、フレームパターンF1についてのチャンネル
ナ1〜す4からなるブロックの最終チャンネルのフレー
ムパターント、フレームパターンF2についてのチャン
ネル÷1〜≠4からなる後続のブロックの先頭チャンネ
ルのフレームパターン、すなわち第2図においてAで示
された16ビツトについてパターン検出を行い、検出時
、例えば前のブロックの最終チャンネル÷4を示す選択
(SEL)信号を発生する。これによってフレーム同期
をとって各チャンネルの信号をそれぞれ分離して出力す
る。
説明するものである。第2図において並列に展開された
データ中、フレームパターンF1についてのチャンネル
ナ1〜す4からなるブロックの最終チャンネルのフレー
ムパターント、フレームパターンF2についてのチャン
ネル÷1〜≠4からなる後続のブロックの先頭チャンネ
ルのフレームパターン、すなわち第2図においてAで示
された16ビツトについてパターン検出を行い、検出時
、例えば前のブロックの最終チャンネル÷4を示す選択
(SEL)信号を発生する。これによってフレーム同期
をとって各チャンネルの信号をそれぞれ分離して出力す
る。
本発明方式においてパターン検出を行うのは第2図のA
の部分のように2バイト分なのでパターン検出回路の回
路規模は小さくてよい。しかも同時に特定チャンネルの
位置(第2図ではチャンネル≠4の位置)を知ることが
できるので、チャンネル番号識別のために識別ピッ)
IDの情報を用いる必要がない。
の部分のように2バイト分なのでパターン検出回路の回
路規模は小さくてよい。しかも同時に特定チャンネルの
位置(第2図ではチャンネル≠4の位置)を知ることが
できるので、チャンネル番号識別のために識別ピッ)
IDの情報を用いる必要がない。
第3図は本発明の一実施例であって、第2図に示された
伝送信号に対して本発明方式を適用した場合におけるパ
ターン検出およびフレーム同期回路の構成を示したもの
である。
伝送信号に対して本発明方式を適用した場合におけるパ
ターン検出およびフレーム同期回路の構成を示したもの
である。
21は直並列(S/P)変換部であってシフトレジスタ
とラッチ回路等からなり、直列信号からなるバイト多重
化データを直並列変換して32ビツトの並列データとし
て出力する。22はパターン検出部であって、S/P変
換部21の並列出力から、第2図において人で示す境界
部分におけるFlとF2の2バイト(16ビツト)分の
フレームパターンとの一致を検出する。田はフレーム同
期部であって、パターン検出部22におけるフレームパ
ターン検出釦よって、7レ一ム検出位置のタイミングを
とシカウンタを動作させることKよって、各種のタイミ
ングパルスを作成する。この場合のタイミング検出には
周知の前方および後方の保護をかけ、所定の保護段数が
確保されたとき同期確立を示す情報として5YNC(同
期)端子に7ラグを立てる。また同時に例えば最後のチ
ャンネル+4を示すSEL信号を発生する。冴はセレク
タ(SEL )部であって、S/P変換部21において
並列に展開された信号からSEL信号に応じて選択する
ことKよって、各チャンネルφ1〜÷4のデータをそれ
ぞれ8ビツトの並列信号として所定の出力線に出力する
。
とラッチ回路等からなり、直列信号からなるバイト多重
化データを直並列変換して32ビツトの並列データとし
て出力する。22はパターン検出部であって、S/P変
換部21の並列出力から、第2図において人で示す境界
部分におけるFlとF2の2バイト(16ビツト)分の
フレームパターンとの一致を検出する。田はフレーム同
期部であって、パターン検出部22におけるフレームパ
ターン検出釦よって、7レ一ム検出位置のタイミングを
とシカウンタを動作させることKよって、各種のタイミ
ングパルスを作成する。この場合のタイミング検出には
周知の前方および後方の保護をかけ、所定の保護段数が
確保されたとき同期確立を示す情報として5YNC(同
期)端子に7ラグを立てる。また同時に例えば最後のチ
ャンネル+4を示すSEL信号を発生する。冴はセレク
タ(SEL )部であって、S/P変換部21において
並列に展開された信号からSEL信号に応じて選択する
ことKよって、各チャンネルφ1〜÷4のデータをそれ
ぞれ8ビツトの並列信号として所定の出力線に出力する
。
このように本実施例においては、複数バイトのフレーム
パターンをそれぞれチャンネル番号層に配列した複数の
ブロックにおける、前のブロックと後のブロックの境界
部分すなわち第2図の例では最終チャンネル÷4のF1
パターンと先頭チャン→。
パターンをそれぞれチャンネル番号層に配列した複数の
ブロックにおける、前のブロックと後のブロックの境界
部分すなわち第2図の例では最終チャンネル÷4のF1
パターンと先頭チャン→。
ネル+iのF1パターンからなる16ビツトを検出すよ
うにしているのでパターン検出の回路規模を小さくでき
る。またこの位置を検出することによってPi (チャ
ンネルナ4)の位置を認識することができるので、第6
図(alに示された従来技術のようにチャンネル番号を
識別するために識別ビットIDの情報を用いる必要がな
くなる。
うにしているのでパターン検出の回路規模を小さくでき
る。またこの位置を検出することによってPi (チャ
ンネルナ4)の位置を認識することができるので、第6
図(alに示された従来技術のようにチャンネル番号を
識別するために識別ビットIDの情報を用いる必要がな
くなる。
なお本発明の方式はフレームパターンが2バイトからな
る場合に限られるものでなく、3バイト以上であっても
よい。この場合は2個所以上の境界部におけるそれぞれ
のパターン検出によってフレーム同期をとればよい。
る場合に限られるものでなく、3バイト以上であっても
よい。この場合は2個所以上の境界部におけるそれぞれ
のパターン検出によってフレーム同期をとればよい。
以上説明したように本発明によれば、複数バイトからな
るフレームパターンを有する複数チャンネルのバイト多
重化伝送方式のデータ受信部において、複数バイトのフ
レームパターンをそれぞれ一定の順序で配列した複数の
ブロックにおける境界部分の2バイト分のパターン検出
を行って7レ一ム同期をとるようにしたので、パターン
検出用回路の規模を小さくできるとともに、チャンネル
番号を識別するための識別ビットの情報が不要になる。
るフレームパターンを有する複数チャンネルのバイト多
重化伝送方式のデータ受信部において、複数バイトのフ
レームパターンをそれぞれ一定の順序で配列した複数の
ブロックにおける境界部分の2バイト分のパターン検出
を行って7レ一ム同期をとるようにしたので、パターン
検出用回路の規模を小さくできるとともに、チャンネル
番号を識別するための識別ビットの情報が不要になる。
第1図は本発明の原理的構成を示す図、第2図は本発明
方式におけるフレームパターンの検出を説明する図、 第3図は本発明の一実施例を示す図、 第4図はバイト多重化伝送方式を示す図、第5図はフレ
ームパターンが2バイトからなる場合の伝送路上のフォ
ーマットを示す図、第6図は従来のフレームパターン検
出方法を示す図である。 21・・・直並列(S/P )変換部 22・・・パターン検出部 23・・・フレーム同期部 冴・・・セレクタ(SEL)部
方式におけるフレームパターンの検出を説明する図、 第3図は本発明の一実施例を示す図、 第4図はバイト多重化伝送方式を示す図、第5図はフレ
ームパターンが2バイトからなる場合の伝送路上のフォ
ーマットを示す図、第6図は従来のフレームパターン検
出方法を示す図である。 21・・・直並列(S/P )変換部 22・・・パターン検出部 23・・・フレーム同期部 冴・・・セレクタ(SEL)部
Claims (1)
- 【特許請求の範囲】 複数バイトからなるフレームパターンを複数チャンネル
からなるブロックごとにバイト多重化して伝送するバイ
ト多重化伝送方式のデータ受信部において、 入力信号を並列データに展開する直並列変換部(1)と
、 該並列データから前のブロックにおける特定チャンネル
のフレームパターンと後続のブロックにおける特定チャ
ンネルのフレームパターンとを検出するパターン検出部
(2)と、 該フレームパターン検出時該ブロックにおける特定チャ
ンネルの位置を示す選択信号を発生するフレーム同期部
(3)と、 該選択信号に基づいて前記並列データにおける各チャン
ネルの信号を所定の出力線に配列して出力するセレクタ
部(4)と を具えてなることを特徴とするフレーム同期方式。
Priority Applications (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62315821A JPH0622359B2 (ja) | 1987-12-14 | 1987-12-14 | フレーム同期方式 |
CA000585708A CA1298420C (en) | 1987-12-14 | 1988-12-13 | Demultiplexer system |
DE3850067T DE3850067T2 (de) | 1987-12-14 | 1988-12-13 | Demultiplexeranordnung. |
EP88120819A EP0320882B1 (en) | 1987-12-14 | 1988-12-13 | Demultiplexer system |
US07/284,395 US4920535A (en) | 1987-12-14 | 1988-12-14 | Demultiplexer system |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62315821A JPH0622359B2 (ja) | 1987-12-14 | 1987-12-14 | フレーム同期方式 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH01157138A true JPH01157138A (ja) | 1989-06-20 |
JPH0622359B2 JPH0622359B2 (ja) | 1994-03-23 |
Family
ID=18069963
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP62315821A Expired - Lifetime JPH0622359B2 (ja) | 1987-12-14 | 1987-12-14 | フレーム同期方式 |
Country Status (5)
Country | Link |
---|---|
US (1) | US4920535A (ja) |
EP (1) | EP0320882B1 (ja) |
JP (1) | JPH0622359B2 (ja) |
CA (1) | CA1298420C (ja) |
DE (1) | DE3850067T2 (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
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Families Citing this family (39)
Publication number | Priority date | Publication date | Assignee | Title |
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KR0136568B1 (ko) * | 1992-07-23 | 1998-11-16 | 강진구 | D2 mac신호의 프레임동기검출방법 및 장치 |
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