JPH01119046A - Fp型半導体装置 - Google Patents

Fp型半導体装置

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Publication number
JPH01119046A
JPH01119046A JP62276263A JP27626387A JPH01119046A JP H01119046 A JPH01119046 A JP H01119046A JP 62276263 A JP62276263 A JP 62276263A JP 27626387 A JP27626387 A JP 27626387A JP H01119046 A JPH01119046 A JP H01119046A
Authority
JP
Japan
Prior art keywords
insulating board
type
leads
lead
insulating substrate
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP62276263A
Other languages
English (en)
Inventor
Toshifumi Togawa
外川 敏文
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Toshiba Corp
Toshiba AVE Co Ltd
Original Assignee
Toshiba Corp
Toshiba Audio Video Engineering Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Toshiba Corp, Toshiba Audio Video Engineering Co Ltd filed Critical Toshiba Corp
Priority to JP62276263A priority Critical patent/JPH01119046A/ja
Publication of JPH01119046A publication Critical patent/JPH01119046A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181Encapsulation
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistor
    • H05K3/32Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits
    • H05K3/34Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits by soldering
    • H05K3/341Surface mounted components
    • H05K3/3421Leaded components

Landscapes

  • Lead Frames For Integrated Circuits (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [発明の目的] (産業上の利用分野) 本発明はF P (F fat Pakage )型半
導体装置に関し、特にリードに改良を施したFP型IC
に係わる。
(従来の技術) 従来、FP型ICとしては、例えば第5図に示す構造の
ものが知られている。
図中の1は、絶縁基板2に搭載されているFP型ICで
ある。このFP型ICIは、各種の電子回路が形成され
たパッケージ本体2とこのパッケージ本体2の側壁に設
けられた複数のリード3とから構成されている。かかる
構造のFP型ICは、リード3の先端部を半田層4によ
り絶縁基板2表面に形成された配線パターン(図示せず
)にリフロー半田漬けすることにより前記基板2上に搭
載していた。
しかしながら、従来のFP型ICによれば、絶縁基板2
と面する箇所が平坦な構造となっているため、リード3
に半田層4がのりにくく絶縁基板2への固定が不十分で
あるという問題点があった。
(発明が解決しようとする問題点) 本発明は上記事情に鑑みてなされたもので、リードの形
状に改良を施すことにより、リードに半田層がのりやす
くし、もって絶縁基板への固定を確実になしえるFP型
半導体装置を提供することを目的とする。
[発明の構成] (問題点を解決するための手段と作用)本発明は、電子
回路が形成されたパッケージ本体と、このパッケージ本
体の側壁に設けられ先端部が絶縁基板面と当接されるリ
ードとからなり、前記リードのうち前記基板面と面する
箇所に前記基板表面から離間する四部を設けることを要
旨とする。
本発明によれば、リフロー半田漬けする際、半田層が前
記凹部に侵入するので、リードを半田層を谷して確実に
絶縁基板上の配線パターンなどに固定でき、もってFP
型半導体装置の絶縁基板への固定が確実になる。
(実施例) 以下、本発明の一実施例を第1因、第2図及び第3図を
参照して説明する。ここで、第1図は本発明に係るFP
型ICの説明図、第2図は第1図の部分拡大図、第3図
は同ICを絶縁基板へ搭載した状態の説明図である。
図中の11は、絶縁基板12上に搭載されるFP型IC
である。このFP型IC11は、パッケージ本体13と
このパッケージ本体13の側壁に設けられた複数のり−
ド14から構成されている。ここで、前記リード14の
基板面と面する箇所には、凹部15が前記絶縁基板12
の表面側から設けられている。この凹部15は、例えば
り−ド14の基板と面する箇所の一部をレーザ照射等に
より溶融させて形成したり、ブラスト処理等の手法によ
り機械的に削除して形成することができる。
しかして、上記実施例によれば、FP型IC11のリー
ド14の絶縁基板12と面する箇所にこの絶縁基板12
側からの凹部15が設けられた構造となっているため、
前記FP型ICI 1を絶縁基板12上の所定の位置に
搭載してリフロー半田漬けすると、リード14の絶縁基
板と面する部位の側面のみならず、前記凹部15にも半
田層16が侵入するため、リード14が絶縁基板12上
の配線パターン(図示せず)に十分に固定される。従っ
て、FP型IC11が絶縁基板上に確実に固定される。
なお、本発明に係るFP型ICは上記実施例の構造のも
のに限らず、第4図に示す如く、リード14の絶縁基板
12と面する部位を折曲げ、絶縁基板12と離間する凹
部17を設けた構造でもよい。かかる構造のFP型IC
も上記実施例と同様な効果を有する。
[発明の効果] 以上詳述した如く本発明によれば、リードの形状に改良
を施すことにより、リードに半田層がのりやすくし、も
って絶縁基板への固定を確実になしえるFP型半導体装
置を提供できる。
【図面の簡単な説明】
第1図は本発明に係るFP型ICの説明図、第2図は第
1図の部分拡大図、第3図は同ICを絶縁基板へ搭載し
た状態の説明図、第4図は本発明の他の実施例に係るF
P型ICの説明図、第5図は従来のFP型ICの説明図
である。 11・・・FP型IC,12・・・絶縁基板、13・・
・パッケージ本体、 14・・・リード、 15・・・
凹部、16・・・半田層。 出願人代理人  弁理士 鈴江武彦 第2図 第3図 t5 第4図 第5図

Claims (1)

    【特許請求の範囲】
  1.  電子回路が形成されたパッケージ本体と、このパッケ
    ージ本体の側壁に設けられ先端部が絶縁基板面と当接さ
    れるリードとからなり、前記リードのうち前記基板面と
    面する箇所に前記基板表面から離間する凹部を設けるこ
    とを特徴とするFP型半導体装置。
JP62276263A 1987-10-31 1987-10-31 Fp型半導体装置 Pending JPH01119046A (ja)

Priority Applications (1)

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JP62276263A JPH01119046A (ja) 1987-10-31 1987-10-31 Fp型半導体装置

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JP62276263A JPH01119046A (ja) 1987-10-31 1987-10-31 Fp型半導体装置

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Publication Number Publication Date
JPH01119046A true JPH01119046A (ja) 1989-05-11

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ID=17566997

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JP62276263A Pending JPH01119046A (ja) 1987-10-31 1987-10-31 Fp型半導体装置

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JP (1) JPH01119046A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN103624463A (zh) * 2013-11-29 2014-03-12 中国电子科技集团公司第四十七研究所 Fp型陶瓷管壳平行缝焊封装夹具

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN103624463A (zh) * 2013-11-29 2014-03-12 中国电子科技集团公司第四十七研究所 Fp型陶瓷管壳平行缝焊封装夹具

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