JPH03220792A - Pga型集積回路の実装構造 - Google Patents
Pga型集積回路の実装構造Info
- Publication number
- JPH03220792A JPH03220792A JP1563190A JP1563190A JPH03220792A JP H03220792 A JPH03220792 A JP H03220792A JP 1563190 A JP1563190 A JP 1563190A JP 1563190 A JP1563190 A JP 1563190A JP H03220792 A JPH03220792 A JP H03220792A
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- JP
- Japan
- Prior art keywords
- pga
- lead
- soldering
- recess
- circuit board
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
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- 239000011248 coating agent Substances 0.000 claims description 3
- 238000000576 coating method Methods 0.000 claims description 3
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Classifications
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/30—Assembling printed circuits with electric components, e.g. with resistor
- H05K3/32—Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits
- H05K3/34—Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits by soldering
- H05K3/341—Surface mounted components
- H05K3/3421—Leaded components
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/40—Forming printed elements for providing electric connections to or between printed circuits
- H05K3/4007—Surface contacts, e.g. bumps
Landscapes
- Electric Connection Of Electric Components To Printed Circuits (AREA)
- Structures For Mounting Electric Components On Printed Circuit Boards (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、PGA型集積回路のパッケージ下面に多数立
設されたリードをプリント基板に半田付けするPGA型
集積回路の実装構造に関するものである。
設されたリードをプリント基板に半田付けするPGA型
集積回路の実装構造に関するものである。
従来、PGA型集積回路としては、パッケージ本体の下
面にバットリードが多数立設されたバソトリーFPGA
型LSIパッケージ(以下、車にPGAパッケージとい
う。)がある。このPGAパッケージをプリント基板上
に実装するには、プリント基板の表面に設けられた導電
材からなる半田付は部にバットリードを半田付けして行
なわれていた。半田付は方法としては、プリント基板の
半田付は部上に半田ペーストを塗布し、この半田ペース
ト上に、バットリードを支承させるように位置づけた状
態で加熱する所謂リフロー半田付は法が採用されていた
。
面にバットリードが多数立設されたバソトリーFPGA
型LSIパッケージ(以下、車にPGAパッケージとい
う。)がある。このPGAパッケージをプリント基板上
に実装するには、プリント基板の表面に設けられた導電
材からなる半田付は部にバットリードを半田付けして行
なわれていた。半田付は方法としては、プリント基板の
半田付は部上に半田ペーストを塗布し、この半田ペース
ト上に、バットリードを支承させるように位置づけた状
態で加熱する所謂リフロー半田付は法が採用されていた
。
しかるに、このようにPGAパッケージをプリント基板
上に半田付けする従来の実装構造においては、プリント
基板の半田付は部が平坦であり、半田付は時にはこの平
坦部分にハツトリードを支承させた状態で加熱するため
に、半田付は時にバットリードが半田付は部に対して横
方向へずれて位置ずれを起こし易い。バットリードが位
置ずれを起こすと、電気的に不導通になったり、半田接
続部の品質や信頼性が損なわれたりする。このような不
具合を解消するためには、半田付は時に位置ずれの有無
を確認しながら作業を行なえばよいが、バントリードの
寸法が小さく、しかも本数も多い関係からPGAパッケ
ージの半田付は部を目視によって確認することは非常に
困難であった。
上に半田付けする従来の実装構造においては、プリント
基板の半田付は部が平坦であり、半田付は時にはこの平
坦部分にハツトリードを支承させた状態で加熱するため
に、半田付は時にバットリードが半田付は部に対して横
方向へずれて位置ずれを起こし易い。バットリードが位
置ずれを起こすと、電気的に不導通になったり、半田接
続部の品質や信頼性が損なわれたりする。このような不
具合を解消するためには、半田付は時に位置ずれの有無
を確認しながら作業を行なえばよいが、バントリードの
寸法が小さく、しかも本数も多い関係からPGAパッケ
ージの半田付は部を目視によって確認することは非常に
困難であった。
本発明に係るPGA型集積回路の実装構造は、プリント
基板にリードの先端部が挿入される凹部を設け、かつプ
リント基板の表面における前記凹部の開口縁の周囲に半
田付は用導電性被覆を設けたものである。
基板にリードの先端部が挿入される凹部を設け、かつプ
リント基板の表面における前記凹部の開口縁の周囲に半
田付は用導電性被覆を設けたものである。
リードの先端部を凹部内に挿入した状態で半田付けする
ので、半田付は時にリードが横方向へずれるのを防ぐこ
とができる。
ので、半田付は時にリードが横方向へずれるのを防ぐこ
とができる。
以下、本発明の一実施例を第1図および第2図によって
詳細に説明する。
詳細に説明する。
第1図は本発明に係るPGA型集積回路の実装構造に使
用するPGA型集積回路を示す斜視図、第2図は本発明
に係るPGA型集積回路の実装構造を示す断面図である
。これらの図において、1はPGA型集積回路としての
ハツトリードPGA型LSIパッケージ(以下、単にP
GAパッケージという。)を示す。このPGAパッケー
ジ1は、半導体素子(図示せず)を内蔵しかつセラミッ
ク等によって形成されたパッケージ本体1aと、このパ
ッケージ本体1aの下面に多数立設されたハツトリード
1bとから構成されている。このバットリード1bの寸
法は直径が約0.2nで長さが約2Rであり、多数立設
されたハントリード1bのピッチは1.27uである。
用するPGA型集積回路を示す斜視図、第2図は本発明
に係るPGA型集積回路の実装構造を示す断面図である
。これらの図において、1はPGA型集積回路としての
ハツトリードPGA型LSIパッケージ(以下、単にP
GAパッケージという。)を示す。このPGAパッケー
ジ1は、半導体素子(図示せず)を内蔵しかつセラミッ
ク等によって形成されたパッケージ本体1aと、このパ
ッケージ本体1aの下面に多数立設されたハツトリード
1bとから構成されている。このバットリード1bの寸
法は直径が約0.2nで長さが約2Rであり、多数立設
されたハントリード1bのピッチは1.27uである。
2は前記PGAパッケージ1を実装するための回路基板
で、この回路基板2は、PGAパッケージ1のバットリ
ード1bと対応する部位に凹部としての窪み3が形成さ
れている。また、この回路基板2は、上下の基板4.5
を重ね合わせて形成されており、上側の基板4には前記
窪み3を形成するための透孔が穿設されている。すなわ
ち、この回路基板2においては、上下の基板4.5を重
ね合わせ、透孔の下部開口部分を下側の基板5により閉
塞することによって、窪み3が形成されている。なお、
窪み3を形成するには、上述したように回路基板2を上
下に2分割形成して行なう他に、1枚の回路基板に機械
加工等を施して形成することもできる。
で、この回路基板2は、PGAパッケージ1のバットリ
ード1bと対応する部位に凹部としての窪み3が形成さ
れている。また、この回路基板2は、上下の基板4.5
を重ね合わせて形成されており、上側の基板4には前記
窪み3を形成するための透孔が穿設されている。すなわ
ち、この回路基板2においては、上下の基板4.5を重
ね合わせ、透孔の下部開口部分を下側の基板5により閉
塞することによって、窪み3が形成されている。なお、
窪み3を形成するには、上述したように回路基板2を上
下に2分割形成して行なう他に、1枚の回路基板に機械
加工等を施して形成することもできる。
6および7はバットリード1bに半田8によって接続さ
れる導電性部材で、これら導電性部材6゜7は、その表
面に導電性材料が被覆されており、導電性部材6は前記
窪み3の底に設けられ、導電性部材7は回路基板2の表
面における窪み3の開口縁の周囲に設けられている。
れる導電性部材で、これら導電性部材6゜7は、その表
面に導電性材料が被覆されており、導電性部材6は前記
窪み3の底に設けられ、導電性部材7は回路基板2の表
面における窪み3の開口縁の周囲に設けられている。
次に、このように窪み3が設けられた回路基板2にPG
Aパッケージ1を実装する手順について説明する。先ず
、回路基板2の窪み3に、導電性部材6.7を覆うよう
にして半田ペースト(図示せず)を塗布する。次いで、
この窪み3内にバットリード1bを挿入する。この状態
でリフロー半田付けを行なうことによってPGAパッケ
ージ1を回路基板2上に実装することができる。リフ口
−後は、第2図に示すように、バットリード1bと窪み
3の内壁との間が半田8によって埋められ、導電性部材
6,7が半田8を介してハツトリード1bに接続される
ことになる。
Aパッケージ1を実装する手順について説明する。先ず
、回路基板2の窪み3に、導電性部材6.7を覆うよう
にして半田ペースト(図示せず)を塗布する。次いで、
この窪み3内にバットリード1bを挿入する。この状態
でリフロー半田付けを行なうことによってPGAパッケ
ージ1を回路基板2上に実装することができる。リフ口
−後は、第2図に示すように、バットリード1bと窪み
3の内壁との間が半田8によって埋められ、導電性部材
6,7が半田8を介してハツトリード1bに接続される
ことになる。
したがって、本発明によれば、バットリード1bの先端
部を窪み3内に挿入した状態で半田付けするので、半田
付は時にバントリード1bが横方向へずれるのを防くこ
とができる。
部を窪み3内に挿入した状態で半田付けするので、半田
付は時にバントリード1bが横方向へずれるのを防くこ
とができる。
また、本実施例では窪み3の底に導電性部材6を設けた
ため、比較的小径な窪み3内に半田8を溶は込ませ易く
することができ、より確実に半田付けを行なうことがで
きる。
ため、比較的小径な窪み3内に半田8を溶は込ませ易く
することができ、より確実に半田付けを行なうことがで
きる。
〔発明の効果〕
以上説明したように本発明に係るPGA型集積回路の実
装構造は、プリント基板にリードの先端部が挿入される
凹部を設け、かつプリント基板の表面における前記四部
の開口縁の周囲に半田付は用導電性被覆を設けたため、
リードの先端部を凹部内に挿入した状態で半田付けする
ので、リードを半田付は位置に保持した状態で半田付け
を行なうことかできる。したがって、半田付は時にリー
ドが横方向へずれるのを防くことができるから、半田接
続部の品質および信頼性を高めることができる。また、
凹部内が半田で満たされる関係から半田量を多くするこ
とができるので、従来の実装構造で不安視されていた半
田接続部の強度を向上させることができる。このため、
半田接続部を長期にわたって信頼性高く維持できると共
に、半田接続部の無検査化が期待できるという効果もあ
る。
装構造は、プリント基板にリードの先端部が挿入される
凹部を設け、かつプリント基板の表面における前記四部
の開口縁の周囲に半田付は用導電性被覆を設けたため、
リードの先端部を凹部内に挿入した状態で半田付けする
ので、リードを半田付は位置に保持した状態で半田付け
を行なうことかできる。したがって、半田付は時にリー
ドが横方向へずれるのを防くことができるから、半田接
続部の品質および信頼性を高めることができる。また、
凹部内が半田で満たされる関係から半田量を多くするこ
とができるので、従来の実装構造で不安視されていた半
田接続部の強度を向上させることができる。このため、
半田接続部を長期にわたって信頼性高く維持できると共
に、半田接続部の無検査化が期待できるという効果もあ
る。
第1図は本発明に係るPGA型集型口積回路装構造に使
用するPGA型集型口積回路す斜視図、第2図は本発明
に係るPGA型集型口積回路装構造を示す断面図である
。 1・・・・PGAパッケージ、1a・・・・パッケージ
本体、1b・・・・ハツトリード、2・・・・回路基板
、3・・・・窪み、6,7・・・・導電性部材、8・・
・・半田。
用するPGA型集型口積回路す斜視図、第2図は本発明
に係るPGA型集型口積回路装構造を示す断面図である
。 1・・・・PGAパッケージ、1a・・・・パッケージ
本体、1b・・・・ハツトリード、2・・・・回路基板
、3・・・・窪み、6,7・・・・導電性部材、8・・
・・半田。
Claims (1)
- PGA型集積回路のパッケージ下面に多数立設された
リードをプリント基板に半田付けするPGA型集積回路
の実装構造において、プリント基板に前記リードの先端
部が挿入される凹部を設け、かつプリント基板の表面に
おける前記凹部の開口縁の周囲に半田付け用導電性被覆
を設けたことを特徴とするPGA型集積回路の実装構造
。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1563190A JPH03220792A (ja) | 1990-01-25 | 1990-01-25 | Pga型集積回路の実装構造 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1563190A JPH03220792A (ja) | 1990-01-25 | 1990-01-25 | Pga型集積回路の実装構造 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH03220792A true JPH03220792A (ja) | 1991-09-27 |
Family
ID=11894067
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1563190A Pending JPH03220792A (ja) | 1990-01-25 | 1990-01-25 | Pga型集積回路の実装構造 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH03220792A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH05275826A (ja) * | 1992-03-24 | 1993-10-22 | Kofu Nippon Denki Kk | プリント基板 |
EP1083778A1 (de) * | 1999-09-07 | 2001-03-14 | Endress + Hauser GmbH + Co. | Verfahren zum Bestücken einer Leiterplatte |
-
1990
- 1990-01-25 JP JP1563190A patent/JPH03220792A/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH05275826A (ja) * | 1992-03-24 | 1993-10-22 | Kofu Nippon Denki Kk | プリント基板 |
EP1083778A1 (de) * | 1999-09-07 | 2001-03-14 | Endress + Hauser GmbH + Co. | Verfahren zum Bestücken einer Leiterplatte |
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