JP7240496B2 - 基板製造のための方法および装置 - Google Patents

基板製造のための方法および装置 Download PDF

Info

Publication number
JP7240496B2
JP7240496B2 JP2021525549A JP2021525549A JP7240496B2 JP 7240496 B2 JP7240496 B2 JP 7240496B2 JP 2021525549 A JP2021525549 A JP 2021525549A JP 2021525549 A JP2021525549 A JP 2021525549A JP 7240496 B2 JP7240496 B2 JP 7240496B2
Authority
JP
Japan
Prior art keywords
substrate
deposition chamber
chamber
vacuum
bitline
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
JP2021525549A
Other languages
English (en)
Other versions
JP2022507132A (ja
Inventor
プリヤダルシ パンダ,
ギル リー,
シュリーニヴァース ガンディコッタ,
スンクォン カン,
サンジェイ ナタラジャン,
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Applied Materials Inc
Original Assignee
Applied Materials Inc
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Applied Materials Inc filed Critical Applied Materials Inc
Publication of JP2022507132A publication Critical patent/JP2022507132A/ja
Application granted granted Critical
Publication of JP7240496B2 publication Critical patent/JP7240496B2/ja
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67011Apparatus for manufacture or treatment
    • H01L21/67155Apparatus for manufacturing or treating in a plurality of work-stations
    • H01L21/67196Apparatus for manufacturing or treating in a plurality of work-stations characterized by the construction of the transfer chamber
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67011Apparatus for manufacture or treatment
    • H01L21/67155Apparatus for manufacturing or treating in a plurality of work-stations
    • H01L21/67184Apparatus for manufacturing or treating in a plurality of work-stations characterized by the presence of more than one transfer chamber
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/44Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02225Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer
    • H01L21/0226Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process
    • H01L21/02263Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67011Apparatus for manufacture or treatment
    • H01L21/67017Apparatus for fluid treatment
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67011Apparatus for manufacture or treatment
    • H01L21/67098Apparatus for thermal treatment
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67011Apparatus for manufacture or treatment
    • H01L21/67155Apparatus for manufacturing or treating in a plurality of work-stations
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67011Apparatus for manufacture or treatment
    • H01L21/67155Apparatus for manufacturing or treating in a plurality of work-stations
    • H01L21/67161Apparatus for manufacturing or treating in a plurality of work-stations characterized by the layout of the process chambers
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67011Apparatus for manufacture or treatment
    • H01L21/67155Apparatus for manufacturing or treating in a plurality of work-stations
    • H01L21/67161Apparatus for manufacturing or treating in a plurality of work-stations characterized by the layout of the process chambers
    • H01L21/67167Apparatus for manufacturing or treating in a plurality of work-stations characterized by the layout of the process chambers surrounding a central transfer chamber
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67011Apparatus for manufacture or treatment
    • H01L21/67155Apparatus for manufacturing or treating in a plurality of work-stations
    • H01L21/67207Apparatus for manufacturing or treating in a plurality of work-stations comprising a chamber adapted to a particular process
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67242Apparatus for monitoring, sorting or marking
    • H01L21/67276Production flow monitoring, e.g. for increasing throughput
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/677Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere for conveying, e.g. between different workstations
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10BELECTRONIC MEMORY DEVICES
    • H10B12/00Dynamic random access memory [DRAM] devices
    • H10B12/01Manufacture or treatment

Landscapes

  • Engineering & Computer Science (AREA)
  • Manufacturing & Machinery (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Physics & Mathematics (AREA)
  • Chemical & Material Sciences (AREA)
  • Automation & Control Theory (AREA)
  • General Chemical & Material Sciences (AREA)
  • Chemical Kinetics & Catalysis (AREA)
  • Materials Engineering (AREA)
  • Mechanical Engineering (AREA)
  • Metallurgy (AREA)
  • Organic Chemistry (AREA)
  • Semiconductor Memories (AREA)
  • Container, Conveyance, Adherence, Positioning, Of Wafer (AREA)

Description

[0001] 本開示は概して、基板製造のための方法および装置に関し、より具体的には、ダイナミックランダムアクセスメモリ(DRAM)ビット線積層体処理のために使用されるクラスタツールおよび方法に関する。
[0002] 従来のDRAMビット線積層体処理は、基板上にあらかじめ製造されたポリシリコンプラグ(ポリプラグ)を有する基板(例えば、ウエハ)上で、対応する処理を実行するために、複数の異なる/独立したツールを使用する。例えば、典型的には、基板上で実行される処理は、1つまたは複数のタイプの予洗浄処理、バリア金属堆積、バリア層堆積、ビット線金属堆積、ハードマスク堆積などを含みうる。
[0003] 本発明者らは、基板を大気圧条件に曝露することによって引き起こされうる、堆積膜上の酸化が、ポリプラグ製造後に起こり、そして、各後続の処理が基板上で実行された後に、継続して起こりうること、例えば、ポリプラグからバリア金属堆積まで、バリア金属堆積からバリア層堆積まで、バリア層堆積からビット線金属堆積まで、などを観察した。酸化は、基板上の抵抗の欠点(すなわち、抵抗接点の欠如)、および基板の材料特性の劣化につながる可能性がある。
[0004] そのため、本発明者らは、例えば、DRAMビット線積層体処理に有用な基板を処理するための改善された方法および装置を提示した。
[0005] 基板製造のための方法および装置を本明細書に提示している。本開示の一態様では、基板上でポリプラグ製造後にDRAMビット線積層体処理を実行するためのクラスタツールが提供される。いくつかの実施形態では、クラスタツールは、フロントエンドモジュールと、真空搬送モジュール(VTM)と、基板を受け取り、基板上で複数のDRAMビット線処理のうちの対応する1つの処理を実行するために、それぞれ独立してVTMに接続された複数の処理チャンバとを含む。
[0006] 本開示の一態様では、基板上でポリプラグ製造後にDRAMビット線積層体処理を実施するための方法が提供される。いくつかの実施形態では、この方法は、クラスタツールのフロントエンドモジュールに基板を装填することと、クラスタツールのVTMを使用して、フロントエンドモジュールから複数の処理チャンバのうちの少なくとも1つに基板を搬送することと、基板上で複数のDRAMビット線処理のうちの少なくとも1つの処理を実行することとを含む。
[0007] 本開示の一態様では、プロセッサによって実行されたときに、基板上のポリプラグ製造後にDRAMビット線積層体処理を実行するための方法を実行する複数の命令が記憶された非一時的なコンピュータ可読記憶媒体が提供される。いくつかの実施形態では、この方法は、クラスタツールのフロントエンドモジュールに基板を装填することと、クラスタツールのVTMを使用して、フロントエンドモジュールから複数の処理チャンバのうちの少なくとも1つに基板を搬送することと、基板上で複数のDRAMビット線処理のうちの少なくとも1つの処理を実行することとを含む。
[0008] 本開示のその他の実施形態および、さらなる実施形態については、以下で説明する。
[0009] 上記で簡潔に要約されており、以下で詳述する本開示の実施形態は、付随する図面に示している本開示の例示的な実施形態を参照することにより、理解することができる。
本開示の少なくともいくつかの実施形態によるクラスタツールの図である。 本開示の少なくともいくつかの実施形態による、基板製造のための方法のフロー図である。 本開示の少なくともいくつかの実施形態による基板の図である。
[0013] 理解を容易にするために、可能な場合には、図に共通する同一の要素を指し示すのに同一の参照番号を使用した。図は縮尺どおりには描かれておらず、明確性のために簡略化されていることがある。一実施形態の要素および特徴は、さらなる記述がなくても、他の実施形態に有益に組み込むことが可能である。
[0014] 基板製造のための方法および装置を本明細書に提示している。より具体的には、図1は、本開示の少なくともいくつかの実施形態による、基板製造のために、例えば、ポリプラグ製造後に構成されるクラスタツール100の図である。クラスタツール100は、1つまたは複数の真空搬送モジュール(VTM;図1に示されるVTM101およびVTM102)、フロントエンドモジュール104、複数の処理チャンバ/モジュール106、108、110、112、114、116および118、ならびに処理コントローラ120(コントローラ120)を含む。図1に示すように、2つ以上のVTMを有する実施形態では、1つまたは複数の通過チャンバが設けられ、1つのVTMから別のVTMへの真空搬送を容易にすることができる。図1に示す実施形態と矛盾しない実施形態では、2つの通過チャンバ(例えば、通過チャンバ140および通過チャンバ142)を設けることができる。本開示による修正に適したクラスタツールの非限定的な例には、カリフォルニア州サンタクララのApplied Materials, Inc.から市販されているENDURA(登録商標)ラインの処理ツールが含まれる。
[0015] フロントエンドモジュール104は、クラスタツール100を使用して処理される、例えばFOUP(前方開口型統一ポッド)または他の適切な基板収容ボックスまたはキャリアから1つまたは複数の基板を受け取るように構成された装填ポート122を含む。装填ポート122は、1つまたは複数の基板を装填するために使用することができる3つの装填領域124a~124cを含むことができる。しかしながら、より多くの装填領域、またはより少ない装填領域を使用することもできる。説明のために、図3は、例えば、クラスタツール100の外で処理されたポリプラグ302と、クラスタツール100内で製造された、以下に説明するような複数の追加層とを有する基板300の一部の概略側面図を示す。
[0016] フロントエンドモジュール104は、装填ポート122に装填された基板を搬送するために使用される大気搬送モジュール(ATM)126を含む。より具体的には、ATM126は、ATM126を装填ポート122に接続するドア135(破線で示される)を通して、装填領域124a~124cからATM126に基板を搬送するように構成された、1つまたは複数のロボットアーム128(破線で示される)を含む。典型的には、各装填ポート(124a~124c)に対して1つのドアがあり、それぞれの装填ポートからATM126への基板搬送を可能にする。また、ロボットアーム128は、ATM126から、ATM126をエアロック130a、130bに接続するドア132(各エアロックに1つずつ、破線で示す)を介してエアロック130a、130bに基板を搬送するように構成されている。エアロックの数は、2つより多くても少なくてもよいが、例示を目的として、2つのエアロック(130aおよび130b)が示されており、各エアロックはATM126に接続するためのドアを有する。
[0017] エアロック130a、130bは、コントローラ120の制御下で、大気圧環境または真空圧環境のいずれかに維持することができ、VTM101、102へ、またはVTM101、102から搬送される基板のための中間的な、または一時的な保持空間として機能する。VTM101は、基板をエアロック130a、130bから複数の処理チャンバ106、108の1つまたは複数に、または1つまたは複数の通過チャンバ140および142に、真空破壊することなく、すなわち、VTM102および複数の処理チャンバ106、108ならびに通過チャンバ140および142内の真空圧力環境を維持しながら搬送するように構成されたロボットアーム138(破線で示す)を含む。VTM102は、真空破壊することなく、すなわち、VTM102および複数の処理チャンバ106、108、110、112、114、116、および118内の真空圧力環境を維持しながら、基板をエアロック130a、130bから複数の処理チャンバ106、108、110、112、114、116、および118のうちの1つまたは複数に搬送するように構成されたロボットアーム138(破線で示す)を含む。
[0018] 特定の実施形態では、エアロック130a、130bを省略することができ、コントローラ120は、基板をATM126からVTM102に直接移動させるように構成することができる。
[0019] ドア134、例えばスリット弁ドアは、それぞれのエアロック130a、130bをVTM101に接続する。同様に、ドア136、例えばスリット弁ドアは、それぞれの処理モジュールが連結されるVTM(例えば、VTM101またはVTM102のいずれか)に各処理モジュールを接続する。複数の処理チャンバ106、108、110、112、114、116、および118は、本明細書で説明するポリプラグ製造後の基板に典型的に関連する1つまたは複数の処理を実行するように構成される。
[0020] コントローラ120は、クラスタツール100の全体的な動作を制御し、クラスタツール100の動作に関連するデータまたはコマンド/命令を記憶するためのメモリ121を含む。例えば、基板をVTM101へ、あるいはVTM101から搬送するため、また、VTM101とVTM102との間で搬送するため、コントローラ120は、ATM126、VTM101、VTM102のロボットアーム128、138、139をそれぞれ制御する。コントローラ120は、ドア132、134、136の開閉を制御し、エアロック130a、130bの圧力を制御し、例えば、基板搬送処理のために必要に応じて、エアロック130a、130b内の大気圧環境または真空圧環境のいずれかを維持する。コントローラ120はまた、以下でより詳細に説明するように、個々の処理チャンバ106、108、110、112、114、116、および118の動作を制御して、それらに関連する動作を実行する。
[0021] 図2は、クラスタツール100を使用して、ポリプラグ製造後に、1つまたは複数のDRAMビット線積層体処理を実行するための方法である。例示のために、図3は、例えば、ポリプラグ302がクラスタツール100の外側の基板300上に形成された後の、ポリプラグ302を含む基板300の一部の概略側面図を示す。図2の方法を実行する前に、基板300は、1つまたは複数の装填領域124a~124cを介して、装填ポート122に装填されうる。ATM126のロボットアーム128は、コントローラ120の制御下で、ポリプラグ302を有する基板300を装填領域124aからATM126に搬送することができる。
[0022] コントローラ120は、一方または両方のエアロック130a、130bが使用されているかどうかに応じて、少なくとも1つのエアロック130a、130bが大気圧環境にあるかどうかを判断することができる。説明のために、エアロック130aのみが使用されていると仮定する。コントローラ120が、エアロック130aは大気圧環境にあると判断した場合には、コントローラ120では、ATM126をエアロック130aに接続するドア(132の一部)を開けることができる。逆に、コントローラ120が、エアロック130aは大気圧環境にないと判断した場合には、コントローラ120は、エアロック130a内の圧力を大気圧環境(例えば、エアロック130a、130bに動作可能に接続され、コントローラ120によって制御される圧力制御バルブを介して)に調整することができ、エアロック130a内の圧力を再チェックすることができる。
[0023] コントローラは、ロボットアーム128に、基板300をATM126からエアロック130aに搬送するように指示し、ドア132を閉じ、エアロック130a内の圧力を真空圧力環境に調整し、例えば、VTM101の内部の真空圧力環境に合致させるか、または実質的に合致させることができる。
[0024] コントローラ120は、エアロック130aが真空圧力環境にあるか否かを判断することができる。コントローラ120が、エアロック130aは真空圧力環境にあると判断した場合には、コントローラは、VTM101をエアロック130aに接続するドア134を開けることができる。逆に、コントローラ120が、エアロック130aは真空圧力環境にないと判断した場合には、コントローラ120は、エアロック130a内の圧力を真空圧力環境に(例えば、エアロック130a、130bに動作可能に接続され、コントローラ120によって制御される圧力制御バルブを介して)調整し、エアロック130a内の圧力を再チェックすることができる。
[0025] 200では、コントローラ120は、ロボットアーム138に、エアロック130aからドア134を通ってVTM101に基板300を搬送するように指示し、ドア134を閉じる。あるいは、ドア134は、例えば、クラスタツール100内での処理の完了時にアウトバウンド基板を受け取るために、開いたままにすることができる。
[0026] 202では、コントローラ120は、ロボットアーム138に、基板300を処理チャンバの1つまたは複数に搬送するように指示し、その結果、基板の製造を完了することができる。すなわち、基板300上のポリプラグ302の上にビット線積層体処理を完了することができる。例えば、202では、コントローラ120は、ロボットアーム138に、処理チャンバ106に対応するドア136を開くように指示することができる。一旦開かれると、コントローラ120は、(真空破壊することなく、すなわち、基板300が処理チャンバ106、108、110、112、および114の間で搬送される間に、真空圧力環境がVTM101およびVTM102内に維持されるように)ロボットアーム138に、基板300を予洗浄チャンバ(例えば、処理チャンバ106)に搬送するように指示することができる。処理チャンバ106は、基板300上に存在しうる汚染物質、例えば、基板300上に存在しうる自然酸化を除去するために、1回以上の予洗浄処理を実行するために使用されうる。そのような予洗浄チャンバの1つは、カリフォルニア州サンタクララのApplied Materials, Inc.から市販されているSiCoNi(商標)処理ツールである。
[0027] 次に、204では、コントローラ120は、ドア136を開き、ロボットアーム138に、基板300を次の処理チャンバに搬送するように指示する。例えば、204では、コントローラ120は、ロボットアーム138に、真空破壊することなく、基板300を予洗浄チャンバからバリア金属堆積チャンバへ搬送するように指示することができる。例えば、コントローラ120は、ロボットアーム138に、処理チャンバ106から、例えば、処理チャンバ108へ真空下で基板を搬送するように指示することができる。処理チャンバ108は、基板300上でバリア金属堆積処理を実行する(例えば、洗浄された基板300およびポリプラグ302の上にバリア金属304を堆積させる)ように構成される。バリア金属は、チタン(Ti)またはタンタル(Ta)のうちの1つとすることができる。
[0028] 次に、206では、コントローラ120は、ロボットアーム138に、真空破壊することなく、バリア金属堆積チャンバからバリア層堆積チャンバへ基板300を搬送するように指示することができる。例えば、コントローラ120は、ロボットアーム138に、真空下の基板を処理チャンバ108から通過チャンバ140、142のいずれかに搬送するように指示することができ、その時点で、VTM102内部のロボットアーム139は基板300を拾い上げ、それを、例えば、処理チャンバ110に移動させることができる。処理チャンバ110は、基板300上でバリア層堆積処理を実行する(例えば、バリア金属304の上にバリア層306を堆積させる)ように構成される。バリア層は、窒化チタン(TiN)、窒化タンタル(TaN)、または窒化タングステン(WN)のうちの1つとすることができる。
[0029] 次に、208では、コントローラ120は、ロボットアーム139に、真空破壊することなく、基板300を処理チャンバ110から、例えば、処理チャンバ112へ搬送するように指示することができる。処理チャンバ112は、基板300上でビット線金属堆積処理を実行する(例えば、206で堆積されたバリア層306の上にビット線金属層308を堆積させる)ように構成される。ビット線金属は、タングステン(W)、モリブデン(Mo)、ルテニウム(Ru)、イリジウム(Ir)、またはロジウム(Rh)のうちの1つとすることができる。
[0030] 次に、210では、コントローラ120は、ロボットアーム139に、真空破壊することなく、基板300を処理チャンバ112から、例えば、処理チャンバ114へ搬送するように指示することができる。処理チャンバ114は、(例えば、208で堆積されたビット線金属層308の上にハードマスク層310を堆積させるために)基板300上にハードマスク堆積処理を実行するように構成される。ハードマスクは、窒化ケイ素(SiN)、酸化ケイ素(SiO)、または炭化ケイ素(SiC)のうちの1つとすることができる。
[0031] いくつかの実施形態では、205に示すように、バリア金属304の堆積後、かつバリア金属304の上にバリア306を堆積させる前に、アニール処理を基板300に実行することができる。アニール処理は、高速熱処理(RTP)アニールのような任意の適切なアニール処理とすることができる。例えば、基板300を処理チャンバ108から処理チャンバ110に搬送する前に、基板300を最初に処理チャンバ116に搬送することができる。真空チャンバ116は、基板300にアニール処理を実行するように構成される。アニール処理の後に、バリア金属304を含むアニールされた基板300は、例えばロボットアーム139を使用して、アニールチャンバ(例えば、処理チャンバ116)からバリア層堆積チャンバ(例えば、処理チャンバ110)へ真空下で搬送されうる。
[0032] 代替的に、または組み合わせて、209aで示されるように、ビット線金属層308の堆積後で、かつビット線金属層308の上にハードマスク層310を堆積させる前に、基板300にアニール処理を実行することができる。例えば、基板300を処理チャンバ112から処理チャンバ114に搬送する前に、基板300を最初に処理チャンバ116(すなわち、アニールチャンバ)に搬送することができる。アニール処理、または、205でアニールが既に実行されている場合の別のアニール処理は、上述のように、その上に堆積されたビット線金属層308を有する基板300上で実行することができる。アニール処理が209aで実行されるいくつかの実施形態では、209bで示すように、アニールされた基板300を別の処理チャンバに移して、ビット線金属層308上に任意選択のキャッピング層309を堆積させることができる。例えば、ビット線金属層308を含むアニールされた基板300は、例えば、ロボットアーム139を使用して、アニールされたビット線金属層308の上にキャッピング層を堆積させることにより、アニールチャンバ(例えば、処理チャンバ116)からキャッピング層堆積チャンバ(例えば、処理チャンバ118)に真空下で搬送することができる。
[0033] いくつかの実施形態では、ビット線金属が堆積された後、ルテニウム(Ru)などのいくつかの金属は、粒子成長材料である。本発明者らは、高温でこのようなビット線金属の上にハードマスク層をその後堆積させると、表面粗さが不良になることを観察した。本発明者らは、低温キャップ層の堆積後にハードマスク層を堆積させる前にビット線金属層をアニールすると、ビット線金属層の表面粗さを有利に改善できることを発見した。一体化されたツール(例えば、クラスタツール100)において上記のシーケンスの各々を実行することによって、結晶粒成長のためのアニール中のビット線金属の酸化は、さらに有利に回避される。
[0034] 本明細書に記載されていない追加の処理を基板300上で実行することもでき、または本明細書に記載されている処理の一部を省略することもできる。
[0035] 処理チャンバ108、110、112、および114(および、使用される場合、チャンバ116、118)に関連する上述の処理が基板300上で実行された後、例えば、VTM102内のロボットアーム139を使用して、基板300を通過チャンバ140、142に搬送し、VTM101内のロボットアーム138を使用して、通過チャンバ140、142からエアロック130a、130bのうちの1つに基板300を搬送するため、基板300はVTM102から搬送ポート122に戻される。次に、ロボットアーム128を使用して、基板300を装填ポート122内のFOUP内の空のスロットに戻すことができる。
[0036] 本明細書で説明するクラスタツール100および使用方法は、有利には、ユーザが、DRAMビット線処理全体にわたって真空圧力環境を維持するように構成された単一のマシンを使用して、ポリプラグ上で複数のDRAMビット線処理を実行することを可能にする。したがって、ポスト基板300の製造中に基板上で生じる酸化の可能性は、排除されないまでも、低減される。加えて、真空圧力環境は、DRAMビット線処理全体を通して維持されるので、ビット線金属材料の選択は、金属の結晶粒成長特性によって制限されない。
[0037] 上記は本開示の実施形態を対象とするが、本開示の基本的な範囲から逸脱することなく、本開示の他の実施形態およびさらなる実施形態が考案されうる。

Claims (20)

  1. ダイナミックランダムアクセスメモリ(DRAM)ビット線積層体処理を実行するためのクラスタツールであって、前記クラスタツールは、
    真空条件下で、その上に形成されたポリシリコンプラグを有する基板を受け取り、真空破壊することなく、複数の処理チャンバとの間で前記基板を搬送するように構成された真空搬送モジュール(VTM)であって、前記複数の処理チャンバの各々は、前記基板に、複数のDRAMビット線処理のうちの対応する処理を実行するため、前記VTMに独立して接続される、真空搬送モジュールを備え、前記複数の処理チャンバは、
    前記基板の表面から自然酸化物を除去するように構成された予洗浄チャンバと、
    前記基板の表面上にバリア金属を堆積させるように構成されたバリア金属堆積チャンバと、
    前記基板の前記表面上にバリア層を堆積させるように構成されたバリア層堆積チャンバと、
    ビット線金属層を前記基板の前記表面上に堆積させるように構成されたビット線金属堆積チャンバと、
    前記ビット線金属層の堆積後、前記基板にアニール処理を実行するように構成されたアニールチャンバと、
    ハードマスク層を前記基板の前記表面上に堆積させるように構成されたハードマスク堆積チャンバと、
    を備える、クラスタツール。
  2. 前記複数の処理チャンバは
    前記基板の前記表面上にキャッピング層を堆積させるように構成されたキャッピングチャンバ、
    をさらに含む、請求項1に記載のクラスタツール。
  3. 前記バリア金属堆積チャンバが堆積させるように構成される前記バリア金属は、チタン(Ti)またはタンタル(Ta)のうちの少なくとも1つを含む、請求項1に記載のクラスタツール。
  4. 前記バリア層堆積チャンバが堆積させるように構成される前記バリア層は、窒化チタン(TiN)、窒化タンタル(TaN)、または窒化タングステン(WN)のうちの少なくとも1つを含む、請求項1に記載のクラスタツール。
  5. 前記ビット線金属堆積チャンバが堆積させるように構成される前記ビット線金属層は、タングステン(W)、モリブデン(Mo)、ルテニウム(Ru)、イリジウム(Ir)、またはロジウム(Rh)のうちの少なくとも1つを含む、請求項1に記載のクラスタツール。
  6. 前記ハードマスク堆積チャンバが堆積させるように構成される前記ハードマスク層は、窒化シリコン(SiN)、酸化シリコン(SiO)、または炭化シリコン(SiC)のうちの少なくとも1つを含む、請求項1から5のいずれか一項に記載のクラスタツール。
  7. 前記クラスタツールは、前記複数の処理チャンバを制御するように構成されたコントローラをさらに備える、請求項1に記載のクラスタツール。
  8. コントローラは、複数の命令が記憶された非一時的コンピュータ可読記憶媒体を備え、前記複数の命令は、前記コントローラによって実行されると、前記DRAMビット線積層体処理を実行するための方法を実行し、当該方法は、
    真空条件下で、ポリシリコンプラグを有するシリコン基板を、前記クラスタツールのVTMで受け取ることと、
    真空破壊することなく、前記基板を前記VTMから予洗浄チャンバに搬送して、前記ポリシリコンプラグの表面から自然酸化物を除去することと、
    真空破壊することなく、前記基板を前記予洗浄チャンバからバリア金属堆積チャンバに搬送して、前記ポリシリコンプラグ上にバリア金属を堆積させることと、
    真空破壊することなく、前記基板を前記バリア金属堆積チャンバからバリア層堆積チャンバに搬送して、前記バリア金属上にバリア層を堆積させることと、
    真空破壊することなく、前記基板を前記バリア層堆積チャンバからビット線金属堆積チャンバに搬送して、前記バリア層上にビット線金属層を堆積させることと、
    真空破壊することなく、前記基板を前記ビット線金属堆積チャンバからアニールチャンバに搬送し、前記基板にアニール処理を実行することと、
    真空破壊することなく、前記基板を前記アニールチャンバからハードマスク堆積チャンバに搬送して、前記ビット線金属層上にハードマスク層を堆積することと、
    を含む、請求項1から5または7のいずれか一項に記載のクラスタツール。
  9. ダイナミックランダムアクセスメモリ(DRAM)ビット線積層体処理を実行する方法であって、
    クラスタツールの真空搬送モジュール(VTM)内で、真空条件下で、ポリシリコンプラグを有する基板を受け取ることと、
    前記基板上のポリプラグの表面から自然酸化物を除去するために、真空破壊することなく、前記基板を前記VTMから予洗浄チャンバに搬送することと、
    真空破壊することなく、前記基板を前記予洗浄チャンバからバリア金属堆積チャンバに搬送し、前記ポリプラグ上にバリア金属を堆積させることと、
    真空破壊することなく、前記基板を前記バリア金属堆積チャンバからバリア層堆積チャンバに搬送し、前記バリア金属上にバリア層を堆積させることと、
    真空破壊することなく、前記基板を前記バリア層堆積チャンバからビット線金属堆積チャンバに搬送し、前記バリア層上にビット線金属層を堆積させることと、
    真空破壊することなく、前記基板を前記ビット線金属堆積チャンバからアニールチャンバに搬送し、前記基板にアニール処理を実行することと、
    真空破壊することなく、前記基板を前記アニールチャンバからハードマスク堆積チャンバに搬送し、前記ビット線金属層上にハードマスク層を堆積させることと、
    を含む方法。
  10. 真空破壊することなく、前記基板を前記バリア金属堆積チャンバから前記バリア層堆積チャンバに搬送する前に、真空破壊することなく、前記基板を前記バリア金属堆積チャンバから前記アニールチャンバに搬送し、前記基板にアニール処理を実行することをさらに含む、請求項9に記載の方法。
  11. 真空破壊することなく、前記基板を前記アニールチャンバから前記ハードマスク堆積チャンバに搬送する前に
    真空破壊することなく、前記基板を前記アニールチャンバからキャッピングチャンバに搬送し、前記ビット線金属層上にキャッピング層を堆積させること、
    をさらに含む、請求項9に記載の方法。
  12. 前記バリア金属堆積チャンバが堆積させるバリア金属は、チタン(Ti)またはタンタル(Ta)のうちの少なくとも1つを含む、請求項9に記載の方法。
  13. 前記バリア層堆積チャンバが堆積させる前記バリア層は、窒化チタン(TiN)、窒化タンタル(TaN)、または窒化タングステン(WN)のうちの少なくとも1つを含む、請求項9に記載の方法。
  14. 前記ビット線金属堆積チャンバが堆積させる前記ビット線金属層は、タングステン(W)、モリブデン(Mo)、ルテニウム(Ru)、イリジウム(Ir)、またはロジウム(Rh)のうちの少なくとも1つを含む、請求項9に記載の方法。
  15. 前記ハードマスク堆積チャンバが堆積させる前記ハードマスク層は、窒化シリコン(SiN)、酸化シリコン(SiO)、または炭化シリコン(SiC)のうちの少なくとも1つを含む、請求項9から14のいずれか一項に記載の方法。
  16. 前記基板を、前記予洗浄チャンバ、前記バリア金属堆積チャンバ、前記バリア層堆積チャンバ、前記ビット線金属堆積チャンバ、および前記ハードマスク堆積チャンバとの間で搬送することは、前記クラスタツールのコントローラを用いて制御される、請求項9に記載の方法。
  17. 前記VTは、少なくとも1つのエアロックとロボットアームとを備え、前記VTМで前記基板を受け取ることは、真空破壊することなく、前記ロボットアームを用いて前記基板を前記少なくとも1つのエアロックから前記VTに搬送することを含む、請求項9から14または16のいずれか一項に記載の方法。
  18. プロセッサによって実行されるときに、ダイナミックランダムアクセスメモリ(DRAM)ビット線積層体処理を実行するための方法を実行する複数の命令を記憶した、非一時的コンピュータ可読記憶媒体であって、前記方法は、
    真空条件下で、クラスタツールの真空搬送モジュール(VTM)で、ポリシリコンプラグを有する基板を受け取ることと、
    真空破壊することなく、前記基板を前記VTMから予洗浄チャンバに搬送し、前記基板の表面から自然酸化物を除去することと、
    真空破壊することなく、前記基板を前記予洗浄チャンバからバリア金属堆積チャンバに搬送し、前記ポリプラグ上にバリア金属を堆積させることと、
    真空破壊することなく、前記基板を前記バリア金属堆積チャンバからバリア層堆積チャンバに搬送し、前記バリア金属上にバリア層を堆積させることと、
    真空破壊することなく、前記基板を前記バリア層堆積チャンバからビット線金属堆積チャンバに搬送し、前記バリア層上にビット線金属層を堆積させることと、
    真空破壊することなく、前記基板を前記ビット線金属堆積チャンバからアニールチャンバに搬送し、前記基板にアニール処理を実行することと、
    真空破壊することなく、前記基板を前記アニールチャンバからハードマスク堆積チャンバに搬送し、前記ビット線金属層の前記表面上にハードマスク層を堆積させることと、
    を含む、非一時的コンピュータ可読記憶媒体。
  19. 前記基板を前記バリア金属堆積チャンバから前記バリア層堆積チャンバに搬送する前に、真空破壊することなく、前記基板を前記バリア金属堆積チャンバから前記アニールチャンバに搬送し、前記基板にアニール処理を実行すること、または、
    前記基板を前記アニールチャンバから前記ハードマスク堆積チャンバに搬送する前に、真空破壊することなく、前記基板を前記アニールチャンバからキャッピングチャンバに搬送し、前記基板の前記表面上にキャッピング層を堆積させること、
    のうちの少なくとも1つをさらに含む、請求項18に記載の非一時的コンピュータ可読記憶媒体。
  20. 前記バリア金属堆積チャンバが堆積させる前記バリア金属は、チタン(Ti)またはタンタル(Ta)のうちの少なくとも1つを含み、
    前記ビット線金属堆積チャンバが堆積させる前記バリア層は、窒化チタン(TiN)または窒化タンタル(TaN)または窒化タングステン(WN)のうちの少なくとも1つを含み、
    前記ビット線金属堆積チャンバが堆積させる前記ビット線金属層は、タングステン(W)、モリブデン(Mo)、ルテニウム(Ru)、イリジウム(Ir)またはロジウム(Rh)のうちの少なくとも1つを含み、
    前記ハードマスク堆積チャンバが堆積させる前記ハードマスク層は、窒化シリコン(SiN)、酸化シリコン(SiO)または炭化シリコン(SiC)のうちの少なくとも1つを含む、
    請求項18または19に記載の非一時的コンピュータ可読記憶媒体。
JP2021525549A 2018-11-13 2019-10-02 基板製造のための方法および装置 Active JP7240496B2 (ja)

Applications Claiming Priority (3)

Application Number Priority Date Filing Date Title
US16/189,487 2018-11-13
US16/189,487 US10529602B1 (en) 2018-11-13 2018-11-13 Method and apparatus for substrate fabrication
PCT/US2019/054174 WO2020101814A1 (en) 2018-11-13 2019-10-02 Method and apparatus for substrate fabrication

Publications (2)

Publication Number Publication Date
JP2022507132A JP2022507132A (ja) 2022-01-18
JP7240496B2 true JP7240496B2 (ja) 2023-03-15

Family

ID=69058619

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2021525549A Active JP7240496B2 (ja) 2018-11-13 2019-10-02 基板製造のための方法および装置

Country Status (6)

Country Link
US (1) US10529602B1 (ja)
JP (1) JP7240496B2 (ja)
KR (1) KR102517788B1 (ja)
CN (1) CN113016059A (ja)
TW (1) TWI739199B (ja)
WO (1) WO2020101814A1 (ja)

Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US11709477B2 (en) 2021-01-06 2023-07-25 Applied Materials, Inc. Autonomous substrate processing system
WO2022225618A1 (en) * 2021-04-19 2022-10-27 Applied Materials, Inc. System and methods for dram contact formation

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2005260228A (ja) 2004-03-10 2005-09-22 Internatl Business Mach Corp <Ibm> 垂直dramを含む集積回路デバイスとその製法
JP2009503818A (ja) 2005-07-19 2009-01-29 アプライド マテリアルズ インコーポレイテッド 半導体処理のための方法および装置
JP2010103486A (ja) 2008-09-26 2010-05-06 Hitachi Kokusai Electric Inc 基板処理装置のセットアップ方法。

Family Cites Families (25)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO1996025760A1 (fr) * 1995-02-15 1996-08-22 Hitachi, Ltd. Procede et machine de fabrication de semiconducteurs
KR19980068046A (ko) * 1997-02-14 1998-10-15 김광호 자연 산화막을 억제한 폴리사이드 형성방법
JP3630551B2 (ja) * 1998-04-02 2005-03-16 株式会社東芝 半導体記憶装置及びその製造方法
US6391756B1 (en) * 1999-08-31 2002-05-21 Micron Technology, Inc. Semiconductor processing methods of forming contact openings
US6824825B2 (en) * 1999-09-13 2004-11-30 Tokyo Electron Limited Method for depositing metallic nitride series thin film
KR100364656B1 (ko) * 2000-06-22 2002-12-16 삼성전자 주식회사 실리사이드 증착을 위한 화학 기상 증착 방법 및 이를수행하기 위한 장치
KR100413481B1 (ko) * 2001-06-12 2003-12-31 주식회사 하이닉스반도체 반도체 소자의 구리 박막 증착 장비
US20090004850A1 (en) * 2001-07-25 2009-01-01 Seshadri Ganguli Process for forming cobalt and cobalt silicide materials in tungsten contact applications
US6674138B1 (en) 2001-12-31 2004-01-06 Advanced Micro Devices, Inc. Use of high-k dielectric materials in modified ONO structure for semiconductor devices
US20040087163A1 (en) 2002-10-30 2004-05-06 Robert Steimle Method for forming magnetic clad bit line
US20040141832A1 (en) * 2003-01-10 2004-07-22 Jang Geun-Ha Cluster device having dual structure
US8120949B2 (en) 2006-04-27 2012-02-21 Avalanche Technology, Inc. Low-cost non-volatile flash-RAM memory
US8871645B2 (en) 2008-09-11 2014-10-28 Applied Materials, Inc. Semiconductor devices suitable for narrow pitch applications and methods of fabrication thereof
TW201027784A (en) * 2008-10-07 2010-07-16 Applied Materials Inc Advanced platform for processing crystalline silicon solar cells
KR101583717B1 (ko) 2009-01-13 2016-01-11 삼성전자주식회사 저항 메모리 장치의 제조방법
KR101570044B1 (ko) * 2009-03-17 2015-11-20 삼성전자주식회사 저저항의 매립형 금속 게이트 전극 구조를 갖는 반도체 장치 및 그 제조 방법
JP5410174B2 (ja) * 2009-07-01 2014-02-05 株式会社日立国際電気 半導体装置の製造方法、基板処理方法および基板処理システム
US20120088356A1 (en) * 2010-09-14 2012-04-12 Applied Materials, Inc. Integrated platform for in-situ doping and activation of substrates
KR102214961B1 (ko) * 2012-08-08 2021-02-09 어플라이드 머티어리얼스, 인코포레이티드 링크된 진공 프로세싱 툴들 및 그 사용 방법들
KR101686032B1 (ko) * 2013-03-28 2016-12-13 가부시키가이샤 히다치 고쿠사이 덴키 기판 처리 장치, 반도체 장치의 제조 방법 및 기록 매체
JP2016106386A (ja) * 2013-03-28 2016-06-16 東京エレクトロン株式会社 平坦化方法、基板処理システム及びメモリ製造方法
CN105453246A (zh) * 2013-08-12 2016-03-30 应用材料公司 具有工厂接口环境控制的基板处理系统、装置和方法
US10043670B2 (en) * 2015-10-22 2018-08-07 Applied Materials, Inc. Systems and methods for low resistivity physical vapor deposition of a tungsten film
CN108257958A (zh) * 2016-12-29 2018-07-06 联华电子股份有限公司 动态随机存取存储器的位线栅极结构及形成方法
US9960045B1 (en) 2017-02-02 2018-05-01 Applied Materials, Inc. Charge-trap layer separation and word-line isolation for enhanced 3-D NAND structure

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2005260228A (ja) 2004-03-10 2005-09-22 Internatl Business Mach Corp <Ibm> 垂直dramを含む集積回路デバイスとその製法
JP2009503818A (ja) 2005-07-19 2009-01-29 アプライド マテリアルズ インコーポレイテッド 半導体処理のための方法および装置
JP2010103486A (ja) 2008-09-26 2010-05-06 Hitachi Kokusai Electric Inc 基板処理装置のセットアップ方法。

Also Published As

Publication number Publication date
TW202036756A (zh) 2020-10-01
KR20210068138A (ko) 2021-06-08
TWI739199B (zh) 2021-09-11
JP2022507132A (ja) 2022-01-18
WO2020101814A1 (en) 2020-05-22
US10529602B1 (en) 2020-01-07
CN113016059A (zh) 2021-06-22
KR102517788B1 (ko) 2023-04-03

Similar Documents

Publication Publication Date Title
US10903112B2 (en) Methods and apparatus for smoothing dynamic random access memory bit line metal
US6696367B1 (en) System for the improved handling of wafers within a process tool
JP7240496B2 (ja) 基板製造のための方法および装置
JP7254924B2 (ja) ワークピースを処理するためのシステムおよび方法
US20190385838A1 (en) In-Situ Pre-Clean For Selectivity Improvement For Selective Deposition
US11600503B2 (en) High-throughput, multi-chamber substrate processing system
JP2004235456A (ja) 成膜装置、成膜方法および半導体装置の製造方法
US11631680B2 (en) Methods and apparatus for smoothing dynamic random access memory bit line metal
US7077929B2 (en) Apparatus for manufacturing a semiconductor device
JP7206355B2 (ja) ダイナミックランダムアクセスメモリビット線金属を滑らかにするための方法及び装置
US10269926B2 (en) Purging deposition tools to reduce oxygen and moisture in wafers
TW200915484A (en) Filming method, and treating system
US20230044391A1 (en) Selective silicide deposition for 3-d dram
JP7512386B2 (ja) ダイナミックランダムアクセスメモリのビットラインメタルを平滑化する方法及び装置
JP2006253483A (ja) 基板処理装置
TW202319127A (zh) 用於斜角處理的整合濕法清潔
US20220320133A1 (en) Method for forming semiconductor structure
US20230017955A1 (en) System and method for cleaning a pre-clean process chamber
US20240194526A1 (en) Metal based hydrogen barrier
WO2024129544A1 (en) Post-treatment for removing residues from dielectric surface
WO2024211099A1 (en) Memory devices and methods of forming the same
JP2014187104A (ja) 半導体装置の製造方法、基板処理装置、半導体装置、プログラムおよび記憶媒体

Legal Events

Date Code Title Description
A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20210719

A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20210719

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20220802

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20221102

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20230207

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20230303

R150 Certificate of patent or registration of utility model

Ref document number: 7240496

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150