JP7028653B2 - 絶縁同期整流型dc/dcコンバータ - Google Patents

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Description

本発明は、絶縁同期整流型DC/DCコンバータに関する。
AC/DCコンバータをはじめとする様々な電源回路に、絶縁同期整流型DC/DCコンバータが利用される。
図7は、絶縁同期整流型DC/DCコンバータの二次側における一部構成の一例を示す回路図である。図7に示す二次側の構成は、フライバックコンバータ、LLCコンバータで共通である。
図7に示す二次巻線W200は、トランスTrに含まれる。絶縁同期整流型DC/DCコンバータの一次側(不図示)には、トランスTrの一次巻線、スイッチングトランジスタ、当該スイッチングトランジスタを駆動する一次側コントローラなどが含まれる。
二次巻線W200の一端は、不図示の出力端子に接続され、他端は同期整流トランジスタM200のドレインに接続される。同期整流トランジスタM200のソースは、グランドの印加端に接続される。
絶縁同期整流型DC/DCコンバータは、二次側に同期整流コントローラ300Sを有する。同期整流コントローラ300Sは、外部端子として、ゲート端子G10、ドレイン端子D10、ソース端子S10、およびグランド端子GNDを有する。ゲート端子G10には、同期整流トランジスタM200のゲートが接続される。ドレイン端子D10には、同期整流トランジスタM2000のドレインが接続される。ソース端子S10には、同期整流トランジスタM200のソースが接続される。グランド端子GNDには、グランドの印加端が接続される。
同期整流コントローラ300Sは、ドレイン端子D10に発生するドレイン電圧VDS2に基づいてゲート端子G10からゲート信号GSを出力し、同期整流トランジスタM200をスイッチング制御する。一次側のスイッチングトランジスタのスイッチング、および同期整流トランジスタM200のスイッチングにより、一次巻線に印加される入力電圧が出力電圧に変換されて出力端子から出力される。
同期整流コントローラ300Sは、具体的には、ドライバDr1、第1コンパレータCP1、第2コンパレータCP2、フリップフロップFF1、第1ダイオードD1、および第2ダイオードD2を有する。
第1コンパレータCP1の反転入力端(-)には、ドレイン端子D10が接続される。第1コンパレータCP1の非反転入力端(+)には、第1閾値電圧VthAが印加される。第1コンパレータCP1の出力端は、フリップフロップFF1のクロック端子に接続される。第2コンパレータCP2の反転入力端(-)には、ドレイン端子D10が接続される。第2コンパレータCP2の非反転入力端(+)には、第2閾値電圧VthBが印加される。第2コンパレータCP2の出力端は、フリップフロップFF1のリセット端子に接続される。フリップフロップFF1のD入力端子には、所定の電源電圧が印加される。フリップフロップFF1のQ出力端子は、ドライバDr1の入力端に接続される。ドライバDr1の出力端は、ゲート端子G10に接続される。ドライバDr1の低電位側は、ソース端子S10に接続される。
第1閾値電圧VthA、および第2閾値電圧VthBは、ソース端子S10の電位を基準としている。一次側のスイッチングトランジスタの切替えによって、ドレイン電圧VDS2に負の電圧が発生し、第1コンパレータCP1によりドレイン電圧VDS2が第1閾値電圧VthA(例えば-200mV)以下となったことを検出し、第1コンパレータCP1はオン信号Sonをアサートする。これにより、フリップフロップFF1は、Q出力端子の信号をHighレベルとし、ドライバDr1から出力されるゲート信号GSがオンレベルとなり、同期整流トランジスタM200がターンオンされる。
同期整流トランジスタM200がターンオンされると、同期整流トランジスタM200のソースからドレインへ向けて電流Isが流れ始める。電流Isと同期整流トランジスタM200のオン抵抗によってドレイン電圧VDS2が発生し、電流Isが実質的にゼロとなるゼロカレントをドレイン電圧VDS2に基づき第2コンパレータCP2が検出する。具体的には、第2コンパレータCP2は、ドレイン電圧VDS2が第2閾値電圧VthB(例えば-6mV)以上となったことを検出すると、オフ信号Soffをアサートする。これにより、フリップフロップFF1がリセットされ、Q出力端子の信号がLowレベルとされ、ドライバDr1から出力されるゲート信号GSがオフレベルとなり、同期整流トランジスタM200はターンオフされる。
ここで仮に、第2コンパレータCP2の第2閾値電圧VthBがグランド基準である場合、第2コンパレータCP2による検出は、グランドと同期整流トランジスタM200のソースとの間に寄生するインピーダンスR1の影響を受けてしまう。そこで、第2閾値電圧VthBをソース端子S10の電位を基準とすることで、第2コンパレータCP2は、インピーダンスR1の影響を受けないソース基準のドレイン電圧VDS2を検出に用いることができる。従って、同期整流トランジスタM200のターンオフのタイミングを正確に検出できる。
また、ソース端子S10とグランド端子GNDとの間には、互いに逆方向に並列接続される第1ダイオードD1および第2ダイオードD2が配置される。これにより、ソース端子S10と同期整流トランジスタM200のソースとの間がオープン(ソースオープン)となる異常の場合に、ソース端子S10の電圧は、第1ダイオードD1の順方向電圧をVf1、第2ダイオードD2の順方向電圧をVf2とすれば、-Vf1以上+Vf2以下の電圧にクランプされ、電圧が不定となることを回避できる。
特開2009-159721号公報
しかしながら、上記図7で示す構成では、ソースオープンが発生した場合に、第2コンパレータCP2の非反転入力端に印加される閾値電圧は、Vf2+VthBとなる場合がある。例えば、Vf2が+0.6Vで、VthBが-6mAである場合は、Vf2+VthBはほぼ+0.6Vで正電圧となる。
すると、第2コンパレータCP2は、同期整流トランジスタM200がオンで流れる電流Isに基づくドレイン電圧VDS2が所定の正電圧(例えば+0.6V)以上とならなければ、オフ信号Soffをアサートできない。従って、同期整流トランジスタM200のソースからドレインに向かって流れる電流Isが逆方向に逆流してから、オフ信号Soffがアサートされ、同期整流トランジスタM200がターンオフされることになる。このとき、二次巻線W200に蓄えられたエネルギーが同期整流トランジスタM200にかかることで、同期整流トランジスタM200に大電流が流れるアバランシェ降伏が発生し、同期整流トランジスタM200が破壊される虞があった。
なお、ソース端子S10とグランド端子GNDが仮にダイオードにより接続されない構成である場合も、ソースオープンが発生したときにソース端子S10の電圧が不定となって正電圧になった場合に、第2コンパレータCP2の非反転入力端に印加される閾値電圧が正電圧となって、上記と同様の問題が生じる。
上記問題点に鑑み、本発明は、同期整流コントローラにおけるソース端子のソースオープン異常を検出することが可能となる絶縁同期整流型DC/DCコンバータを提供することを目的とする。
本発明は、
二次側に配置される同期整流トランジスタと、
前記同期整流トランジスタの駆動を制御する同期整流コントローラと、を備えた絶縁同期整流型DC/DCコンバータであって、
前記同期整流コントローラは、
前記同期整流トランジスタのドレインに接続されるドレイン端子と、
前記同期整流トランジスタのソースに接続されるソース端子と、
前記ドレイン端子のドレイン電圧と、前記ソース端子の電位を基準とした所定の閾値電圧とを比較するコンパレータと、
前記コンパレータから出力されるオフ信号が入力される第1フリップフロップと、
前記第1フリップフロップの出力信号に基づいて前記同期整流トランジスタにゲート信号を出力するドライバと、
前記ソース端子の電圧を検出用閾値電圧と比較する異常検出用コンパレータを含んで、前記異常検出用コンパレータの出力に基づいて第1異常検出信号を出力する第1異常検出回路と、
を有する構成としている(第1の構成)。
また、上記第1の構成において、前記同期整流コントローラは、前記第1フリップフロップの出力信号と前記第1異常検出信号とが入力されて前記ドライバへ出力信号を出力するAND回路をさらに有することとしてもよい(第2の構成)。
また、上記第2の構成において、前記第1異常検出回路は、前記異常検出用コンパレータの出力が入力される第2フリップフロップと、前記第2フリップフロップの出力が入力されて前記第1異常検出信号を出力するインバータと、をさらに有することとしてもよい(第3の構成)。
また、上記第1の構成において、前記同期整流コントローラは、外部端子として異常出力端子を有し、前記第1異常検出回路は、前記異常検出用コンパレータの出力に基づいて前記異常出力端子を介して前記第1異常検出信号を出力することとしてもよい(第4の構成)。
また、上記第1から第4のいずれかの構成において、前記同期整流コントローラは、グランド端子と、前記ソース端子と前記グランド端子との間に互いに逆方向に並列接続されるダイオードと、をさらに有することとしてもよい(第5の構成)。
また、上記第1から第4のいずれかの構成において、前記同期整流コントローラは、グランド端子を有し、前記同期整流コントローラ内部において、前記ソース端子と前記グランド端子とは非接続であることとしてもよい(第6の構成)。
また、上記第1から第6のいずれかの構成において、前記異常検出用コンパレータは、前記ソース端子の電圧が前記検出用閾値電圧を上回った状態が所定期間継続したときに、出力信号をアサートすることとしてもよい(第7の構成)。
また、上記第1から第7のいずれかの構成において、前記同期整流コントローラは、前記ドレイン端子のオープンを検出すると、第2異常検出信号をアサートすることにより一次側コントローラに一次側に配置されるスイッチングトランジスタのスイッチングを停止させる第2異常検出回路をさらに有することとしてもよい(第8の構成)。
また、上記第8の構成において、前記第2異常検出回路は、前記ドレイン端子に周期信号が発生しておらず、且つ、当該絶縁同期整流型DC/DCコンバータの出力電圧が発生している場合に、前記第2異常検出信号をアサートすることとしてもよい(第9の構成)。
また、上記第8または第9の構成において、フォトカプラと、当該絶縁同期整流型DC/DCコンバータの出力電圧に基づいて前記フォトカプラの発光素子を駆動することで前記一次側コントローラへのフィードバック信号を生成するフィードバック回路と、をさらに備え、前記同期整流コントローラは、前記発光素子に接続されて前記第2異常検出信号により駆動されるトランジスタを有することとしてもよい(第10の構成)。
また、上記第1から第10のいずれかの構成において、第1同期整流トランジスタおよび第2同期整流トランジスタを有するLLCコンバータとして構成される絶縁同期整流型DC/DCコンバータであり、
前記同期整流コントローラは、
前記第1同期整流トランジスタのドレインに接続される第1ドレイン端子と、
前記第2同期整流トランジスタのドレインに接続される第2ドレイン端子と、
前記第1同期整流トランジスタのソースに接続される第1ソース端子と、
前記第2同期整流トランジスタのソースに接続される第2ソース端子と、
前記第1同期整流トランジスタのゲートに接続される第1ゲート端子と、
前記第2同期整流トランジスタのゲートに接続される第2ゲート端子と、
前記第1ゲート端子からゲート信号を出力する第1ドライバと、
前記第2ゲート端子からゲート信号を出力する第2ドライバと、
前記第1フリップフロップの出力信号が入力される分周器と、
前記分周器の出力に基づいて、前記第1ドレイン端子、前記第2ドレイン端子と前記コンパレータとの間の経路を切替えるとともに、前記第1フリップフロップと前記第1ドライバ、前記第2ドライバとの間の経路を切替えるセレクタと、
を有し、
前記閾値電圧は、前記第1ソース端子および前記第2ソース端子の電位を基準とし、
前記異常検出用コンパレータは、前記第1ソース端子の電圧と前記第2ソース端子の電圧のうち高い方の電圧を前記検出用閾値電圧と比較することとしてもよい(第11の構成)。
また、上記第11の構成において、前記同期整流コントローラは、前記第1フリップフロップの出力信号と前記第1異常検出信号とが入力されて前記セレクタへ出力信号を出力するAND回路をさらに有することとしてもよい。
本発明の絶縁同期整流型DC/DCコンバータによると、ソース端子のソースオープン異常を検出することが可能となる。
本発明の第1実施形態に係るDC/DCコンバータの回路図である。 分周器の一構成例を示す回路図である。 本発明の第1実施形態に係るDC/DCコンバータの通常動作を示すタイミングチャートである。 本発明の第2実施形態に係るDC/DCコンバータの回路図である。 本発明の第3実施形態に係るDC/DCコンバータの回路図である。 本発明の第4実施形態に係るDC/DCコンバータの回路図である。 同期整流コントローラの一構成例を示す回路図である。
以下に本発明の一実施形態について図面を参照して説明する。
<1.第1実施形態>
<<LLCコンバータの全体構成>>
図1は、第1実施形態に係るDC/DCコンバータ200Aの回路図である。DC/DCコンバータ200Aは、LLCコンバータとしての絶縁同期整流型DC/DCコンバータである。DC/DCコンバータ200Aは、入力端子P1に印加される入力電圧Vinに基づいて出力電圧Voutを生成して出力端子P2から出力する。
DC/DCコンバータ200Aは、一次側の構成としてスイッチングトランジスタM11,M12、一次側コントローラ202A、共振コンデンサCr、およびトランスT1の一次巻線W1を有し、二次側の構成としてトランスT1の二次巻線W21,W22、同期整流トランジスタM21,M22、出力コンデンサC1、抵抗R21,R22、ダイオードDD、コンデンサCC、および同期整流コントローラ300Aを有する。
スイッチングトランジスタM11のドレインは、直流の入力電圧Vinが印加される入力端子P1に接続される。スイッチングトランジスタM11のソースは、スイッチングトランジスタM12のドレインに接続される。スイッチングトランジスタM12のソースは、グランドの印加端に接続される。スイッチングトランジスタM11とスイッチングトランジスタM12とが接続される接続ノードには、共振コンデンサCrの一端が接続される。共振コンデンサCrの他端は、一次巻線W1の一端に接続される。一次巻線W1の他端は、スイッチングトランジスタM12のソースに接続される。
一次側コントローラ202Aは、スイッチングトランジスタM11,M12のゲートに駆動信号を出力することでスイッチングトランジスタM11,M12をスイッチング制御する。
二次巻線W21の一端は、第1同期整流トランジスタM21のドレインに接続される。第1同期整流トランジスタM21は、ボディダイオードBD1を有する。第1同期整流トランジスタM21のソースは、接地端子P3に接続される。接地端子P3は、グランドの印加端に接続される。
二次巻線W21の他端は、二次巻線W22の一端に接続される。二次巻線W22の他端は、第2同期整流トランジスタM22のドレインに接続される。第2同期整流トランジスタM22は、ボディダイオードBD2を有する。第2同期整流トランジスタM22のソースは、接地端子P3に接続される。
二次巻線W21と二次巻線W22とが接続される接続ノードは、出力端子P2に接続される。出力端子P2と接地端子P3との間には、出力コンデンサC1が接続される。また、出力端子P2と接地端子P3との間には、抵抗R21と抵抗R22とが直列に接続される。抵抗R21と抵抗R22とが接続される接続ノードには、FB(フィードバック)回路206が接続される。
FB回路206は、例えばシャントレギュレータ等を有し、出力電圧Voutを抵抗R21,R22により分圧した後の電圧と、所定の目標電圧との誤差に応じた電流でフォトカプラ204の発光素子を駆動する。フォトカプラ204の受光素子には、誤差に応じたフィードバック電流Ifbが流れる。一次側コントローラ202AのFB(フィードバック)ピンには、フィードバック電流Ifbに応じたフィードバック信号Vfbが発生し、一次側コントローラ202Aは、フィードバック信号Vfbに基づいてスイッチングトランジスタM11,M12を駆動する。
同期整流コントローラ300Aは、LDO(Low Dropout)レギュレータ301と、セレクタ302と、分周器303と、フリップフロップ304と、第1コンパレータ305と、第2コンパレータ306と、ソースオープン異常検出回路307と、AND回路308と、セレクタ309と、第1ドライバDr21と、第2ドライバDr22と、ダイオードD211,D212と、ダイオードD221,D222と、を一つのパッケージに収めて有する。
また、同期整流コントローラ300Aは、外部との電気的接続を確立するための第1ドレイン端子D21、第1ゲート端子G21、第1ソース端子S21、第2ドレイン端子D22、第2ゲート端子G22、第2ソース端子S22、電源端子VCC、およびグランド端子GNDを有する。
第1同期整流トランジスタM21のドレインが接続される第1ドレイン端子D21は、セレクタ302の入力端302Aにおける一方の端子に接続される。第2同期整流トランジスタM22のドレインが接続される第2ドレイン端子D22は、入力端302Aにおける他方の端子に接続される。セレクタ302の出力端子302Bは、第1コンパレータ305、第2コンパレータ306それぞれの反転入力端(-)に接続される。セレクタ302は、第1ドレイン端子D21から出力端302Bへの経路の導通と、第2ドレイン端子D22から出力端302Bへの経路の導通とを切替える。すなわち、セレクタ302は、第1ドレイン端子D21のドレイン電圧VDS21と第2ドレイン端子D22のドレイン電圧VDS22のいずれを、第1コンパレータ305、および第2コンパレータ306の検出対象とするかを選択する。
第1コンパレータ305の非反転入力端(+)には、第1閾値電圧VthAが印加される。セレクタ309の出力端309Bが第1閾値電圧VthAの基準電位となる。セレクタ309の入力端309Aにおける一方の端子は、第1ソース端子S21に接続され、入力端309Aにおける他方の端子は、第2ソース端子S22に接続される。セレクタ309により第1ソース端子S21と出力端309Bが導通した場合、第1閾値電圧VthAは、第1ソース端子S21の電位が基準となり、セレクタ309により第2ソース端子S22と出力端309Bが導通した場合、第1閾値電圧VthAは、第2ソース端子S22の電位が基準となる。第1コンパレータ305の出力端は、フリップフロップ304のセット端子に接続される。第1コンパレータ305は、スイッチングトランジスタM11,M12のターンオンによりドレイン電圧VDS21,VDS22が負電圧に低下したことを、ドレイン電圧VDS21,VDS22が第1閾値電圧VthA(例えば-200mV)以下となったことで検出する。このとき、第1コンパレータ305は、オン信号Sonをアサートする。アサートされたオン信号Sonによって第1同期整流トランジスタM21,第2同期整流トランジスタM22はターンオンされる。
第2コンパレータ306の非反転入力端(+)には、第2閾値電圧VthBが印加される。セレクタ309の出力端309Bが第2閾値電圧VthBの基準電位となる。セレクタ309により第1ソース端子S21と出力端309Bが導通した場合、第2閾値電圧VthBは、第1ソース端子S21の電位が基準となり、セレクタ309により第2ソース端子S22と出力端309Bが導通した場合、第2閾値電圧VthBは、第2ソース端子S22の電位が基準となる。第2コンパレータ306の出力端は、フリップフロップ304のリセット端子に接続される。第2コンパレータ306は、オンとされた第1同期整流トランジスタM21、第2同期整流トランジスタM22により流れる電流Is1,Is2が実質的にゼロとなるゼロカレントを、ドレイン電圧VDS21,VDS22が第2閾値電圧VthB(例えば-6mV)以上となったことで検出する。このとき、第2コンパレータ306は、オフ信号Soffをアサートする。アサートされたオフ信号Soffによって第1同期整流トランジスタM21,第2同期整流トランジスタM22はターンオフされる。
第2閾値電圧VthBが第1ソース端子S21の電位を基準としていることにより、第1同期整流トランジスタM21がオンのときにグランドと第1同期整流トランジスタM21との間に寄生するインピーダンスの影響を受けないソースを基準としたドレイン電圧VDS21を検出に利用できる。同様に、第2閾値電圧VthBが第2ソース端子S22の電位を基準としていることにより、第2同期整流トランジスタM22がオンのときにグランドと第2同期整流トランジスタM22との間に寄生するインピーダンスの影響を受けないソースを基準としたドレイン電圧VDS22を検出に利用できる。
フリップフロップ304のQ出力端子は、分周器303の入力端とともに後述するAND回路308の入力端に接続される。分周器303は、例えば図2に示す構成であり、Dフリップフロップ303Aと、インバータ303Bと、を有する。Dフリップフロップ303Aのクロック端子に、フリップフロップ304からのQ出力信号SQが入力される。Dフリップフロップ303AのQ出力端子には、インバータ303Bの入力端が接続される。インバータ303Bの出力端は、Dフリップフロップ303AのD入力端子に接続される。
このような構成により、Q出力信号SQのHighからLowへの立下りタイミングごとに、Dフリップフロップ303AのQ出力端子から出力される分周器出力信号Sfは、HighとLowが切替わる。分周器303は、入力されるQ出力信号SQの周期を2倍として分周器出力信号Sfを出力する。
分周器出力信号Sfは、セレクタ302に出力される。セレクタ302は、分周器出力信号Sfのレベルに応じて、入力端302Aと出力端302との間の切替え、および入力端302Dと出力端302Cとの切替えを行う。Q出力信号SQが入力されるAND回路308の出力端は、入力端302Dに接続される。出力端302Cにおける一方の端子は、第1ドライバDr21の入力端に接続される。第1ドライバDr21の出力端は、第1ゲート端子G21を介して第1同期整流トランジスタM21のゲートに接続される。第1ドライバDr21は、入力される信号のレベルに応じてレベルを切替えたゲート信号SG21を出力する。
出力端302Cにおける他方の端子は、第2ドライバDr22の入力端に接続される。第2ドライバDr22の出力端は、第2ゲート端子G22を介して第2同期整流トランジスタM22のゲートに接続される。第2ドライバDr22は、入力される信号のレベルに応じてレベルを切替えたゲート信号SG22を出力する。
セレクタ302により、AND回路308の出力端から第1ドライバDr21までの経路の導通と、AND回路308の出力端から第2ドライバDr22までの経路の導通と、が切替えられる。
また、分周器出力信号Sfは、セレクタ309にも出力される。セレクタ309は、分周器出力信号Sfのレベルに応じて、入力端309Aと出力端309Bとの間の導通の切替えを行う。
ダイオードDDのアノードは、出力端子P2に接続される。ダイオードDDのカソードは、電源端子VCCとともにコンデンサCCの一端に接続される。コンデンサCCの他端は、接地端P3に接続される。LDOレギュレータ301は、電源端子VCCに印加される入力電圧に基づいて内部電圧を生成して出力する。内部電圧の一部は、第1ドライバDr21、第2ドライバDr22の高電位側に供給される。第1ドライバDr11の低電位側は、第1ソース端子S21に接続される。第2ドライバDr22の低電位側は、第2ソース端子S22に接続される。
また、第1ソース端子S21とグランド端子GNDとの間には、互いに逆方向に並列接続されたダイオードD211,D212が接続される。これにより、仮に第1ソース端子S21と第1同期整流トランジスタM21のソースとの間でソースオープンとなる異常が発生した場合でも、第1ソース端子S21の電圧はダイオードD211,D212の順方向電圧によりクランプされ、不定となることを回避できる。
同様に、第2ソース端子S22とグランド端子GNDとの間には、互いに逆方向に並列接続されたダイオードD221,D222が接続される。これにより、仮に第2ソース端子S22と第2同期整流トランジスタM22のソースとの間でソースオープンとなる異常が発生した場合でも、第2ソース端子S22の電圧はダイオードD221,D222の順方向電圧によりクランプされ、不定となることを回避できる。
なお、ソースオープン異常検出回路307は、第1ソース端子S21、第2ソース端子S22のソースオープンを検出する回路であるが、その詳細については後述する。
<<LLCコンバータの基本的な動作>>
次に、このように構成されたDC/DCコンバータ200Aの動作について説明する。ここでは、図3に示すタイミングチャートを用い、第1ソース端子S21、第2ソース端子S22ともにソースオープンは発生しておらず、後述するソースオープン異常検出回路307から出力されてAND回路308の一方の入力端に入力される異常検出信号SFLは正常を示すHighであり、Q出力信号SQがそのままセレクタ302の入力端302Dに入力される状態での動作を説明する。
タイミングt0の手前で、分周器出力信号SfはLowであり、セレクタ302により、検出対象として第2ドレイン端子D22のドレイン電圧VDS22、Q出力信号SQの出力先として第2ドライバDr22がそれぞれ選択されている。また、セレクタ309により、第1閾値電圧VthAおよび第2閾値電圧VthBの基準電位として、第2ソース端子S22の電位が選択される。そして、タイミングt0において、スイッチングトランジスタM11がターンオンされると、第2同期整流トランジスタM22のボディダイオードBD2を介して電流Is2が流れ始め、ドレイン電圧VDS22が負電圧に低下したことが第1コンパレータ305により検出され、オン信号Sonがアサートされる。これにより、Q出力信号SQはHighに切替えられ、第2ドライバDr22によりゲート信号SG22がオンレベルとなり、タイミングt1で第2同期整流トランジスタM22がターンオンされる。従って、電流Is2は、第2同期整流トランジスタM22をソースからドレイン側へ流れ始める。
電流Is2は共振電流であり、正弦波状となる。そして、タイミングt2において、電流Is2がゼロカレントとなったことがドレイン電圧VDS22に基づき第2コンパレータ306により検出され、オフ信号Soffがアサートされる。これにより、Q出力信号SQはLowに切替えられ、ゲート信号SG22はオフレベルとなり、第2同期整流トランジスタM22はターンオフされる。このとき、分周器出力信号SfはHighに切替えられる。これにより、セレクタ302により、検出対象として第1ドレイン端子D21のドレイン電圧VDS21、Q出力信号SQの出力先として第1ドライバDr21がそれぞれ選択される。また、セレクタ309により、第1閾値電圧VthAおよび第2閾値電圧VthBの基準電位として、第1ソース端子S21の電位が選択される。
なお、ターンオフされた第2同期整流トランジスタM22においては、ボディダイオードBD2を介して電流Is2は流れ続け、タイミングt3にて電流Is2は流れなくなる。
そして、タイミングt4において、スイッチングトランジスタM12がターンオンされると、第1同期整流トランジスタM21のボディダイオードBD1を介して電流Is1が流れ始め、ドレイン電圧VDS21が負電圧に低下したことが第1コンパレータ305により検出され、オン信号Sonがアサートされる。これにより、Q出力信号SQはHighに切替えられ、第1ドライバDr21によりゲート信号SG21がオンレベルとなり、タイミングt5で第1同期整流トランジスタM21がターンオンされる。従って、電流Is1は、第1同期整流トランジスタM21をソースからドレイン側へ流れ始める。
電流Is1は共振電流であり、正弦波状となる。そして、タイミングt6において、電流Is1がゼロカレントとなったことがドレイン電圧VDS21に基づき第2コンパレータ306により検出され、オフ信号Soffがアサートされる。これにより、Q出力信号SQはLowに切替えられ、ゲート信号SG21はオフレベルとなり、第1同期整流トランジスタM21はターンオフされる。このとき、分周器出力信号SfはLowに切替えられる。これにより、セレクタ302により、検出対象として第2ドレイン端子D22のドレイン電圧VDS22、Q出力信号SQの出力先として第2ドライバDr22がそれぞれ選択される。また、セレクタ309により、第1閾値電圧VthAおよび第2閾値電圧VthBの基準電位として、第2ソース端子S22の電位が選択される。
なお、ターンオフされた第1同期整流トランジスタM21においては、ボディダイオードBD1を介して電流Is1は流れ続け、タイミングt7にて電流Is1は流れなくなる。以降は、同様の繰り返し動作となる。
<<ソースオープン異常検出回路について>>
次に、ソースオープン異常検出回路307について詳述する。図1に示すように、ソースオープン異常検出回路307は、コンパレータ307Aと、フリップフロップ307Bと、インバータ307Cと、を有する。
コンパレータ307Aの一方の非反転入力端には、第1ソース端子S21が接続され、他方の非反転入力端には、第2ソース端子S22が接続される。コンパレータ307Aの反転入力端には、所定の閾値電圧Vth307が印加される。コンパレータ307Aの出力端は、フリップフロップ307Bのクロック端子に接続される。フリップフロップ307BのD入力端子には、所定の電源電圧が印加される。フリップフロップ307BのQ出力端子には、インバータ307Cの入力端が接続される。インバータ307Cの出力端は、AND回路308の一方の入力端に接続される。
コンパレータ307Aは、第1ソース端子S21の電圧と第2ソース端子S22の電圧のうち高いほうの電圧を閾値電圧Vth307と比較し、比較結果が閾値電圧Vth307より高い状態が所定期間(例えば10μs)継続すると、フリップフロップ307Bのクロック端子に出力する信号をHighに切替える。第1ソース端子S21にソースオープンが発生した場合は、第1ソース端子S21にダイオードD212の順方向電圧(例えば+0.6V)が発生する場合がある。第2ソース端子S22にソースオープンが発生した場合は、第2ソース端子S22にダイオードD222の順方向電圧(例えば+0.6V)が発生する場合がある。従って、閾値電圧Vth307をダイオードD212、D222の順方向電圧よりも低い値に設定しておけば、第1ソース端子S21と第2ソース端子S22の少なくとも一方にソースオープンが発生した場合に、コンパレータ307Aによりソースオープンを検出することができる。
なお、上記のように所定期間継続した場合にHighの信号を出力するのは、ノイズによる誤検出を抑制するためである。コンパレータ307Aから出力される信号がHighに切替えられると、フリップフロップ307BはQ出力端子からHighの信号をインバータ307Cへ出力するので、AND回路308の一方の入力端には異常を示すLowの信号が入力される。従って、Q出力信号SQのレベルに依らず、AND回路308の出力はLowとなり、ゲート信号SG21,SG22はオフレベルとされ、第1同期整流トランジスタM21および第2同期整流トランジスタM22はオフとされる。
第1ソース端子S21,第2ソース端子S22にソースオープンが発生した場合に、第2閾値電圧VthBに対してダイオードD212,D222の順方向電圧が加算され、第2コンパレータ306の非反転入力端に印加される電圧が正電圧となる場合がある。しかしながら、ソースオープン異常検出回路307によりソースオープンを検出して第1同期整流トランジスタM21、第2同期整流トランジスタM22をオフとするので、電流Is1,Is2に逆流が発生することを回避できる。
すなわち、電流Is1,Is2が第1同期整流トランジスタM21、第2同期整流トランジスタM22のソースからドレイン側への方向と逆流するまで第1同期整流トランジスタM21、第2同期整流トランジスタM22をターンオフできずに、ターンオフ時に第1同期整流トランジスタM21、第2同期整流トランジスタM22にアバランシェ降伏が発生し、第1同期整流トランジスタM21、第2同期整流トランジスタM22が破壊されることを回避することができる。
なお、仮に、第1ソース端子S21、第2ソース端子S22とグランド端子GNDとの間にダイオードを配置しない構成とすると、ソースオープンが発生した場合に第1ソース端子S21、第2ソース端子S22の電圧が不定となるが、当該電圧が閾値電圧Vth307を上回れば、コンパレータ307Aによる検出が可能となり、第1同期整流トランジスタM21、第2同期整流トランジスタM22のオフが可能となる。
<2.第2実施形態>
図4は、第2実施形態に係るDC/DCコンバータ200Bの回路図である。DC/DCコンバータ200Bは、先述した第1実施形態(図1)と異なる構成の同期整流コントローラ300Bを有する。同期整流コントローラ300Bは、ソースオープンの異常を検出する機能に加えて、第1ドレイン端子D21および第2ドレイン端子D22のドレインオープンの異常を検出する機能を有する。
同期整流コントローラ300Bの同期整流コントローラ300A(図1)との相違点は、外部端子として出力電圧端子VOUTおよびフォトカプラ端子PCを有するとともに、ドレインオープン異常検出回路310とトランジスタM30を有することである。
出力電圧端子VOUTには、出力電圧Voutを抵抗R21,R22により分圧した後の分圧電圧DVが印加される。分圧電圧DVは、出力電圧端子VOUTを介してドレインオープン異常検出回路310に入力される。また、ドレインオープン異常検出回路310は、第1ドレイン端子D21および第2ドレイン端子D22が接続される。
トランジスタM30のドレインは、フォトカプラ端子PCを介してフォトカプラ204の発光素子のカソードに接続される。トランジスタM30のソースは、グランドの印加端に接続される。ドレインオープン異常検出回路310は、異常検出信号S13によってトランジスタM30のゲートを駆動する。
ドレインオープン異常検出回路310は、第1ドレイン端子D21と第2ドレイン端子D22の少なくとも一方に周期信号が発生しておらず、且つ、出力電圧Voutが発生している場合に、異常検出信号S13をアサートする。
例えば、ドレインオープン異常検出回路310は、パルス検出器を有する。当該パルス検出器は、ドレイン電圧VDS21,VDS22のエッジを検出する検出器を含み、少なくとも一方のドレイン電圧においてエッジが所定時間検出されないときに、検出信号をアサートする。また、例えば、ドレインオープン異常検出回路310は、コンパレータを有し、当該コンパレータは、分圧電圧VDを所定の閾値電圧と比較し、分圧電圧VDのほうが高くなったときに、出力判定信号をアサートする。そして、ドレインオープン異常検出回路310は、例えば、上記検出信号、上記出力判定信号がともにアサートされるときに異常検出信号S13をアサートする論理ゲートを有する。当該論理ゲートは、例えばANDゲートである。
このように、ドレインオープン異常検出回路310は、第1ドレイン端子D21、第2ドレイン端子D22の少なくとも一方におけるドレインオープンを検出して、異常検出信号S13をアサートする。このとき、トランジスタM30のゲート駆動により、フォトカプラ204に大きな電流Iopが流れ、フィードバック電流Ifbが増加する。これにより、フィードバック信号Vfbの電位が低下するので、一次側コントローラ202Dは、スイッチングトランジスタM11,M12のスイッチングを停止させる。
このように本実施形態に係るDC/DCコンバータ200Bによれば、同期整流コントローラ300Bにドレインオープンの異常を検出する機能を備えることで、ドレインオープンが発生したときに、DC/DCコンバータ200BがボディダイオードBD1,BD2によるダイオード整流モードにて大電力で動作し続けるのを回避し、信頼性を高めることができる。
<3.第3実施形態>
図5は、第3実施形態に係るDC/DCコンバータ200Cの回路図である。DC/DCコンバータ200Cは、先述した第1実施形態(図1)と異なる構成の同期整流コントローラ300Cを有する。
同期整流コントローラ300Cの同期整流コントローラ300A(図1)との相違点は、ソースオープン異常検出回路3071である。ソースオープン異常検出回路3071は、ソースオープン異常検出回路307と同様に、コンパレータ307Aと、フリップフロップ307Bを有する。同期整流コントローラ300Cは、外部端子として異常出力端子FLを有する。フリップフロップ307BのQ出力端子は、異常出力端子FLに接続される。
コンパレータ307Aは、第1ソース端子S21の電圧と第2ソース端子S22の電圧のうち高いほうの電圧を閾値電圧Vth307と比較し、比較結果が閾値電圧Vth307より高い状態が所定期間(例えば10μs)継続すると、フリップフロップ307Bのクロック端子に出力する信号をHighに切替える。すると、フリップフロップ307Bにより、Q出力端子から異常出力端子FLを介して外部へ出力される異常検出信号SFがアサートされる。
このように本実施形態によれば、同期整流コントローラ300Cにソースオープン異常検出回路3071を備えることで、ソースオープンが発生した場合に異常検出信号SFにより外部へ異常状態を通知することができる。なお、本実施形態では、フリップフロップ304から出力されるQ出力信号SQは、そのままセレクタ302に入力されるので、ソースオープンが発生した場合でも第1同期整流トランジスタM21、第2同期整流トランジスタM22の動作は継続させることになる。
<4.第4実施形態>
本発明は、以上の実施形態で例示したLLCコンバータのみではなく、フライバックコンバータに適用することも可能である。図6は、第4実施形態に係るDC/DCコンバータ200Dの回路図である。DC/DCコンバータ200Dは、フライバックコンバータとしての絶縁同期整流型DC/DCコンバータである。DC/DCコンバータ200Dは、入力端子P1に印加される入力電圧Vinに基づいて出力電圧Voutを生成して出力端子P2から出力する。
DC/DCコンバータ200Dは、一次側の構成として、トランスT10に含まれる一次巻線W1、スイッチングトランジスタM1、および一次側コントローラ202Dを有し、二次側の構成として、トランスT10に含まれる二次巻線W2、出力コンデンサC1、同期整流トランジスタM2、および同期整流コントローラ300Dを有する。
直流の入力電圧Vinが印加される入力端子P1は、一次巻線W1の一端に接続される。一次巻線W1の他端は、スイッチングトランジスタM1のドレインに接続される。スイッチングトランジスタM1のソースは、グランドの印加端に接続される。
二次巻線W2の一端は、出力端子P2に接続される。二次巻線W2の他端は、同期整流トランジスタM2のドレインに接続される。同期整流トランジスタM2のソースは、接地端子P3に接続される。接地端子P3は、グランドの印加端に接続される。出力コンデンサC1は、出力端子P1と接地端子P3との間に接続される。
DC/DCコンバータ200Dは、FB回路206も備える。FB回路206は、出力電圧Voutと目標電圧との誤差に応じた電流でフォトカプラ204の発光素子を駆動する。フォトカプラ204の受光素子には、誤差に応じたフィードバック電流Ifbが流れる。一次側コントローラ202DのFBピンには、フィードバック電流Ifbに応じたフィードバック信号Vfbが発生し、一次側コントローラ202Dは、フィードバック信号Vfbに基づいてスイッチングトランジスタM1を駆動する。
同期整流コントローラ300Dは、LDOレギュレータ301と、フリップフロップ304と、第1コンパレータ305と、第2コンパレータ306と、ソースオープン異常検出回路3072と、AND回路308と、ドライバDr10と、ダイオードD10,D20と、を一つのパッケージに収めて有する。また、同期整流コントローラ300Dは、外部との電気的接続を確立するためのドレイン端子D1、ゲート端子G1、ソース端子S1、電源端子VCC、およびグランド端子GNDを有する。
同期整流トランジスタM2のドレインが接続されるドレイン端子D1は、第1コンパレータ305、第2コンパレータ306の各々の反転入力端(-)に接続される。第1コンパレータ305の非反転入力端(+)には、第1閾値電圧VthA(例えば-100mV)が印加される。第2コンパレータ306の非反転入力端には、第2閾値電圧VthB(例えば-6mV)が印加される。第1コンパレータ305の出力端は、フリップフロップ304のセット端子に接続される。第2コンパレータ306の出力端は、フリップフロップ304のリセット端子に接続される。
また、ソースオープン異常検出回路3072は、先述した第1実施形態(図1)と同様に、コンパレータ3072A、フリップフロップ3072B、およびインバータ3072Cを有する。
コンパレータ3072Aの非反転入力端には、ソース端子S1が接続される。コンパレータ3072Aの反転入力端には、所定の閾値電圧Vth3072が印加される。コンパレータ3072Aの出力端は、フリップフロップ3072Bのクロック端子に接続される。フリップフロップ3072BのQ出力端子は、インバータ3072Cの入力端に接続される。インバータ3072Cの出力端は、AND回路308の一方の入力端に接続される。AND回路308の他方の入力端には、フリップフロップ304のQ出力端子が接続される。
AND回路308の出力端は、ドライバDr10の入力端に接続される。ドライバDr10の出力端は、同期整流トランジスタM2のゲートが接続されるゲート端子G1に接続される。ドライバDr10の低電位側は、ソース端子S1に接続される。
また、第1閾値電圧VthAと第2閾値電圧VthBは、ソース端子S1の電位を基準としている。これにより、グランドと同期整流トランジスタM2のソースとの間に寄生するインピーダンスの影響を受けないドレイン端子D1のドレイン電圧VDS2を第1コンパレータ305、第2コンパレータ306の検出対象とすることができる。
また、ソース端子S1とグランド端子GNDとの間には、互いに逆方向に並列接続されるダイオードD10,D20が配置される。これにより、ソース端子S1のソースオープンが発生した場合でも、ソース端子S1の電圧が不定となることを回避できる。
このような構成としたDC/DCコンバータ200Dの動作について、ソースオープン異常検出回路3072が異常を検出していない状態での動作を説明する。すなわち、インバータ3072Cから出力される異常検出信号SFLは正常を示すHighであり、フリップフロップ304のQ出力端子から出力されるQ出力信号SQがそのままAND回路308を介してドライバDr10に入力される状態である。
スイッチングトランジスタM1がターンオフされたとき、ドレイン電圧VDS2は負電圧となり、これを第1コンパレータ305が検出し、オン信号Sonがアサートされる。これにより、Q出力信号SQはHighに切替えられ、ドライバDr10がゲート端子G1を介して出力するゲート信号SG2はオンレベルとされ、同期整流トランジスタM2はターンオンされる。
これにより、同期整流トランジスタM2のソースからドレイン側へ流れる電流Isが流れ始める。電流Isが減少してゼロカレントに達すると、これを第2コンパレータ306がドレイン電圧VDS2に基づいて検出し、オフ信号Soffがアサートされる。すると、Q出力信号SQがLowに切替えられ、ゲート信号SG2はオフレベルとなり、同期整流トランジスタM2はターンオフされる。その後、スイッチングトランジスタM1はターンオンされる。
次に、ソースオープン異常検出回路3072の動作について説明する。ソース端子S1にソースオープンが発生すると、ダイオードD20の順方向電圧によりソース端子S1の電圧に所定の正電圧が発生する場合がある。これにより、コンパレータ3072Aは、ソース端子S1の電圧が閾値電圧Vth3072を上回った状態が所定期間継続されることを検出すると、フリップフロップ3072Bのクロック端子に出力する信号をHighに切替える。
すると、フリップフロップ3072Bから出力されるQ出力によって、インバータ3072Cの出力である異常検出信号SFLはLowとされる。これにより、Q出力信号SQに依らず、AND回路308の出力はLowとされるので、ゲート信号SG2はオフレベルとされ、同期整流トランジスタM2はオフとされる。
ソースオープンが発生した場合に、第2閾値電圧VthBに対してダイオードD20の順方向電圧が加算され、第2コンパレータ306の非反転入力端に印加される電圧が正電圧となる場合がある。しかしながら、ソースオープン異常検出回路3072によりソースオープンを検出して同期整流トランジスタM2をオフとするので、電流Isに逆流が発生することを回避できる。
すなわち、電流Isが同期整流トランジスタM2のソースからドレイン側への方向と逆方向に逆流するまで同期整流トランジスタM2をターンオフできずに、ターンオフ時に同期整流トランジスタM2にアバランシェ降伏が発生し、同期整流トランジスタM2が破壊されることを回避することができる。
なお、仮に、ソース端子S1とグランド端子GNDとの間にダイオードを配置しない構成とすると、ソースオープンが発生した場合にソース端子S1の電圧が不定となるが、当該電圧が閾値電圧Vth3072を上回れば、コンパレータ3072Aによる検出が可能となり、同期整流トランジスタM2のオフが可能となる。
<5.その他>
以上、本発明の実施形態について説明したが、本発明の趣旨の範囲内であれば、実施形態は種々の変更が可能である。
本発明は、例えばLLCコンバータなどに利用することができる。
200A~200D DC/DCコンバータ
P1 入力端子
P2 出力端子
P3 接地端子
T1、T10 トランス
W1 一次巻線
W2、W21、W22 二次巻線
M1、M11、M12 スイッチングトランジスタ
M2、M21、M22 同期整流トランジスタ
BD10、BD1、BD2 ボディダイオード
C1 出力コンデンサ
R21、R22 抵抗
DD ダイオード
CC コンデンサ
202A、202D 一次側コントローラ
204 フォトカプラ
206 フィードバック回路
300A~300D 同期整流コントローラ
301 LDOレギュレータ
302 セレクタ
303 分周器
304 フリップフロップ
305 第1コンパレータ
306 第2コンパレータ
307、3072 ソースオープン異常検出回路
307A、3072A コンパレータ
307B、3072B フリップフロップ
307C、3072C インバータ
308 AND回路
309 セレクタ
310 ドレインオープン異常検出回路
Dr21 第1ドライバ
Dr22 第2ドライバ
Dr10 ドライバ
D211、D212、D221、D222、D10、D20 ダイオード
M30 トランジスタ
D21 第1ドレイン端子
G21 第1ゲート端子
S21 第1ソース端子
D22 第2ドレイン端子
G22 第2ゲート端子
S22 第2ソース端子
VCC 電源端子
GND グランド端子
D1 ドレイン端子
G1 ゲート端子
S1 ソース端子
VOUT 出力電圧端子
PC フォトカプラ端子
FL 異常出力端子

Claims (12)

  1. 二次側に配置される同期整流トランジスタと、
    前記同期整流トランジスタの駆動を制御する同期整流コントローラと、を備えた絶縁同期整流型DC/DCコンバータであって、
    前記同期整流コントローラは、
    前記同期整流トランジスタのドレインに接続されるドレイン端子と、
    前記同期整流トランジスタのソースに接続されるソース端子と、
    前記ドレイン端子のドレイン電圧と、前記ソース端子の電位を基準とした所定の閾値電圧とを比較するコンパレータと、
    前記コンパレータから出力される前記同期整流トランジスタをオフ状態に変更するための信号であるオフ信号が入力される第1フリップフロップと、
    前記第1フリップフロップの出力信号に基づいて前記同期整流トランジスタにゲート信号を出力するドライバと、
    前記ソース端子の電圧を検出用閾値電圧と比較する異常検出用コンパレータを含んで、前記異常検出用コンパレータの出力に基づいて第1異常検出信号を出力する第1異常検出回路と、
    を有し、
    前記同期整流コントローラは、前記第1フリップフロップの出力信号と前記第1異常検出信号とが入力されて前記ドライバへ出力信号を出力するAND回路をさらに有する、
    絶縁同期整流型DC/DCコンバータ。
  2. 前記第1異常検出回路は、
    前記異常検出用コンパレータの出力が入力される第2フリップフロップと、
    前記第2フリップフロップの出力が入力されて前記第1異常検出信号を出力するインバータと、をさらに有する、請求項に記載の絶縁同期整流型DC/DCコンバータ。
  3. 二次側に配置される同期整流トランジスタと、
    前記同期整流トランジスタの駆動を制御する同期整流コントローラと、を備えた絶縁同期整流型DC/DCコンバータであって、
    前記同期整流コントローラは、
    前記同期整流トランジスタのドレインに接続されるドレイン端子と、
    前記同期整流トランジスタのソースに接続されるソース端子と、
    前記ドレイン端子のドレイン電圧と、前記ソース端子の電位を基準とした所定の閾値電圧とを比較するコンパレータと、
    前記コンパレータから出力される前記同期整流トランジスタをオフ状態に変更するための信号であるオフ信号が入力される第1フリップフロップと、
    前記第1フリップフロップの出力信号に基づいて前記同期整流トランジスタにゲート信号を出力するドライバと、
    前記ソース端子の電圧を検出用閾値電圧と比較する異常検出用コンパレータを含んで、前記異常検出用コンパレータの出力に基づいて第1異常検出信号を出力する第1異常検出回路と、
    を有し、
    前記同期整流コントローラは、グランド端子と、前記ソース端子と前記グランド端子との間に互いに逆方向に並列接続されるダイオードと、をさらに有する、絶縁同期整流型DC/DCコンバータ。
  4. 二次側に配置される同期整流トランジスタと、
    前記同期整流トランジスタの駆動を制御する同期整流コントローラと、を備えた絶縁同期整流型DC/DCコンバータであって、
    前記同期整流コントローラは、
    前記同期整流トランジスタのドレインに接続されるドレイン端子と、
    前記同期整流トランジスタのソースに接続されるソース端子と、
    前記ドレイン端子のドレイン電圧と、前記ソース端子の電位を基準とした所定の閾値電圧とを比較するコンパレータと、
    前記コンパレータから出力される前記同期整流トランジスタをオフ状態に変更するための信号であるオフ信号が入力される第1フリップフロップと、
    前記第1フリップフロップの出力信号に基づいて前記同期整流トランジスタにゲート信号を出力するドライバと、
    前記ソース端子の電圧を検出用閾値電圧と比較する異常検出用コンパレータを含んで、前記異常検出用コンパレータの出力に基づいて第1異常検出信号を出力する第1異常検出回路と、
    を有し、
    第1同期整流トランジスタおよび第2同期整流トランジスタを有するLLCコンバータとして構成される絶縁同期整流型DC/DCコンバータであり、
    前記同期整流コントローラは、
    前記第1同期整流トランジスタのドレインに接続される第1ドレイン端子と、
    前記第2同期整流トランジスタのドレインに接続される第2ドレイン端子と、
    前記第1同期整流トランジスタのソースに接続される第1ソース端子と、
    前記第2同期整流トランジスタのソースに接続される第2ソース端子と、
    前記第1同期整流トランジスタのゲートに接続される第1ゲート端子と、
    前記第2同期整流トランジスタのゲートに接続される第2ゲート端子と、
    前記第1ゲート端子からゲート信号を出力する第1ドライバと、
    前記第2ゲート端子からゲート信号を出力する第2ドライバと、
    前記第1フリップフロップの出力信号が入力される分周器と、
    前記分周器の出力に基づいて、前記第1ドレイン端子、前記第2ドレイン端子と前記コンパレータとの間の経路を切替えるとともに、前記第1フリップフロップと前記第1ドライバ、前記第2ドライバとの間の経路を切替えるセレクタと、
    を有し、
    前記閾値電圧は、前記分周器の出力に基づいて、前記第1ソース端子の電位と前記第2ソース端子の電位とを切り替えて基準とし、
    前記異常検出用コンパレータは、前記第1ソース端子の電圧と前記第2ソース端子の電圧のうち高い方の電圧を前記検出用閾値電圧と比較する、絶縁同期整流型DC/DCコンバータ。
  5. 前記同期整流コントローラは、前記第1フリップフロップの出力信号と前記第1異常検出信号とが入力されて前記セレクタへ出力信号を出力するAND回路をさらに有する、請求項に記載の絶縁同期整流型DC/DCコンバータ。
  6. 前記同期整流コントローラは、外部端子として異常出力端子を有し、
    前記第1異常検出回路は、前記異常検出用コンパレータの出力に基づいて前記異常出力端子を介して前記第1異常検出信号を出力する、請求項1から請求項5のいずれか1項に記載の絶縁同期整流型DC/DCコンバータ。
  7. 前記同期整流コントローラは、グランド端子と、前記ソース端子と前記グランド端子との間に互いに逆方向に並列接続されるダイオードと、をさらに有する、請求項1、または請求項2、または請求項4、または請求項5に記載の絶縁同期整流型DC/DCコンバータ。
  8. 前記同期整流コントローラは、グランド端子を有し、
    前記同期整流コントローラ内部において、前記ソース端子と前記グランド端子とは非接続である、請求項1、または請求項2、または請求項4、または請求項5に記載の絶縁同期整流型DC/DCコンバータ。
  9. 前記異常検出用コンパレータは、前記ソース端子の電圧が前記検出用閾値電圧を上回った状態が所定期間継続したときに、出力信号をアサートする、請求項1から請求項のいずれか1項に記載の絶縁同期整流型DC/DCコンバータ。
  10. 前記同期整流コントローラは、前記ドレイン端子のオープンを検出すると、第2異常検出信号をアサートすることにより一次側コントローラに一次側に配置されるスイッチングトランジスタのスイッチングを停止させる第2異常検出回路をさらに有する、請求項1から請求項のいずれか1項に記載の絶縁同期整流型DC/DCコンバータ。
  11. 前記第2異常検出回路は、前記ドレイン端子に周期信号が発生しておらず、且つ、当該絶縁同期整流型DC/DCコンバータの出力電圧が発生している場合に、前記第2異常検出信号をアサートする、請求項10に記載の絶縁同期整流型DC/DCコンバータ。
  12. フォトカプラと、
    当該絶縁同期整流型DC/DCコンバータの出力電圧に基づいて前記フォトカプラの発光素子を駆動することで前記一次側コントローラへのフィードバック信号を生成するフィードバック回路と、
    をさらに備え、
    前記同期整流コントローラは、前記発光素子に接続されて前記第2異常検出信号により駆動されるトランジスタを有する、請求項10または請求項11に記載の絶縁同期整流型DC/DCコンバータ。
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