JP7026061B2 - 受信機、および、受信機の制御方法 - Google Patents
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Description
1.第1の実施の形態(オフセット電流を低減する例)
2.第2の実施の形態(同相側および直交側のそれぞれにgmアンプを設け、オフセット電流を低減する例)
[受信機の構成例]
図1は、本技術の第1の実施の形態における受信機100の一構成例を示すブロック図である。この受信機100は、RF(Radio Frequency)信号を受信してダイレクトコンバージョン方式で復調するものであり、RF部200、AD(Analog to Digital)変換部110およびデジタル信号処理部120を備える。また、受信機100には、アンテナ300が取り付けられる。
図2は、本技術の第1の実施の形態におけるRF部200の一構成例を示す回路図である。このRF部200は、gmアンプ210、正側アクティブインダクタ回路220、負側アクティブインダクタ回路230、同相側ミキサ241、直交側ミキサ242、同相側電流電圧変換部250および直交側電流電圧変換部260を備える。
図3は、本技術の第1の実施の形態における正側アクティブインダクタ回路220の一構成例を示す回路図である。この正側アクティブインダクタ回路220は、gmアンプ221および224と、コンデンサ222と、抵抗223とを備える。
i=vigm1{1/(sC1)+RL}gm2 ・・・式1
上式において、gm1は、gmアンプ221のトランスコンダクタンスであり、gm2は、gmアンプ224のトランスコンダクタンスである。これらのコンダクタンスの単位は、例えば、ジーメンス(S)である。また、sは複素数である。C1は、コンデンサ222の容量であり、単位は、例えば、ファラッド(F)である。RLは、抵抗223の抵抗値であり、単位は、例えば、オームである。また、電流iの単位は、例えば、アンペア(A)であり、電圧viの単位は、例えば、ボルト(V)である。
i/vi={(gm1gm2)/(sC1)}+gm1gm2RL…式2
vo=(vi―vo)gm1{1/(sC1)+RL}gm2/sC2…式3
上式において、C2は、寄生容量の容量値を示し、単位は、例えば、ファラッド(F)である。出力電圧voの単位は、例えば、ボルト(V)である。
q=(1/RL)・{C2/(gm1gm2C1))1/2 ・・・式5
LE=sC1/(gm1×gm2) ・・・式6
上式において、インダクタンス値LEの単位は、例えば、ヘンリー(H)である。
RE=1/(gm1gm2RL) ・・・式7
図6は、本技術の第1の実施の形態における受信機100の動作の一例を示すフローチャートである。この動作は、例えば、受信機100に電源が投入されたときに開始される。
上述の第1の実施の形態では、アクティブインダクタ回路により、オフセット電流を低減していたが、図4の等価回路により表すことができる回路であれば、アクティブインダクタ回路以外の回路によりオフセット電流を低減することができる。この第1の実施の形態の変形例の受信機100は、アクティブインダクタ回路よりも簡易な回路により、オフセット電流を低減した点において第1の実施の形態と異なる。
上述の第1の実施の形態では、1つのgmアンプ210を同相側および直交側で共有し、そのアンプからの電流信号を分流して同相側ミキサ241および直交側ミキサ242の両方に供給していた。しかし、デューティ比を大きくした場合などにおいて、同相側ミキサ241および直交側ミキサ242のそれぞれへの供給電流が不足することがある。この場合には、同相側、直交側のそれぞれの系統にgmアンプを配置して電流信号を増幅すればよい。この第2の実施の形態の受信機100は、同相側および直交側のそれぞれにgmアンプを配置した点において第1の実施の形態と異なる。
(1)所定周波数より周波数の高い高周波数成分と前記所定周波数より周波数の低い低周波数成分とのうち前記低周波数成分内に所定のオフセット電流を含む電流信号を電圧信号から生成して出力する電流出力部と、
前記高周波数成分に対して復調を行う復調部と、
前記電流信号において前記高周波数成分を前記電流出力部から前記復調部へ通過させるとともに前記低周波数成分を前記電流出力部から所定の基準電位点へ流すフィルタ回路と
を具備する受信機。
(2)前記フィルタ回路は、前記電流信号の周波数が低いほど値が小さなインピーダンス成分を介して前記低周波数成分を流す
前記(1)記載の受信機。
(3)前記インピーダンス成分は、前記電流出力部から前記復調部へ配線された信号線と前記所定の基準電位点との間に接続されたインダクタンス成分および抵抗成分を含む
前記(2)記載の受信機。
(4)前記フィルタ回路は、アクティブインダクタである
前記(3)記載の受信機。
(5)前記フィルタ回路は、入力端子および出力端子が接続されたオペアンプからなるバイアス回路である
前記(3)記載の受信機。
(6)前記電流信号は、正側信号および負側信号からなる差動信号であり、
前記フィルタ回路は、
前記正側信号において前記高周波数成分を前記電流出力部から前記復調部へ通過させる正側フィルタ回路と、
前記負側信号において前記高周波数成分を前記電流出力部から前記復調部へ通過させる負側フィルタ回路と
を備える前記(1)から(5)のいずれかに記載の受信機。
(7)前記復調部は、
前記高周波数成分に所定のローカル信号を混合して混合信号として出力する混合部と、
前記混合信号に対して電流電圧変換を行って電圧信号を出力する電流電圧変換部と
を備える前記(1)から(5)のいずれかに記載の受信機。
(8)前記ローカル信号は、同相側ローカル信号と当該同相側ローカル信号に対して位相が90度異なる直交側ローカル信号とを含み、
前記混合部は、
前記高周波数成分と前記同相側ローカル信号とを混合して同相側混合信号として出力する同相側ミキサと、
前記高周波数成分と前記直交側ローカル信号とを混合して直交側混合信号として出力する直交側ミキサと
を備える前記(7)記載の受信機。
(9)前記電流電圧変換部は、
前記同相側混合信号に対して電流電圧変換を行う同相側電流電圧変換部と、
前記直交側混合信号に対して電流電圧変換を行う直交側電流電圧変換部と
を備える前記(8)記載の受信機。
(10)前記電流出力部は、前記電流信号を出力する同相側電流出力部および直交側電流出力部を備え、
前記フィルタ回路は、
前記同相側電流出力部から前記同相側ミキサへ前記高周波数成分を通過させる同相側フィルタ回路と、
前記直交側電流出力部から前記直交側ミキサへ前記高周波数成分を通過させる直交側フィルタ回路と
を備える前記(8)から(9)のいずれかに記載の受信機。
(11)前記電流信号は、正側信号および負側信号からなる差動信号であり、
前記同相側フィルタ回路は、
前記正側信号において前記高周波数成分を前記電流出力部から前記復調部へ通過させる同相正側フィルタ回路と、
前記負側信号において前記高周波数成分を前記電流出力部から前記復調部へ通過させる同相負側フィルタ回路と
を備え、
前記直交側フィルタ回路は、
前記正側信号において前記高周波数成分を前記電流出力部から前記復調部へ通過させる直交正側フィルタ回路と、
前記負側信号において前記高周波数成分を前記電流出力部から前記復調部へ通過させる直交負側フィルタ回路と
を備える前記(10)記載の受信機。
(12)所定周波数より周波数の高い高周波数成分と前記所定周波数より周波数の低い低周波数成分とのうち前記低周波数成分内に所定のオフセット電流を含む電流信号を電圧信号から生成して出力する電流出力手順と、
前記高周波数成分に対して復調を行う復調手順と、
前記電流信号において前記高周波数成分を前記電流出力部から前記復調部へ通過させるとともに前記低周波数成分を前記電流出力部から所定の基準電位点へ流すフィルタリング手順と
を具備する受信機の制御方法。
110 AD変換部
120 デジタル信号処理部
200 RF部
210、221、224 gmアンプ
211 同相側gmアンプ
212 直交側gmアンプ
220 正側アクティブインダクタ回路
222 コンデンサ
223、251、253、261、263 抵抗
225 インダクタンス成分
226 抵抗成分
230 負側アクティブインダクタ回路
241 同相側ミキサ
242 直交側ミキサ
250 同相側電流電圧変換部
252、262 TIA
260 直交側電流電圧変換部
270 正側バイアス回路
271 オペアンプ
275 負側バイアス回路
281 同相正側アクティブインダクタ回路
282 同相負側アクティブインダクタ回路
291 直交正側アクティブインダクタ回路
292 直交負側アクティブインダクタ回路
300 アンテナ
Claims (6)
- 所定周波数より周波数の高い高周波数成分と前記所定周波数より周波数の低い低周波数成分とのうち前記低周波数成分内に所定のオフセット電流を含む電流信号を電圧信号から生成し、一対の信号線を介して出力する電流出力部と、
前記高周波数成分に対して復調を行う復調部と、
前記電流信号において前記高周波数成分を前記電流出力部から前記復調部へ通過させるとともに前記低周波数成分を前記電流出力部から所定の基準電位点へ流すフィルタ回路と
を具備し、
前記電流信号は、正側信号および負側信号からなる差動信号であり、
前記フィルタ回路は、
前記正側信号において前記高周波数成分を前記電流出力部から前記復調部へ通過させる正側フィルタ回路と、
前記負側信号において前記高周波数成分を前記電流出力部から前記復調部へ通過させる負側フィルタ回路と
を備え、
前記正側フィルタ回路および前記負側フィルタ回路のそれぞれは、
前記一対の信号線のいずれかに一対の入力端子の一方が接続され、前記一対の入力端子の他方に所定電圧が入力された前段アンプと、
前記前段アンプの出力端子と前記基準電位点との間に直列に挿入されたコンデンサおよび抵抗と、
前記前段アンプの出力端子に入力端子が入力され、出力端子が前記一対の信号線のいずれかに接続された後段アンプと
を備える受信機。 - 前記復調部は、
前記高周波数成分に所定のローカル信号を混合して混合信号として出力する混合部と、
前記混合信号に対して電流電圧変換を行って電圧信号を出力する電流電圧変換部と
を備える請求項1記載の受信機。 - 前記ローカル信号は、同相側ローカル信号と当該同相側ローカル信号に対して位相が90度異なる直交側ローカル信号とを含み、
前記混合部は、
前記高周波数成分と前記同相側ローカル信号とを混合して同相側混合信号として出力する同相側ミキサと、
前記高周波数成分と前記直交側ローカル信号とを混合して直交側混合信号として出力する直交側ミキサと
を備える請求項2記載の受信機。 - 前記電流電圧変換部は、
前記同相側混合信号に対して電流電圧変換を行う同相側電流電圧変換部と、
前記直交側混合信号に対して電流電圧変換を行う直交側電流電圧変換部と
を備える請求項3記載の受信機。 - 前記電流出力部は、前記電流信号を出力する同相側電流出力部および直交側電流出力部を備え、
前記正側フィルタ回路および前記負側フィルタ回路のそれぞれは、
前記同相側電流出力部から前記同相側ミキサへ前記高周波数成分を通過させる同相側フィルタ回路と、
前記直交側電流出力部から前記直交側ミキサへ前記高周波数成分を通過させる直交側フィルタ回路と
を備える請求項3記載の受信機。 - 電流出力部が、所定周波数より周波数の高い高周波数成分と前記所定周波数より周波数の低い低周波数成分とのうち前記低周波数成分内に所定のオフセット電流を含む電流信号を電圧信号から生成し、一対の信号線を介して出力する電流出力手順と、
復調部が、前記高周波数成分に対して復調を行う復調手順と、
フィルタ回路が、前記電流信号において前記高周波数成分を前記電流出力部から前記復調部へ通過させるとともに前記低周波数成分を前記電流出力部から所定の基準電位点へ流すフィルタリング手順と
を具備し、
前記電流信号は、正側信号および負側信号からなる差動信号であり、
前記フィルタ回路は、
前記正側信号において前記高周波数成分を前記電流出力部から前記復調部へ通過させる正側フィルタ回路と、
前記負側信号において前記高周波数成分を前記電流出力部から前記復調部へ通過させる負側フィルタ回路と
を備え、
前記正側フィルタ回路および前記負側フィルタ回路のそれぞれは、
前記一対の信号線のいずれかに一対の入力端子の一方が接続され、前記一対の入力端子の他方に所定電圧が入力された前段アンプと、
前記前段アンプの出力端子と前記基準電位点との間に直列に挿入されたコンデンサおよび抵抗と、
前記前段アンプの出力端子に入力端子が入力され、出力端子が前記一対の信号線のいずれかに接続された後段アンプと
を備える受信機の制御方法。
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Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2003018743A (ja) | 2001-07-02 | 2003-01-17 | Synclayer Inc | 保安器 |
JP2003152538A (ja) | 2001-11-16 | 2003-05-23 | Mitsubishi Electric Corp | A/dコンバータ |
JP2004517513A (ja) | 2000-07-21 | 2004-06-10 | スカイワークス ソリューションズ,インコーポレイテッド | ダイレクトコンバージョン受信機及び送信機用のシステム及び装置 |
JP2008236135A (ja) | 2007-03-19 | 2008-10-02 | Toshiba Corp | 周波数コンバータ |
JP2012500597A (ja) | 2008-08-18 | 2012-01-05 | クゥアルコム・インコーポレイテッド | 負荷切換を用いた高線形性低ノイズ受信器 |
JP2012156936A (ja) | 2011-01-28 | 2012-08-16 | Renesas Electronics Corp | 半導体集積回路およびその動作方法 |
Family Cites Families (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH09275328A (ja) | 1996-04-04 | 1997-10-21 | Hitachi Ltd | 可変容量回路及びそれを用いたアナログフィルタ回路 |
JP2002232239A (ja) | 2001-02-01 | 2002-08-16 | Akita Kaihatsu Center Ard:Kk | 演算増幅器 |
JP5018028B2 (ja) | 2006-11-10 | 2012-09-05 | セイコーエプソン株式会社 | 基準電圧供給回路、アナログ回路及び電子機器 |
US7773968B2 (en) | 2006-11-30 | 2010-08-10 | Silicon Laboratories, Inc. | Interface/synchronization circuits for radio frequency receivers with mixing DAC architectures |
JP5375521B2 (ja) | 2009-10-27 | 2013-12-25 | ソニー株式会社 | 高周波増幅器および無線通信装置 |
US8886147B2 (en) | 2010-07-20 | 2014-11-11 | Broadcom Corporation | Concurrent impedance and noise matching transconductance amplifier and receiver implementing same |
JP5665571B2 (ja) * | 2011-01-28 | 2015-02-04 | ルネサスエレクトロニクス株式会社 | 半導体集積回路およびその動作方法 |
JP6249732B2 (ja) | 2013-11-19 | 2017-12-20 | 三菱電機株式会社 | ダイレクトコンバージョン受信機 |
JP6462541B2 (ja) * | 2015-09-11 | 2019-01-30 | 株式会社東芝 | 複素バンドパスフィルタ及び受信装置 |
-
2017
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- 2017-11-08 WO PCT/JP2017/040182 patent/WO2018150653A1/ja active Application Filing
Patent Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2004517513A (ja) | 2000-07-21 | 2004-06-10 | スカイワークス ソリューションズ,インコーポレイテッド | ダイレクトコンバージョン受信機及び送信機用のシステム及び装置 |
JP2003018743A (ja) | 2001-07-02 | 2003-01-17 | Synclayer Inc | 保安器 |
JP2003152538A (ja) | 2001-11-16 | 2003-05-23 | Mitsubishi Electric Corp | A/dコンバータ |
JP2008236135A (ja) | 2007-03-19 | 2008-10-02 | Toshiba Corp | 周波数コンバータ |
JP2012500597A (ja) | 2008-08-18 | 2012-01-05 | クゥアルコム・インコーポレイテッド | 負荷切換を用いた高線形性低ノイズ受信器 |
JP2012156936A (ja) | 2011-01-28 | 2012-08-16 | Renesas Electronics Corp | 半導体集積回路およびその動作方法 |
Also Published As
Publication number | Publication date |
---|---|
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JPWO2018150653A1 (ja) | 2019-12-12 |
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WO2018150653A1 (ja) | 2018-08-23 |
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