JP6856777B2 - オールインワンチップオンフィルム用軟性回路基板及びこれを含むチップパッケージ、及びこれを含む電子デバイス - Google Patents
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Description
Claims (20)
- 基板;
前記基板上に配置される導電性パターン部;及び
前記導電性パターン部上に部分的に配置される保護層を含み、
前記導電性パターン部は、互いに離隔して配置される第1導電性パターン部及び第2導電性パターン部を含み、
前記第1導電性パターン部及び前記第2導電性パターン部は、それぞれ前記基板上に順に配置される配線パターン層、第1メッキ層及び第2メッキ層を含み、
前記第1導電性パターン部は、前記保護層がオープンされた第1オープン領域を含み、
前記第2導電性パターン部は、前記保護層がオープンされた第2オープン領域を含み、
前記第1オープン領域において、前記第2メッキ層のスズの含有量は、前記第2オープン領域において、前記第2メッキ層のスズの含有量よりも多いオールインワンチップオンフィルム用軟性回路基板。 - 前記第1オープン領域において、前記第2メッキ層のスズ(Sn)の含有量は、50原子%以上であり、
前記第2オープン領域において、前記第2メッキ層のスズ(Sn)の含有量は、50原子%未満である、請求項1に記載のオールインワンチップオンフィルム用軟性回路基板。 - 前記第2オープン領域において、前記第2メッキ層は、銅(Cu)とスズ(Sn)の合金層である、請求項1または請求項2に記載のオールインワンチップオンフィルム用軟性回路基板。
- 前記第1導電性パターン部は、前記第1導電性パターン部の一端と他端に位置する第1リードパターン部、及び前記第1導電性パターン部の前記一端と前記他端を連結する第1延長パターン部を含み、
前記第2導電性パターン部は、前記第2導電性パターン部の一端と他端に位置する第2リードパターン部、及び前記第2導電性パターン部の前記一端と前記他端を連結する第2延長パターン部を含み、
前記第1リードパターン部は、前記第2リードパターン部と形状が互いに異なる、請求項1ないし請求項3のいずれか一項に記載のオールインワンチップオンフィルム用軟性回路基板。 - 前記第1リードパターン部の線幅は、前記第2リードパターン部の線幅よりも小さい、
請求項4に記載のオールインワンチップオンフィルム用軟性回路基板。 - 前記第1リードパターン部の線幅は、前記第1延長パターン部の線幅と対応し、前記第2リードパターン部の少なくとも一つの端部の線幅は、前記第2延長パターン部の線幅と異なる、請求項4または請求項5に記載のオールインワンチップオンフィルム用軟性回路基板。
- 前記第1導電性パターン部は、前記基板上に第1間隔で離隔した複数の第1導電性パターン部を含み、
前記第2導電性パターン部は、前記基板上に第2間隔で離隔した複数の第2導電性パターン部を含み、
前記第1間隔は、前記第2間隔よりも小さい、請求項4ないし請求項6のいずれか一項に記載のオールインワンチップオンフィルム用軟性回路基板。 - 基板;
前記基板上に配置される導電性パターン部;及び
前記導電性パターン部上に部分的に配置される保護層を含み、
前記導電性パターン部は、互いに離隔して配置される第1導電性パターン部及び第2導電性パターン部を含み、
前記第1導電性パターン部及び前記第2導電性パターン部は、それぞれ前記基板上に順に配置される配線パターン層、第1メッキ層及び第2メッキ層を含み、
前記第1導電性パターン部は、前記保護層がオープンされた第1オープン領域を含み、
前記第2導電性パターン部は、前記保護層がオープンされた第2オープン領域を含み、
前記第1オープン領域において、前記第2メッキ層のスズの含有量は、前記第2オープン領域において、前記第2メッキ層のスズの含有量よりも多く、
前記第1オープン領域に配置される第1チップと、
前記第2オープン領域に配置される第2チップとを含むオールインワンチップオンフィルム用軟性回路基板を含むチップパッケージ。 - 前記第1チップは、駆動ICチップ(Drive Ic chip)であり、
前記第2チップは、ダイオードチップ、電源ICチップ、タッチセンサICチップ、MLCCチップ、BGAチップ、チップコンデンサの少なくとも一つである、請求項8に記載のオールインワンチップオンフィルム用軟性回路基板を含むチップパッケージ。 - 前記第1チップ及び前記第2チップが、前記オールインワンチップオンフィルム用軟性回路基板の同じ一面上に配置される、請求項8または請求項9に記載のオールインワンチップオンフィルム用軟性回路基板を含むチップパッケージ。
- 前記第1導電性パターン部は、前記第1導電性パターン部の一端に位置する第1インナーリードパターン部、前記第1導電性パターン部の他端に位置する第1アウターリードパターン部、及び前記第1導電性パターン部の前記一端と前記他端を連結する第1延長パターン部を含み、
前記第2導電性パターン部は、前記第2導電性パターン部の一端に位置する第2インナーリードパターン部、前記第2導電性パターン部の他端に位置する第2アウターリードパターン部、及び前記第2導電性パターン部の前記一端と前記他端を連結する第2延長パターン部を含み、
前記第1インナーリードパターン部上には、第1接続部及び第1チップが配置され、
前記第2インナーリードパターン部上には、第2接続部及び第2チップが配置される、
請求項8ないし請求項10のいずれか一項に記載のオールインワンチップオンフィルム用軟性回路基板を含むチップパッケージ。 - 前記第1接続部及び前記第2接続部は、互いに異なるサイズであり、互いに異なる形状である、請求項11に記載のオールインワンチップオンフィルム用軟性回路基板を含むチップパッケージ。
- 前記第1接続部は、金(Au)を含み、
前記第2接続部は、金(Au)以外の金属を含む、請求項11または請求項12に記載のオールインワンチップオンフィルム用軟性回路基板を含むチップパッケージ。 - 前記第1インナーリードパターン部の前記第2メッキ層は、スズ(Sn)の含有量が50原子%以上である純スズ層であり、
前記第2インナーリードパターン部の前記第2メッキ層は、スズ(Sn)の含有量が50原子%未満のスズ合金層である、請求項11ないし請求項13のいずれか一項に記載のオールインワンチップオンフィルム用軟性回路基板を含むチップパッケージ。 - 前記第1インナーリードパターン部の幅と前記第1接続部の幅は、互いに同一であるか、または20%以内の差を有し、
前記第2接続部の幅は、前記第2インナーリードパターン部の幅の1.5倍以上である、請求項11ないし請求項14のいずれか一項に記載のオールインワンチップオンフィルム用軟性回路基板を含むチップパッケージ。 - 基板;
前記基板上に配置される導電性パターン部;及び
前記導電性パターン部上に部分的に配置される保護層を含み、
前記導電性パターン部は、互いに離隔して配置される第1導電性パターン部及び第2導電性パターン部を含み、
前記第1導電性パターン部及び前記第2導電性パターン部は、それぞれ前記基板上に順に配置される配線パターン層、第1メッキ層及び第2メッキ層を含み、
前記第1導電性パターン部は、前記保護層がオープンされた第1オープン領域を含み、
前記第2導電性パターン部は、前記保護層がオープンされた第2オープン領域を含み、
前記第1オープン領域において、前記第2メッキ層のスズの含有量は、前記第2オープン領域において、前記第2メッキ層のスズの含有量よりも多いオールインワンチップオンフィルム用軟性回路基板;
前記オールインワンチップオンフィルム用軟性回路基板の一端と連結されるディスプレイパネル;及び
前記オールインワンチップオンフィルム用軟性回路基板の前記一端と反対となる他端と連結されるメインボード;を含む電子デバイス。 - 前記オールインワンチップオンフィルム用軟性回路基板の前記第1オープン領域に配置される第1チップと、前記第2オープン領域に配置される第2チップは、互いに異なる種類であり、
前記ディスプレイパネル及び前記メインボードは、互いに向かい合って配置され、
前記オールインワンチップオンフィルム用軟性回路基板は、前記ディスプレイパネルと前記メインボードとの間で折り曲げられて配置される、請求項16に記載の電子デバイス。 - 前記第1オープン領域において、前記第2メッキ層のスズ(Sn)の含有量は、70原子%以上である、請求項1ないし請求項7のいずれか一項に記載のオールインワンチップオンフィルム用軟性回路基板。
- 前記第1オープン領域において、前記第2メッキ層のスズ(Sn)の含有量は、90原子%以上である、請求項1ないし請求項7のいずれか一項に記載のオールインワンチップオンフィルム用軟性回路基板。
- 前記保護層は、前記第1延長パターン部及び前記第2延長パターン部上に配置され、
前記第1リードパターン部及び前記第2リードパターン部の一面は外部に露出する、請求項4ないし請求項7のいずれか一項に記載のオールインワンチップオンフィルム用軟性回路基板。
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