JP6783689B2 - 半導体装置および半導体装置の製造方法 - Google Patents
半導体装置および半導体装置の製造方法 Download PDFInfo
- Publication number
- JP6783689B2 JP6783689B2 JP2017048802A JP2017048802A JP6783689B2 JP 6783689 B2 JP6783689 B2 JP 6783689B2 JP 2017048802 A JP2017048802 A JP 2017048802A JP 2017048802 A JP2017048802 A JP 2017048802A JP 6783689 B2 JP6783689 B2 JP 6783689B2
- Authority
- JP
- Japan
- Prior art keywords
- film
- antireflection film
- wiring
- forming
- opening
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
- 239000004065 semiconductor Substances 0.000 title claims description 120
- 238000000034 method Methods 0.000 title claims description 69
- 238000004519 manufacturing process Methods 0.000 title claims description 62
- 150000004767 nitrides Chemical group 0.000 claims description 140
- 229910052751 metal Inorganic materials 0.000 claims description 137
- 239000002184 metal Substances 0.000 claims description 137
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 claims description 53
- 229910052814 silicon oxide Inorganic materials 0.000 claims description 53
- IJGRMHOSHXDMSA-UHFFFAOYSA-N Atomic nitrogen Chemical compound N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 claims description 41
- NRTOMJZYCJJWKI-UHFFFAOYSA-N Titanium nitride Chemical compound [Ti]#N NRTOMJZYCJJWKI-UHFFFAOYSA-N 0.000 claims description 39
- XKRFYHLGVUSROY-UHFFFAOYSA-N Argon Chemical compound [Ar] XKRFYHLGVUSROY-UHFFFAOYSA-N 0.000 claims description 32
- 230000001681 protective effect Effects 0.000 claims description 30
- 239000007789 gas Substances 0.000 claims description 24
- 229910001873 dinitrogen Inorganic materials 0.000 claims description 19
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 claims description 18
- QJGQUHMNIGDVPM-UHFFFAOYSA-N nitrogen group Chemical group [N] QJGQUHMNIGDVPM-UHFFFAOYSA-N 0.000 claims description 18
- 229910052786 argon Inorganic materials 0.000 claims description 16
- 238000005121 nitriding Methods 0.000 claims description 16
- 238000005546 reactive sputtering Methods 0.000 claims description 13
- 229910052710 silicon Inorganic materials 0.000 claims description 8
- 239000010703 silicon Substances 0.000 claims description 8
- 229910052581 Si3N4 Inorganic materials 0.000 claims description 7
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 claims description 7
- 238000010438 heat treatment Methods 0.000 claims description 6
- 230000000149 penetrating effect Effects 0.000 claims description 6
- 239000010936 titanium Substances 0.000 claims description 5
- 229910052719 titanium Inorganic materials 0.000 claims description 5
- 229910052721 tungsten Inorganic materials 0.000 claims description 5
- 239000010937 tungsten Substances 0.000 claims description 5
- GPBUGPUPKAGMDK-UHFFFAOYSA-N azanylidynemolybdenum Chemical compound [Mo]#N GPBUGPUPKAGMDK-UHFFFAOYSA-N 0.000 claims description 4
- MZLGASXMSKOWSE-UHFFFAOYSA-N tantalum nitride Chemical compound [Ta]#N MZLGASXMSKOWSE-UHFFFAOYSA-N 0.000 claims description 4
- -1 tungsten nitride Chemical class 0.000 claims description 4
- 238000009832 plasma treatment Methods 0.000 claims description 3
- 239000010410 layer Substances 0.000 description 20
- 229910052757 nitrogen Inorganic materials 0.000 description 16
- 238000000206 photolithography Methods 0.000 description 11
- 238000005530 etching Methods 0.000 description 8
- 239000011229 interlayer Substances 0.000 description 8
- 230000007774 longterm Effects 0.000 description 8
- 239000000758 substrate Substances 0.000 description 8
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 7
- 230000000052 comparative effect Effects 0.000 description 7
- 229910052782 aluminium Inorganic materials 0.000 description 6
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 6
- 230000015572 biosynthetic process Effects 0.000 description 6
- 230000003647 oxidation Effects 0.000 description 6
- 238000007254 oxidation reaction Methods 0.000 description 6
- 238000005268 plasma chemical vapour deposition Methods 0.000 description 6
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Substances O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 description 6
- 229910004298 SiO 2 Inorganic materials 0.000 description 4
- 229910045601 alloy Inorganic materials 0.000 description 4
- 239000000956 alloy Substances 0.000 description 4
- 238000006243 chemical reaction Methods 0.000 description 4
- 239000000463 material Substances 0.000 description 4
- 229910000838 Al alloy Inorganic materials 0.000 description 3
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 3
- BOTDANWDWHJENH-UHFFFAOYSA-N Tetraethyl orthosilicate Chemical compound CCO[Si](OCC)(OCC)OCC BOTDANWDWHJENH-UHFFFAOYSA-N 0.000 description 3
- 229910052802 copper Inorganic materials 0.000 description 3
- 239000010949 copper Substances 0.000 description 3
- 230000007797 corrosion Effects 0.000 description 3
- 238000005260 corrosion Methods 0.000 description 3
- 238000010586 diagram Methods 0.000 description 3
- 238000005229 chemical vapour deposition Methods 0.000 description 2
- 239000004020 conductor Substances 0.000 description 2
- 230000002950 deficient Effects 0.000 description 2
- 238000002845 discoloration Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 238000004151 rapid thermal annealing Methods 0.000 description 2
- 238000004544 sputter deposition Methods 0.000 description 2
- QGZKDVFQNNGYKY-UHFFFAOYSA-N Ammonia Chemical compound N QGZKDVFQNNGYKY-UHFFFAOYSA-N 0.000 description 1
- ZOKXTWBITQBERF-UHFFFAOYSA-N Molybdenum Chemical compound [Mo] ZOKXTWBITQBERF-UHFFFAOYSA-N 0.000 description 1
- GWEVSGVZZGPLCZ-UHFFFAOYSA-N Titan oxide Chemical compound O=[Ti]=O GWEVSGVZZGPLCZ-UHFFFAOYSA-N 0.000 description 1
- 150000001875 compounds Chemical class 0.000 description 1
- 230000007547 defect Effects 0.000 description 1
- 229910044991 metal oxide Inorganic materials 0.000 description 1
- 150000004706 metal oxides Chemical class 0.000 description 1
- 239000000203 mixture Substances 0.000 description 1
- 229910052750 molybdenum Inorganic materials 0.000 description 1
- 239000011733 molybdenum Substances 0.000 description 1
- 238000001020 plasma etching Methods 0.000 description 1
- 230000002265 prevention Effects 0.000 description 1
- 239000011241 protective layer Substances 0.000 description 1
- 239000002994 raw material Substances 0.000 description 1
- 239000002356 single layer Substances 0.000 description 1
- 229910052715 tantalum Inorganic materials 0.000 description 1
- GUVRBAGPIYLISA-UHFFFAOYSA-N tantalum atom Chemical compound [Ta] GUVRBAGPIYLISA-UHFFFAOYSA-N 0.000 description 1
- OGIDPMRJRNCKJF-UHFFFAOYSA-N titanium oxide Inorganic materials [Ti]=O OGIDPMRJRNCKJF-UHFFFAOYSA-N 0.000 description 1
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 1
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/02—Bonding areas ; Manufacturing methods related thereto
- H01L24/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L24/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/482—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of lead-in layers inseparably applied to the semiconductor body
- H01L23/485—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of lead-in layers inseparably applied to the semiconductor body consisting of layered constructions comprising conductive layers and insulating layers, e.g. planar contacts
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/48—Manufacture or treatment of parts, e.g. containers, prior to assembly of the devices, using processes not provided for in a single one of the subgroups H01L21/06 - H01L21/326
- H01L21/4814—Conductive parts
- H01L21/4846—Leads on or in insulating or insulated substrates, e.g. metallisation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/28—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
- H01L23/31—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
- H01L23/3157—Partial encapsulation or coating
- H01L23/3192—Multilayer coating
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/02—Bonding areas ; Manufacturing methods related thereto
- H01L24/03—Manufacturing methods
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/0212—Auxiliary members for bonding areas, e.g. spacers
- H01L2224/02122—Auxiliary members for bonding areas, e.g. spacers being formed on the semiconductor or solid-state body
- H01L2224/02123—Auxiliary members for bonding areas, e.g. spacers being formed on the semiconductor or solid-state body inside the bonding area
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/0212—Auxiliary members for bonding areas, e.g. spacers
- H01L2224/02122—Auxiliary members for bonding areas, e.g. spacers being formed on the semiconductor or solid-state body
- H01L2224/02163—Auxiliary members for bonding areas, e.g. spacers being formed on the semiconductor or solid-state body on the bonding area
- H01L2224/02165—Reinforcing structures
- H01L2224/02166—Collar structures
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/0212—Auxiliary members for bonding areas, e.g. spacers
- H01L2224/02122—Auxiliary members for bonding areas, e.g. spacers being formed on the semiconductor or solid-state body
- H01L2224/02163—Auxiliary members for bonding areas, e.g. spacers being formed on the semiconductor or solid-state body on the bonding area
- H01L2224/022—Protective coating, i.e. protective bond-through coating
- H01L2224/02205—Structure of the protective coating
- H01L2224/02206—Multilayer protective coating
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/0212—Auxiliary members for bonding areas, e.g. spacers
- H01L2224/02122—Auxiliary members for bonding areas, e.g. spacers being formed on the semiconductor or solid-state body
- H01L2224/02163—Auxiliary members for bonding areas, e.g. spacers being formed on the semiconductor or solid-state body on the bonding area
- H01L2224/022—Protective coating, i.e. protective bond-through coating
- H01L2224/02215—Material of the protective coating
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/023—Redistribution layers [RDL] for bonding areas
- H01L2224/0239—Material of the redistribution layers
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/03—Manufacturing methods
- H01L2224/03001—Involving a temporary auxiliary member not forming part of the manufacturing apparatus, e.g. removable or sacrificial coating, film or substrate
- H01L2224/03009—Involving a temporary auxiliary member not forming part of the manufacturing apparatus, e.g. removable or sacrificial coating, film or substrate for protecting parts during manufacture
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/03—Manufacturing methods
- H01L2224/03011—Involving a permanent auxiliary member, i.e. a member which is left at least partly in the finished device, e.g. coating, dummy feature
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/03—Manufacturing methods
- H01L2224/03011—Involving a permanent auxiliary member, i.e. a member which is left at least partly in the finished device, e.g. coating, dummy feature
- H01L2224/03019—Involving a permanent auxiliary member, i.e. a member which is left at least partly in the finished device, e.g. coating, dummy feature for protecting parts during the process
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/03—Manufacturing methods
- H01L2224/038—Post-treatment of the bonding area
- H01L2224/0382—Applying permanent coating, e.g. in-situ coating
- H01L2224/03826—Physical vapour deposition [PVD], e.g. evaporation, or sputtering
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/03—Manufacturing methods
- H01L2224/039—Methods of manufacturing bonding areas involving a specific sequence of method steps
- H01L2224/0391—Forming a passivation layer after forming the bonding area
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/04042—Bonding areas specifically adapted for wire connectors, e.g. wirebond pads
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
- H01L2224/0554—External layer
- H01L2224/05599—Material
- H01L2224/056—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/05617—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 400°C and less than 950°C
- H01L2224/05624—Aluminium [Al] as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
- H01L2224/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
- H01L2224/45001—Core members of the connector
- H01L2224/45099—Material
- H01L2224/451—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
- H01L2224/45138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/45139—Silver (Ag) as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
- H01L2224/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
- H01L2224/45001—Core members of the connector
- H01L2224/45099—Material
- H01L2224/451—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
- H01L2224/45138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/45144—Gold (Au) as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
- H01L2224/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
- H01L2224/45001—Core members of the connector
- H01L2224/45099—Material
- H01L2224/451—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
- H01L2224/45138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/45147—Copper (Cu) as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/85—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a wire connector
- H01L2224/852—Applying energy for connecting
- H01L2224/85201—Compression bonding
- H01L2224/85205—Ultrasonic bonding
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/85—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a wire connector
- H01L2224/8536—Bonding interfaces of the semiconductor or solid state body
- H01L2224/85375—Bonding interfaces of the semiconductor or solid state body having an external coating, e.g. protective bond-through coating
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/00011—Not relevant to the scope of the group, the symbol of which is combined with the symbol of this group
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01013—Aluminum [Al]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01014—Silicon [Si]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01022—Titanium [Ti]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01029—Copper [Cu]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01042—Molybdenum [Mo]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01073—Tantalum [Ta]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01074—Tungsten [W]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/013—Alloys
- H01L2924/0132—Binary Alloys
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/013—Alloys
- H01L2924/0133—Ternary Alloys
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Manufacturing & Machinery (AREA)
- Ceramic Engineering (AREA)
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
- Physical Vapour Deposition (AREA)
- Electrodes Of Semiconductors (AREA)
- Wire Bonding (AREA)
- Exposure Of Semiconductors, Excluding Electron Or Ion Beam Exposure (AREA)
Description
このような半導体装置では、高温高湿度環境下でのバイアス印加を伴う長期信頼性試験(THB)により、開口部を囲む反射防止膜を形成している窒化チタンが腐食することがある。
例えば、特許文献1には、パッド上に第1開口部が形成された第1表面保護膜と、パッド上に第2開口部が形成され、パッドおよび第1表面保護膜上に形成された第2表面保護膜とを備え、パッドは、第1導体膜と、第1導体膜上に形成された反射防止膜とを有し、第1開口部の内部領域に第2開口部が内包されており、第1開口部の内部領域では反射防止膜が除去されている半導体装置が提案されている。
また、従来の半導体装置においては、特に、窒化チタンからなる反射防止膜上にシリコン酸化膜が設けられている場合、高温高湿度環境下でのバイアス印加を伴う長期信頼性試験(THB)により、反射防止膜が酸化チタンとなって外観不良をおこすことがある。
その結果、反射防止膜上に設けられた酸化膜と反射防止膜との対向面と、開口部に露出する反射防止膜の露出面の一方または両方の少なくとも一部に、反射防止膜中よりも未結合手の少ない金属窒化物領域が形成されていればよいことを見出し、本発明を想到した。
すなわち、本発明は以下の事項に関する。
前記基板上に設けられた配線と、
前記配線上に設けられた窒化チタンからなる反射防止膜と、
前記反射防止膜上に設けられたシリコン酸化膜とを有し、
前記シリコン酸化膜に形成された第1開口部と前記反射防止膜に形成された第2開口部とが平面視で重なる位置に、前記配線が露出されてなるパッド部が形成され、
前記反射防止膜上の前記シリコン酸化膜との対向面と前記第2開口部に露出する前記反射防止膜の露出面の一方または両方の少なくとも一部に、前記反射防止膜中よりも未結合手の少ない金属窒化物領域が形成されていることを特徴とする半導体装置。
前記配線上に、アルゴンガスと窒素ガスを用いる反応性スパッタ法により窒化チタンからなる反射防止膜を形成する反射防止膜形成工程と、
前記反射防止膜上に、前記反射防止膜の形成時よりもアルゴンガスに対する窒素ガスの割合を多くした反応性スパッタ法により、前記反射防止膜中よりも未結合手の少ない金属窒化物膜を形成する工程と、
前記未結合手の少ない金属窒化物膜上にシリコン酸化膜を形成する酸化膜形成工程と、
前記シリコン酸化膜と前記未結合手の少ない金属窒化物膜と前記反射防止膜とを貫通し、底面に前記配線が露出する開口を設ける開口部形成工程とを有することを特徴とする半導体装置の製造方法。
前記配線上に、窒化チタンからなる反射防止膜を形成する反射防止膜形成工程と、
前記反射防止膜の表面に、窒化処理を行うことにより、前記反射防止膜中よりも未結合手の少ない金属窒化物膜を形成する工程と、
前記未結合手の少ない金属窒化物膜上にシリコン酸化膜を形成する酸化膜形成工程と、
前記シリコン酸化膜と前記未結合手の少ない金属窒化物膜と前記反射防止膜とを貫通し、底面に前記配線が露出する開口を設ける開口部形成工程とを有することを特徴とする半導体装置の製造方法。
前記配線上に、窒化チタンからなる反射防止膜を形成する反射防止膜形成工程と、
前記反射防止膜上にシリコン酸化膜を形成する酸化膜形成工程と、
前記シリコン酸化膜と前記反射防止膜とを貫通し、底面に前記配線が露出する開口を設ける開口部形成工程と、
前記開口内に露出する前記反射防止膜に、窒化処理を行うことにより、前記反射防止膜中よりも未結合手の少ない金属窒化物領域を形成する工程とを有することを特徴とする半導体装置の製造方法。
また、本発明の半導体装置は、1回のフォトリソグラフィー工程によりパッド開口部を形成でき、生産性に優れる。
すなわち、従来の半導体装置において、高温高湿度環境下でのバイアス印加を伴う長期信頼性試験(THB)を行うことにより生じる窒化チタンの腐食について調べた。その結果、配線上に窒化チタンからなる反射防止膜とシリコン酸化膜とがこの順に設けられ、シリコン酸化膜に形成された第1開口部と反射防止膜に形成された第2開口部とが平面視で重なる位置に、配線が露出されてなるパッド部が形成されている場合、反射防止膜上のシリコン酸化膜との対向面の開口部(特許請求の範囲における第2開口部)側から窒化チタンが酸化することが分かった。
[半導体装置]
図1は、本発明の半導体装置の一例を示した断面模式図である。
本実施形態の半導体装置10は、基板1と、基板1上に層間絶縁膜2を介して設けられた配線6と、配線6上に設けられた反射防止膜7と、反射防止膜7上に設けられたシリコン酸化膜3と、シリコン酸化膜3上に設けられた保護膜4とを有する。
図1に示すように、本実施形態の半導体装置10では、シリコン酸化膜3に形成された第1開口部91と、反射防止膜7に形成された第2開口部92と、保護膜4に形成された第3開口部93とが平面視で重なる位置に、配線6が露出されてなるパッド部8が形成されている。
層間絶縁膜2としては、SiO2膜、TEOS(オルトケイ酸テトラエチル(Si(OC2H5)4))を原料とする酸化膜など公知の絶縁膜を用いることができる。
シリコン酸化膜3は、上面に反射防止膜7および未結合手の少ない金属窒化物領域7aの設けられた配線6を覆うように設けられている。
シリコン酸化膜3としては、具体的には、SiO2膜、TEOSを原料とする酸化膜などを用いることができる。
シリコン酸化膜3の厚みは、2000〜8000Åとすることが好ましく、5000Å程度とすることがより好ましい。
保護膜4の厚みは、5000〜15000Åであることが好ましく、10000Å程度であることがより好ましい。
配線6の厚みは、3000〜30000Åであることが好ましく、5000Å程度であることがより好ましい。
反射防止膜7は、配線としても機能する。反射防止膜7は、窒化チタンからなる。
反射防止膜7の厚みは、250〜800Åであることが好ましく、400Å程度であることがより好ましい。
未結合手の少ない金属窒化物領域7aを形成している金属窒化物としては、例えば、後述する方法により形成された窒化チタン、窒化タンタル、窒化モリブデン、窒化タングステンなどが挙げられる。未結合手の少ない金属窒化物領域7aを形成している金属窒化物は、後述する方法により容易に形成できるため窒化チタンであることが好ましい。
(第1製造方法)
次に、本発明の半導体の製造方法の一例として、図1に示す半導体装置の製造方法を例に挙げて説明する。図2〜図6は、図1に示す半導体装置の製造方法の一例を説明するための工程図である。
具体的には、図2に示すように、基板1上にCVD法などにより層間絶縁膜2を形成する。その後、層間絶縁膜2上にスパッタリング法などにより配線6を形成する(配線工程)。
次に、図3に示すように、配線6上に、アルゴンガス(Ar)と窒素ガス(N2)を用いる反応性スパッタ法により窒化チタンからなる反射防止膜7を形成する(反射防止膜形成工程)。
次に、図6に示すように、シリコン酸化膜3上に、プラズマCVD法などにより、保護膜4を形成する(保護膜形成工程)。
以上の工程により、図1に示す半導体装置10が得られる。
図1に示す半導体装置10の製造方法は、上記の第1製造方法に限定されるものではなく、例えば、以下に示す第2製造方法により製造してもよい。
図7および図8は、図1に示す半導体装置の製造方法の他の例を説明するための工程図である。
窒素含有ガス雰囲気中での熱処理としては、例えば、窒素含有ガス雰囲気中で350℃〜650℃で1分間程度保持する熱処理(RTA(Rapid Thermal Annealing))などが挙げられる。
プラズマ処理としては、窒素含有ガス雰囲気中でプラズマエッチング装置を用いて行う処理などが挙げられる。
なお、第2製造方法における未結合手の少ない金属窒化物膜を形成する工程は、必要に応じて、上述した第1製造方法における未結合手の少ない金属窒化物膜を形成する工程の後、酸化膜形成工程前に行ってもよい。
この場合、反射防止膜7上に金属窒化物膜71として、第1製造方法で形成された膜と、第2製造方法で形成された膜との積層膜が形成される。
[半導体装置]
図9は、本発明の半導体装置の他の例を示した断面模式図である。
図9に示す本実施形態の半導体装置20が、第一実施形態の半導体装置10と異なるところは、未結合手の少ない金属窒化物領域の形成されている位置のみである。したがって、本実施形態においては、第一実施形態の半導体装置10と同じ部材についての説明を省略する。
未結合手の少ない金属窒化物領域7bを形成している金属窒化物としては、反射防止膜7中よりも未結合手の少ない金属窒化物であればよく、例えば、後述する方法により形成された窒化チタンが挙げられる。
次に、図9に示す半導体装置の製造方法を、例を挙げて説明する。図10〜図13は、図9に示す半導体装置の製造方法の一例を説明するための工程図である。
次に、図10に示すように、従来公知のフォトリソグラフィー法およびエッチング法を用いて、配線6と反射防止膜7とを所定の形状にパターニングする。図9に示す例では、配線6と反射防止膜7とを同形状にパターニングすることにより、配線6と反射防止膜7とからなる配線層が形成される。
次に、図12に示すように、シリコン酸化膜3上に、プラズマCVD法などにより、保護膜4を形成する(保護膜形成工程)。
以上の工程により、図9に示す半導体装置20が得られる。
[半導体装置]
図14は、本発明の半導体装置の他の例を示した断面模式図である。
図14に示す本実施形態の半導体装置30が、第一実施形態の半導体装置10と異なるところは、未結合手の少ない金属窒化物領域の形成されている位置のみである。したがって、本実施形態においては、第一実施形態の半導体装置10と同じ部材についての説明を省略する。
また、未結合手の少ない金属窒化物領域7cのうち、第2開口部92に露出する反射防止膜7の露出面を形成している金属窒化物としては、第二実施形態の半導体装置20の未結合手の少ない金属窒化物領域7bと同様の金属窒化物が挙げられる。
次に、図14に示す半導体装置の製造方法を、例を挙げて説明する。図14に示す半導体装置30を製造するには、まず、上述した製造方法により、図1に示す第一実施形態の半導体装置10を製造する。
以上の工程により、図14に示す半導体装置30が得られる。
本発明の半導体装置は、上述した第一実施形態〜第三実施形態の半導体装置10、20、30に限定されない。例えば、未結合手の少ない金属窒化物領域は、反射防止膜7上の酸化膜3との対向面と第2開口部92に露出する反射防止膜7の露出面の一方または両方の少なくとも一部に、設けられていれば良い。
また、本発明の半導体装置には、用途に応じて、さらに様々な機能を有する層が含まれていてもよい。
以下に示す製造方法により、図1に示す実施例1の半導体装置を得た。
まず、図2に示すように、シリコンからなる基板1上に、CVD法により、SiO2膜からなる層間絶縁膜2を形成した。その後、層間絶縁膜2上にスパッタリング法により、アルミニウムとSiと銅との合金からなる厚み5000Åの配線6を形成した(配線工程)。
次に、反射防止膜7上に、アルゴンガスに対する窒素ガスの割合(Ar:N2)を体積比で1:9とし、反射防止膜7の形成と連続して反応性スパッタ法により、窒化チタン膜からなる金属窒化物膜71を形成した(未結合手の少ない金属窒化物膜を形成する工程)。
次に、図6に示すように、シリコン酸化膜3上に、プラズマCVD法により、シリコン窒化膜からなる厚み7000Åの保護膜4を形成した(保護膜形成工程)。
以上の工程により、図1に示す実施例1の半導体装置10を得た。
実施例1の半導体装置10を製造する際に行った未結合手の少ない金属窒化物膜を形成する工程に代えて、以下に示す未結合手の少ない金属窒化物膜を形成する工程を行ったこと以外は、実施例1と同様にして、実施例2の半導体装置10を得た。
実施例2では、未結合手の少ない金属窒化物膜を形成する工程として、反射防止膜7の表面に窒化処理を行った。窒化処理としては、窒素ガス雰囲気中で350℃で1分間保持する熱処理を行った。
以下に示す製造方法により、図9に示す実施例3の半導体装置を得た。
実施例1と同様にして反射防止膜形成工程までの各工程を行った。次に、図10に示すように、フォトリソグラフィー法およびエッチング法を用いて、配線6と反射防止膜7とをパターニングし、配線6と反射防止膜7とからなる配線層を形成した。
次に、配線6と反射防止膜7とからなる配線層上に、実施例1と同様にしてシリコン酸化膜3と、保護膜4とをこの順に形成した。
次に、第2開口部92内に露出する反射防止膜7に、実施例2における未結合手の少ない金属窒化物膜を形成する工程での窒化処理と同様の窒化処理を行い、図9に示す実施例3の半導体装置20を得た。
実施例1の半導体装置10に、実施例3の半導体装置20を製造する際に行った未結合手の少ない金属窒化物膜を形成する工程での窒化処理と同様の窒化処理を行い、図14に示す実施例4の半導体装置30を得た。
未結合手の少ない金属窒化物膜を形成する工程を行わなかったこと以外は、実施例1と同様にして、比較例1の半導体装置を得た。
実施例1〜4、比較例1の半導体装置をそれぞれパッケージに実装し、22個ずつサンプルを形成した。そして、各サンプルに、温度85℃、湿度(RH)85%の環境下で、1000時間電圧を印加した。その後、パッケージを開封し、パッド部周辺を顕微鏡により観察し、下記の基準により外観検査を行なった。
「基準」
外観が良好である:パッド部またはその周辺に腐食・剥離・変色が存在しない
外観が不良である(NG):パッド部またはその周辺に腐食・剥離・変色が存在する
また、実施例1〜4の半導体装置の中でも特に、反射防止膜7上の酸化膜3との対向面と第2開口部92に露出する反射防止膜7の露出面の両方の全域に未結合手の少ない金属窒化物領域が形成されている実施例4の半導体装置は、本長期信頼性試験においては差がないものの、信頼性はより高いと考えられる。
Claims (10)
- 基板と、
前記基板上に設けられた配線と、
前記配線上に設けられた窒化チタンからなる反射防止膜と、
前記反射防止膜上に設けられたシリコン酸化膜とを有し、
前記シリコン酸化膜に形成された第1開口部と前記反射防止膜に形成された第2開口部とが平面視で重なる位置に、前記配線が露出されてなるパッド部が形成され、
前記反射防止膜上の前記シリコン酸化膜との対向面と前記第2開口部に露出する前記反射防止膜の露出面の一方または両方の少なくとも一部に、前記反射防止膜中よりも未結合手の少ない金属窒化物領域が形成されていることを特徴とする半導体装置。 - 前記対向面に前記未結合手の少ない金属窒化物領域が形成されている請求項1に記載の半導体装置。
- 前記未結合手の少ない金属窒化物領域が、窒化チタン、窒化タンタル、窒化モリブデン、窒化タングステンのいずれかで形成されていることを特徴とする請求項1または請求項2に記載の半導体装置。
- 前記シリコン酸化膜上にシリコン窒化膜からなる保護膜が設けられ、
前記パッド部が、前記保護膜に形成された第3開口部と前記第1開口部と前記第2開口部とが平面視で重なる位置に形成されていることを特徴とする請求項1〜請求項3のいずれか一項に記載の半導体装置。 - 基板上に配線を形成する配線工程と、
前記配線上に、アルゴンガスと窒素ガスを用いる反応性スパッタ法により窒化チタンからなる反射防止膜を形成する反射防止膜形成工程と、
前記反射防止膜上に、前記反射防止膜の形成時よりもアルゴンガスに対する窒素ガスの割合を多くした反応性スパッタ法により、前記反射防止膜中よりも未結合手の少ない金属窒化物膜を形成する工程と、
前記未結合手の少ない金属窒化物膜上にシリコン酸化膜を形成する酸化膜形成工程と、
前記シリコン酸化膜と前記未結合手の少ない金属窒化物膜と前記反射防止膜とを貫通し、底面に前記配線が露出する開口を設ける開口部形成工程とを有することを特徴とする半導体装置の製造方法。 - 前記未結合手の少ない金属窒化物膜を形成する工程において、チタンを含むターゲットを用いる反応性スパッタ法により、窒化チタン膜を形成することを特徴とする請求項5に記載の半導体装置の製造方法。
- 基板上に配線を形成する配線工程と、
前記配線上に、窒化チタンからなる反射防止膜を形成する反射防止膜形成工程と、
前記反射防止膜の表面に、窒化処理を行うことにより、前記反射防止膜中よりも未結合手の少ない金属窒化物膜を形成する工程と、
前記未結合手の少ない金属窒化物膜上にシリコン酸化膜を形成する酸化膜形成工程と、
前記シリコン酸化膜と前記未結合手の少ない金属窒化物膜と前記反射防止膜とを貫通し、底面に前記配線が露出する開口を設ける開口部形成工程とを有することを特徴とする半導体装置の製造方法。 - 基板上に配線を形成する配線工程と、
前記配線上に、窒化チタンからなる反射防止膜を形成する反射防止膜形成工程と、
前記反射防止膜上にシリコン酸化膜を形成する酸化膜形成工程と、
前記シリコン酸化膜と前記反射防止膜とを貫通し、底面に前記配線が露出する開口を設ける開口部形成工程と、
前記開口内に露出する前記反射防止膜に、窒化処理を行うことにより、前記反射防止膜中よりも未結合手の少ない金属窒化物領域を形成する工程とを有することを特徴とする半導体装置の製造方法。 - 前記窒化処理が、窒素含有ガス雰囲気中での熱処理、または窒素含有ガスを用いたプラズマ処理であることを特徴とする請求項7または請求項8に記載の半導体装置の製造方法。
- 前記酸化膜形成工程後、前記シリコン酸化膜上にシリコン窒化膜からなる保護膜を設ける保護膜形成工程を有し、
前記開口部形成工程において、前記保護膜を貫通し、底面に前記配線が露出する開口を設けることを特徴とする請求項5〜請求項8のいずれか一項に記載の半導体装置の製造方法。
Priority Applications (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2017048802A JP6783689B2 (ja) | 2017-03-14 | 2017-03-14 | 半導体装置および半導体装置の製造方法 |
TW107108006A TW201901905A (zh) | 2017-03-14 | 2018-03-09 | 半導體裝置以及半導體裝置的製造方法 |
CN201810193403.0A CN108573943A (zh) | 2017-03-14 | 2018-03-09 | 半导体装置和半导体装置的制造方法 |
US15/918,405 US10607954B2 (en) | 2017-03-14 | 2018-03-12 | Semiconductor device and method of manufacturing a semiconductor device |
US16/794,443 US10978414B2 (en) | 2017-03-14 | 2020-02-19 | Semiconductor device and method of manufacturing a semiconductor device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2017048802A JP6783689B2 (ja) | 2017-03-14 | 2017-03-14 | 半導体装置および半導体装置の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2018152507A JP2018152507A (ja) | 2018-09-27 |
JP6783689B2 true JP6783689B2 (ja) | 2020-11-11 |
Family
ID=63520317
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2017048802A Expired - Fee Related JP6783689B2 (ja) | 2017-03-14 | 2017-03-14 | 半導体装置および半導体装置の製造方法 |
Country Status (4)
Country | Link |
---|---|
US (2) | US10607954B2 (ja) |
JP (1) | JP6783689B2 (ja) |
CN (1) | CN108573943A (ja) |
TW (1) | TW201901905A (ja) |
Family Cites Families (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5275863A (en) | 1975-12-20 | 1977-06-25 | Kikumi Shidori | Constant ouantity cleanser feeder for washer |
JP4170103B2 (ja) * | 2003-01-30 | 2008-10-22 | Necエレクトロニクス株式会社 | 半導体装置、および半導体装置の製造方法 |
JP5443827B2 (ja) | 2009-05-20 | 2014-03-19 | ルネサスエレクトロニクス株式会社 | 半導体装置 |
JP6508601B2 (ja) * | 2014-08-11 | 2019-05-08 | パナソニックIpマネジメント株式会社 | 半導体装置 |
-
2017
- 2017-03-14 JP JP2017048802A patent/JP6783689B2/ja not_active Expired - Fee Related
-
2018
- 2018-03-09 TW TW107108006A patent/TW201901905A/zh unknown
- 2018-03-09 CN CN201810193403.0A patent/CN108573943A/zh not_active Withdrawn
- 2018-03-12 US US15/918,405 patent/US10607954B2/en not_active Expired - Fee Related
-
2020
- 2020-02-19 US US16/794,443 patent/US10978414B2/en active Active
Also Published As
Publication number | Publication date |
---|---|
US10607954B2 (en) | 2020-03-31 |
US10978414B2 (en) | 2021-04-13 |
TW201901905A (zh) | 2019-01-01 |
CN108573943A (zh) | 2018-09-25 |
US20200185343A1 (en) | 2020-06-11 |
JP2018152507A (ja) | 2018-09-27 |
US20180269171A1 (en) | 2018-09-20 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR0145649B1 (ko) | 반도체 장치 및 이의 제조방법 | |
US6521523B2 (en) | Method for forming selective protection layers on copper interconnects | |
KR100761467B1 (ko) | 금속배선 및 그 형성 방법 | |
US20110097890A1 (en) | Method of fabricating semiconductor device | |
US8946083B2 (en) | In-situ formation of silicon and tantalum containing barrier | |
TW560002B (en) | Semiconductor device and process for the same | |
US8623759B2 (en) | Method for manufacturing semiconductor device | |
JP6783689B2 (ja) | 半導体装置および半導体装置の製造方法 | |
US10388618B2 (en) | Semiconductor device and method of manufacturing a semiconductor device | |
US20090289366A1 (en) | Semiconductor device and manufacturing method of semiconductor device | |
JP6793575B2 (ja) | 半導体装置とその製造方法 | |
JP6783688B2 (ja) | 半導体装置および半導体装置の製造方法 | |
TWI322471B (en) | A semiconductor device having a second level of metallization formed over a first level with minimal damage to the first level and method | |
JPH08139090A (ja) | 半導体集積回路装置 | |
JP5569561B2 (ja) | 半導体装置の製造方法 | |
JPH0629294A (ja) | 半導体装置の製造方法 | |
JP2008147252A (ja) | 半導体装置とその製造方法 | |
US7439175B2 (en) | Method for fabricating a thin film and metal line of semiconductor device | |
JPH06310597A (ja) | 半導体装置 | |
JPH03237745A (ja) | 半導体装置 | |
TW406139B (en) | Isolated protection process of the copper metal | |
US20090136724A1 (en) | Method of fabricating semiconductor device | |
KR100525089B1 (ko) | 반도체 소자의 금속배선 형성방법 | |
KR101029105B1 (ko) | 반도체 소자의 금속배선 및 그 형성방법 | |
US20140183720A1 (en) | Methods of manufacturing integrated circuits having a compressive nitride layer |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20191205 |
|
TRDD | Decision of grant or rejection written | ||
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20200930 |
|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20201006 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20201022 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 6783689 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
LAPS | Cancellation because of no payment of annual fees |