JP6770848B2 - 被処理体を処理する方法 - Google Patents

被処理体を処理する方法 Download PDF

Info

Publication number
JP6770848B2
JP6770848B2 JP2016147475A JP2016147475A JP6770848B2 JP 6770848 B2 JP6770848 B2 JP 6770848B2 JP 2016147475 A JP2016147475 A JP 2016147475A JP 2016147475 A JP2016147475 A JP 2016147475A JP 6770848 B2 JP6770848 B2 JP 6770848B2
Authority
JP
Japan
Prior art keywords
gas
mask
processing container
plasma
etched
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
JP2016147475A
Other languages
English (en)
Other versions
JP2017183688A (ja
Inventor
嘉英 木原
嘉英 木原
亨 久松
亨 久松
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Tokyo Electron Ltd
Original Assignee
Tokyo Electron Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Tokyo Electron Ltd filed Critical Tokyo Electron Ltd
Priority to TW106109244A priority Critical patent/TWI766857B/zh
Priority to KR1020187030670A priority patent/KR102362462B1/ko
Priority to US16/089,071 priority patent/US10763123B2/en
Priority to PCT/JP2017/012399 priority patent/WO2017170405A1/ja
Priority to CN201780020009.0A priority patent/CN108885990B/zh
Publication of JP2017183688A publication Critical patent/JP2017183688A/ja
Application granted granted Critical
Publication of JP6770848B2 publication Critical patent/JP6770848B2/ja
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic System or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/3105After-treatment
    • H01L21/311Etching the insulating layers by chemical or physical means
    • H01L21/31144Etching the insulating layers by chemical or physical means using masks
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic System or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/302Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
    • H01L21/306Chemical or electrical treatment, e.g. electrolytic etching
    • H01L21/3065Plasma etching; Reactive-ion etching
    • CCHEMISTRY; METALLURGY
    • C09DYES; PAINTS; POLISHES; NATURAL RESINS; ADHESIVES; COMPOSITIONS NOT OTHERWISE PROVIDED FOR; APPLICATIONS OF MATERIALS NOT OTHERWISE PROVIDED FOR
    • C09KMATERIALS FOR MISCELLANEOUS APPLICATIONS, NOT PROVIDED FOR ELSEWHERE
    • C09K13/00Etching, surface-brightening or pickling compositions
    • GPHYSICS
    • G03PHOTOGRAPHY; CINEMATOGRAPHY; ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ELECTROGRAPHY; HOLOGRAPHY
    • G03FPHOTOMECHANICAL PRODUCTION OF TEXTURED OR PATTERNED SURFACES, e.g. FOR PRINTING, FOR PROCESSING OF SEMICONDUCTOR DEVICES; MATERIALS THEREFOR; ORIGINALS THEREFOR; APPARATUS SPECIALLY ADAPTED THEREFOR
    • G03F1/00Originals for photomechanical production of textured or patterned surfaces, e.g., masks, photo-masks, reticles; Mask blanks or pellicles therefor; Containers specially adapted therefor; Preparation thereof
    • G03F1/68Preparation processes not covered by groups G03F1/20 - G03F1/50
    • G03F1/80Etching
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02109Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02112Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer
    • H01L21/02123Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon
    • H01L21/02164Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material being a silicon oxide, e.g. SiO2
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02109Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02205Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates the layer being characterised by the precursor material for deposition
    • H01L21/02208Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates the layer being characterised by the precursor material for deposition the precursor containing a compound comprising Si
    • H01L21/02219Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates the layer being characterised by the precursor material for deposition the precursor containing a compound comprising Si the compound comprising silicon and nitrogen
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02225Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer
    • H01L21/0226Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process
    • H01L21/02263Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase
    • H01L21/02271Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase deposition by decomposition or reaction of gaseous or vapour phase compounds, i.e. chemical vapour deposition
    • H01L21/02274Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase deposition by decomposition or reaction of gaseous or vapour phase compounds, i.e. chemical vapour deposition in the presence of a plasma [PECVD]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02225Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer
    • H01L21/0226Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process
    • H01L21/02263Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase
    • H01L21/02271Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase deposition by decomposition or reaction of gaseous or vapour phase compounds, i.e. chemical vapour deposition
    • H01L21/0228Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase deposition by decomposition or reaction of gaseous or vapour phase compounds, i.e. chemical vapour deposition deposition by cyclic CVD, e.g. ALD, ALE, pulsed CVD
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/027Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34
    • H01L21/0271Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising organic layers
    • H01L21/0273Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising organic layers characterised by the treatment of photoresist layers
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic System or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/3105After-treatment
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic System or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/3105After-treatment
    • H01L21/31058After-treatment of organic layers
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic System or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/3105After-treatment
    • H01L21/311Etching the insulating layers by chemical or physical means
    • H01L21/31105Etching inorganic layers
    • H01L21/31111Etching inorganic layers by chemical means
    • H01L21/31116Etching inorganic layers by chemical means by dry-etching
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic System or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/3105After-treatment
    • H01L21/311Etching the insulating layers by chemical or physical means
    • H01L21/31127Etching organic layers
    • H01L21/31133Etching organic layers by chemical means
    • H01L21/31138Etching organic layers by chemical means by dry-etching
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic System or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/3205Deposition of non-insulating-, e.g. conductive- or resistive-, layers on insulating layers; After-treatment of these layers
    • H01L21/321After treatment
    • H01L21/3213Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer
    • H01L21/32139Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer using masks
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05HPLASMA TECHNIQUE; PRODUCTION OF ACCELERATED ELECTRICALLY-CHARGED PARTICLES OR OF NEUTRONS; PRODUCTION OR ACCELERATION OF NEUTRAL MOLECULAR OR ATOMIC BEAMS
    • H05H1/00Generating plasma; Handling plasma
    • H05H1/24Generating plasma
    • H05H1/46Generating plasma using applied electromagnetic fields, e.g. high frequency or microwave energy

Description

本発明の実施形態は、被処理体を処理する方法に関するものであり、特にマスクの作成を含む方法に関するものである。
半導体素子といったデバイスの微細化を実現するためには、これまでのフォトリソグラフィ技術を用いた微細加工により得られる限界寸法よりも小さな寸法をもったパターンを形成する必要がある。このような寸法のパターンを形成するための一手法として、次世代露光技術であるEUV(Extreme Ultraviolet)技術等の開発が進められている。EUV技術では、従来のUV光源波長に比べて著しく短い波長の光が用いられており、例えば13.5[nm]と非常に短い波長の光が用いられる。また、従来のリソグラフィ技術に代わる技術として、秩序パターンを自発的に組織化する自己組織化(self-assembled)材料の一つである自己組織化ブロック・コポリマー(BCP:blockcopolymer)を用いてパターンを形成する誘導自己組織化(DSA:Directed Self-Assembly)技術が着目されている。
上記のEUV技術およびDSA技術等を用いて狭パターンのパターンエッチングを行う場合、狭パターンに起因してマスクが脆弱となり、マスクの倒壊等が生じ得る。これに対し、特許文献1,2には、マスクを保護する技術が開示されている。
特許文献1に開示されているプラズマエッチング性能強化方法は、プラズマを用いてエッチマスクにより定めた構造をエッチングすることによって、半導体ウェーハ上の誘電層にボーイングのない特徴部をエッチングによって形成するための方法である。特許文献1の技術では、マスクを誘電層上に形成し、保護シリコン含有被覆をマスクの露出面に形成し、マスク及び保護シリコン含有被覆を介して特徴部をエッチングする。さらに別の方法においては、この特徴部は保護シリコン含有被覆を形成する前に部分的にエッチングされる。このように、特許文献1の技術では、レジストマスク上において、または、部分的にエッチングされた特徴部の側壁上において、保護シリコン含有被覆をプラズマを用いて形成し、このように形成した保護シリコン含有被覆によって、マスクを保護し、CD(Critical Dimension)寸法のシュリンク制御し、エッチングによるボーイングを制御することが提案されている。
特許文献2に開示されているプラズマエッチング方法は、多層レジストマスクを用いたシリコン酸化膜等のプラズマエッチング後にパターンの倒壊等により発生するラインウィグリングやストライエーションを防止および抑制することを目的としている。特許文献2の技術では、多層レジストマスクを用いて、被エッチング膜をプラズマエッチングするプラズマエッチング方法において、多層レジストマスクは、上層レジストと無機膜系中間膜と下層レジストを含み、下層レジストの側壁に側壁保護膜を形成する側壁保護膜形成工程を有する。
このように、特許文献2の技術では、ラインウィグリング、ストライエーションを防止するために、三層構造のマスクに対し、下層レジストの処理後に側壁保護膜を形成し、この形成後のエッチング時のラインウィグリング、ストライエーションを防止することが提案されている。
特開2008−60566号公報 特開2012−15343号公報
しかし、上記の特許文献1,2のようにマスクに保護膜を形成する技術では、特に無機膜系のエッチング時に用いられるCxFx系ガスによって炭素およびフッ素の重合膜がマスクに形成される場合、当該重合膜にイオンが衝突することによってマスクに縒れ(wiggling)が生じ得る。このようなマスクの縒れによって、精密なパターンエッチングが阻害される場合があり、またマスクの破損等も誘引され得る。一方、当該重合膜の堆積を低減させる場合には、マスクに対する保護が不十分となり、よって、マスク選択比の低下等の事態が生じ得る。以上のように、マスクを保護しつつマスクを保護する保護膜によって生じるマスクの縒れを回避する技術の実現が必要となる。
一態様においては、被処理体を処理する方法が提供される。被処理体は、被エッチング層と該被エッチング層上に設けられた第1のマスクとを備え、当該方法は、被処理体が収容されたプラズマ処理装置の処理容器内においてプラズマを発生させて該処理容器に設けられた平行平板電極の上部電極に負の直流電圧を印可することによって、第1のマスクに二次電子を照射すると共に、該上部電極が備えシリコンを含有する電極板からシリコンを放出させて該シリコンを含む酸化シリコン化合物で該第1のマスクを覆う、第1の工程と、第1の工程の実行後に、処理容器内において第1のガスのプラズマを生成し、該プラズマに含まれるラジカルを含む混合層を被エッチング層の表面の原子層に形成する第2の工程と、第2の工程の実行後に、処理容器内の空間をパージする第3の工程と、第3の工程の実行後に、処理容器内において第2のガスのプラズマを生成し、該プラズマにバイアス電圧を印可して、混合層を除去する第4の工程と、第4の工程の実行後に、処理容器内の空間をパージする第5の工程と、を含む第1のシーケンスを繰り返し実行し、被エッチング層を原子層毎に除去することによって、該被エッチング層をエッチングする。
このように、被エッチング層の表面の原子層を除去する第1のシーケンスの実行毎に第1のマスクに対する必要な保護がその都度行われ、このような第1のシーケンスが繰り返し実行されることによって、被エッチング層のエッチングに対し必要な保護が第1のマスクに形成されつつ過剰な保護が回避され得る。従って、マスクを保護する保護膜の膜厚が十分に低減されるので、当該保護膜によって生じるマスクの縒れが回避され得る。
第1のガスは、フルオロカーボン系ガスと希ガスとを含む。このように、第1のガスがフルオロカーボン系ガスを含むので、第2の工程において、被エッチング層の表面にフッ素ラジカルおよび炭素ラジカルが供給され、当該表面に当該両ラジカルを含有する混合層が形成され得る。
第2のガスは、希ガスである。このように、第2のガスが希ガスを含むので、第4の工程において、被エッチング層の表面に形成された混合層は、当該希ガスのプラズマがバイアス電圧によって受けるエネルギによって、当該表面から除去され得る。
第1のシーケンスの実行前に、第1のマスクを形成する工程を更に備え、該工程は、第6の工程と第7の工程とを備え、該第6の工程と該第7の工程とにおいて、被エッチング層上に設けられていた有機膜と該有機膜上に設けられていた反射防止膜とに対し該反射防止膜上に設けられていた第2のマスクを用いてエッチング処理を行うことによって、第1のマスクを形成し、第6の工程は、反射防止膜をエッチングし、第7の工程は、第6の工程の実行後に、有機膜をエッチングし、第1のマスクは、第6の工程および第7の工程の実行によって形成され、反射防止膜および有機膜から形成される。
第6の工程は、処理容器内において、第2のマスクの表面に保護膜をコンフォーマル(conformal)に形成する工程(工程aという)と、工程aの実行後に、該保護膜が形成された第2のマスクを用いて、処理容器内で発生させたプラズマにより反射防止膜を原子層毎に除去し、該反射防止膜をエッチングする工程(工程bという)と、を備える。このように、工程aが実行されることによって、マスクの疎密差によらずに、第2のマスク上に精度良く制御されたコンフォーマルな膜厚の保護膜が形成され、マスクの形状を維持しつつマスクのエッチングに対する耐性が強化され、更に工程bが実行されることによって、マスクの選択比が向上され、マスクの形状(LWR(Line Width Roughness)およびLER(Line Edge Roughness))がエッチングによって受ける影響が低減される。
第6の工程は、工程aの実行前に、処理容器内でプラズマを発生させて処理容器に設けられた上部電極に負の直流電圧を印可することにより、第2のマスクに二次電子を照射する工程(工程cという)を更に備える。このように、工程aの実行前において、第2のマスクに二次電子を照射するので、保護膜の形成前に第2のマスクを改質することができ、後続の工程による第2のマスクの損傷を抑制することができる。
工程cは、処理容器内でプラズマを発生させて上部電極に負の直流電圧を印可することにより、電極板からシリコンを放出させて該シリコンを含む酸化シリコン化合物で第2のマスクを覆う。このように、工程cにおいて、酸化シリコン化合物が第2のマスクを覆うので、後続の工程による第2のマスクの損傷を更に抑制できる。
工程aは、処理容器内に第3のガスを供給する第8の工程と、第8の工程の実行後に、処理容器内の空間をパージする第9の工程と、第9の工程の実行後に、処理容器内において第4のガスのプラズマを生成する第10の工程と、第10の工程の実行後に、処理容器内の空間をパージする第11の工程と、を含む第2のシーケンスを繰り返し実行することによって、第2のマスクの表面に保護膜をコンフォーマルに形成し、第8の工程は、第3のガスのプラズマを生成しない。このように、工程aは、ALD(Atomic Layer Deposition)法と同様の方法によって、第2のマスクの表面に保護膜をコンフォーマルに形成できる。
第3のガスは、有機含有されたアミノシラン系ガスを含む。このように第3のガスが有機含有されたアミノシラン系ガスを含むので、第8の工程によって、シリコンの反応前駆体が第2のマスクの原子層に沿って第2のマスク上に形成される。
一実施形態において、第3のガスのアミノシラン系ガスは、1〜3個のケイ素原子を有するアミノシランを含み得る。第3のガスのアミノシラン系ガスは、1〜3個のアミノ基を有するアミノシランを含み得る。このように第3のガスのアミノシラン系ガスには、1〜3個のケイ素原子を含むアミノシランを用いることができる。また、第3のガスのアミノシラン系ガスには、1〜3個のアミノ基を含むアミノシランを用いることができる。
第4のガスは、酸素原子および炭素原子を含有するガスを含む。このように第4のガスが酸素原子を含むので、第10の工程において、当該酸素原子が第2のマスク上に設けられるシリコンの反応前駆体と結合することによって、第2のマスク上に酸化シリコンの保護膜がコンフォーマルに形成され得る。また、第4のガスが炭素原子を含むので、酸素原子による第2のマスクに対する浸食が当該炭素原子によって抑制され得る。
工程bは、工程aの実行後に、処理容器内において第5のガスのプラズマを生成し、該プラズマに含まれるラジカルを含む混合層を反射防止膜の表面に形成する第12の工程と、第12の工程の実行後に、処理容器内の空間をパージする第13の工程と、第13の工程の実行後に、処理容器内において第6のガスのプラズマを生成し、該プラズマにバイアス電圧を印可して、混合層を除去する第14の工程と、第14の工程の実行後に、処理容器内の空間をパージする第15の工程と、を含む第3のシーケンスを繰り返し実行し、反射防止膜を原子層毎に除去することによって、該反射防止膜をエッチングする。このように、工程bは、ALE(Atomic Layer Etching)法と同様の方法によって、反射防止膜を原子層毎に除去することができる。
第5のガスは、フルオロカーボン系ガスと希ガスとを含む。このように、第5のガスがフルオロカーボン系ガスを含むので、第12の工程において、反射防止膜の表面にフッ素ラジカルおよび炭素ラジカルが供給され、当該表面に当該両ラジカルを含有する混合層が形成され得る。
第6のガスは、希ガスを含む。このように、第6のガスが希ガスを含むので、第14の工程において、反射防止膜の表面に形成された混合層は、当該希ガスのプラズマがバイアス電圧によって受けるエネルギによって、当該表面から除去され得る。
第7の工程は、第6の工程の実行後に、処理容器内で発生させたプラズマにより、第3のマスクを用いて有機膜に対しエッチング処理を行い、第3のマスクは、第6の工程において、第2のマスクと反射防止膜とから形成される。このように、第6の工程の実行によって、マスクの疎密によらずに、形状が維持され選択比が向上された第3のマスクが有機膜上に形成されるので、このような良好な形状のマスクによる有機膜のエッチングが可能となり、有機膜のエッチングが良好に行える。
以上説明したように、マスクを保護しつつマスクを保護する保護膜によって生じるマスクの縒れを回避する技術が実現可能となる。
図1は、一実施形態の方法を示す流れ図である。 図2は、プラズマ処理装置の一例を示す図である。 図3は、(a)部、(b)部、(c)部を備え、図1に示す各工程の実施前および実施後の被処理体の状態を示す断面図である。 図4は、(a)部、(b)部、(c)部を備え、図1に示す各工程の実施後の被処理体の状態を示す断面図である。 図5は、図1に示す保護膜を形成するシーケンスにおける保護膜の形成の様子を模式的に示す図である。 図6は、図1に示す方法におけるエッチングの原理を示す図である。
以下、図面を参照して種々の実施形態について詳細に説明する。なお、図面において同一または相当の部分に対しては同一の符号を附すこととする。
以下、図1を参照して、プラズマ処理装置10を用いて実施することができるエッチング方法(方法MT)について説明する。図1は、一実施形態の方法を示す流れ図である。図1に示す一実施形態の方法MTは、被処理体(以下、「ウエハ」ということがある)を処理する方法である。方法MTは、ウエハをエッチングする方法の一例である。一実施形態の方法MTでは、一連の工程を単一のプラズマ処理装置を用いて実行することが可能である。
図2は、プラズマ処理装置の一例を示す図である。図2には、被処理体を処理する方法の種々の実施形態で利用可能なプラズマ処理装置10の断面構造が概略的に示されている。図2に示すように、プラズマ処理装置10は、平行平板の電極を備えるプラズマエッチング装置であり、処理容器12を備えている。処理容器12は、略円筒形状を有している。処理容器12は、例えば、アルミニウムから構成されており、その内壁面には陽極酸化処理が施されている。処理容器12は保安接地されている。
処理容器12の底部上には、略円筒状の支持部14が設けられている。支持部14は、例えば、絶縁材料から構成されている。支持部14を構成する絶縁材料は、石英のように酸素を含み得る。支持部14は、処理容器12内において、処理容器12の底部から鉛直方向に延在している。処理容器12内には、載置台PDが設けられている。載置台PDは、支持部14によって支持されている。
載置台PDは、載置台PDの上面においてウエハWを保持する。載置台PDは、下部電極LEおよび静電チャックESCを有している。下部電極LEは、第1プレート18aおよび第2プレート18bを含んでいる。第1プレート18aおよび第2プレート18bは、例えばアルミアルミニウムといった金属から構成されており、略円盤形状をなしている。第2プレート18bは、第1プレート18a上に設けられており、第1プレート18aに電気的に接続されている。
第2プレート18b上には、静電チャックESCが設けられている。静電チャックESCは、導電膜である電極を、一対の絶縁層の間または一対の絶縁シートの間に配置した構造を有している。静電チャックESCの電極には、直流電源22がスイッチ23を介して電気的に接続されている。静電チャックESCは、直流電源22からの直流電圧により生じるクーロン力等の静電力によりウエハWを吸着する。これにより、静電チャックESCは、ウエハWを保持することができる。
第2プレート18bの周縁部上には、ウエハWのエッジおよび静電チャックESCを囲むようにフォーカスリングFRが配置されている。フォーカスリングFRは、エッチングの均一性を向上させるために設けられている。フォーカスリングFRは、エッチング対象の膜の材料によって適宜選択される材料から構成されており、例えば、石英から構成され得る。
第2プレート18bの内部には、冷媒流路24が設けられている。冷媒流路24は、温調機構を構成している。冷媒流路24には、処理容器12の外部に設けられたチラーユニット(図示略)から配管26aを介して冷媒が供給される。冷媒流路24に供給される冷媒は、配管26bを介してチラーユニットに戻される。このように、冷媒流路24には、冷媒が循環するように供給される。この冷媒の温度を制御することによって、静電チャックESCによって支持されたウエハWの温度が制御される。
プラズマ処理装置10には、ガス供給ライン28が設けられている。ガス供給ライン28は、伝熱ガス供給機構からの伝熱ガス、例えばHeガスを、静電チャックESCの上面とウエハWの裏面との間に供給する。
プラズマ処理装置10には、加熱素子であるヒータHTが設けられている。ヒータHTは、例えば、第2プレート18b内に埋め込まれている。ヒータHTには、ヒータ電源HPが接続されている。ヒータ電源HPからヒータHTに電力が供給されることにより、載置台PDの温度が調整され、載置台PD上に載置されるウエハWの温度が調整されるようになっている。なお、ヒータHTは、静電チャックESCに内蔵されていてもよい。
プラズマ処理装置10は、上部電極30を備えている。上部電極30は、載置台PDの上方において、載置台PDと対向配置されている。下部電極LEと上部電極30とは、互いに略平行に設けられている。上部電極30と下部電極LEとの間には、ウエハWにプラズマ処理を行うための処理空間Sが提供されている。
上部電極30は、絶縁性遮蔽部材32を介して、処理容器12の上部に支持されている。絶縁性遮蔽部材32は、絶縁材料から構成されており、例えば、石英のように酸素を含み得る。上部電極30は、電極板34および電極支持体36を含み得る。電極板34は処理空間Sに面しており、当該電極板34には複数のガス吐出孔34aが設けられている。電極板34は、一実施形態では、シリコンを含有する。別の実施形態では、電極板34は、酸化シリコンを含有し得る。
電極支持体36は、電極板34を着脱自在に支持するものであり、例えばアルミニウムといった導電性材料から構成され得る。電極支持体36は、水冷構造を有し得る。電極支持体36の内部には、ガス拡散室36aが設けられている。ガス拡散室36aからは、ガス吐出孔34aに連通する複数のガス通流孔36bが下方に延びている。電極支持体36には、ガス拡散室36aに処理ガスを導くガス導入口36cが形成されており、ガス導入口36cには、ガス供給管38が接続されている。
ガス供給管38には、バルブ群42および流量制御器群44を介して、ガスソース群40が接続されている。ガスソース群40は、複数のガスソースを有している。複数のガスソースは、有機含有されたアミノシラン系ガスのソース、フルオロカーボン系ガス(Cガス(x、yは1〜10の整数))のソース、酸素原子および炭素原子を有するガスのソース(例えば二酸化炭素ガス等)、窒素ガスのソース、水素含有ガスのソース、および、希ガスのソースを含み得る。フルオロカーボン系ガスとしては、CFガス、Cガス、Cガスといった任意のフルオロカーボン系ガスが用いられ得る。アミノシラン系ガスとしては、アミノ基の数が比較的に少ない分子構造のものが用いられることができ、例えば、モノアミノシラン(H−Si−R(Rは有機を含んでおり置換されていても良いアミノ基))が用いられ得る。また、上記のアミノシラン系ガス(後述のガスG1に含まれるガス)は、1〜3個のケイ素原子を有し得るアミノシランを含むことができ、または、1〜3個のアミノ基を有するアミノシランを含むことができる。1〜3個のケイ素原子を有するアミノシランは、1〜3個のアミノ基を有するモノシラン(モノアミノシラン)、1〜3個のアミノ基を有するジシラン、または、1〜3個のアミノ基を有するトリシランであり得る。さらに、上記のアミノシランは、置換されていてもよいアミノ基を有し得る。さらに、上記のアミノ基は、メチル基、エチル基、プロピル基、および、ブチル基の何れかによって置換され得る。さらに、上記のメチル基、エチル基、プロピル基、または、ブチル基は、ハロゲンによって置換され得る。希ガスとしては、Arガス、Heガスといった任意の希ガスが用いられ得る。
バルブ群42は複数のバルブを含んでおり、流量制御器群44はマスフローコントローラといった複数の流量制御器を含んでいる。ガスソース群40の複数のガスソースのそれぞれは、バルブ群42の対応のバルブおよび流量制御器群44の対応の流量制御器を介して、ガス供給管38に接続されている。したがって、プラズマ処理装置10は、ガスソース群40の複数のガスソースのうち選択された一以上のガスソースからのガスを、個別に調整された流量で、処理容器12内に供給することが可能である。
プラズマ処理装置10では、処理容器12の内壁に沿ってデポシールド46が着脱自在に設けられている。デポシールド46は、支持部14の外周にも設けられている。デポシールド46は、処理容器12にエッチング副生物(デポ)が付着することを防止するものであり、アルミニウム材にY等のセラミックスを被覆することにより構成され得る。デポシールドは、Yの他に、例えば、石英のように酸素を含む材料から構成され得る。
処理容器12の底部側、且つ、支持部14と処理容器12の側壁との間には排気プレート48が設けられている。排気プレート48は、例えば、アルミニウム材にY等のセラミックスを被覆することにより構成され得る。排気プレート48の下方、且つ、処理容器12には、排気口12eが設けられている。排気口12eには、排気管52を介して排気装置50が接続されている。排気装置50は、ターボ分子ポンプなどの真空ポンプを有しており、処理容器12内の空間を所望の真空度まで減圧することができる。処理容器12の側壁にはウエハWの搬入出口12gが設けられており、搬入出口12gはゲートバルブ54により開閉可能となっている。
プラズマ処理装置10は、第1の高周波電源62および第2の高周波電源64を更に備えている。第1の高周波電源62は、プラズマ生成用の第1の高周波電力を発生する電源であり、27〜100[MHz]の周波数、一例においては60[MHz]の高周波電力を発生する。第1の高周波電源62は、整合器66を介して上部電極30に接続されている。整合器66は、第1の高周波電源62の出力インピーダンスと負荷側(下部電極LE側)の入力インピーダンスを整合させるための回路である。なお、第1の高周波電源62は、整合器66を介して下部電極LEに接続されていてもよい。
第2の高周波電源64は、ウエハWにイオンを引き込むための第2の高周波電力、すなわち高周波バイアス電力を発生する電源であり、400[kHz]〜40.68[MHz]の範囲内の周波数、一例においては13.56[MHz]の周波数の高周波バイアス電力を発生する。第2の高周波電源64は、整合器68を介して下部電極LEに接続されている。整合器68は、第2の高周波電源64の出力インピーダンスと負荷側(下部電極LE側)の入力インピーダンスを整合させるための回路である。
プラズマ処理装置10は、電源70を更に備えている。電源70は、上部電極30に接続されている。電源70は、処理空間S内に存在する正イオンを電極板34に引き込むための電圧を、上部電極30に印加する。一例においては、電源70は、負の直流電圧を発生する直流電源である。このような電圧が電源70から上部電極30に印加されると、処理空間Sに存在する正イオンが、電極板34に衝突する。これにより、電極板34から二次電子および/またはシリコンが放出される。
一実施形態においては、プラズマ処理装置10は、制御部Cntを更に備え得る。制御部Cntは、プロセッサ、記憶部、入力装置、表示装置等を備えるコンピュータであり、プラズマ処理装置10の各部を制御する。具体的に、制御部Cntは、バルブ群42、流量制御器群44、排気装置50、第1の高周波電源62、整合器66、第2の高周波電源64、整合器68、電源70、ヒータ電源HP、およびチラーユニットに接続されている。
制御部Cntは、入力されたレシピに基づくプログラムに従って動作し、制御信号を送出する。制御部Cntからの制御信号により、ガスソース群40から供給されるガスの選択および流量、排気装置50の排気、第1の高周波電源62および第2の高周波電源64からの電力供給、電源70からの電圧印加、ヒータ電源HPの電力供給、チラーユニットからの冷媒流量および冷媒温度を制御することが可能である。なお、本明細書において開示される被処理体を処理する方法MTの各工程は、制御部Cntによる制御によってプラズマ処理装置10の各部を動作させることにより、実行され得る。
図3の(a)部を参照して、図1に示す方法MTの工程ST1で準備されるウエハWの主要な構成を説明する。図3は、図1に示す各工程の実施前および実施後の被処理体の状態を示す断面図である。
工程ST1において準備されるウエハWは、図3の(a)部に示すように、基板SBと、被エッチング層ELと、有機膜OLと、反射防止膜ALと、マスクMK1(第2のマスク)とを備える。被エッチング層ELは、基板SB上に設けられる。被エッチング層ELは、有機膜OLに対して選択的にエッチングされる材料から構成される層であり絶縁膜が用いられる。被エッチング層ELは、例えば、酸化シリコン(SiO)から構成され得る。なお、被エッチング層ELは、多結晶シリコンといった他の材料から構成されることができる。
有機膜OLは、被エッチング層EL上に設けられる。有機膜OLは、炭素を含む層であり、例えば、SOH(スピンオンハードマスク)層である。反射防止膜ALは、シリコン含有の反射防止膜であり、有機膜OL上に設けられる。
マスクMK1は、反射防止膜AL上に設けられる。マスクMK1は、レジスト材料から構成されたレジストマスクであり、フォトリソグラフィ技術によってレジスト層がパターニングされることによって作製される。マスクMK1は、例えば、ArFレジストであり得る。マスクMK1は、反射防止膜ALを部分的に覆っている。マスクMK1は、反射防止膜ALを部分的に露出させる開口OP1を画成している。マスクMK1のパターンは、例えば、ライン・アンド・スペースパターンであるが、平面視において円形の開口を提供するパターン、平面視において楕円形状の開口を提供するパターン等、他の種々の形状のパターンを有し得る。
なお、マスクMK1は、例えばポリスチレン−ブロック−ポリメチルメタクリレート(PS−b−PMMA)等のブロック・コポリマーを用い、さらに、このPS及びPMMAの相分離構造を利用して形成されたものであり得る。
図1に戻って、方法MTについての説明を続ける。以下の説明では、図1と共に、図3、図4、図5を参照して説明する。図3は、図1に示す各工程の実施前および実施後の被処理体の状態を示す断面図である。図4は、図1に示す方法の各工程の実施後の被処理体の状態を示す断面図である。図5は、図1に示す保護膜を形成するシーケンスにおける保護膜の形成の様子を模式的に示す図である。
工程ST1では、図3の(a)部に示すウエハWが準備され、ウエハWがプラズマ処理装置10の処理容器12内に収容され、静電チャックESC上に載置される。工程ST1において図2に示すウエハWとして図3の(a)部に示す上記のウエハWを準備した後に、工程ST2以降の各工程を実行する。工程ST2〜ST7の一連の工程(第6の工程)は、反射防止膜ALをエッチングする工程である。
工程ST1に引き続く工程ST2では、ウエハWに二次電子が照射される。工程ST2は、酸化シリコンの保護膜(保護膜SX)をマスクMK1にコンフォーマル(conformal)に形成するシーケンスSQ1(第2のシーケンス)および工程ST4の実行前に、処理容器12内でプラズマを発生させて上部電極30に負の直流電圧を印可することにより、マスクMK1に二次電子を照射する工程である。
以上のように、保護膜SXを形成するシーケンスSQ1〜工程ST4の一連の工程の実行前において、マスクMK1に二次電子を照射するので、保護膜SXの形成前にマスクMK1を改質することができ、後続の工程によるマスクMK1の損傷を抑制することができる。
工程ST2の処理内容を具体的説明する。まず、処理容器12内に水素含有ガスおよび希ガスが供給され、第1の高周波電源62から高周波電力が供給されることによって、処理容器12内にプラズマが生成される。ガスソース群40の複数のガスソースのうち選択したガスソースから水素含有ガスおよび希ガスを処理容器12内に供給する。従って、処理空間S中の正イオンが上部電極30に引き込まれて、当該正イオンが上部電極30に衝突する。正イオンが上部電極30に衝突することにより、上部電極30からは二次電子が放出される。放出された二次電子がウエハWに照射されることによって、マスクMK1が改質される。また、電極板34に正イオンが衝突することによって、電極板34の構成材料であるシリコンが、二次電子と共に放出される。放出されたシリコンは、プラズマに晒されたプラズマ処理装置10の構成部品から放出される酸素と結合する。当該酸素は、例えば、支持部14、絶縁性遮蔽部材32、およびデポシールド46といった部材から放出される。シリコンと酸素の結合により、酸化シリコン化合物が生成され、当該酸化シリコン化合物がウエハW上に堆積してマスクMK1を覆い保護する。このように、マスクMK1に二次電子を照射する工程ST2では、処理容器12内でプラズマを発生させて上部電極30に負の直流電圧を印可することにより、マスクMK1に二次電子を照射すると共に、電極板34からシリコンを放出させて該シリコンを含む酸化シリコン化合物でマスクMK1を覆う。そして、マスクMK1に二次電子を照射し、マスクMK1を酸化シリコン化合物で覆った後に処理容器12内の空間をパージして、工程ST2aに移行する。
以上のように、工程ST2において、酸化シリコン化合物がマスクMK1を覆うので、後続の工程によるマスクMK1の損傷を更に抑制できる。
工程ST2に引き続き、シーケンスSQ1、工程ST5、シーケンスSQ2(第3のシーケンス)、工程ST7(シーケンスSQ1〜工程ST7)を順次実行する。シーケンスSQ1〜工程ST5の一連の工程は、マスクMK1の表面にシリコン酸化膜の保護膜SXをコンフォーマルに形成する工程であり、シーケンスSQ2〜工程ST7の一連の工程は、シーケンスSQ1〜工程ST5の一連の工程の実行後に、シリコン酸化膜の保護膜SXが形成されたマスクMK1を用いて反射防止膜ALを原子層毎に除去することによって、反射防止膜ALを精密にエッチングする工程である。このように、シーケンスSQ1〜工程ST5の一連の工程が実行されることによって、マスクの疎密差によらずに、マスク上に精度良く制御されたコンフォーマルな膜厚の保護膜SXが形成され、マスクの形状を維持しつつマスクのエッチングに対する耐性が強化され、更にシーケンスSQ2〜工程ST7の一連の工程が実行されることによって、マスクの選択比が向上され、マスクの形状(LWR(Line Width Roughness)およびLER(Line Edge Roughness))がエッチングによって受ける影響が低減される。
工程ST2に引き続き、シーケンスSQ1を一回以上実行する。シーケンスSQ1、工程ST4は、ALD(Atomic Layer Deposition)法と同様の方法によってウエハW上に酸化シリコンの保護膜SXを均一の厚みでコンフォーマルに形成する工程であり、シーケンスSQ1において順次実行される工程ST3a(第8の工程)、工程ST3b(第9の工程)、工程ST3c(第10の工程)、工程ST3d(第11の工程)を含む。
工程ST3aは、処理容器12内にガスG1(第3のガス)を供給する。具体的には、工程ST3aでは、図5の(a)部に示すように、処理容器12内に、シリコンを含有するガスG1を導入する。ガスG1は、有機含有のアミノシラン系ガスを含む。ガスソース群40の複数のガスソースのうち選択したガスソースから有機含有のアミノシラン系ガスのガスG1を処理容器12内に供給する。ガスG1は、有機含有のアミノシラン系ガスとして、例えばモノアミノシラン(H−Si−R(Rは有機含有のアミノ基))が用いられる。工程ST3aでは、ガスG1のプラズマを生成しない。
ガスG1の分子は、図5の(b)部に示すように、反応前駆体(層Ly1)としてウエハWの表面に付着する。ガスG1の分子(モノアミノシラン)は、化学結合に基づく化学吸着によってウエハWの表面に付着するのであり、プラズマは用いられない。工程ST3aでは、ウエハWの温度は、摂氏0度以上且つマスクMK1に含まれる材料のガラス転移温度以下(例えば摂氏200度以下)の程度である。なお、当該温度範囲で化学結合によって表面に付着可能であって且つシリコンを含有するものであれば、モノアミノシラン以外のガスの利用も可能である。
以上のように、ガスG1が有機含有のアミノシラン系ガスを含むので、工程ST3aによって、シリコンの反応前駆体(層Ly1)がマスクMK1の表面の原子層に沿ってマスクMK1上に形成される。
工程ST3aに引き続く工程ST3bは、処理容器12内の空間をパージする。具体的には、工程ST3aにおいて供給されたガスG1が排気される。工程ST3bでは、パージガスとして窒素ガスまたは希ガス(例えばAr等)ガスといった不活性ガスを処理容器12に供給してもよい。すなわち、工程ST3bのパージは、不活性ガスを処理容器12内に流すガスパージ、または真空引きによるパージの何れであってもよい。工程ST3bでは、ウエハW上に過剰に付着した分子も除去され得る。以上によって、反応前駆体の層Ly1は、極めて薄い単分子層となる。
工程ST3bに引き続く工程ST3cでは、図5の(b)部に示すように、処理容器12内においてガスG2(第4のガス)のプラズマP1を生成する。ガスG2は、酸素原子および炭素原子を含有するガスを含み、例えば二酸化炭素ガスを含み得る。工程ST3cにおいて、ガスG2のプラズマP1が生成される際のウエハWの温度は、摂氏0度以上且つマスクMK1に含まれる材料のガラス転移温度以下(例えば摂氏200度以下)である。ガスソース群40の複数のガスソースのうち選択したガスソースから酸素原子および炭素原子を含有するガスを含むガスG2が処理容器12内に供給する。そして、第1の高周波電源62から高周波電力を供給する。この場合、第2の高周波電源64のバイアス電力を印加することもできる。また、第1の高周波電源62を用いずに第2の高周波電源64のみを用いてプラズマを生成することもできる。排気装置50を動作させることによって処理容器12内の空間の圧力を予め設定された圧力に設定する。このようにして、ガスG2のプラズマP1が処理容器12内において生成される。
図5の(b)部に示すように、ガスG2のプラズマP1が生成されると、酸素の活性種および炭素の活性種、例えば、酸素ラジカル、炭素ラジカルが生成され、図5の(c)部に示すように、シリコン酸化膜である層Ly2(保護膜SXに対応している)が単分子層として形成される。炭素ラジカルは、マスクMK1への酸素浸食を抑制する機能を奏し得るので、シリコン酸化膜が保護膜としてマスクMK1の表面において安定に形成され得る。シリコン酸化膜のSi−O結合の結合エネルギは、192[kcal]程度であり、C−C結合、C−H結合、C−F結合それぞれの結合エネルギ(50−110[kcal]程度、70−110[kcal]程度、100−120[kcal]程度)よりも高いので、シリコン酸化膜は、保護膜としての機能を奏し得る。
以上のように、ガスG2が酸素原子を含むので、工程ST3cにおいて、当該酸素原子がマスクMK1上に設けられるシリコンの反応前駆体(層Ly1)と結合することによって、マスクMK1上に酸化シリコン膜の層Ly2がコンフォーマルに形成され得る。また、ガスG2が炭素原子を含むので、酸素原子によるマスクMK1に対する浸食が当該炭素原子によって抑制され得る。従って、シーケンスSQ1においては、ALD法と同様に、1回(単位サイクル)のシーケンスSQ1の実行によって、シリコン酸化膜の層Ly2を、ウエハWの表面上に、マスクMK1の粗密によらず薄く均一な膜厚でコンフォーマルに、形成することができる。
工程ST3cに引き続く工程ST3dでは、処理容器12内の空間をパージする。具体的には、工程ST3cにおいて供給されたガスG2が排気される。工程ST3dでは、パージガスとして窒素ガスまたは希ガス(例えばAr等)といった不活性ガスを処理容器12に供給してもよい。すなわち、工程ST3dのパージは、不活性ガスを処理容器12内に流すガスパージ、または真空引きによるパージの何れであってもよい。
シーケンスSQ1に引き続く工程ST4では、シーケンスSQ1の実行を終了するか否かを判定する。具体的には、工程ST4では、シーケンスSQ1の実行回数が予め設定された回数に達したか否かを判定する。シーケンスSQ1の実行回数の決定は、図3の(b)部に示すウエハW上に形成される保護膜SXの膜の厚みを決定することである。すなわち、1回(単位サイクル)のシーケンスSQ1の実行によって形成されるシリコン酸化膜の膜厚とシーケンスSQ1の実行回数との積によって、最終的にウエハW上に形成される保護膜SXの膜の厚みが実質的に決定され得る。したがって、ウエハW上に形成される保護膜SXの所望の厚みに応じて、シーケンスSQ1の実行回数が設定され得る。このように、シーケンスSQ1が繰り返し実行されることによって、マスクMK1の表面にシリコン酸化膜の保護膜SXがコンフォーマルに形成される。
工程ST4においてシーケンスSQ1の実行回数が予め設定された回数に達していないと判定される場合には(工程ST4:NO)、シーケンスSQ1の実行が再び繰り返される。一方、工程ST4においてシーケンスSQ1の実行回数が予め設定された回数に達していると判定される場合には(工程ST4:YES)、シーケンスSQ1の実行が終了される。これによって、図3の(b)部に示すように、ウエハWの表面上にシリコン酸化膜である保護膜SXが形成される。すなわち、シーケンスSQ1が予め設定された回数だけ繰り返されることによって、予め設定された膜厚を有する保護膜SXが、マスクMK1の粗密によらず均一の膜みでコンフォーマルに、ウエハWの表面に形成される。マスクMK1上に設ける保護膜SXの膜の厚みは、シーケンスSQ1を繰り返し実行することによって、精度良く制御される。
以上のように、シーケンスSQ1および工程ST4の一連の工程は、ALD法と同様の方法によって、マスクMK1の表面に保護膜SXをコンフォーマルに形成できる。
シーケンスSQ1および工程ST4の一連の工程によって形成された保護膜SXは、図3の(b)部に示すように、領域R1、領域R2および領域R3を含む。領域R3は、マスクMK1の側面上で当該側面に沿って延在する領域である。領域R3は、反射防止膜ALの表面から領域R1の下側まで延在している。領域R1は、マスクMK1の上面の上および領域R3上で延在している。領域R2は、隣接する領域R3の間、且つ、反射防止膜ALの表面上で延在している。上述したように、シーケンスSQ1は、ALD法と同様に保護膜SXを形成するので、マスクMK1の粗密によらずに、領域R1、領域R2、および領域R3のそれぞれの膜厚は、互いに略等しい膜厚となる。
工程ST4に引き続く工程ST5では、領域R1および領域R2を除去するように、保護膜SXをエッチング(エッチバック)する。領域R1および領域R2の除去のためには、異方性のエッチング条件が必要である。このため、工程ST5では、ガスソース群40の複数のガスソースのうち選択したガスソースからフルオロカーボン系ガスを含む処理ガス(CはCF、C、CHF)を処理容器12内に供給する。そして、第1の高周波電源62から高周波電力を供給し、第2の高周波電源64から高周波バイアス電力を供給し、排気装置50を動作させることによって処理容器12内の空間の圧力を予め設定された圧力に設定する。この際異方性エッチングを促進するために、平均自由工程を長くするために低圧方向(20[mT]以下)が望ましい。このようにして、フルオロカーボン系ガスのプラズマが生成される。生成されたプラズマ中のフッ素を含む活性種は、高周波バイアス電力による鉛直方向への引き込みによって、領域R1および領域R2を優先的にエッチングする。この結果、図3の(c)部に示すように、領域R1および領域R2が選択的に除去され、残された領域R3によってマスクMSが形成される。マスクMSとマスクMK1とは、反射防止膜ALの表面上のマスクMK2を構成する。
工程ST5に引き続き、シーケンスSQ2〜工程ST7の一連の工程を実行する。シーケンスSQ2〜工程ST7の一連の工程は、反射防止膜ALをエッチングする工程である。
まず、工程ST5に引き続きシーケンスSQ2を一回以上実行する。シーケンスSQ2は、ALE(Atomic Layer Etching)法と同様の方法によって、反射防止膜ALのうちマスクMK2で覆われていない領域を、マスクMK2の疎密によらず高選択比で精密にエッチングする一連の工程であり、シーケンスSQ2において順次実行される工程ST6a(第12の工程)、工程ST6b(第13の工程)、工程ST6c(第14の工程)、工程ST6d(第15の工程)を含む。
工程ST6aは、処理容器12内においてガスG3(第5のガス)のプラズマを生成し、このプラズマに含まれるラジカルを含む混合層MX1を反射防止膜ALの表面の原子層に形成する。工程ST6aにおいて、ウエハWが静電チャックESC上に載置されている状態で、処理容器12内にガスG3を供給し、当該ガスG3のプラズマを生成する。ガスG3は、シリコンを含有する反射防止膜ALのエッチングに適したエッチャントガスであり、フルオロカーボン系ガスと希ガスとを含み、例えばC/Arガスであり得る。CはCFであり得る。具体的には、ガスソース群40の複数のガスソースのうち選択したガスソースからフルオロカーボン系ガスと希ガスとを含むガスG3を処理容器12内に供給する。そして、第1の高周波電源62から高周波電力を供給し、第2の高周波電源64から高周波バイアス電力を供給し、排気装置50を動作させることによって処理容器12内の空間の圧力を予め設定された圧力に設定する。このようにして、ガスG3のプラズマが処理容器12内において生成される。ガスG3のプラズマは炭素ラジカルおよびフッ素ラジカルを含む。
図6は、図1に示す方法(シーケンスSQ2、および後述のシーケンスSQ3)におけるエッチングの原理を示す図である。図6において、白抜きの円(白丸)は、反射防止膜ALを構成する原子を示しており、黒塗りの円(黒丸)はラジカルを示しており、円で囲まれた「+」は後述のガスG4(第6のガス)に含まれる希ガスの原子のイオン(例えばAr原子のイオン)を示している。図6の(a)部に示すように、工程ST6aによって、ガスG3のプラズマに含まれる炭素ラジカルおよびフッ素ラジカルが、反射防止膜ALの表面に供給される。このように、工程ST6aによって、反射防止膜ALを構成する原子と炭素ラジカルおよびフッ素ラジカルとを含む混合層MX1が、反射防止膜ALの表面に形成される。(図6の(a)部と共に図3の(c)部も参照)。
以上のように、ガスG3がフルオロカーボン系ガスを含むので、工程ST6aにおいて、反射防止膜ALの表面の原子層にフッ素ラジカルおよび炭素ラジカルが供給され、当該原子層に当該両ラジカルを含有する混合層MX1が形成され得る。
なお、ArFレジストのマスクMK1においては、マスクMK2に含まれるマスクMSのSiや、ガスG3のプラズマに含まれる炭素ラジカルが、保護膜として機能する。また、フッ素ラジカル量の調整には、電源70による直流電圧によって制御され得る。
工程ST6aに引き続く工程ST6bでは、処理容器12内の空間をパージする。具体的には、工程ST6aにおいて供給されたガスG3が排気される。工程ST6bでは、パージガスとして窒素ガスまたは希ガス(例えばArガス等)といった不活性ガスを処理容器12に供給してもよい。すなわち、工程ST6bのパージは、不活性ガスを処理容器12内に流すガスパージ、または真空引きによるパージの何れであってもよい。
工程ST6bに引き続く工程ST6cにおいて、処理容器12内においてガスG4のプラズマを生成し、該プラズマにバイアス電圧を印可して、混合層MX1を除去する。ガスG4は、希ガスを含み、例えばArガスを含み得る。具体的には、ガスソース群40の複数のガスソースのうち選択したガスソースから希ガス(例えばArガス)を含むガスG4が処理容器12内に供給され、第1の高周波電源62から高周波電力が供給され、第2の高周波電源64から高周波バイアス電力が供給され、排気装置50を動作させることによって処理容器12内の空間の圧力が予め設定された圧力に設定される。このようにして、ガスG4のプラズマが処理容器12内において生成される。生成されたプラズマ中のガスG4の原子のイオン(例えばAr原子のイオン)は、高周波バイアス電力による鉛直方向への引き込みによって、反射防止膜ALの表面の混合層MX1に衝突し、当該混合層MX1にエネルギを供給する。図6の(b)部に示すように、工程ST6cによって、反射防止膜ALの表面に形成された混合層MX1にガスG4の原子のイオンを介してエネルギが供給され、このエネルギによって反射防止膜ALから混合層MX1が除去され得る。
以上のように、ガスG4が希ガスを含むので、工程ST6cにおいて、反射防止膜ALの表面に形成された混合層MX1は、当該希ガスのプラズマがバイアス電圧によって受けるエネルギによって、当該表面から除去され得る。
工程ST6cに引き続く工程ST6dでは、処理容器12内の空間をパージする。具体的には、工程ST6cにおいて供給されたガスG4が排気される。工程ST6dでは、パージガスとして窒素ガスまたは希ガス(例えばArガス等)といった不活性ガスを処理容器12に供給してもよい。すなわち、工程ST6dのパージは、不活性ガスを処理容器12内に流すガスパージ、または真空引きによるパージの何れであってもよい。図6の(c)部に示すように、工程ST6cで行われるパージによって、反射防止膜ALの表面の混合層を構成する原子、および、ガスG4のプラズマに含まれる過剰なイオン(例えばAr原子のイオン)も十分に除去され得る。
シーケンスSQ2に引き続く工程ST7では、シーケンスSQ2の実行を終了するか否かを判定する。具体的には、工程ST7では、シーケンスSQ2の実行回数が予め設定された回数に達したか否かを判定する。シーケンスSQ2の実行回数の決定は、反射防止膜ALに対するエッチングの程度(深さ)を決定することである。シーケンスSQ2は、有機膜OLの表面に至るまで反射防止膜ALをエッチングするように、繰り返し実行され得る。すなわち、1回(単位サイクル)のシーケンスSQ2の実行によってエッチングされる反射防止膜ALの厚みとシーケンスSQ2の実行回数との積が反射防止膜AL自体の全厚みとなるように、シーケンスSQ2の実行回数が決定され得る。したがって、反射防止膜ALの厚みに応じて、シーケンスSQ2の実行回数が設定され得る。
工程ST7においてシーケンスSQ2の実行回数が予め設定された回数に達していないと判定される場合には(工程ST7:NO)、シーケンスSQ2の実行が再び繰り返される。一方、工程ST7においてシーケンスSQ2の実行回数が予め設定された回数に達していると判定される場合には(工程ST7:YES)、シーケンスSQ2の実行が終了される。これによって、図4の(a)部に示すように、反射防止膜ALがエッチングされて、マスクALMが形成される。すなわち、シーケンスSQ2が予め設定された回数だけ繰り返されることによって、反射防止膜ALが、マスクMK2の粗密(マスクMK1の疎密)によらずに、マスクMK2が提供する開口OP2の幅と同一および均一な幅でエッチングされ、また、選択比も向上される。
マスクALMは、マスクMK2と共に、開口OP3を提供する。開口OP3は、マスクMK2が提供する開口OP2の幅(図3の(c)部を参照)と同じ幅を備える。マスクMK2とマスクALMとは、有機膜OLに対するマスクMK3(第3のマスク)を構成する。反射防止膜ALのエッチングにって形成される開口OP3の幅は、シーケンスSQ2を繰り返し実行することによって精度良く制御される。
また、均一で精度良く制御された膜厚で安定したシリコン酸化膜が工程ST5までの一連の工程で反射防止膜AL上のマスクMK2の側面に形成されているので、反射防止膜ALに対するシーケンスSQ2のエッチングによってマスクMK2の形状(LWRおよびLER)が受ける影響を低減できる。このようにマスクMK2の形状がシーケンスSQ2のエッチングによって受ける影響を低減できるので、エッチングによって形成される開口OP3の幅も、シーケンスSQ2のエッチングによる影響を低減でき、マスクMK2の疎密(マスクMK1の疎密)による影響も低減できる。
以上のように、シーケンスSQ2〜工程ST7の一連の工程は、マスクMK1の表面にシリコン酸化膜(保護膜SXの領域R3(マスクMS))をコンフォーマルに形成する工程の実行後(工程ST5の実行後)に行われる工程であって、マスクMSが形成されたマスクMK1(マスクMK2)を用いてシーケンスSQ2を繰り返し実行して反射防止膜ALを原子層毎に除去することによって反射防止膜ALを精密にエッチングする工程である。従って、シーケンスSQ2〜工程ST7の一連の工程は、ALE法と同様の方法によって、反射防止膜ALを原子層毎に除去することができる。
工程ST7:YESに引き続く工程ST8(第7の工程)では、有機膜OLをエッチングする。工程ST8は、反射防止膜ALに対するエッチング処理を行うシーケンスSQ1〜工程ST7の実行後に(工程ST7:YESの後に)、処理容器12内で発生させたプラズマによって、マスクMK3を用いて有機膜OLに対しエッチング処理を行う工程である。マスクMK3は、反射防止膜ALをエッチングする工程(シーケンスSQ1〜工程ST7)において、反射防止膜ALから形成される。
工程ST8の処理を具体的に説明する。まず、ガスソース群40の複数のガスソースのうち選択したガスソースから窒素ガスと水素含有ガスとを含む処理ガスを処理容器12内に供給する。当該ガスとしては、酸素を含む処理ガスを用いてもよい。そして、第1の高周波電源62から高周波電力を供給し、第2の高周波電源64から高周波バイアス電力を供給し、排気装置50を動作させることによって処理容器12内の空間の圧力を所定の圧力に設定する。これによって、窒素ガスと水素含有ガスとを含む処理ガスのプラズマが生成される。生成されたプラズマ中の水素の活性種である水素ラジカルは、有機膜OLの全領域のうちマスクMK3から露出した領域をエッチングする。以上により、図4の(b)部に示すように、有機膜OLがエッチングされて、マスクMK3が提供する開口OP3の幅(図4の(a)部を参照)と同じ幅の開口OP4を有するマスクOLMが有機膜OLから形成される。マスクALMとマスクOLMとは、被エッチング層ELに対するマスクMK4(第1のマスク)を構成する。シーケンスSQ2によってマスクMK3の開口OP3の幅の均一性がマスクMK3の疎密(マスクMK2の疎密)によらずに向上されており、また、マスクMK3の形状(LWRおよびLER)も良好であるので、マスクMK4の開口OP4の幅の均一性もマスクMK4の疎密(マスクMK3の疎密)によらずに向上され、また、マスクMK4の形状(LWRおよびLER)も良好となる。
以上のように、工程ST2〜ST7の一連の工程の実行によって、マスクの疎密によらずに、形状が維持され選択比が向上されたマスクMK3が有機膜OL上に形成されるので、このような良好な形状のマスクMK3による有機膜OLのエッチングが可能となり、有機膜OLのエッチングが良好に行える。
工程ST18に引き続きシーケンスSQ3(第1のシーケンス)、工程ST10を実行する。シーケンスSQ3および工程ST10は、被エッチング層ELを原子層毎に除去することによって、被エッチング層ELをエッチングする一連の工程である。シーケンスSQ3は、工程ST9a(第1の工程)、工程ST9b(第2の工程)、工程ST9c(第3の工程)、工程ST9d(第4の工程)、工程ST9(第5の工程)を含む。
工程ST9aでは、プラズマ処理装置10の処理容器12内においてプラズマを発生させて処理容器12に設けられた平行平板電極の上部電極30に負の直流電圧を印可することによって、マスクMK4に二次電子を照射すると共に、上部電極30が備えシリコンを含有する電極板34からシリコンを放出させて該シリコンを含む酸化シリコン化合物でマスクMK4を覆う。そして、酸化シリコン化合物でマスクMK4を覆った後に処理容器12内の空間をパージした後に工程ST9bに移行する。
工程ST9aの処理内容を具体的説明する。まず、処理容器12内に水素含有ガスおよび希ガス(例えばArガス)が供給され、第1の高周波電源62から高周波電力が供給されることによって、処理容器12内にプラズマが生成される。ガスソース群40の複数のガスソースのうち選択したガスソースから水素含有ガスおよび希ガス(例えばArガス)を処理容器12内に供給する。従って、処理空間S中の正イオンが上部電極30に引き込まれて、当該正イオンが上部電極30に衝突する。正イオンが上部電極30に衝突することにより、上部電極30からは二次電子が放出される。放出された二次電子がウエハWに照射されることによって、マスクMK1が改質される。また、電極板34に正イオンが衝突することによって、電極板34の構成材料であるシリコンが、二次電子と共に放出される。放出されたシリコンは、プラズマに晒されたプラズマ処理装置10の構成部品から放出される酸素と結合する。当該酸素は、例えば、支持部14、絶縁性遮蔽部材32、およびデポシールド46といった部材から放出される。シリコンと酸素の結合により、酸化シリコン化合物が生成され、当該酸化シリコン化合物がウエハW上に堆積してマスクMK4を覆い保護する。そして、マスクMK4に二次電子を照射し、マスクMK4を酸化シリコン化合物で覆った後に処理容器12内の空間をパージして、工程ST9bに移行する。
このように、工程ST9aでは、処理容器12内でプラズマを発生させて上部電極30に負の直流電圧を印可することにより、マスクMK4に二次電子を照射すると共に、電極板34からシリコンを放出させて該シリコンを含む酸化シリコン化合物でマスクMK4を覆う。従って、工程ST9aにおいて、酸化シリコン化合物がマスクMK4を覆うので、後続の工程によるマスクMK4の損傷を抑制できる。
工程ST9aに引き続く工程ST9bでは、工程ST6aと同様の方法によって、処理容器12内においてガスG5(第1のガス)のプラズマを生成し、該プラズマに含まれるラジカルを含む混合層MX2を被エッチング層ELの表面の原子層に形成する。工程ST9bにおいて、ウエハWが静電チャックESC上に載置されている状態で、処理容器12内にガスG5を供給し、当該ガスG5のプラズマを生成する。ガスG5は、被エッチング層ELのエッチングに適したエッチャントガスであり、フルオロカーボン系ガスと希ガスとを含み、例えばC/Arガスであり得る。CはCFであり得る。具体的には、ガスソース群40の複数のガスソースのうち選択したガスソースからフルオロカーボン系ガスと希ガスとを含むガスG5を処理容器12内に供給する。そして、第1の高周波電源62から高周波電力を供給し、第2の高周波電源64から高周波バイアス電力を供給し、排気装置50を動作させることによって処理容器12内の空間の圧力を予め設定された圧力に設定する。このようにして、ガスG5のプラズマが処理容器12内において生成される。ガスG5のプラズマは炭素ラジカルおよびフッ素ラジカルを含む。工程ST9bによって、炭素ラジカルおよびフッ素ラジカルを含む混合層MX2が被エッチング層ELの表面の原子層に形成される(図6の(a)部と共に図4の(b)部を参照)。従って、ガスG5がフルオロカーボン系ガスを含むので、工程ST9bにおいて、被エッチング層ELの表面の原子層にフッ素ラジカルおよび炭素ラジカルが供給され、当該原子層に当該両ラジカルを含有する混合層MX2が形成され得る。
工程ST9bに引き続く工程ST9cでは、工程ST6bと同様の方法によって、処理容器12内の空間をパージする。具体的には、工程ST9bにおいて供給されたガスG5が排気される。工程ST9cでは、パージガスとして窒素ガスまたは希ガス(例えばArガス等)といった不活性ガスを処理容器12に供給してもよい。すなわち、工程ST9cのパージは、不活性ガスを処理容器12内に流すガスパージ、または真空引きによるパージの何れであってもよい。
工程ST9cに引き続く工程ST9dでは、工程ST6cと同様の方法によって、処理容器12内においてガスG6(第2のガス)のプラズマを生成し、該プラズマにバイアス電圧を印可して、混合層MX2を除去する。ガスG6は、希ガスを含み、例えばArガスを含み得る。具体的には、ガスソース群40の複数のガスソースのうち選択したガスソースから希ガス(例えばArガス)を含むガスG6が処理容器12内に供給され、第1の高周波電源62から高周波電力が供給され、第2の高周波電源64から高周波バイアス電力が供給され、排気装置50を動作させることによって処理容器12内の空間の圧力が予め設定された圧力に設定される。このようにして、ガスG6のプラズマが処理容器12内において生成される。生成されたプラズマ中のガスG6の原子のイオン(例えばAr原子のイオン)は、高周波バイアス電力による鉛直方向への引き込みによって、被エッチング層ELの表面の混合層MX2に衝突し、当該混合層MX2にエネルギを供給する。図6の(b)部に示すように、工程ST6cによって、被エッチング層ELの表面に形成された混合層MX2にガスG6の原子のイオンを介してエネルギが供給され、このエネルギによって被エッチング層ELから混合層MX2が除去され得る。
以上のように、ガスG6が希ガスを含むので、工程ST9dにおいて、被エッチング層ELの表面に形成された混合層MX2は、当該希ガスのプラズマがバイアス電圧によって受けるエネルギによって、当該表面から除去され得る。
工程ST9dに引き続く工程ST9eでは、工程ST6dと同様の方法によって、処理容器12内の空間をパージする。具体的には、工程ST9dにおいて供給されたガスG6が排気される。工程ST9eでは、パージガスとして窒素ガスまたは希ガス(例えばArガス等)といった不活性ガスを処理容器12に供給してもよい。すなわち、工程ST9eのパージは、不活性ガスを処理容器12内に流すガスパージ、または真空引きによるパージの何れであってもよい。図6の(c)部に示すように、工程ST9eで行われるパージによって、被エッチング層ELの表面の混合層MX2を構成する原子、および、ガスG6のプラズマに含まれる過剰なイオン(例えばAr原子のイオン)も十分に除去され得る。従って、シーケンスSQ3〜工程ST10の一連の工程は、ALEと同様の方法によって、被エッチング層ELを原子層毎に除去する事ができる。
シーケンスSQ3に引き続く工程ST10では、工程ST7と同様の方法によって、シーケンスSQ3の実行を終了するか否かを判定する。具体的には、工程ST10では、シーケンスSQ3の実行回数が予め設定された回数に達したか否かを判定する。シーケンスSQ3の実行回数の決定は、被エッチング層ELに対するエッチングの程度(深さ)を決定することである。シーケンスSQ3は、基板SBの表面に至るまで被エッチング層ELをエッチングするように、繰り返し実行され得る。すなわち、1回(単位サイクル)のシーケンスSQ3の実行によってエッチングされる被エッチング層ELの厚みとシーケンスSQ3の実行回数との積が被エッチング層EL自体の全厚みとなるように、シーケンスSQ3の実行回数が決定され得る。したがって、被エッチング層ELの厚みに応じて、シーケンスSQ3の実行回数が設定され得る。
工程ST10においてシーケンスSQ3の実行回数が予め設定された回数に達していないと判定される場合には(工程ST10:NO)、シーケンスSQ3の実行が再び繰り返される。一方、工程ST10においてシーケンスSQ3の実行回数が予め設定された回数に達していると判定される場合には(工程ST10:YES)、シーケンスSQ3の実行が終了される。これによって、図4の(c)部に示すように、被エッチング層ELがエッチングされる。すなわち、シーケンスSQ3が予め設定された回数だけ繰り返されることによって、被エッチング層ELが、マスクMK4の粗密(マスクMK1の疎密)によらずに、マスクMK4が提供する開口OP4(図4の(b)部を参照)の幅と同一および均一な幅でエッチングされ、また、選択比も向上される。被エッチング層ELのエッチングにって形成される開口OP4の幅は、シーケンスSQ3を繰り返し実行することによって精度良く制御される。
酸化シリコン化合物が工程ST9aで被エッチング層EL上のマスクMK4の側面に形成されているので、被エッチング層ELに対するシーケンスSQ3のエッチングによってマスクMK4の形状(LWRおよびLER)が受ける影響を低減できる。このようにマスクMK4の形状がシーケンスSQ3のエッチングによって受ける影響を低減できるので、エッチングによって形成される開口OP4の幅も、シーケンスSQ3のエッチングによる影響を低減でき、マスクMK4の疎密(マスクMK1の疎密)による影響も低減できる。
以上のように、被エッチング層ELの表面の原子層を除去するシーケンスSQ3の実行毎にマスクMK4に対する必要な保護がその都度行われ、このようなシーケンスSQ3が繰り返し実行されることによって、被エッチング層ELのエッチングに対し必要な保護がマスクMK4に形成されつつ過剰な保護が回避され得る。従って、マスクMK4を保護する保護膜の膜厚が十分に低減されるので、当該保護膜によって生じるマスクMK4の縒れが回避され得る。
なお、工程ST9bにおいて、ガスG5が例えばCFおよびArを含む場合、Arのガス流量の方がCFのガス流量よりも多いほど、更に、Arガスを処理容器12内に供給する時間の方がCFガスを処理容器12内に供給する時間よりも多いほど、LWRが低減され、マスクMK4の形状維持が良好となる。また、工程ST9aにおいて二次電子およびシリコンの放出に用いられる希ガスとしてArガスが用いられる場合、Arガスを処理容器12に供給する時間(工程ST9aの実施時間)が長いほど、LWRが低減され、マスクMK4の形状維持が良好となる。
以上、好適な実施の形態において本発明の原理を図示し説明してきたが、本発明は、そのような原理から逸脱することなく配置および詳細において変更され得ることは、当業者によって認識される。本発明は、本実施の形態に開示された特定の構成に限定されるものではない。したがって、特許請求の範囲およびその精神の範囲から来る全ての修正および変更に権利を請求する。例えば、反射防止膜ALをエッチングするために、工程ST2〜ST7の一連の工程を設けたが、反射防止膜ALのエッチングは、工程ST2〜ST7の一連の工程を行わずに、または、シーケンスSQ2〜工程ST7の一連の工程を行わずに、公知のRIE(Reactive Ion Etching)によってエッチングすることができる。また、工程ST2〜ST7の一連の工程のうち、例えば、工程ST2を行わない場合が可能であり、シーケンスSQ1〜工程ST5を行わない場合も可能である。
10…プラズマ処理装置、12…処理容器、12e…排気口、12g…搬入出口、14…支持部、18a…第1プレート、18b…第2プレート、22…直流電源、23…スイッチ、24…冷媒流路、26a…配管、26b…配管、28…ガス供給ライン、30…上部電極、32…絶縁性遮蔽部材、34…電極板、34a…ガス吐出孔、36…電極支持体、36a…ガス拡散室、36b…ガス通流孔、36c…ガス導入口、38…ガス供給管、40…ガスソース群、42…バルブ群、44…流量制御器群、46…デポシールド、48…排気プレート、50…排気装置、52…排気管、54…ゲートバルブ、62…第1の高周波電源、64…第2の高周波電源、66…整合器、68…整合器、70…電源、AL…反射防止膜、ALM…マスク、Cnt…制御部、EL…被エッチング層、ESC…静電チャック、FR…フォーカスリング、G1…ガス、HP…ヒータ電源、HT…ヒータ、LE…下部電極、Ly1…層、Ly2…層、MK1…マスク、MK2…マスク、MK3…マスク、MK4…マスク、MS…マスク、MX1…混合層、MX2…混合層、OL…有機膜、OLM…マスク、OP1…開口、OP2…開口、OP3…開口、OP4…開口、P1…プラズマ、PD…載置台、R1…領域、R2…領域、R3…領域、S…処理空間、SB…基板、SX…保護膜、W…ウエハ。

Claims (16)

  1. 被処理体を処理する方法であって、
    前記被処理体は、被エッチング層と該被エッチング層上に設けられた第1のマスクとを備え、
    当該方法は、
    前記被処理体が収容されたプラズマ処理装置の処理容器内においてプラズマを発生させて該処理容器に設けられた平行平板電極の上部電極に負の直流電圧を印可することによって、前記第1のマスクに二次電子を照射すると共に、該上部電極が備えシリコンを含有する電極板からシリコンを放出させて該シリコンを含む酸化シリコン化合物で該第1のマスクを覆う、第1の工程と、
    前記第1の工程の実行後に、前記処理容器内において第1のガスのプラズマを生成し、該プラズマに含まれるラジカルを含む混合層を前記被エッチング層の表面の原子層に形成する第2の工程と、
    前記第2の工程の実行後に、前記処理容器内の空間をパージする第3の工程と、
    前記第3の工程の実行後に、前記処理容器内において第2のガスのプラズマを生成し、該プラズマにバイアス電圧を印可して、前記混合層を除去する第4の工程と、
    前記第4の工程の実行後に、前記処理容器内の空間をパージする第5の工程と、
    を含む第1のシーケンスを繰り返し実行し、前記被エッチング層を原子層毎に除去することによって、該被エッチング層をエッチングする、
    方法。
  2. 前記第1のガスは、フルオロカーボン系ガスと希ガスとを含む、
    請求項1に記載の方法。
  3. 前記第2のガスは、希ガスである、
    請求項1または請求項2に記載の方法。
  4. 前記第1のシーケンスの実行前に、前記第1のマスクを形成する工程を更に備え、
    前記第1のマスクを形成する前記工程は、第6の工程と第7の工程とを備え、該第6の工程と該第7の工程とにおいて、前記被エッチング層上に設けられていた有機膜と該有機膜上に設けられていた反射防止膜とに対し該反射防止膜上に設けられていた第2のマスクを用いてエッチング処理を行うことによって、前記第1のマスクを形成し、
    前記第6の工程は、前記反射防止膜をエッチングし、
    前記第7の工程は、前記第6の工程の実行後に、前記有機膜をエッチングし、
    前記第1のマスクは、前記第6の工程および前記第7の工程の実行によって形成され、前記反射防止膜および前記有機膜から形成される、
    請求項1〜3の何れか一項に記載の方法。
  5. 前記第6の工程は、
    前記処理容器内において、前記第2のマスクの表面に保護膜をコンフォーマルに形成する工程と、
    前記保護膜をコンフォーマルに形成する前記工程の実行後に、該保護膜が形成された前記第2のマスクを用いて、前記処理容器内で発生させたプラズマにより前記反射防止膜を原子層毎に除去し、該反射防止膜をエッチングする工程と、
    を備える、
    請求項4に記載の方法。
  6. 前記第6の工程は、
    前記保護膜をコンフォーマルに形成する前記工程の実行前に、前記処理容器内でプラズマを発生させて前記処理容器に設けられた上部電極に負の直流電圧を印可することにより、前記第2のマスクに二次電子を照射する工程を更に備える、
    請求項5に記載の方法。
  7. 前記第2のマスクに二次電子を照射する前記工程は、前記処理容器内でプラズマを発生させて前記上部電極に負の直流電圧を印可することにより、前記電極板からシリコンを放出させて該シリコンを含む酸化シリコン化合物で前記第2のマスクを覆う、
    請求項6に記載の方法。
  8. 前記保護膜をコンフォーマルに形成する前記工程は、
    前記処理容器内に第3のガスを供給する第8の工程と、
    前記第8の工程の実行後に、前記処理容器内の空間をパージする第9の工程と、
    前記第9の工程の実行後に、前記処理容器内において第4のガスのプラズマを生成する第10の工程と、
    前記第10の工程の実行後に、前記処理容器内の空間をパージする第11の工程と、
    を含む第2のシーケンスを繰り返し実行することによって、前記第2のマスクの前記表面に前記保護膜をコンフォーマルに形成し、
    前記第8の工程は、前記第3のガスのプラズマを生成しない、
    請求項5〜7の何れか一項に記載の方法。
  9. 前記第3のガスは、有機含有のアミノシラン系ガスを含む、
    請求項8に記載の方法。
  10. 前記第3のガスのアミノシラン系ガスは、1〜3個のケイ素原子を有するアミノシランを含む、請求項9に記載の方法。
  11. 前記第3のガスのアミノシラン系ガスは、1〜3個のアミノ基を有するアミノシランを含む、請求項9または請求項10に記載の方法。
  12. 前記第4のガスは、酸素原子および炭素原子を含有するガスを含む、
    請求項8または請求項9に記載の方法。
  13. 前記反射防止膜をエッチングする前記工程は、
    前記保護膜をコンフォーマルに形成する前記工程の実行後に、前記処理容器内において第5のガスのプラズマを生成し、該プラズマに含まれるラジカルを含む混合層を前記反射防止膜の表面の原子層に形成する第12の工程と、
    前記第12の工程の実行後に、前記処理容器内の空間をパージする第13の工程と、
    前記第13の工程の実行後に、前記処理容器内において第6のガスのプラズマを生成し、該プラズマにバイアス電圧を印可して、前記混合層を除去する第14の工程と、
    前記第14の工程の実行後に、前記処理容器内の空間をパージする第15の工程と、
    を含む第3のシーケンスを繰り返し実行し、前記反射防止膜を原子層毎に除去することによって、該反射防止膜をエッチングする、
    請求項5〜12の何れか一項に記載の方法。
  14. 前記第5のガスは、フルオロカーボン系ガスと希ガスとを含む、
    請求項13に記載の方法。
  15. 前記第6のガスは、希ガスを含む、
    請求項13または請求項14に記載の方法。
  16. 前記第7の工程は、前記第6の工程の実行後に、前記処理容器内で発生させたプラズマにより、第3のマスクを用いて前記有機膜に対しエッチング処理を行い、
    前記第3のマスクは、前記第6の工程において、前記第2のマスクと前記反射防止膜とから形成される、
    請求項4〜15の何れか一項に記載の方法。
JP2016147475A 2016-03-29 2016-07-27 被処理体を処理する方法 Active JP6770848B2 (ja)

Priority Applications (5)

Application Number Priority Date Filing Date Title
TW106109244A TWI766857B (zh) 2016-03-29 2017-03-21 被處理體之處理方法
KR1020187030670A KR102362462B1 (ko) 2016-03-29 2017-03-27 피처리체를 처리하는 방법
US16/089,071 US10763123B2 (en) 2016-03-29 2017-03-27 Method for processing workpiece
PCT/JP2017/012399 WO2017170405A1 (ja) 2016-03-29 2017-03-27 被処理体を処理する方法
CN201780020009.0A CN108885990B (zh) 2016-03-29 2017-03-27 对被处理物进行处理的方法

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP2016065802 2016-03-29
JP2016065802 2016-03-29

Publications (2)

Publication Number Publication Date
JP2017183688A JP2017183688A (ja) 2017-10-05
JP6770848B2 true JP6770848B2 (ja) 2020-10-21

Family

ID=60006491

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2016147475A Active JP6770848B2 (ja) 2016-03-29 2016-07-27 被処理体を処理する方法

Country Status (4)

Country Link
US (1) US10763123B2 (ja)
JP (1) JP6770848B2 (ja)
CN (1) CN108885990B (ja)
TW (1) TWI766857B (ja)

Families Citing this family (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR102362282B1 (ko) 2016-03-29 2022-02-11 도쿄엘렉트론가부시키가이샤 피처리체를 처리하는 방법
JP6784530B2 (ja) * 2016-03-29 2020-11-11 東京エレクトロン株式会社 被処理体を処理する方法
JP7089881B2 (ja) * 2018-01-10 2022-06-23 東京エレクトロン株式会社 成膜方法
JP7203531B2 (ja) 2018-08-08 2023-01-13 東京エレクトロン株式会社 プラズマ処理方法及びプラズマ処理装置
KR20200087694A (ko) * 2019-01-11 2020-07-21 도쿄엘렉트론가부시키가이샤 처리 방법 및 플라즈마 처리 장치
JPWO2020161879A1 (ja) * 2019-02-08 2021-02-18 株式会社日立ハイテク ドライエッチング方法及びドライエッチング装置
CN111627809B (zh) * 2019-02-28 2024-03-22 东京毅力科创株式会社 基片处理方法和基片处理装置
US20210210355A1 (en) * 2020-01-08 2021-07-08 Tokyo Electron Limited Methods of Plasma Processing Using a Pulsed Electron Beam
CN116631850B (zh) * 2023-07-24 2023-10-03 无锡邑文电子科技有限公司 低损伤碳化硅界面的处理方法

Family Cites Families (16)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN100371491C (zh) 1999-08-17 2008-02-27 东京电子株式会社 脉冲等离子体处理方法及其设备
US7169695B2 (en) 2002-10-11 2007-01-30 Lam Research Corporation Method for forming a dual damascene structure
JP2004207286A (ja) * 2002-12-24 2004-07-22 Sony Corp ドライエッチング方法および半導体装置の製造方法
JP2004273933A (ja) * 2003-03-11 2004-09-30 Seiko Instruments Inc 金属および金属酸化物の微細加工方法
US7604908B2 (en) * 2005-03-09 2009-10-20 Tokyo Electron Limited Fine pattern forming method
JP4946138B2 (ja) * 2006-03-31 2012-06-06 東京エレクトロン株式会社 エッチング方法
MY148830A (en) 2006-08-22 2013-06-14 Lam Res Corp Method for plasma etching performance enhancement
JP5484325B2 (ja) * 2008-06-13 2014-05-07 東京エレクトロン株式会社 半導体装置の製造方法
JP4733214B1 (ja) * 2010-04-02 2011-07-27 東京エレクトロン株式会社 マスクパターンの形成方法及び半導体装置の製造方法
JP2012015343A (ja) 2010-07-01 2012-01-19 Hitachi High-Technologies Corp プラズマエッチング方法
JP5528244B2 (ja) * 2010-07-26 2014-06-25 東京エレクトロン株式会社 プラズマ処理方法および記憶媒体
US8993072B2 (en) * 2011-09-27 2015-03-31 Air Products And Chemicals, Inc. Halogenated organoaminosilane precursors and methods for depositing films comprising same
US9666414B2 (en) * 2011-10-27 2017-05-30 Applied Materials, Inc. Process chamber for etching low k and other dielectric films
JP6063264B2 (ja) * 2012-09-13 2017-01-18 東京エレクトロン株式会社 被処理基体を処理する方法、及びプラズマ処理装置
JP5519059B2 (ja) * 2013-05-23 2014-06-11 株式会社日立国際電気 半導体デバイスの製造方法および基板処理装置
JP6366454B2 (ja) * 2014-10-07 2018-08-01 東京エレクトロン株式会社 被処理体を処理する方法

Also Published As

Publication number Publication date
JP2017183688A (ja) 2017-10-05
CN108885990A (zh) 2018-11-23
US20190131141A1 (en) 2019-05-02
TWI766857B (zh) 2022-06-11
CN108885990B (zh) 2023-06-30
US10763123B2 (en) 2020-09-01
TW201807741A (zh) 2018-03-01

Similar Documents

Publication Publication Date Title
JP6770848B2 (ja) 被処理体を処理する方法
KR102362462B1 (ko) 피처리체를 처리하는 방법
KR101083623B1 (ko) 가스 화학물질의 주기적 조절을 사용하는 플라즈마 에칭방법
US11658036B2 (en) Apparatus for processing substrate
JP7061653B2 (ja) 被処理体を処理する方法
CN107026081B (zh) 对被处理体进行处理的方法
US11823903B2 (en) Method for processing workpiece
CN107731677B (zh) 处理被处理体的方法
TW201131639A (en) Method for processing a target object and computer readable storage medium
US10692726B2 (en) Method for processing workpiece
JP6823527B2 (ja) エッチング方法

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20190415

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20200107

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20200901

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20200928

R150 Certificate of patent or registration of utility model

Ref document number: 6770848

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250