JP6396352B2 - 半導体装置 - Google Patents
半導体装置 Download PDFInfo
- Publication number
- JP6396352B2 JP6396352B2 JP2016048892A JP2016048892A JP6396352B2 JP 6396352 B2 JP6396352 B2 JP 6396352B2 JP 2016048892 A JP2016048892 A JP 2016048892A JP 2016048892 A JP2016048892 A JP 2016048892A JP 6396352 B2 JP6396352 B2 JP 6396352B2
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- slave
- pmb
- bus
- cpu
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
- G06F1/26—Power supply means, e.g. regulation thereof
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
- G06F1/26—Power supply means, e.g. regulation thereof
- G06F1/32—Means for saving power
- G06F1/3203—Power management, i.e. event-based initiation of a power-saving mode
- G06F1/3206—Monitoring of events, devices or parameters that trigger a change in power modality
- G06F1/3215—Monitoring of peripheral devices
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
- G06F1/26—Power supply means, e.g. regulation thereof
- G06F1/32—Means for saving power
- G06F1/3203—Power management, i.e. event-based initiation of a power-saving mode
- G06F1/3234—Power saving characterised by the action undertaken
- G06F1/3287—Power saving characterised by the action undertaken by switching off individual functional units in the computer system
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
- H03K5/13—Arrangements having a single output and transforming input signals into pulses delivered at desired time intervals
- H03K5/135—Arrangements having a single output and transforming input signals into pulses delivered at desired time intervals by the use of time reference signals, e.g. clock signals
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
- Y02D10/00—Energy efficient computing, e.g. low power processors, power management or thermal management
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Nonlinear Science (AREA)
- Computer Hardware Design (AREA)
- Computing Systems (AREA)
- Power Sources (AREA)
- Semiconductor Integrated Circuits (AREA)
- Electronic Switches (AREA)
Description
第1実施形態に係る半導体装置について説明する。以下では、半導体装置がLSI(large scale integration)である場合を例に挙げて説明する。
まず、半導体装置の構成について説明する。
次に、PMB回路20の構成について説明する。
次にCPU10からスレーブ回路30へのアクセス動作について説明する。
まず、アクセス動作全体の流れについて説明する。以下では、説明を簡略化するために、CPU10からスレーブ回路30にスレーブ制御信号が送信される場合について説明し、スレーブ回路30からCPU10に送信される信号については、説明を省略する。
次に、バスアクセスのタイミングについて説明する。
本実施形態に係る構成では、消費電力を低減できる。以下、具体的に説明する。
次に、第2実施形態について説明する。第1実施形態と異なる点は、スレーブ回路30がアイドル状態、すなわちスレーブ回路30の電源をオンした状態で、CPU10とスレーブ回路30とのバスアクセスが無い状態になると、一定時間経過後にスレーブ回路30の電源をオフにする点である。以下、第1実施形態と異なる点についてのみ説明する。
まず、PMB回路20の構成について説明する。
次に、アクセス動作全体の流れについて説明する。
次に、バスアクセスのタイミングについて説明する。
本実施形態に係る構成であると、第1実施形態と同様の効果を得ることができる。
次に、第3実施形態について説明する。第1及び第2実施形態と異なる点は、1つのスレーブユニットSUが2つのスレーブ回路30を含む点である。以下、第1及び第2実施形態と異なる点についてのみ説明する。
まず、半導体装置の構成について説明する。
本実施形態に係る構成であると、第1及び第2実施形態と同様の効果を得ることができる。
次に、第4実施形態について説明する。第1乃至第3実施形態と異なる点は、CPU10からスレーブ回路30に対し、特定の信号(コマンド)のバスアクセスがあった場合に、それをトリガーとして、PSW回路40をオフにする点である。本実施形態では、信号(コマンド)の例として、CPU10からスレーブ回路30に処理を停止させるためのストップコマンドを送信する場合について説明する。以下、第1乃至第3実施形態と異なる点についてのみ説明する。
まず、PMB回路20の構成について説明する。
次に、アクセス動作全体の流れについて説明する。
次に、バスアクセスのタイミングについて説明する。
本実施形態に係る構成であると、第1実施形態と同様の効果を得ることができる。
次に、第5実施形態について説明する。第5実施形態では、PMB回路20は、スレーブ回路30の状態を確認し、スレーブ回路30がアイドル状態にある場合に、スレーブ回路30をオフさせる点である。以下、第1乃至第4実施形態と異なる点についてのみ説明する。
まず、PMB回路20の構成について説明する。
次に、アクセス動作全体の流れについて説明する。
PMB回路20は、取得したレジスタ情報を元にスレーブ回路30が使用状態にあると判定した場合(ステップS54_No)、ステップS51に戻り、CPU10からのアクセスの検知と、スレーブ回路30の監視を継続する。すなわち、PMB回路20は、CPU10からのアクセスが無い場合、スレーブ回路30が未使用状態になるまで、定期的にスレーブ回路30のレジスタ情報の取得を繰り返す。
次に、バスアクセスのタイミングについて説明する。
本実施形態に係る構成であると、第1実施形態と同様の効果を得ることができる。
次に、第6実施形態について説明する。第5実施形態と異なる点は、スレーブ回路30はCPU10に割り込み通知を発行する機能を有する点である。以下、第1乃至第5実施形態と異なる点について説明する。
まず、半導体装置の構成について説明する。
次に、アクセス動作全体の流れについて説明する。本実施形態におけるアクセス動作全体の流れは、第5実施形態の図13及び図14と同じである。
次に、バスアクセスのタイミングについて説明する。
本実施形態に係る構成を、第5実施形態に適用できる。
上記実施形態に係る半導体装置は、バス(バス@図1)に接続された制御回路(CPU10@図1)と、制御回路の制御により動作する第1回路(スレーブ30_1@図1)と、第1回路と電源との間に接続されたスイッチ素子(40_1@図1)と、バスと第1回路との間に接続され、制御回路からバスを介して第1回路に送信される第1信号に応じて、スイッチ素子をオン状態にする第2回路(PMB@図1)とを含む。
Claims (5)
- バスに接続された制御回路と、
前記制御回路の制御により動作する第1回路と、
前記第1回路と電源との間に接続されたスイッチ素子と、
前記バスと前記第1回路との間に接続され、前記制御回路から前記バスを介して前記第1回路に送信される第1信号に応じて、前記スイッチ素子をオン状態にする第2回路と
を具備し、
前記第2回路は、前記制御から前記第1回路に送信される前記第1信号を遅延させるバッファと、
前記制御回路から前記第1回路に送信される前記第1信号を検知する検知回路と、
前記第1信号の検知に応じて、前記スイッチ素子をオンさせた後、前記バッファから前記第1回路に前記第1信号を送信させる第3回路と
を含む半導体装置。 - 前記第2回路は、前記スイッチ素子をオン状態にした後に、前記第1回路に前記制御回路から送信された前記第1信号を転送する
請求項1記載の半導体装置。 - 前記第2回路は、前記制御回路から前記第2回路に送信される第2信号に応じて、前記スイッチ素子をオフ状態にする
請求項1または2記載の半導体装置。 - 前記第2回路は、第1期間、前記バスを介して前記制御回路と前記第1回路との間で送受信される信号がない場合に、前記スイッチ素子をオフ状態にする
請求項1または2記載の半導体装置。 - 前記第1回路は、前記第1回路の動作状態に関する情報を保持するレジスタを含み、
前記第2回路は、前記レジスタに保持された前記情報を読み込み、前記情報に応じて、前記スイッチ素子をオフ状態にする
請求項1または2記載の半導体装置。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2016048892A JP6396352B2 (ja) | 2016-03-11 | 2016-03-11 | 半導体装置 |
US15/253,877 US10042406B2 (en) | 2016-03-11 | 2016-09-01 | Semiconductor device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2016048892A JP6396352B2 (ja) | 2016-03-11 | 2016-03-11 | 半導体装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2017162407A JP2017162407A (ja) | 2017-09-14 |
JP6396352B2 true JP6396352B2 (ja) | 2018-09-26 |
Family
ID=59786696
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2016048892A Expired - Fee Related JP6396352B2 (ja) | 2016-03-11 | 2016-03-11 | 半導体装置 |
Country Status (2)
Country | Link |
---|---|
US (1) | US10042406B2 (ja) |
JP (1) | JP6396352B2 (ja) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2019160150A (ja) | 2018-03-16 | 2019-09-19 | 株式会社東芝 | 半導体装置 |
Family Cites Families (13)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3343346B2 (ja) | 1990-11-28 | 2002-11-11 | 株式会社日立製作所 | 消費電力制御方式、情報処理装置および複合部品 |
US5461266A (en) | 1990-11-27 | 1995-10-24 | Hitachi, Ltd. | Power consumption control system |
JPH07230346A (ja) * | 1994-02-17 | 1995-08-29 | Hitachi Ltd | 電力制御装置 |
JPH10326129A (ja) * | 1997-05-23 | 1998-12-08 | Mitsubishi Electric Corp | 半導体装置 |
JPH11212687A (ja) | 1998-01-26 | 1999-08-06 | Fujitsu Ltd | バス制御装置 |
US6448671B1 (en) * | 1999-08-05 | 2002-09-10 | Trw Inc. | Distributed vehicle safety system having fault protection |
JP2006031537A (ja) * | 2004-07-20 | 2006-02-02 | Ricoh Co Ltd | ドライブ装置、その節電方法、節電用プログラム及び記憶媒体 |
JP4660140B2 (ja) * | 2004-08-18 | 2011-03-30 | セイコーエプソン株式会社 | データ転送制御システム、電子機器及びプログラム |
JP2009015752A (ja) | 2007-07-09 | 2009-01-22 | Fujitsu Ltd | 記憶装置 |
JP5636653B2 (ja) * | 2009-08-25 | 2014-12-10 | 株式会社リコー | 半導体集積回路及び省電力制御方法 |
DE102009052947B3 (de) * | 2009-11-12 | 2010-12-16 | Sinitec Vertriebsgesellschaft Mbh | Energiesparschaltung für ein Peripheriegerät, Peripheriegerät, Vermittlungsgerät und Arbeitsverfahren |
JP4944214B2 (ja) * | 2010-02-09 | 2012-05-30 | 株式会社バッファロー | 周辺装置およびその動作方法 |
JP2013011953A (ja) | 2011-06-28 | 2013-01-17 | Denso Corp | 情報処理システムおよび情報処理システムにおける電源およびクロックの制御方法 |
-
2016
- 2016-03-11 JP JP2016048892A patent/JP6396352B2/ja not_active Expired - Fee Related
- 2016-09-01 US US15/253,877 patent/US10042406B2/en not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
US10042406B2 (en) | 2018-08-07 |
US20170262031A1 (en) | 2017-09-14 |
JP2017162407A (ja) | 2017-09-14 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR101997316B1 (ko) | 제어 장치, 제어 장치의 제어 방법 및 기억 매체 | |
US20130044844A1 (en) | Electronics device capable of efficient communication between components with asyncronous clocks | |
US9836104B2 (en) | Power sequencing by slave power sequencers sharing a command bus | |
JP5359742B2 (ja) | 省電力制御装置、画像形成装置、及びプログラム | |
TW201541466A (zh) | 記憶體控制裝置、半導體裝置、系統板、及資訊處理裝置 | |
US11209885B2 (en) | Information processing apparatus, method for controlling the same, and non-transitory computer-readable storage medium | |
JP2009260918A (ja) | 画像処理装置、画像処理方法および画像処理プログラム | |
JP4393954B2 (ja) | マイクロコンピュータ | |
JP6396352B2 (ja) | 半導体装置 | |
US20170147362A1 (en) | Stand-by mode of an electronic circuit | |
JP6425492B2 (ja) | 情報処理装置、情報処理方法およびプログラム | |
JP6047033B2 (ja) | Lsiおよび情報処理システム | |
US9733690B2 (en) | Communication device which decreases power comsumption by powering off unused functions when device is inactive | |
US10460772B2 (en) | Semiconductor device | |
CN111142653A (zh) | 一种PCIe设备低功耗控制方法、装置及电子设备 | |
JP5774764B2 (ja) | メモリ制御装置、半導体装置、システムボード、および情報処理装置 | |
JP6245056B2 (ja) | 情報処理装置、電源制御プログラム及びusb機器 | |
US20100332874A1 (en) | Microcomputer and microcomputer system | |
JP5783348B2 (ja) | 制御装置、制御プログラム、画像形成装置 | |
JP2015156196A (ja) | マイクロコンピュータ | |
US9311172B2 (en) | External electronic device | |
JP6377659B2 (ja) | 半導体装置及びその制御方法 | |
JP2011008346A (ja) | 半導体集積回路 | |
JP6906369B2 (ja) | コンピュータシステム、その制御方法、及びプログラム | |
US10338665B2 (en) | Microcontroller power reduction system and method |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A711 | Notification of change in applicant |
Free format text: JAPANESE INTERMEDIATE CODE: A712 Effective date: 20170911 |
|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20170912 |
|
A711 | Notification of change in applicant |
Free format text: JAPANESE INTERMEDIATE CODE: A711 Effective date: 20170912 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20180425 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20180522 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20180626 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20180731 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20180829 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 6396352 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
LAPS | Cancellation because of no payment of annual fees |