JP6334060B2 - 酸化物半導体薄膜トランジスタにおけるスキャン駆動回路 - Google Patents
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- 239000010409 thin film Substances 0.000 title claims description 55
- 239000004065 semiconductor Substances 0.000 title claims description 46
- 239000003990 capacitor Substances 0.000 claims description 19
- 238000012546 transfer Methods 0.000 claims description 10
- 238000000034 method Methods 0.000 claims description 7
- 230000005540 biological transmission Effects 0.000 claims description 6
- 238000010586 diagram Methods 0.000 description 6
- 229910021417 amorphous silicon Inorganic materials 0.000 description 5
- 238000013461 design Methods 0.000 description 4
- 239000004973 liquid crystal related substance Substances 0.000 description 3
- 230000007257 malfunction Effects 0.000 description 3
- 238000013459 approach Methods 0.000 description 2
- 230000009471 action Effects 0.000 description 1
- 230000003213 activating effect Effects 0.000 description 1
- 230000004913 activation Effects 0.000 description 1
- 238000005034 decoration Methods 0.000 description 1
- 238000011161 development Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- NNAJZRCFFYCSEP-UHFFFAOYSA-N gallium zinc indium(3+) oxygen(2-) Chemical compound [O--].[O--].[O--].[O--].[Zn++].[Ga+3].[In+3] NNAJZRCFFYCSEP-UHFFFAOYSA-N 0.000 description 1
- 230000006698 induction Effects 0.000 description 1
- 230000008569 process Effects 0.000 description 1
- 239000002994 raw material Substances 0.000 description 1
- 230000004044 response Effects 0.000 description 1
- 239000000758 substrate Substances 0.000 description 1
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- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
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- G09G3/34—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
- G09G3/36—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
- G09G3/3611—Control of matrices with row and column drivers
- G09G3/3674—Details of drivers for scan electrodes
- G09G3/3677—Details of drivers for scan electrodes suitable for active matrices only
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
- G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
- G09G3/34—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
- G09G3/36—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
- G09G3/3611—Control of matrices with row and column drivers
- G09G3/3696—Generation of voltages supplied to electrode drivers
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
- H01L27/02—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
- H01L27/12—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body
- H01L27/1214—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs
- H01L27/1222—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs with a particular composition, shape or crystalline structure of the active layer
- H01L27/1225—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs with a particular composition, shape or crystalline structure of the active layer with semiconductor materials not belonging to the group IV of the periodic table, e.g. InGaZnO
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- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2300/00—Aspects of the constitution of display devices
- G09G2300/04—Structural and physical details of display devices
- G09G2300/0404—Matrix technologies
- G09G2300/0408—Integration of the drivers onto the display substrate
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- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2310/00—Command of the display device
- G09G2310/02—Addressing, scanning or driving the display screen or processing steps related thereto
- G09G2310/0264—Details of driving circuits
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- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
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- G09G2310/00—Command of the display device
- G09G2310/06—Details of flat display driving waveforms
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- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2310/00—Command of the display device
- G09G2310/08—Details of timing specific for flat panels, other than clock recovery
Landscapes
- Engineering & Computer Science (AREA)
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- Crystallography & Structural Chemistry (AREA)
- Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- General Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Power Engineering (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Shift Register Type Memory (AREA)
- Thin Film Transistor (AREA)
- Liquid Crystal Display Device Control (AREA)
- Logic Circuits (AREA)
Description
本発明を制限するものではなく、本領域の一般の技術者は、本発明の精神と範囲を逸脱しない範囲内で、各種変更や潤飾をすることができ、本発明の申請範囲は請求項によって定義された範囲であるものとする。
200 プルアップ部
300 トランスファ部
400 第1プルダウン部
500 ブートストラップコンデンサ部
600 プルダウン保持部600
T11 第11トランジスタ
T21 第21トランジスタ
T22 第22トランジスタ
T41 第41トランジスタ
T51 第51トランジスタ
T52 第52トランジスタ
T53 第53トランジスタ
T54 第54トランジスタ
T71 第71トランジスタ
T72 第72トランジスタ
T73 第73トランジスタ
T74 第74トランジスタ
T42 第42トランジスタ
T32 第32トランジスタ
ST(N1) 駆動出力端子
G(N1) 出力端子
Q(N) 第1ノード
P(N) 第2ノード
K(N) 第3ノード
S(N) 第4ノード
CK(M) クロック信号
CK(1) 第1クロック信号
CK(2) 第2クロック信号
CK(3) 第3クロック信号
CK(4) 第4クロック信号
VSS1 第1負電位
VSS2 第2負電位
CB コンデンサ
DCH 定電圧高電位
DCL 定電圧低電位
Claims (13)
- 縦続接続の複数のGOAユニットからなる酸化物半導体薄膜トランジスタにおけるスキャン駆動回路であって、第N級GOAユニットは、プルアップ制御部と、プルアップ部と、トランスファ部と、第1プルダウン部と、ブートストラップコンデンサ部と、プルダウン保持部とを備え、Nは正整数であり、
前記プルアップ制御部は、第11トランジスタを備え、前記第11トランジスタのグリッド電極は前記第N級GOAユニットの一つ前のGOAユニットである第N−1級GOAユニットの駆動出力端子に電気接続され、ドレイン電極は前記第N級GOAユニットの一つ前のGOAユニットである第N−1級GOAユニットの出力端子に電気接続され、ソース電極は第1ノードに電気接続され、
前記第1プルダウン部は、第41トランジスタを備え、前記第41トランジスタのグリッド電極は第M+2組クロック信号に電気接続され、ドレイン電極は第1ノードに電気接続され、ソース電極は第2負電位または出力端子に電気接続され、
前記プルダウン保持部は、第51トランジスタと、第52トランジスタと、第53トランジスタと、第54トランジスタと、第73トランジスタと、第74トランジスタと、第42トランジスタと、第32トランジスタとを備え、前記第51トランジスタのグリッド電極とドレイン電極はどちらも定電圧高電位に電気接続され、ソース電極は第4ノードに電気接続され、前記第52トランジスタのグリッド電極は第1ノードに電気接続され、ドレイン電極は第4ノードに電気接続され、ソース電極は第1負電位に電気接続され、前記第53トランジスタのグリッド電極は第4ノードに電気接続され、ドレイン電極は定電圧高電位に電気接続され、ソース電極は第2ノードに電気接続され、前記第54トランジスタのグリッド電極は第1ノードに電気接続され、ドレイン電極は第2ノードに電気接続され、ソース電極は第3ノードに電気接続され、前記第73トランジスタのグリッド電極は第4ノードに電気接続され、ドレイン電極は定電圧高電位に電気接続され、ソース電極は第3ノードに電気接続され、前記第74トランジスタのグリッド電極は第1ノードに電気接続され、ドレイン電極は第3ノードに電気接続され、ソース電極は定電圧低電位に電気接続され、前記第42トランジスタのグリッド電極は第2ノードに電気接続され、ドレイン電極は第1ノードに電気接続され、ソース電極は第2負電位に電気接続され、前記第32トランジスタのグリッド電極は第2ノードに電気接続され、ドレイン電極は出力端子に電気接続され、ソース電極は第1負電位に電気接続され、
主インバータは、前記第51トランジスタ、第52トランジスタ、第53トランジスタ、第54トランジスタからなり、前記主インバータは、前記第32トランジスタと第42トランジスタを制御し、補助インバータは、前記第73トランジスタと第74トランジスタからなり、前記補助インバータが作動している時には主インバータに低電位を供給し、作動していない時には主インバータに高電位を供給し、
前記第1負電位と、第2負電位と、定電圧低電位との関係は、定電圧低電位<第2負電位<第1負電位であることを特徴とする、酸化物半導体薄膜トランジスタにおけるスキャン駆動回路。 - 前記補助インバータは、第71トランジスタと第72トランジスタをも備え、前記第71トランジスタのグリッド電極とドレイン電極はどちらも定電圧高電位に電気接続され、ソース電極は第73トランジスタのグリッド電極に電気接続され、前記第72トランジスタのグリッド電極は第1ノードに電気接続され、ドレイン電極は第73トランジスタのグリッド電極に電気接続され、ソース電極は定電圧低電位に電気接続され、前記第73トランジスタのグリッド電極と第4ノードは切断されることを特徴とする、請求項1に記載の酸化物半導体薄膜トランジスタにおけるスキャン駆動回路。
- 採用する級の送信方法は、第N−1級から第N級への送信であることを特徴とする、請求項1に記載の酸化物半導体薄膜トランジスタにおけるスキャン駆動回路。
- 前記プルアップ部は、第21トランジスタを備え、前記第21トランジスタのグリッド電極は第1ノードに電気接続され、ドレイン電極はクロック信号に電気接続され、ソース電極は出力端子に電気接続され、
前記トランスファ部は、第22トランジスタを備え、前記第22トランジスタのグリッド電極は第1ノードに電気接続され、ドレイン電極はクロック信号に電気接続され、ソース電極は駆動出力端子に電気接続され、
前記ブートスラップコンデンサ部は、コンデンサを備え、前記コンデンサの一端は第1ノードに電気接続され、他端は出力端子に電気接続されることを特徴とする、請求項1に記載の酸化物半導体薄膜トランジスタにおけるスキャン駆動回路。 - 前記スキャン駆動回路の第1級接続関係において、第11トランジスタのグリッド電極とドレイン電極はどちらも回路の起動信号端子に電気接続されることを特徴とする、請求項1に記載の酸化物半導体薄膜トランジスタにおけるスキャン駆動回路。
- 前記クロック信号の波形デューティ比は、25/75より大きくないことを特徴とする、請求項4に記載の酸化物半導体薄膜トランジスタにおけるスキャン駆動回路。
- 前記クロック信号の波形デューティ比は、25/75であることを特徴とする、請求項6に記載の酸化物半導体薄膜トランジスタにおけるスキャン駆動回路。
- 前記第1ノードの信号の出力波形は、"凸"の字の形であることを特徴とする、請求項1に記載の酸化物半導体薄膜トランジスタにおけるスキャン駆動回路。
- 前記クロック信号は、第1クロック信号と、第2クロック信号と、第3クロック信号と、第4クロック信号の4組のクロック信号を備え、前記クロック信号が第3クロック信号の時、前記第M+2組クロック信号は第1クロック信号であり、前記クロック信号が第4クロック信号の時、前記第M+2組クロック信号は第2クロック信号であることを特徴とする、請求項4に記載の酸化物半導体薄膜トランジスタにおけるスキャン駆動回路。
- 縦続接続の複数のGOAユニットからなる酸化物半導体薄膜トランジスタにおけるスキャン駆動回路であって、第N級GOAユニットは、プルアップ制御部と、プルアップ部と、トランスファ部と、第1プルダウン部と、ブートストラップコンデンサ部と、プルダウン保持部とを備え、Nは正整数であり、
前記プルアップ制御部は、第11トランジスタを備え、前記第11トランジスタのグリッド電極は前記第N級GOAユニットの一つ前のGOAユニットである第N−1級GOAユニットの駆動出力端子に電気接続され、ドレイン電極は前記第N級GOAユニットの一つ前のGOAユニットである第N−1級GOAユニットの出力端子に電気接続され、ソース電極は第1ノードに電気接続され、
前記第1プルダウン部は、第41トランジスタを備え、前記第41トランジスタのグリッド電極は第M+2組クロック信号に電気接続され、ドレイン電極は第1ノードに電気接続され、ソース電極は第2負電位または出力端子に電気接続され、
前記プルダウン保持部は、第51トランジスタと、第52トランジスタと、第53トランジスタと、第54トランジスタと、第73トランジスタと、第74トランジスタと、第42トランジスタと、第32トランジスタとを備え、前記第51トランジスタのグリッド電極とドレイン電極はどちらも定電圧高電位に電気接続され、ソース電極は第4ノードに電気接続され、前記第52トランジスタのグリッド電極は第1ノードに電気接続され、ドレイン電極は第4ノードに電気接続され、ソース電極は第1負電位に電気接続され、前記第53トランジスタのグリッド電極は第4ノードに電気接続され、ドレイン電極は定電圧高電位に電気接続され、ソース電極は第2ノードに電気接続され、前記第54トランジスタのグリッド電極は第1ノードに電気接続され、ドレイン電極は第2ノードに電気接続され、ソース電極は第3ノードに電気接続され、前記第73トランジスタのグリッド電極は第4ノードに電気接続され、ドレイン電極は定電圧高電位に電気接続され、ソース電極は第3ノードに電気接続され、前記第74トランジスタのグリッド電極は第1ノードに電気接続され、ドレイン電極は第3ノードに電気接続され、ソース電極は定電圧低電位に電気接続され、前記第42トランジスタのグリッド電極は第2ノードに電気接続され、ドレイン電極は第1ノードに電気接続され、ソース電極は第2負電位に電気接続され、前記第32トランジスタのグリッド電極は第2ノードに電気接続され、ドレイン電極は出力端子に電気接続され、ソース電極は第1負電位に電気接続され、
主インバータは、前記第51トランジスタ、第52トランジスタ、第53トランジスタ、第54トランジスタからなり、前記主インバータは、前記第32トランジスタと第42トランジスタを制御し、補助インバータは、前記第73トランジスタと第74トランジスタからなり、前記補助インバータが作動している時には主インバータに低電位を供給し、作動していない時には主インバータに高電位を供給し、
前記第1負電位と、第2負電位と、定電圧低電位との関係は、定電圧低電位<第2負電位<第1負電位であり、
そのうち、前記プルアップ部は、第21トランジスタを備え、前記第21トランジスタのグリッド電極は第1ノードに電気接続され、ドレイン電極はクロック信号に電気接続され、ソース電極は出力端子に電気接続され、
前記トランスファ部は、第22トランジスタを備え、前記第22トランジスタのグリッド電極は第1ノードに電気接続され、ドレイン電極はクロック信号に電気接続され、ソース電極は駆動出力端子に電気接続され、
前記ブーストトラップコンデンサ部は、コンデンサを備え、前記コンデンサの一端は第1ノードに電気接続され、他端は出力端子に電気接続され、
そのうち、前記クロック信号の波形デューティ比は、25/75より大きくなく、
前記クロック信号の波形デューティ比は、25/75であり、
前記第1ノードの信号の出力波形は、"凸"の字の形であることを特徴とする、酸化物半導体薄膜トランジスタにおけるスキャン駆動回路。 - 採用する級の送信方法は、第N−1級から第N級への送信であることを特徴とする、請求項10に記載の酸化物半導体薄膜トランジスタにおけるスキャン駆動回路。
- 前記スキャン駆動回路の第1級接続関係において、第11トランジスタのグリッド電極とドレイン電極は、どちらも回路の起動信号端子に電気接続されることを特徴とする、請求項10に記載の酸化物半導体薄膜トランジスタにおけるスキャン駆動回路。
- 前記クロック信号は、第1クロック信号と、第2クロック信号と、第3クロック信号と、第4クロック信号の4組のクロック信号を備え、前記クロック信号が第3クロック信号の時、前記第M+2組クロック信号は第1クロック信号であり、前記クロック信号が第4クロック信号の時、前記第M+2組クロック信号は第2クロック信号であることを特徴とする、請求項10に記載の酸化物半導体薄膜トランジスタにおけるスキャン駆動回路。
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201410624066.8 | 2014-11-07 | ||
CN201410624066.8A CN104409055B (zh) | 2014-11-07 | 2014-11-07 | 用于氧化物半导体薄膜晶体管的扫描驱动电路 |
PCT/CN2015/072361 WO2016070516A1 (zh) | 2014-11-07 | 2015-02-06 | 用于氧化物半导体薄膜晶体管的扫描驱动电路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2017537339A JP2017537339A (ja) | 2017-12-14 |
JP6334060B2 true JP6334060B2 (ja) | 2018-05-30 |
Family
ID=52646679
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2017519235A Active JP6334060B2 (ja) | 2014-11-07 | 2015-02-06 | 酸化物半導体薄膜トランジスタにおけるスキャン駆動回路 |
Country Status (6)
Country | Link |
---|---|
US (2) | US9548036B2 (ja) |
JP (1) | JP6334060B2 (ja) |
KR (1) | KR101943236B1 (ja) |
CN (1) | CN104409055B (ja) |
GB (1) | GB2544933B (ja) |
WO (1) | WO2016070516A1 (ja) |
Families Citing this family (13)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN104700801B (zh) * | 2015-03-24 | 2016-11-02 | 深圳市华星光电技术有限公司 | Pmos栅极驱动电路 |
CN104851403B (zh) * | 2015-06-01 | 2017-04-05 | 深圳市华星光电技术有限公司 | 基于氧化物半导体薄膜晶体管的goa电路 |
CN104882108B (zh) * | 2015-06-08 | 2017-03-29 | 深圳市华星光电技术有限公司 | 基于氧化物半导体薄膜晶体管的goa电路 |
CN106251816B (zh) * | 2016-08-31 | 2018-10-12 | 深圳市华星光电技术有限公司 | 一种栅极驱动电路及液晶显示装置 |
CN106448606A (zh) * | 2016-11-23 | 2017-02-22 | 深圳市华星光电技术有限公司 | 一种goa驱动电路 |
CN107633831B (zh) * | 2017-10-18 | 2020-02-14 | 京东方科技集团股份有限公司 | 移位寄存器及其驱动方法、栅极驱动电路和显示装置 |
CN107863077B (zh) * | 2017-11-16 | 2020-07-31 | 深圳市华星光电半导体显示技术有限公司 | 一种改善goa电路开机大电流的方法 |
CN108492789A (zh) * | 2018-03-13 | 2018-09-04 | 深圳市华星光电半导体显示技术有限公司 | 一种阵列基板行驱动单元、电路以及液晶显示面板 |
US20200035179A1 (en) * | 2018-07-26 | 2020-01-30 | Shenzhen China Star Optoelectronics Technology Co., Ltd. | Liquid crystal panel including goa circuit and driving method thereof |
CN110136652B (zh) | 2019-05-24 | 2020-10-16 | 深圳市华星光电半导体显示技术有限公司 | 一种goa电路及阵列基板 |
CN110570799B (zh) * | 2019-08-13 | 2022-10-04 | 深圳市华星光电半导体显示技术有限公司 | Goa电路及显示面板 |
CN111292672B (zh) | 2020-03-31 | 2023-11-28 | Tcl华星光电技术有限公司 | Goa电路及显示面板 |
CN113674656B (zh) * | 2021-08-13 | 2022-07-12 | Tcl华星光电技术有限公司 | Goa电路及其电学老化测试方法 |
Family Cites Families (14)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7831010B2 (en) * | 2007-11-12 | 2010-11-09 | Mitsubishi Electric Corporation | Shift register circuit |
KR20100075141A (ko) * | 2008-12-24 | 2010-07-02 | 삼성전자주식회사 | 게이트 구동회로 및 이를 구비한 표시 장치 |
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KR101641312B1 (ko) * | 2009-12-18 | 2016-07-21 | 삼성디스플레이 주식회사 | 표시 패널 |
JP5419762B2 (ja) * | 2010-03-18 | 2014-02-19 | 三菱電機株式会社 | シフトレジスタ回路 |
CN102708778B (zh) * | 2011-11-28 | 2014-04-23 | 京东方科技集团股份有限公司 | 移位寄存器及其驱动方法、栅极驱动装置与显示装置 |
KR101963595B1 (ko) * | 2012-01-12 | 2019-04-01 | 삼성디스플레이 주식회사 | 게이트 구동 회로 및 이를 구비한 표시 장치 |
TWI511459B (zh) * | 2012-10-11 | 2015-12-01 | Au Optronics Corp | 可防止漏電之閘極驅動電路 |
TWI505245B (zh) * | 2012-10-12 | 2015-10-21 | Au Optronics Corp | 移位暫存器 |
KR102034140B1 (ko) | 2013-01-23 | 2019-10-21 | 삼성디스플레이 주식회사 | 게이트 구동부 및 이를 포함하는 표시 장치 |
CN103400558B (zh) * | 2013-07-31 | 2015-09-09 | 京东方科技集团股份有限公司 | 移位寄存器单元及其驱动方法、栅极驱动电路及显示装置 |
CN103680453B (zh) * | 2013-12-20 | 2015-09-16 | 深圳市华星光电技术有限公司 | 阵列基板行驱动电路 |
CN103761952B (zh) | 2013-12-31 | 2016-01-27 | 深圳市华星光电技术有限公司 | 一种液晶面板的扫描驱动电路、液晶面板和一种驱动方法 |
CN104392701B (zh) * | 2014-11-07 | 2016-09-14 | 深圳市华星光电技术有限公司 | 用于氧化物半导体薄膜晶体管的扫描驱动电路 |
-
2014
- 2014-11-07 CN CN201410624066.8A patent/CN104409055B/zh active Active
-
2015
- 2015-02-06 GB GB1703826.6A patent/GB2544933B/en active Active
- 2015-02-06 WO PCT/CN2015/072361 patent/WO2016070516A1/zh active Application Filing
- 2015-02-06 JP JP2017519235A patent/JP6334060B2/ja active Active
- 2015-02-06 US US14/424,383 patent/US9548036B2/en active Active
- 2015-02-06 KR KR1020177007048A patent/KR101943236B1/ko active IP Right Grant
-
2016
- 2016-11-15 US US15/352,486 patent/US9767754B2/en active Active
Also Published As
Publication number | Publication date |
---|---|
GB201703826D0 (en) | 2017-04-26 |
KR101943236B1 (ko) | 2019-01-28 |
US9767754B2 (en) | 2017-09-19 |
JP2017537339A (ja) | 2017-12-14 |
US9548036B2 (en) | 2017-01-17 |
KR20170042353A (ko) | 2017-04-18 |
CN104409055B (zh) | 2017-01-11 |
GB2544933B (en) | 2021-03-03 |
US20170061915A1 (en) | 2017-03-02 |
WO2016070516A1 (zh) | 2016-05-12 |
GB2544933A (en) | 2017-05-31 |
US20160343330A1 (en) | 2016-11-24 |
CN104409055A (zh) | 2015-03-11 |
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---|---|---|---|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
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R150 | Certificate of patent or registration of utility model |
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