JP6217736B2 - パルス幅変調器およびそのプログラム - Google Patents
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Description
値、または、上記入力信号の成分を含む信号の値に依存して制御することを特徴とするデルタシグマ変調器がある(特許文献1)。また、従来のΔΣ変調器には、スイッチング増幅器でのノイズおよび歪みを低減するのに、ΔΣ変調器での理想的な出力と現実の出力との残差を帰還するものがある(特許文献2、3)。
2 入力端子
3 出力端子
4 フィードフォワードフィルタ部
5 積和演算部
6 パルス幅変調部
11 減算器
12、14 積分器
13、18 加算器
15、16、17 乗算器
Claims (4)
- m値(m:3以上の整数)デジタル信号を2値以上のパルス幅変調信号に変換するパルス幅変調器であって、
該m値デジタル信号と該パルス幅変調信号とを減算する減算部と、
該減算部の出力信号が入力され、2次以上の積分器を含むΔΣ変調器が従属接続されてサンプリング周波数FSで動作するフィードフォワードフィルタ部と、
該フィードフォワードフィルタ部のそれぞれの該積分器からの出力信号をサンプリング周波数(FS/n)(n:2以上の整数)で動作して積和演算する積和演算部と、
該サンプリング周波数(FS/n)で動作して、該積和演算部の出力信号をパルス幅変調して該パルス幅変調信号を出力するパルス幅変調部と、
を備える、
パルス幅変調器。 - 前記パルス幅変調信号がl値(l:2以上の整数)デジタル信号の場合に、
前記パルス幅変調部が、
前記積和演算器の出力信号を(n+1)値デジタル信号、または、((n+1)*(l−1)−(l−2))値デジタル信号に変換して出力する量子化器と、
該量子化器の出力信号を、最小幅が(1/FS)であり、最大幅が(n/FS)である前記パルス幅変調信号に変換して出力するパルス幅変換部と、
を備える、請求項1に記載のパルス幅変調器。 - m値(m:3以上の整数)デジタル信号を2値以上のパルス幅変調信号に変換する信号処理をコンピュータに実行させるプログラムであって、
該プログラムは、該コンピュータのプロセッサに、
該m値デジタル信号と該パルス幅変調信号とを減算する信号処理を実行させるステップと、
該減算された出力信号が入力され、2次以上の積分器を含むΔΣ変調器が従属接続されてサンプリング周波数FSで動作するフィードフォワードフィルタの信号処理を実行させるステップと、
該フィードフォワードフィルタのそれぞれの該積分器からの出力信号をサンプリング周波数(FS/n)(n:2以上の整数)で動作して積和演算する積和演算の信号処理を実行させるステップと、
該サンプリング周波数(FS/n)で動作して、該積和演算の出力信号をパルス幅変調して該パルス幅変調信号を出力する信号処理を実行させるステップと、
を含む、プログラム。 - 前記パルス幅変調信号がl値(l:2以上の整数)デジタル信号の場合に、
前記パルス幅変調信号を出力する信号処理を実行させるステップが、
前記積和演算器の出力信号を(n+1)値デジタル信号、または、((n+1)*(l−1)−(l−2))値デジタル信号に変換して出力する量子化器の信号処理を実行させるステップと、
該量子化器の出力信号を、最小幅が(1/FS)であり、最大幅が(n/FS)である前記パルス幅変調信号に変換して出力する信号処理を実行させるステップと、
を含む、請求項3に記載のプログラム。
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