JP6070846B2 - 半導体装置の製造方法および半導体装置 - Google Patents

半導体装置の製造方法および半導体装置 Download PDF

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Description

本発明は、熱処理工程を有する半導体装置の製造方法および半導体装置に関する。
近年、パワー半導体装置の分野で、窒化物系半導体、例えば窒化ガリウム(GaN)系半導体といったワイドバンドギャップ半導体を用いた製品の研究開発が活発になされており、既に実用化も始まっている。ワイドバンドギャップ半導体が従来使われているシリコン(Si)と比べて優れている点として、高耐圧な半導体装置を低オン抵抗で作ることができること、高温動作が可能なことが周知されている。このような利点から、窒化物系半導体はSi系材料に代わるインバータやコンバータなどのパワーデバイスの材料として期待されている。
この窒化物系半導体を用いて製造される窒化物系半導体装置の製造プロセスにおいては、イオン注入を行った後に、結晶回復や不純物の活性化のための高温での熱処理、すなわち活性化アニールが必要になる。ところが、GaN系半導体などの窒化物系半導体に対して活性化アニールを行う場合に、加熱温度を800℃以上にすると、窒化物系半導体から組成物である窒素(N)が抜ける、いわゆる窒素抜けが発生して分解が始まる。
そこで、窒化物系半導体層に対して、その上層に耐熱性のより高い材料からなる保護膜(キャップ層)を形成した後に活性化アニールを行う方法が採用されている。特許文献1,2および非特許文献1には、保護膜としてAlN層を用い、表面保護を行いつつ窒素中で熱処理を行う方法が開示されている。
また、イオン注入などの不純物ドープ後の活性化アニールにおいては、半導体層を構成する材料の融点に対して、その2/3程度の温度での加熱が必要とされている。具体的に、半導体材料としてGaNなどの窒化物系半導体を用いる場合には、加熱温度として1500℃〜1700℃程度が予想されている。
特開平8−186332号公報 特許第2540791号公報
J.C.Zolper et al., "Sputtered AlN encapsulant for high-temperature of GaN", Appl. Phys. Lett. 69(4),22 July 1996 pp.538-540. X.A.Cao et al., "Ultrahigh Si+ implant activation efficiency in GaN using a high-temperature rapid thermal process system", APPLIED PHYSICS LETTERS 73 (1998) pp.229-231. K.A.Jones et al., "The Properties of Annealed AlN Films Deposited by Pulsed Laser Deposition", Journal of ELECTRONIC MATERIALS, Vol.29, No.3 2000 pp.262-267. B.N.Feigelson et al, "Multicycle rapid thermal annealing technique and its application for the electrical activation of Mg implanted in GaN" Journal of Crystal Growth 350(2012) pp.21-26.
しかしながら、このような高温度域においては、AlN層を保護膜として用いても、AlN層においてピットが発生したり分解したりすることから、保護膜として機能しないことが報告されている(たとえば非特許文献2,3参照)。例えば、非特許文献2には、高温領域としての1500℃以下の温度での加熱を実施した例として、1400℃以上の温度での加熱によってAlN層にピットが発生することが報告されている。このように、熱処理時に保護膜として用いるAlN層にピットが発生すると、このピットから下層の窒化物系半導体層を構成する窒素が放出される可能性が高くなる。
これらのことから、従来技術においては、活性化アニールの温度としては1300℃程度が限界であった。ところが、イオン注入などの不純物ドープ後に活性化アニールを行った場合、1300℃程度の加熱温度では、半導体層において十分な不純物の活性化および結晶性の回復ができない。そのため、従来技術においては、例えば製造される半導体装置におけるキャリア移動度の低下が問題となる。また、特にイオン注入によってp型領域を形成する場合には、欠陥によって発生するn型キャリアの補償効果によって、注入した不純物の量に対して十分なp型キャリア濃度を得ることができないという問題があった。
本発明は、上記に鑑みてなされたものであって、その目的は、高温での熱処理を、半導体装置を構成する窒化物系半導体層からの窒素抜けを防止しつつ安定してかつ効果的に行うことができる半導体装置の製造方法および半導体装置を提供することにある。
上述した課題を解決し、上記目的を達成するために、本発明に係る半導体装置の製造方法は、窒化物系半導体層を有する半導体装置の製造方法において、窒化物系半導体層の表面に窒化アルミニウム層を形成する形成工程と、形成工程後に、窒化物系半導体層および窒化アルミニウム層に対して、形成工程における処理温度より高い温度、かつ窒化アルミニウムの成長雰囲気において熱処理を行う熱処理工程と、を含むことを特徴とする。
本発明に係る半導体装置の製造方法は、上記の発明において、窒化アルミニウム層が、多結晶構造膜またはエピタキシャル成長法により形成された膜であることを特徴とする。
本発明に係る半導体装置の製造方法は、上記の発明において、熱処理工程における窒化アルミニウムの成長雰囲気が、窒化アルミニウムを成長させる雰囲気、または窒化アルミニウムの成長と分解とが略平衡している雰囲気であることを特徴とする。
本発明に係る半導体装置の製造方法は、上記の発明において、熱処理工程における窒化アルミニウムの成長雰囲気が、アルミニウムを含有する有機金属ガスと、水素および窒素を含むガスとの混合ガス雰囲気によって構成される、有機金属化学気相成長雰囲気であることを特徴とする。本発明に係る半導体装置の製造方法は、この構成において、有機金属ガスがトリメチルアルミニウムガスであるとともに、水素および窒素を含むガスがアンモニアガスと、水素ガスおよび窒素ガスの少なくとも一方を含むガスとの混合ガスからなることを特徴とする。
本発明に係る半導体装置の製造方法は、上記の発明において、熱処理工程における窒化アルミニウムの成長雰囲気が、アルミニウムを含有する塩化物ガスと、水素および窒素を含むガスとの混合ガス雰囲気によって構成される気相成長雰囲気であることを特徴とする。
本発明に係る半導体装置の製造方法は、上記の発明において、熱処理工程における窒化アルミニウムの成長雰囲気が、アルミニウムを含む融液と窒素含有ガスとからなる溶液成長雰囲気であることを特徴とする。
本発明に係る半導体装置の製造方法は、上記の発明において、熱処理工程における窒化アルミニウムの成長雰囲気が、窒化アルミニウムの粉末を昇華させた昇華雰囲気であることを特徴とする。
本発明に係る半導体装置の製造方法は、上記の発明において、熱処理工程前に、窒化物系半導体層に不純物をドープする工程をさらに含むことを特徴とする。
本発明に係る半導体装置の製造方法は、上記の発明において、窒化物系半導体層が窒化ガリウムからなることを特徴とする。
本発明に係る半導体装置は、上記の発明による半導体装置の製造方法により製造されたことを特徴とする。
本発明に係る半導体装置の製造方法および半導体装置によれば、窒化物系半導体層からの窒素抜けを防止しつつ高温での熱処理を安定してかつ効果的に行うことが可能となる。
図1は、本発明の実施の形態1による半導体装置を示す断面図である。 図2は、本発明の実施の形態1による半導体装置の製造方法を説明するための模式図である。 図3は、本発明の実施の形態2による半導体装置の製造方法に含まれる熱処理工程を説明するための模式図である。 図4は、本発明の実施の形態3による半導体装置の製造方法に含まれる熱処理工程を説明するための模式図である。 図5は、本発明の実施の形態4による半導体装置の製造方法に含まれる熱処理工程を説明するための模式図である。 図6は、本発明の実施の形態5による半導体装置の製造方法に含まれる熱処理工程を説明するための被処理基板の断面図である。
以下、本発明の実施の形態について図面を参照しつつ説明する。なお、この実施の形態によりこの発明が限定されるものではない。また、各図面において、同一または対応する要素には適宜同一の符号を付している。さらに、図面は模式的なものであり、各要素の寸法の関係などは、現実のものとは異なる場合があることに留意する必要がある。図面の相互間においても、互いの寸法の関係や比率が異なる部分が含まれている場合がある。
(実施の形態1)
(半導体装置)
まず、本発明の実施の形態1による半導体装置について説明する。図1は、この実施の形態1における半導体装置としての縦型MOSFETの構成を示す断面図である。図1に示すように、この実施の形態1における半導体装置1は、n型不純物がドープされたn型窒化ガリウム(n−GaN)基板11と、n−GaN基板11上に例えばエピタキシャル成長法により形成され、n−GaN基板11よりも不純物濃度の低いn−GaN層12とを備える。
n−GaN層12には、選択的にp型不純物がドープされたp型ウェル領域13、p型ウェル領域13中に選択的にp型不純物がより高濃度にドープされたp+型ウェル領域14、およびp型ウェル領域13とp+型ウェル領域14との部分に選択的にn型不純物がドープされたn+型ソース領域15が形成されている。また、n−GaN層12の表面の部分において、一対のp型ウェル領域13の間にゲート電極16が設けられている。ゲート電極16は、n−GaN層12の表面上に、底面に例えば酸化シリコン(SiO)などの絶縁体からなるゲート絶縁膜17を介して設けられている。また、n−GaN層12上には、一対のソース電極18が、ゲート電極16およびゲート絶縁膜17に対して、これらと離間しつつ挟むように設けられている。一方、n−GaN基板11の裏面にドレイン電極19が設けられている。以上の構成によって、半導体装置1においては、駆動時に上層のp型ウェル領域13からn−GaN基板11にかけてチャネルが形成される。
(半導体装置の製造方法)
次に、以上のように構成された実施の形態1による半導体装置1の製造方法について説明する。図2は、この実施の形態1による半導体装置1の製造方法を説明するための模式図である。
すなわち、まず、図1に示すn−GaN基板11上に、n型不純物をドープしつつ、例えば有機金属気相成長法(MOCVD法)によりGaNを成長させることにより、窒化物系半導体層としてのn−GaN層12を形成する。なお、n−GaN基板11に代えて、サファイア基板やSiC基板やZrB基板などを用いても良い。また、n−GaN層12の成長には、MOCVD法に代えて、ハイドライド気相成長法(HVPE法)や分子線エピタキシー法(MBE法)などを用いても良い。
次に、n−GaN層12に対して選択的に、p型ウェル領域13および高不純物濃度のp+型ウェル領域14を形成すべき領域に、例えばイオン注入法によってp型不純物を順次ドープする。その後、例えばイオン注入法により、p型ウェル領域13およびp+型ウェル領域14の部分のn+型ソース領域15を形成すべき領域に、選択的にn型不純物をドープする。
次に、図2に示すように、n−GaN層12の表面にキャップ層2aを形成する。ここで、このn−GaN層12の表面を保護するキャップ層2aの材料としては、後の熱処理工程に対して好適な材料が選択される。具体的には、キャップ層2aの材料としては、下層のn−GaN層12よりも耐熱性が高く、熱処理において剥がれが生じない程度にn−GaN層12との間で良好な密着性を有するとともに、n−GaN層12と反応することなく、不純物も拡散しない材料が好ましい。
そこで、この実施の形態1においては、キャップ層2aを構成する材料として窒化アルミニウム(AlN)を用いる。また、このキャップ層2aを構成するAlNは、GaNに対してエッチング選択性を高くできるので、熱処理後にキャップ層2aを選択的に除去し易い点でもより好ましい材料である。
そして、この実施の形態1においては、例えば、トリメチルアルミニウム(TMA;Al(CH33)ガス、アンモニア(NH3)ガス、および水素(H2)ガスと窒素(N2)ガスとの少なくとも一方のガスを含む混合ガスを用いたMOCVD法により、n−GaN層12の表面にAlNからなる保護膜としてのキャップ層2aを形成する。このキャップ層2aの形成における加熱温度は、後に行われる熱処理工程における熱処理温度(加熱温度)よりも低い温度が好ましく、具体的には例えば800℃〜1200℃であり、雰囲気圧力は、例えば5kPa〜20kPaである。
また、キャップ層2aは、より高い表面保護効果が得られるように緻密な膜にすることを考慮すると、MOCVD法、HVPE法、またはMBE法などのエピタキシャル成長法により形成することが望ましいが、スパッタリング法などにより形成することも可能である。また、キャップ層2aとしては、MOCVD法などにより成長させたいわゆるエピタキシャル成長膜からなるAlN層以外にも、多結晶構造のAlN層から構成することも可能である。以上により、被処理基板2が得られる。
次に、被処理基板2を例えばMOCVD装置の反応管(図示せず)内に載置して、図2に示すように、キャップ層2aを構成するAlNの成長雰囲気として、TMAガス、NH3ガス、およびH2ガスとN2ガスとの少なくとも一方を含むガスの混合ガス雰囲気、いわゆる有機金属化学気相成長(MOCVD)雰囲気とする。そして、このAlNの成長雰囲気において被処理基板2を加熱する熱処理工程、すなわち被処理基板2に含まれる不純物を活性化するための高温熱処理としての活性化アニールを行う。この活性化アニールは、その加熱温度が例えば800℃以上、好適には1200℃以上、より好適には1500℃以上の高温熱処理である。さらに、被処理基板2が載置されるMOCVD装置の反応管(図示せず)内の雰囲気圧力は、例えば5kPa〜10kPaである。
ここで、この製造方法においては、活性化アニールをAlNの成長雰囲気下で行っている。この活性化アニールにおけるAlNの成長雰囲気とは、AlNを成長させることができる雰囲気である。その結果、活性化アニールを行う温度において、キャップ層2aを構成するAlNの分解反応が発生したとしても、それと同時にAlNの成長雰囲気によるAlNの成長反応も進行する。これによって、キャップ層2aを構成するAlNの分解が抑制され、かつキャップ層2aにピットが形成されることが防止される。この活性化アニールにおけるAlNの成長雰囲気としては、熱処理工程の間においてキャップ層2aが分解したりピットが形成されたりしないように、AlNの分解と成長とが略平衡する雰囲気であっても良い。また、熱処理工程の間にキャップ層2aを構成するAlN層の膜厚が増減しても良く、キャップ層2aにおいて、熱処理工程中においてはピットが形成されずに熱処理工程の終了時に残存している状態であれば良い。なお、AlNの成長と分解の程度は、熱処理温度、雰囲気圧力、および原料ガスであるTMAガス、NH3ガスの供給量の少なくともいずれか1つを調整することによって制御することができる。
以上の活性化アニールにより、n−GaN層12中にドープした不純物が活性化され、p型ウェル領域13、p+型ウェル領域14、およびn+型ソース領域15が形成される。
続いて、GaNとAlNとの間において高いエッチング選択性を有する例えば水酸化カリウム(KOH)水溶液を用いたウェットエッチング法により、被処理基板2からキャップ層2aを除去する。
次に、n−GaN層12の上面全体に、例えばPECVD(Plasma Enhanced CVD)法により、例えばSiO膜からなるゲート絶縁膜17を成長させる。このゲート絶縁膜17の膜厚は、例えば100nm程度である。なお、SiO膜以外にも、SiN膜、SiON膜、Al膜、MgO膜、GaO膜、GdO膜などの絶縁膜、またはこれらのうちのいずれかを含む積層膜であっても良い。
次に、ゲート絶縁膜17上に、例えばLPCVD法(減圧化学気相成長法)により多結晶シリコン膜を形成した後または形成する際、リン(P)や砒素(As)などのn型不純物原子をドーピングする。これにより、多結晶シリコン膜が導電性を示す。なお、多結晶シリコン膜へのn型不純物原子のドーピングは、多結晶シリコンを形成後にn型不純物原子をイオン注入するか、多結晶シリコンの成長中にn型不純物原子を成長雰囲気中に導入することにより行うことができる。ドーピングしたn型不純物原子は、熱処理によって活性化および多結晶シリコン膜内への拡散を行う。
続いて、フォトリソグラフィ工程およびエッチング工程により、多結晶シリコン膜およびゲート絶縁膜17をパターニングすることによって、ゲート絶縁膜17およびゲート電極16の形成領域以外のn−GaN層12の表面を露出させる。なお、エッチング工程は、例えばRIE(反応性イオンエッチング)法やICP(誘導結合方式)−RIE法などにより行う。また、ゲート電極16としては、n型不純物原子がドーピングされた多結晶シリコン膜以外にも、金(Au)や白金(Pt)やニッケル(Ni)などの金属膜、またはこれらの合金膜などを用いることが可能である。
次に、露出させたn−GaN層12の表面に、ゲート電極16と離間させつつ挟む領域に、n−GaN層12に形成したn+型ソース領域15およびp+型ウェル領域14とオーミック接触する一対のソース電極18を選択的に形成する。このソース電極18としては、例えばチタン(Ti)とアルミニウム(Al)とを順次積層させたTi/Alからなる積層金属膜を用いることができる。なお、ソース電極18の構成はこれに限定されるものではなく、n+型ソース領域15およびp+型ウェル領域14とオーミック接合またはオーミック接合に近い低抵抗の接合をする導体膜であれば種々の金属材料を用いることが可能である。また、n+型ソース領域とp+型ウェル領域とで異なる構成であってもよい。ソース電極18の形成には、リフトオフ法や選択成長法などを用いることも可能である。
次に、ソース電極18が形成されたn−GaN層12に対して反対側の面である、n−GaN基板11の裏面に、例えばTi/Alの積層金属膜からなるドレイン電極19を形成する。その後、素子分離を行って個片化することにより、図1に示す半導体装置1が製造される。
以上説明した本発明の実施の形態1によれば、n−GaN層12に不純物をドープし、保護膜としてAlN層からなるキャップ層2aを形成した後、AlNが分解されずにピットが形成されない雰囲気やAlNの分解と成長とが略平衡している雰囲気、すなわちAlNの成長雰囲気において、高温熱処理としての活性化アニールを行っていることにより、キャップ層2a自体の劣化を抑制することができるので、熱処理温度が高温になる活性化アニールにおいても、n−GaN層12に対する表面保護効果を維持でき、n−GaN層12からの窒素抜けを抑制することができる。したがって、半導体装置の製造において、活性化アニールを安定して効果的に行うことが可能になり、製造される半導体装置の動作特性をより一層向上させることができる。
(実施の形態2)
次に、本発明の実施の形態2による半導体装置の製造方法について説明する。図3は、この実施の形態2による半導体装置の製造方法に含まれる熱処理工程を説明するための模式図である。
この実施の形態2においては実施の形態1と異なり、キャップ層2aが形成された被処理基板2に対して、ハイドライド気相成長(HVPE)法に基づいたAlNの成長雰囲気において、高温熱処理としての活性化アニールを行う。具体的には、図3に示すように、第1流路20aとアルミニウムソース21が載置された第2流路20bとを有するハイドライド気相成長装置20内に被処理基板2を載置しつつ、この被処理基板2を加熱することにより、活性化アニールを行う(図3中、点線内高温部)。
すなわち、HVPE装置20において、アルミニウムソース21が載置された第2流路20bに例えば塩化水素(HCl)ガスを供給する。これにより、アルミニウムの塩化物である塩化アルミニウム(AlCl3)が生成され、さらに下流側に載置されている被処理基板2に供給される。一方、第1流路20aを通じて、水素と窒素とを含むガスとして例えばアンモニア(NH3)ガスを被処理基板2に供給する。これにより、HVPE成長装置20内において、被処理基板2を、塩化アルミニウムとアンモニアガスとの混合ガスからなるAlNの成長雰囲気、いわゆる気相成長雰囲気(ハイドライド気相成長雰囲気)に曝す。そして、このAlNの成長雰囲気において、被処理基板2を、例えば800℃以上、好適には1200℃以上、より好適には1500℃以上の高温で加熱して活性化アニールを行う。これにより、n−GaN層12にドープした不純物を活性化させる。その他の半導体装置の製造方法および製造される半導体装置においては、実施の形態1と同様であるので、その説明を省略する。
以上説明した本発明の実施の形態2による半導体装置の製造方法によれば、半導体装置となる被処理基板2に対する活性化アニールを、キャップ層2aを構成するAlNの成長雰囲気において行っていることにより、実施の形態1と同様の効果を得ることができる。また、実施の形態2によれば、高価な有機金属材料を用いる必要なく安価なガスと金属Al原料で実施することができる。
(実施の形態3)
次に、本発明の実施の形態3による半導体装置の製造方法について説明する。図4は、この実施の形態3による半導体装置の製造方法に含まれる熱処理工程を説明するための模式図である。
この実施の形態3においては実施の形態1と異なり、キャップ層2aが形成された被処理基板2に対して、るつぼを用いた融液を介する成長法である溶液成長法に基づいたAlNの成長雰囲気において、高温熱処理としての活性化アニールを行う。具体的には、図4に示すように、アルミニウムを含む融液(Al融液)32が貯留されたるつぼ31内に、窒素(N2)ガスを供給可能に構成されているとともに被処理基板2を浸漬可能に構成された溶液成長装置30を用いて、被処理基板2に対する活性化アニールを行う。
ここで、溶液成長法とは、アルミニウム(Al)の融液(Al融液32)、またはAlに加え、リチウム(Li)、ナトリウム(Na)やカリウム(K)などのアルカリ金属、マグネシウム(Mg)、カルシウム(Ca)、ストロンチウム(Sr)、バリウム(Ba)などのアルカリ土類金属、スズ(Sn)、ガリウム(Ga)、インジウム(In)、銅(Cu)およびビスマス(Bi)などの金属、またはこれらの各種化合物を少なくとも1種類含む混合融液を用いて、AlNの種結晶上にAlNを成長させる方法である。なお、AlNの成長における窒素の圧力としては、例えば10MPa以下、好適には1MPa以下であり、加熱温度は例えば600℃〜2000℃程度である。これにより、窒素を気相から溶解させてAl融液32中のAlと反応させることにより、Alの窒化物であるAlNの結晶が成長される。
この実施の形態3においては、成長容器としてのるつぼ31に、Al融液32を貯留させるとともにN2ガスを供給しつつ、例えば加熱ヒータなどによってるつぼ31を加熱する。一方で、るつぼ31内のAl融液32中に、被処理基板2の少なくともキャップ層2aを浸漬させる。このときのAl融液32の加熱温度は、例えば1200℃〜2000℃とする。これにより、被処理基板2のキャップ層2aを構成するAlN結晶が種結晶となり、さらにキャップ層2aがAlNの成長雰囲気、すなわち溶液成長雰囲気に曝されつつ被処理基板2に対する高温熱処理が行われる。この高温熱処理によって、AlNの成長雰囲気で被処理基板2に対して例えば800℃以上の高温で活性化アニールが行われることになる。これにより、被処理基板2のn−GaN層12にドープした不純物が活性化される。その他の半導体装置の製造方法および製造される半導体装置については、実施の形態1と同様であるので、その説明を省略する。
以上説明した、実施の形態3による半導体装置の製造方法によれば、半導体装置となる被処理基板2に対する活性化アニールを、キャップ層2aを構成するAlNの成長雰囲気において行っていることにより、実施の形態1と同様の効果を得ることができる。また、実施の形態3によれば、除害設備の必要なガスを用いる必要がないので装置を簡略化でき、安全に処理を実施することができる。
(実施の形態4)
次に、本発明の実施の形態4による半導体装置の製造方法について説明する。図5は、この実施の形態4による半導体装置の製造方法に含まれる熱処理工程を説明するための模式図である。
この実施の形態4においては実施の形態1と異なり、キャップ層2aが形成された被処理基板2に対して、るつぼを用いる昇華法に基づいたAlNの成長雰囲気において、高温熱処理としての活性化アニールを行う。
具体的には、図5に示すように、窒化アルミニウムの粉末(AlN粉末)42が貯留されたるつぼ41内に、キャップ層2aが形成された被処理基板2を設置可能に構成された昇華装置40を用いる。そして、この昇華装置40を用いて被処理基板2に対する活性化アニールを行う。
すなわち、AlN粉末42を成長容器としてのるつぼ41に貯留させた状態で、例えば高周波誘導加熱によりるつぼ41を加熱する。このときのAlN粉末42の貯留位置における加熱温度は、例えば1900℃〜2250℃の高温とする。これにより、以下の(1)式によるAlN粉末42の昇華分解が行われる。
2AlN(s) → 2Al(g)+N2(g) ……(1)
他方、被処理基板2を、るつぼ41内において、AlN粉末42の貯留位置の温度よりも例えば100℃〜500℃程度低い温度、具体的には例えば1400℃以上2000℃以下の高温領域となる位置に設置する。これにより、被処理基板2に対して、以下の(2)式に従ってAlNを再析出可能なAlN成長雰囲気において、高温熱処理としての活性化アニールが行われる。なお、AlNの成長雰囲気におけるN2ガスの圧力は例えば10kPa〜100kPaとする。
2Al(g)+N2(g) → 2AlN(s) ……(2)
これにより、被処理基板2に対して、AlNの成長雰囲気において例えば800℃以上の高温熱処理としての活性化アニールが行われることになり、n−GaN層12にドープした不純物が活性化される。その他の半導体装置の製造方法および製造される半導体装置については、実施の形態1と同様であるので、その説明を省略する。
以上説明した実施の形態4による半導体装置の製造方法によれば、半導体装置となる被処理基板2に対する活性化アニールを、キャップ層2aを構成するAlNの成長雰囲気において行っていることにより、実施の形態1と同様の効果を得ることができる。また、実施の形態4によれば、除害設備の必要なガスを用いる必要がないので装置を簡略化でき、安全に処理を実施することができ、かつAlNと窒素原料のみを使用するため不純物混入の恐れもない。
(実施の形態5)
次に、本発明の実施の形態5による半導体装置の製造方法について説明する。図6は、この実施の形態5による、熱処理が行われる被処理基板3を示す断面図である。
この実施の形態5においては実施の形態1〜4と異なり、n−GaN層12の表面にキャップ層2aを形成した後、例えばMOCVD法により、n−GaN基板11のn−GaN層12の積層面とは反対側の裏面に、裏面保護膜としてのAlNからなるキャップ層2bを形成する。すなわち、n−GaN層12の表面とn−GaN基板11の裏面とにそれぞれ、保護膜としてのキャップ層2a,2bが形成された被処理基板3を形成する。なお、キャップ層2a,2bは、互いに同時に形成することも可能である。その後、この被処理基板3に対して、実施の形態1〜4によるAlNの成長雰囲気において活性化アニールを行うことにより、n−GaN層12にドープした不純物が活性化される。その他の半導体装置の製造方法および製造される半導体装置については、実施の形態1〜4と同様であるので、その説明を省略する。
以上説明した実施の形態5による半導体装置の製造方法によれば、活性化アニールを実施の形態1〜4と同様の方法で行っているので、実施の形態1〜4と同様の効果を得ることができるとともに、n−GaN基板11の裏面にキャップ層2bを形成した状態で活性化アニールを行っていることにより、高温熱処理によってn−GaN基板11から窒素抜けが生じるのを抑制しつつ不純物を活性化させることができるので、この被処理基板3を用いて製造される半導体装置の特性をより一層向上させることができる。
(実施の形態6)
次に、本発明の実施の形態6による半導体装置の製造方法について説明する。この実施の形態6による半導体装置の製造方法においては、活性化アニールにおいて、加熱温度の上昇と下降とを繰り返し行う。
具体的には、実施の形態1〜5によるAlNの成長雰囲気において被処理基板2を高温熱処理する際に、その加熱温度を、例えば1000℃から例えば1400℃まで上昇させ、所定時間経過後に、例えば1400℃から例えば1000℃まで下降させる。そして、この温度上昇から温度下降までを1サイクルとし、加熱温度の上昇および下降を複数のサイクルで繰り返す、いわゆるマルチサイクル熱処理によって、被処理基板2に対する活性化アニールを行う。
ここで、非特許文献4には、GaNにマグネシウム(Mg)をドープした後の急速熱処理(RTA:Rapid Thermal Annealing)を、2MPaの雰囲気で、加熱温度を1000℃前後から1400℃まで上昇させた後、再度1000℃前後まで下降させるサイクルを複数サイクル繰り返す、マルチサイクル熱処理が開示されている。ところが、この非特許文献4においては、加熱温度を1400℃前後まで上昇させた後、MgがドープされたGaN層の表面にピットが形成される前に加熱温度を1000℃前後まで下降させることでピットの形成を抑制している。そのため、加熱温度の上昇から下降までの1周期(ΔT)を、8.4秒と極めて短時間にする必要があった。
これに対し、この実施の形態6においては、上述した実施の形態1〜5によるAlNの成長雰囲気における高温熱処理において、加熱温度を上昇させた後の所定時間経過後に下降させるというマルチサイクル熱処理を行う。これにより、被処理基板2のキャップ層2aにおけるピットの形成を大幅に抑制できるので、加熱温度の上昇から下降までの1周期を長期化させたり、より低圧または高温の雰囲気で熱処理を行ったりすることができる。これにより、非特許文献4に記載された従来技術に比して、被処理基板2に対して、より効率良く安定した高温熱処理を行うことができ、より安定した特性を有する半導体装置を製造することが可能になる。
以上、本発明の実施の形態について具体的に説明したが、本発明は、上述の実施の形態に限定されるものではなく、本発明の技術的思想に基づく各種の変形が可能である。例えば、上述の実施の形態において挙げた数値はあくまでも例に過ぎず、必要に応じてこれと異なる数値を用いても良い。
例えば、上述した実施の形態においては、n−GaN層12に対する不純物のドーピングをイオン注入法により行っているが、不純物のドーピング方法は必ずしもイオン注入に限定されるものではなく、例えばn−GaN層12のエピタキシャル成長中における成長雰囲気中に不純物を導入するなどの、その他の不純物ドーピング方法を採用しても良い。
また、上述の実施の形態においては、本発明による高温熱処理を、不純物のドーピング後に行う活性化アニール、具体的にはGaN層にドープした不純物を活性化させるための活性化アニールに適用した例について説明しているが、必ずしも活性化アニールに限定されるものではなく、ゲート酸化膜を形成した後のアニール(ポストデポジションアニール:Post Deposition Anneal;PDA)、またはメタルシンタ処理などの、その他の半導体層に対するあらゆる熱処理に適用することも可能である。
また、例えば上述の実施の形態においては、半導体装置として縦型MOSFETを例に説明しているが、半導体装置としては必ずしも縦型MOSFETに限定されるものではなく、熱処理工程を有する製造方法によって製造されるその他のトランジスタ、ダイオード、電源回路、およびインバータなどの種々の半導体装置であっても良い。
本発明は、例えば窒化ガリウム(GaN)系半導体といったワイドバンドギャップ半導体を用いた半導体装置の製造において、熱処理工程を有する場合に好適に利用できる。
1 半導体装置
2,3 被処理基板
2a,2b キャップ層
11 n−GaN基板
12 n−GaN層
13 p型ウェル領域
14 p+型ウェル領域
15 n+型ソース領域
16 ゲート電極
17 ゲート絶縁膜
18 ソース電極
19 ドレイン電極
20 ハイドライド気相成長装置(HVPE装置)
20a 第1流路
20b 第2流路
21 アルミニウムソース
30 溶液成長装置
31,41 るつぼ
32 アルミニウム融液(Al融液)
40 昇華装置
42 窒化アルミニウム粉末(AlN粉末)

Claims (11)

  1. 窒化物系半導体層を有する半導体装置の製造方法において、
    前記窒化物系半導体層の表面に窒化アルミニウム層を形成する形成工程と、
    前記形成工程後に、前記窒化物系半導体層および前記窒化アルミニウム層に対して、前記形成工程における処理温度より高い温度、かつ窒化アルミニウムの成長雰囲気において熱処理を行う熱処理工程と、
    を含むことを特徴とする半導体装置の製造方法。
  2. 前記窒化アルミニウム層が、多結晶構造膜またはエピタキシャル成長法により形成された膜であることを特徴とする請求項1に記載の半導体装置の製造方法。
  3. 前記熱処理工程における窒化アルミニウムの成長雰囲気が、窒化アルミニウムを成長させる雰囲気、または窒化アルミニウムの成長と分解とが略平衡している雰囲気であることを特徴とする請求項1または2に記載の半導体装置の製造方法。
  4. 前記熱処理工程における窒化アルミニウムの成長雰囲気が、アルミニウムを含有する有機金属ガスと、水素および窒素を含むガスとの混合ガス雰囲気によって構成される、有機金属化学気相成長雰囲気であることを特徴とする請求項1〜3のいずれか1項に記載の半導体装置の製造方法。
  5. 前記有機金属ガスがトリメチルアルミニウムガスであるとともに、前記水素および窒素を含むガスがアンモニアガスと、水素ガスおよび窒素ガスの少なくとも一方を含むガスとの混合ガスからなることを特徴とする請求項4に記載の半導体装置の製造方法。
  6. 前記熱処理工程における窒化アルミニウムの成長雰囲気が、アルミニウムを含有する塩化物ガスと、水素および窒素を含むガスとの混合ガス雰囲気によって構成される気相成長雰囲気であることを特徴とする請求項1〜3のいずれか1項に記載の半導体装置の製造方法。
  7. 前記熱処理工程における窒化アルミニウムの成長雰囲気が、アルミニウムを含む融液と窒素含有ガスとからなる溶液成長雰囲気であることを特徴とする請求項1〜3のいずれか1項に記載の半導体装置の製造方法。
  8. 前記熱処理工程における窒化アルミニウムの成長雰囲気が、窒化アルミニウムの粉末を昇華させた昇華雰囲気であることを特徴とする請求項1〜3のいずれか1項に記載の半導体装置の製造方法。
  9. 前記熱処理工程前に、前記窒化物系半導体層に不純物をドープする工程をさらに含むことを特徴とする請求項1〜8のいずれか1項に記載の半導体装置の製造方法。
  10. 前記窒化物系半導体層が窒化ガリウムからなることを特徴とする請求項1〜9のいずれか1項に記載の半導体装置の製造方法。
  11. 請求項1〜10のいずれか1項に記載の半導体装置の製造方法により製造されたことを特徴とする半導体装置。
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Families Citing this family (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
TWI549297B (zh) * 2014-11-06 2016-09-11 國立交通大學 高電子遷移率電晶體及其製造方法
CN105489723B (zh) * 2016-01-15 2018-08-14 厦门市三安光电科技有限公司 氮化物底层及其制作方法
JP6565759B2 (ja) * 2016-03-28 2019-08-28 豊田合成株式会社 半導体装置の製造方法
JP6834207B2 (ja) * 2016-07-13 2021-02-24 富士電機株式会社 半導体装置の製造方法
JP6327379B1 (ja) * 2017-04-03 2018-05-23 富士電機株式会社 窒化ガリウム半導体装置および窒化ガリウム半導体装置の製造方法
JP6709273B2 (ja) * 2018-03-28 2020-06-10 公益財団法人福岡県産業・科学技術振興財団 蒸着装置
JP7429053B2 (ja) 2019-01-24 2024-02-07 ザ リージェンツ オブ ザ ユニバーシティ オブ カリフォルニア 低減された蒸発および劣化を伴う半導体膜の加工のための方法
US20200411647A1 (en) * 2019-06-28 2020-12-31 Fuji Electric Co., Ltd. Nitride semiconductor device
WO2021161509A1 (ja) * 2020-02-14 2021-08-19 トヨタ自動車株式会社 窒化物半導体装置の製造方法
CN115295401A (zh) * 2022-08-25 2022-11-04 松山湖材料实验室 氮化铝单晶复合衬底及其制备方法、紫外发光器件

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63158836A (ja) * 1986-12-22 1988-07-01 Nec Corp 半導体素子の製造方法
JPH05183189A (ja) * 1991-11-08 1993-07-23 Nichia Chem Ind Ltd p型窒化ガリウム系化合物半導体の製造方法。
JPH08186332A (ja) * 1995-01-06 1996-07-16 Toshiba Corp 半導体素子の製造方法
JP2000323751A (ja) * 1999-05-10 2000-11-24 Pioneer Electronic Corp 3族窒化物半導体素子製造方法

Family Cites Families (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5306662A (en) 1991-11-08 1994-04-26 Nichia Chemical Industries, Ltd. Method of manufacturing P-type compound semiconductor
US5656832A (en) 1994-03-09 1997-08-12 Kabushiki Kaisha Toshiba Semiconductor heterojunction device with ALN buffer layer of 3nm-10nm average film thickness
US5998232A (en) * 1998-01-16 1999-12-07 Implant Sciences Corporation Planar technology for producing light-emitting devices
US6432788B1 (en) * 1999-07-22 2002-08-13 Implant Sciences Corporation Method for fabricating an emitter-base junction for a gallium nitride bipolar transistor
US20020096496A1 (en) * 2000-11-29 2002-07-25 Bela Molnar Patterning of GaN crystal films with ion beams and subsequent wet etching
US6849882B2 (en) * 2001-05-11 2005-02-01 Cree Inc. Group-III nitride based high electron mobility transistor (HEMT) with barrier/spacer layer
US7372077B2 (en) * 2003-02-07 2008-05-13 Sanyo Electric Co., Ltd. Semiconductor device
JP2008258503A (ja) * 2007-04-06 2008-10-23 Sumitomo Electric Ind Ltd 窒化物系半導体発光素子、および窒化物系半導体発光素子を作製する方法
US7994027B2 (en) * 2008-05-09 2011-08-09 George Mason Intellectual Properties, Inc. Microwave heating for semiconductor nanostructure fabrication
CN102197468B (zh) * 2008-10-29 2014-04-02 富士通株式会社 化合物半导体器件及其制造方法
US7977224B2 (en) * 2008-12-03 2011-07-12 The United States Of America As Represented By The Secretary Of The Army Method using multiple layer annealing cap for fabricating group III-nitride semiconductor device structures and devices formed thereby
US8518808B2 (en) * 2010-09-17 2013-08-27 The United States Of America, As Represented By The Secretary Of The Navy Defects annealing and impurities activation in III-nitride compound
JP6047995B2 (ja) * 2012-08-22 2016-12-21 住友電気工業株式会社 Iii族窒化物半導体を作製する方法、半導体素子を作製する方法、iii族窒化物半導体装置、熱処理を行う方法
US8866148B2 (en) * 2012-12-20 2014-10-21 Avogy, Inc. Vertical GaN power device with breakdown voltage control
US9018056B2 (en) * 2013-03-15 2015-04-28 The United States Of America, As Represented By The Secretary Of The Navy Complementary field effect transistors using gallium polar and nitrogen polar III-nitride material

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63158836A (ja) * 1986-12-22 1988-07-01 Nec Corp 半導体素子の製造方法
JPH05183189A (ja) * 1991-11-08 1993-07-23 Nichia Chem Ind Ltd p型窒化ガリウム系化合物半導体の製造方法。
JPH08186332A (ja) * 1995-01-06 1996-07-16 Toshiba Corp 半導体素子の製造方法
JP2000323751A (ja) * 1999-05-10 2000-11-24 Pioneer Electronic Corp 3族窒化物半導体素子製造方法

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