JP5953840B2 - 半導体装置及び受信機 - Google Patents
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Description
しかしながら、ショットキーダイオードを用いる場合、バイアス0V付近で十分な検波特性を得ることが難しかった。
なお、半導体レーザなどの半導体発光素子において、注入キャリアを効率良く活性層に閉じ込め、電子とホールを再結合させるために、多重超格子を設け、電子又はホールに対するエネルギー障壁の高さを高くする技術がある。また、半導体レーザなどの半導体発光素子において、クラッド層と活性層との間にクラッド層に対する少数キャリアの進入を制御する多重量子井戸又は多重量子障壁構造部を設ける技術がある。
ここで、電流をリニアプロットした電流−電圧特性(I−V特性)では、図40(B)中、矢印で示すように、一見、順方向バイアス時にリーク電流が生じないように見える。しかしながら、電流を対数プロットしてみると、図40(C)中、矢印で示すように、電流のリーク成分が見える。これにより、ダイオードの検波特性に影響を与えるγ(Curvature coefficient)の値が大きくなりにくい。なお、γは次式(1)で定義される。
なお、ここでは、p型GaAsSb層とn型InGaAs層とがpn接合されているバックワードダイオードを例に挙げて、その課題を説明しているが、これに限られるものではなく、他のバックワードダイオードにおいても同様の課題がある。
本受信機は、ミキサー回路を備え、ミキサー回路が、上記の半導体装置を含むことを要件とする。
[第1実施形態]
まず、第1実施形態にかかる半導体装置及び受信機について、図1〜図13を参照しながら説明する。
具体的には、バックワードダイオード12を構成するp型GaAsSb層10は、バンドギャップEgが約0.78eVであり、ドーピング濃度が2×1019cm−3であるp+−GaAs0.51Sb0.49層としている。なお、p型半導体層は、これに限られるものではなく、これよりもバンドギャップEgが小さいp−InGaAsSb層(Eg<0.78eV)などを用いても良い。また、逆にこれよりもバンドギャップEgが大きいGaAsxSb1−x(x>0.51)層(Eg>0.78eV)などを用いても良い。
このように、順方向バイアス時のリーク電流が抑制されるため、ダイオードの非線形性を現すγの値が大きくなり、例えばミリ波帯やテラヘルツ波帯などの微弱な電波を検波する検波器に用いた場合に、特にゼロバイアスでの検知能力が高くなり、十分な検波特性が得られることになる。
図3に示すように、キャリアがトンネルできるくらいに薄い障壁層と井戸層とを交互に積層して多層構造とする。このとき、井戸層も薄くすると、キャリアの存在確率が量子化され、量子準位が形成される。そして、MQB構造の障壁層の厚さを徐々に変化させて、量子準位のレベルを徐々に変化させる。これにより、全体で見ると、MQB構造をキャリアが通過できるレベルがなくなり、ブラッグ反射によって井戸層と障壁層とのバンドギャップ差から生じる障壁高さ以上のエネルギーを持つキャリアまで跳ね返されるMQB構造ができる。このときの井戸層と障壁層を構成する半導体層の膜厚の条件、即ち、井戸層と障壁層を構成する半導体層によるキャリアの反射条件は、次式(2)、(3)によって表すことができる。
本実施形態では、図12(B)に示すように、p型GaAsSb層10に設けられるp側MQB構造14は、p型GaAsSb層10に複数のp型AlGaSb層16を設けることによって構成される。つまり、p型GaAsSb層10のpn接合部13近傍において、p型GaAsSb層10とp型AlGaSb層16とを交互に積層させることによってp側MQB構造14が構成される。
まず、図10(A)に示すように、例えば半絶縁性InP基板20上に、例えばMOCVD法によって、i−InAlAsバッファー層21、n−InGaAsオーミックコンタクト層22、n−InPエッチング停止層23、n型半導体層としてのn−InGaAs層11、n−MQB構造15を構成するn−InP層17及びn−InGaAs層11、p−MQB構造14を構成するp−AlGaSb層16及びp−GaAsSb層10、p型半導体層としてのp−GaAsSb層10を形成する。なお、最も上側のp−GaAsSb層10をオーミックコンタクト層ともいう。
次に、例えばフォトレジストによってダイオードメサ領域を規定し、図10(B)に示すように、例えばリン酸と過酸化水素水の混合液で、最も上側のp−GaAsSb層10、p−MQB構造14をエッチングし、次いで、例えばCH4系のドライエッチングによって、Pが含まれるn−MQB構造15を除去する。そして、再びリン酸と過酸化水素水の混合液で最も下側のn−InGaAs層11が除去された後、エッチングはn−InPエッチング停止層23で停止する。次に、図11(A)に示すように、例えば塩酸で、n−InPエッチング停止層23をエッチングする。このエッチングはn−InGaAsオーミックコンタクト層22で停止する。ここでレジストを除去する。
次に、図12(A)に示すように、例えばフォトリソグラフィーを用いて、レジスト25で電極領域を規定する。そして、図12(B)に示すように、例えばTi(厚さ約10nm)/Pt(厚さ約30nm)/Au(厚さ約300nm)を蒸着し、リフトオフ法によって、ダイオードの上部電極26及び下部電極27を同時に形成する。このようにして、本実施形態の半導体装置に備えられるバックワードダイオード12が製造される。
ここで、上述の実施形態のバックワードダイオードの電流を対数プロットした特性を見てみると、図13中、矢印で示すように、電流のリーク成分が抑制されていることがわかる。特に、図13中、符号Xで示す部分で流れる電流が抑制されていることがわかる。これにより、上記式(1)で示されるγの値が大きくなるため、上述の実施形態のバックワードダイオードを検波器に用い、例えばミリ波帯やテラヘルツ波帯などの微弱な電波を検波する場合に、十分な検波特性が得られることになる。
例えば、図24に示すように、p型GaAsSb層10にMQW構造40を設け、n型InGaAs層11にMQB構造15を設けても良い。この場合、p型GaAsSb層10に設けられるMQW構造40は、図25に示すように、p型GaAsSb層10に複数のp型GaSb層42を設けることによって構成すれば良い。つまり、p型GaAsSb層10のpn接合部13近傍において、p型GaAsSb層10とp型GaSb層42とを交互に積層させることによってMQW構造40を構成すれば良い。また、n型InGaAs層11に設けられるMQB構造15は、n型InGaAs層11に、複数のn型InP層17を設けることによって構成すれば良い。つまり、n型InGaAs層11に設けられるMQB構造15は、n型InGaAs層11に、複数のn型InP層17を設けることによって構成すれば良い。
[第2実施形態]
次に、第2実施形態にかかる半導体装置について、図30〜図33を参照しながら説明する。
つまり、本半導体装置は、p型半導体層(p型GaAsSb層)10とn型半導体層(n型InGaAs層)11とが障壁層60を挟んでpn接合されているバックワードダイオードを備える。つまり、本半導体装置は、p型半導体層10とn型半導体層11とが障壁層60を挟んで接合されるpn接合部13を備える。
ここで、障壁層60は、伝導帯の下端がp型半導体層10の伝導帯の下端のエネルギーとn型半導体層11の伝導帯の下端のエネルギーとの間のエネルギーを持ち、かつ、価電子帯の上端がp型半導体層10の価電子帯の上端のエネルギーとn型半導体層11の価電子帯の上端のエネルギーとの間のエネルギーを持つものであれば良い。
また、ここでは、障壁層60をノンドープとしているが、これに限られるものではなく、障壁層60をn型又はp型にドーピングしても良い。例えば、障壁層60として、p型InAlGaAs、p型InxAl1−xAs、p型AlSb、n型InAlGaAs、n型InxAl1−xAsなどを用いても良い。この場合、ドーピング濃度は5×1018cm−3とすれば良い。
したがって、本実施形態にかかる半導体装置によれば、上述の第1実施形態の場合と同様に、バックワードダイオード12の順方向バイアス時のリーク電流を抑制することができるという利点がある。また、バックワードダイオード12を用いた検波器3の検波特性、ひいては、受信機1の特性を向上させることができるという利点がある。
[その他]
なお、本発明は、上述した各実施形態及び変形例に記載した構成に限定されるものではなく、本発明の趣旨を逸脱しない範囲で種々変形することが可能である。
(付記1)
p型半導体層と、
n型半導体層と、
前記p型半導体層と前記n型半導体層とが接合されるpn接合部と、
前記p型半導体層及び前記n型半導体層の少なくとも一方に設けられ、順方向バイアス時に電子及びホールの少なくとも一方に対してバリヤとなる多重量子障壁構造又は多重量子井戸構造とを備え、
逆方向バイアス時に前記pn接合部に電子がバンド間トンネリングしうる部分が形成されることを特徴とする半導体装置。
前記多重量子障壁構造又は前記多重量子井戸構造は、前記p型半導体層に設けられており、
前記pn接合部において、前記p型半導体層と前記n型半導体層とが、前記多重量子障壁構造に含まれる一の障壁層又は前記多重量子井戸構造に含まれる一の井戸層を挟んで接合されており、
前記一の障壁層又は前記一の井戸層と前記n型半導体層とによって、又は、前記多重量子障壁構造と前記n型半導体層とによって、逆方向バイアス時に前記pn接合部に電子がバンド間トンネリングしうる部分が形成されることを特徴とする、付記1に記載の半導体装置。
前記多重量子障壁構造又は前記多重量子井戸構造は、前記n型半導体層に設けられており、
前記pn接合部において、前記p型半導体層と前記n型半導体層とが、前記多重量子障壁構造に含まれる一の障壁層又は前記多重量子井戸構造に含まれる一の井戸層を挟んで接合されており、
前記一の障壁層又は前記一の井戸層と前記p型半導体層とによって、又は、前記多重量子障壁構造と前記p型半導体層とによって、逆方向バイアス時に前記pn接合部に電子がバンド間トンネリングしうる部分が形成されることを特徴とする、付記1に記載の半導体装置。
前記多重量子障壁構造又は前記多重量子井戸構造は、前記p型半導体層に設けられたp側多重量子障壁構造又はp側多重量子井戸構造、及び、前記n型半導体層に設けられたn側多重量子障壁構造又はn側多重量子井戸構造であり、
前記pn接合部において、前記p型半導体層と前記n型半導体層とが、前記p側多重量子障壁構造に含まれる一のp側障壁層又は前記p側多重量子井戸構造に含まれる一のp側井戸層、及び、前記n側多重量子障壁構造に含まれる一のn側障壁層又は前記n側多重量子井戸構造に含まれる一のn側井戸層を挟んで接合されており、
前記一のp側障壁層若しくは前記一のp側井戸層と前記一のn側障壁層若しくは前記一のn側井戸層とによって、又は、前記p側多重量子障壁構造若しくは前記p側多重量子井戸構造と前記n側多重量子障壁構造若しくは前記n側多重量子井戸構造とによって、逆方向バイアス時に前記pn接合部に電子がバンド間トンネリングしうる部分が形成されることを特徴とする、付記1に記載の半導体装置。
前記p型半導体層と前記n型半導体層との間に設けられ、伝導帯の下端が前記p型半導体層の伝導帯の下端のエネルギーと前記n型半導体層の伝導帯の下端のエネルギーとの間のエネルギーを持ち、かつ、価電子帯の上端が前記p型半導体層の価電子帯の上端のエネルギーと前記n型半導体層の価電子帯の上端のエネルギーとの間のエネルギーを持つ障壁層を備え、
前記pn接合部において、前記p型半導体層と前記n型半導体層とが、前記障壁層を挟んで接合されており、
少なくとも前記障壁層によって、逆方向バイアス時に前記pn接合部に電子がバンド間トンネリングしうる部分が形成されることを特徴とする、付記1に記載の半導体装置。
前記多重量子障壁構造又は前記多重量子井戸構造は、前記p型半導体層に設けられていることを特徴とする、付記5に記載の半導体装置。
(付記7)
前記多重量子障壁構造又は前記多重量子井戸構造は、前記n型半導体層に設けられていることを特徴とする、付記5に記載の半導体装置。
前記多重量子障壁構造又は前記多重量子井戸構造は、前記p型半導体層に設けられたp側多重量子障壁構造又はp側多重量子井戸構造、及び、前記n型半導体層に設けられたn側多重量子障壁構造又はn側多重量子井戸構造であることを特徴とする、付記5に記載の半導体装置。
前記多重量子障壁構造を構成する複数の障壁層又は前記多重量子井戸構造を構成する複数の井戸層は、p型にドーピングされていることを特徴とする、付記2又は6に記載の半導体装置。
(付記10)
前記多重量子障壁構造を構成する複数の障壁層又は前記多重量子井戸構造を構成する複数の井戸層は、n型にドーピングされていることを特徴とする、付記3又は7に記載の半導体装置。
前記p側多重量子障壁構造を構成する複数の障壁層又は前記p側多重量子井戸構造を構成する複数の井戸層は、p型にドーピングされており、
前記n側多重量子障壁構造を構成する複数の障壁層又は前記n側多重量子井戸構造を構成する複数の井戸層は、n型にドーピングされていることを特徴とする、付記4又は8に記載の半導体装置。
前記p型半導体層と前記n型半導体層とは、材料が異なることを特徴とする、付記1〜11のいずれか1項に記載の半導体装置。
(付記13)
前記p型半導体層は、GaAsSbを含み、
前記n型半導体層は、InGaAsを含み、
前記多重量子障壁構造が前記p型半導体層に設けられる場合、前記多重量子障壁構造を構成する複数の障壁層は、AlGaSb又はAlAsSbを含み、
前記多重量子井戸構造が前記p型半導体層に設けられる場合、前記多重量子井戸構造を構成する複数の井戸層は、GaSb、AlGaSb、InGaSb、InAsSb、又はInGaAsSbを含むことを特徴とする、付記1、2、4〜6、8、9、11のいずれか1項に記載の半導体装置。
前記p型半導体層は、GaAsSbを含み、
前記n型半導体層は、InGaAsを含み、
前記多重量子障壁構造が前記n型半導体層に設けられる場合、前記多重量子障壁構造を構成する複数の障壁層は、InP、InGaAs、InAlAs又はInAlGaAsを含み、
前記多重量子井戸構造が前記n型半導体層に設けられる場合、前記多重量子井戸構造を構成する複数の井戸層は、前記n型半導体層に用いられるInGaAsよりもバンドギャップが小さいInGaAs、InAlGaAs、又は、InAsSbを含むことを特徴とする、付記1、3〜5、7、8、10、11のいずれか1項に記載の半導体装置。
前記p型半導体層と前記n型半導体層とは、材料が同一であることを特徴とする、付記1〜11のいずれか1項に記載の半導体装置。
(付記16)
前記p型半導体層及び前記n型半導体層は、InGaAsを含み、
前記多重量子障壁構造が前記p型半導体層に設けられる場合、前記多重量子障壁構造を構成する複数の障壁層は、InP、又は、前記p型半導体層に用いられるInGaAsよりもバンドギャップが大きいInGaAsを含み、
前記多重量子井戸構造が前記p型半導体層に設けられる場合、前記多重量子井戸構造を構成する複数の井戸層は、前記p型半導体層に用いられるInGaAsよりもバンドギャップが小さいInGaAsを含むことを特徴とする、付記1、2、4〜6、8、9、11のいずれか1項に記載の半導体装置。
前記p型半導体層及び前記n型半導体層は、InGaAsを含み、
前記多重量子障壁構造が前記n型半導体層に設けられる場合、前記多重量子障壁構造を構成する複数の障壁層は、InP、又は、前記n型半導体層に用いられるInGaAsよりもバンドギャップが大きいInGaAsを含み、
前記多重量子井戸構造が前記n型半導体層に設けられる場合、前記多重量子井戸構造を構成する複数の井戸層は、前記n型半導体層に用いられるInGaAsよりもバンドギャップが小さいInGaAsを含むことを特徴とする、付記1、3〜5、7、8、10、11のいずれか1項に記載の半導体装置。
前記障壁層は、ノンドープInAlGaAs、ノンドープInAlAs、ノンドープAlAs、ノンドープAlSb、p型InAlGaAs、p型InAlAs、p型AlAs、p型AlSb、n型InAlGaAs、n型InAlAs、n型AlAs、n型AlSbからなる群に含まれるいずれか一種の材料を含むことを特徴とする、付記5〜8のいずれか1項に記載の半導体装置。
増幅器と、
前記増幅器に接続された検波器とを備え、
前記検波器が、付記1〜18に記載の半導体装置であることを特徴とする受信機。
(付記20)
ミキサー回路を備え、
前記ミキサー回路が、付記1〜18に記載の半導体装置を含むことを特徴とする受信機。
2 ローノイズアンプ
3 検波器
4 インダクタ
5 モノリシックマイクロ波集積回路
6 アンテナ
10 p型GaAsSb層(p型半導体層)
11 n型InGaAs層(n型半導体層)
12 バックワードダイオード
13 pn接合部
14 p側MQB構造
15 n側MQB構造
16 p型AlGaSb層(障壁層)
17 n型InP層(障壁層)
20 半絶縁性InP基板
21 i−InAlAsバッファー層
22 n−InGaAsオーミックコンタクト層
23 n−InPエッチング停止層
24、25 レジスト
26 上部電極
27 下部電極
30〜35 レジスト
40 p側MQW構造
41 n側MQW構造
42 p型GaSb層
43 n型InGaAs層
50 ミキサー(ミキサー回路)
51 入力端子
52 出力端子
53 局部発振器
54 アンプ
60 障壁層
D1 第1ダイオード
D2 第2ダイオード
R1 抵抗
C1 コンデンサ
Claims (13)
- p型半導体層と、
n型半導体層と、
前記p型半導体層と前記n型半導体層とが接合されるpn接合部とを備えるバックワードダイオードを備え、
前記バックワードダイオードは、
フラットバンド状態で、前記p型半導体層の伝導帯の下端よりも前記n型半導体層の伝導帯の下端のエネルギーが低く、かつ、前記p型半導体層の価電子帯の上端よりも前記n型半導体層の価電子帯の上端のエネルギーが低い接合を持ち、前記p型半導体層の価電子帯の上端よりも前記n型半導体層の伝導帯の下端のエネルギーが高くなっており、
前記p型半導体層及び前記n型半導体層の少なくとも一方に設けられ、順方向バイアス時に電子及びホールの少なくとも一方に対してバリヤとなる多重量子障壁構造又は多重量子井戸構造を備え、
逆方向バイアス時に前記pn接合部に電子がバンド間トンネリングしうる部分が形成されることを特徴とする半導体装置。 - 前記多重量子障壁構造又は前記多重量子井戸構造は、前記p型半導体層に設けられており、
前記pn接合部において、前記p型半導体層と前記n型半導体層とが、前記多重量子障壁構造に含まれる一の障壁層又は前記多重量子井戸構造に含まれる一の井戸層を挟んで接合されており、
前記一の障壁層又は前記一の井戸層と前記n型半導体層とによって、又は、前記多重量子障壁構造と前記n型半導体層とによって、逆方向バイアス時に前記pn接合部に電子がバンド間トンネリングしうる部分が形成されることを特徴とする、請求項1に記載の半導体装置。 - 前記多重量子障壁構造又は前記多重量子井戸構造は、前記n型半導体層に設けられており、
前記pn接合部において、前記p型半導体層と前記n型半導体層とが、前記多重量子障壁構造に含まれる一の障壁層又は前記多重量子井戸構造に含まれる一の井戸層を挟んで接合されており、
前記一の障壁層又は前記一の井戸層と前記p型半導体層とによって、又は、前記多重量子障壁構造と前記p型半導体層とによって、逆方向バイアス時に前記pn接合部に電子がバンド間トンネリングしうる部分が形成されることを特徴とする、請求項1に記載の半導体装置。 - 前記多重量子障壁構造又は前記多重量子井戸構造は、前記p型半導体層に設けられたp側多重量子障壁構造又はp側多重量子井戸構造、及び、前記n型半導体層に設けられたn側多重量子障壁構造又はn側多重量子井戸構造であり、
前記pn接合部において、前記p型半導体層と前記n型半導体層とが、前記p側多重量子障壁構造に含まれる一のp側障壁層又は前記p側多重量子井戸構造に含まれる一のp側井戸層、及び、前記n側多重量子障壁構造に含まれる一のn側障壁層又は前記n側多重量子井戸構造に含まれる一のn側井戸層を挟んで接合されており、
前記一のp側障壁層若しくは前記一のp側井戸層と前記一のn側障壁層若しくは前記一のn側井戸層とによって、又は、前記p側多重量子障壁構造若しくは前記p側多重量子井戸構造と前記n側多重量子障壁構造若しくは前記n側多重量子井戸構造とによって、逆方向バイアス時に前記pn接合部に電子がバンド間トンネリングしうる部分が形成されることを特徴とする、請求項1に記載の半導体装置。 - 前記p型半導体層と前記n型半導体層との間に設けられ、伝導帯の下端が前記p型半導体層の伝導帯の下端のエネルギーと前記n型半導体層の伝導帯の下端のエネルギーとの間のエネルギーを持ち、かつ、価電子帯の上端が前記p型半導体層の価電子帯の上端のエネルギーと前記n型半導体層の価電子帯の上端のエネルギーとの間のエネルギーを持つ障壁層を備え、
前記pn接合部において、前記p型半導体層と前記n型半導体層とが、前記障壁層を挟んで接合されており、
少なくとも前記障壁層によって、逆方向バイアス時に前記pn接合部に電子がバンド間トンネリングしうる部分が形成されることを特徴とする、請求項1に記載の半導体装置。 - 前記多重量子障壁構造又は前記多重量子井戸構造は、前記p型半導体層に設けられていることを特徴とする、請求項5に記載の半導体装置。
- 前記多重量子障壁構造又は前記多重量子井戸構造は、前記n型半導体層に設けられていることを特徴とする、請求項5に記載の半導体装置。
- 前記多重量子障壁構造又は前記多重量子井戸構造は、前記p型半導体層に設けられたp側多重量子障壁構造又はp側多重量子井戸構造、及び、前記n型半導体層に設けられたn側多重量子障壁構造又はn側多重量子井戸構造であることを特徴とする、請求項5に記載の半導体装置。
- 前記多重量子障壁構造を構成する複数の障壁層又は前記多重量子井戸構造を構成する複数の井戸層は、p型にドーピングされていることを特徴とする、請求項2又は6に記載の半導体装置。
- 前記多重量子障壁構造を構成する複数の障壁層又は前記多重量子井戸構造を構成する複数の井戸層は、n型にドーピングされていることを特徴とする、請求項3又は7に記載の半導体装置。
- 前記p側多重量子障壁構造を構成する複数の障壁層又は前記p側多重量子井戸構造を構成する複数の井戸層は、p型にドーピングされており、
前記n側多重量子障壁構造を構成する複数の障壁層又は前記n側多重量子井戸構造を構成する複数の井戸層は、n型にドーピングされていることを特徴とする、請求項4又は8に記載の半導体装置。 - 増幅器と、
前記増幅器に接続された検波器とを備え、
前記検波器が、請求項1〜11に記載の半導体装置であることを特徴とする受信機。 - ミキサー回路を備え、
前記ミキサー回路が、請求項1〜11に記載の半導体装置を含むことを特徴とする受信機。
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