JP5931204B2 - 信号生成装置 - Google Patents
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Description
図1は、本実施の形態の信号生成装置の構成例を示す図である。信号生成装置は、ディジタルフィルタ部1と、ディジタルフィルタ部2と、位相算出部3と、位相精度変換部4と、メモリ5と、係数読出し部6と、位相誤差算出部7と、メモリ8と、係数読出し部9と、利得正規化部10と、を備える。
B(m)=Φ(m)modP …(4)
w1=u(B´(m−2),1)×Z/(u(B´(m−1),0)+u(B´(m−2),1)+u(B´(m−3),2)) …(8)
w2=u(B´(m−3),2)×Z/(u(B´(m−1),0)+u(B´(m−2),1)+u(B´(m−3),2)) …(9)
Claims (5)
- 入力信号を補間して第1の補間信号を出力する第1のディジタルフィルタと、
前記第1の補間信号を補間して第2の補間信号を出力する第2のディジタルフィルタと、
前記第1および第2のディジタルフィルタの出力サンプリング周期単位に変化するディジタル信号の位相を算出する位相算出手段と、
前記ディジタル信号の位相に基づいて、第1の位相信号、および第2の位相信号を算出する位相精度変換手段と、
前記第1のディジタルフィルタのフィルタ係数を記憶する第1のメモリと、
前記第1の位相信号に基づいて前記第1のメモリからフィルタ係数を読み出し、前記第1のディジタルフィルタのフィルタ係数を切り替える第1の係数読出し手段と、
前記第2の位相信号に基づいて、位相誤差信号を算出する位相誤差算出手段と、
前記第2のディジタルフィルタのフィルタ係数を記憶する第2のメモリと、
前記位相誤差信号に基づいて前記第2のメモリからフィルタ係数を読み出す第2の係数読出し手段と、
前記第2の係数読出し手段において前記第2のメモリから読み出されたフィルタ係数の利得正規化を行い、前記第2のディジタルフィルタのフィルタ係数を切り替える利得正規化手段と、
を備えることを特徴とする信号生成装置。 - 自装置の位相分解能が前記第1のディジタルフィルタの位相分解能および前記第2のディジタルフィルタの位相分解能の積として表される場合に、
前記位相精度変換手段は、前記ディジタル信号の位相を示すビットのうち、前記第1のディジタルフィルタの位相分解能を表すビット数分の上位ビットを前記第1の位相信号とし、残りの下位ビットを前記第2の位相信号とする、
ことを特徴とする請求項1に記載の信号生成装置。 - 前記第2のディジタルフィルタが備える乗算器がK個の場合に、
前記位相誤差算出手段は、
前記出力サンプリング周期単位でKステップ前までの前記第2の位相信号を保存可能なレジスタ、を備え、
前記レジスタに保存した1ステップ前からKステップ前の前記第2の位相信号とオーバーサンプリング数とに基づいて、1ステップ前からKステップ前の位相誤差信号を算出する、
ことを特徴とする請求項1または2に記載の信号生成装置。 - 前記第2の係数読出し手段は、前記1ステップ前からKステップ前の位相誤差信号に基づいて、1ステップ前からKステップ前に前記第1のディジタルフィルタから出力された信号に対して、前記第2のディジタルフィルタのフィルタ係数を前記第2のメモリから読み出す、
ことを特徴とする請求項3に記載の信号生成装置。 - 前記第2の係数読出し手段は、前記位相誤差信号の位相誤差値と前記位相誤差信号の遅延ステップ数とに基づいて、一意に前記第2のメモリからフィルタ係数を読み出す、
ことを特徴とする請求項3に記載の信号生成装置。
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