JP5809144B2 - 基板処理方法および基板処理装置 - Google Patents
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Description
まず、COR処理によってシリコン酸化膜から生成される反応生成物であるフルオロケイ酸アンモニウム((NH4)2SiF6)の昇華温度を調べた。N2雰囲気の大気圧下でフルオロケイ酸アンモニウムを加熱し、重量変化を調べたところ図6の結果を得た。約90℃以上であれば、フルオロケイ酸アンモニウムが昇華されることが分かった。
次に、第1の工程と第2の工程を交互に7回繰り返して行い、その後、種々の方法で排気処理工程を行って処理室内のガスを強制的に排気した。その結果を図12に示す。
ウェハを1枚処理する毎に、処理室内を30秒排気して0mTorrに減圧。
ウェハを5枚処理する毎に、処理室内にアルゴンガスを1000sccm供給し、窒素ガスを1000sccm供給して30秒間パージ。
ウェハを1枚処理する毎に、処理室内にアルゴンガスを1000sccm供給し、窒素ガスを1000sccm供給して5分間パージ。
ウェハを1枚処理する毎に、処理室内にアルゴンガスと窒素ガスをいずれも1000sccm供給しながら、処理室内を5秒排気して0mTorrに減圧。
ウェハを1枚処理する毎に、処理室内にアルゴンガスと窒素ガスをいずれも100sccm供給しながら、処理室内を5秒排気して0mTorrに減圧。
ウェハを1枚処理する毎に、処理室内にアルゴンガスを1000sccm、窒素ガスを1000sccm供給し、処理室内を0mTorrに保つ15秒間の第3の工程と、処理室21内の圧力を0mTorrに減圧する10秒間の第4の工程を、交互に10回繰り返した。
ウェハを1枚処理する毎に、処理室内にアルゴンガスを1000sccm、窒素ガスを1000sccm供給し、処理室内を0mTorrに保つ3秒間の第3の工程と、処理室21内の圧力を0mTorrに減圧する5秒間の第4の工程を、交互に10回繰り返した。
1 処理システム
2 搬入出部
3 ロードロック室
4 COR処理装置
5 制御部
5a 演算部
5b 入出力部
5c 記録媒体
10 第一のウェハ搬送機構
12 搬送室
11a、11b 搬送アーム
13 載置台
13a キャリア
14 オリエンタ
16 ゲートバルブ
17 第二のウェハ搬送機構
17a 搬送アーム17a
21 処理室
30 チャンバー
31 載置台
32 ガス供給機構
33 排気機構
35 搬入出口
40 温度調節部材
45 シャワーヘッド
46 フッ化水素ガスの供給源
47 アンモニアガスの供給源
48 アルゴンガスの供給源
49 窒素ガスの供給源
51、53、55、57 流量調整弁
60 排気路
61 開閉弁
62 排気ポンプ
100 単結晶シリコン基板
101 シリコン酸化膜
102 ポリシリコン膜
103 ゲート絶縁膜
104 フローティングゲート
105 溝
106 シリコン酸化膜
107 側壁の一部
108 ONO絶縁膜
109 ポリシリコン膜(コントロールゲート)
Claims (14)
- 処理室内に収納した基板表面のSi系膜を除去する基板処理方法であって、
前記処理室内において、フッ化水素ガスとアンモニアガスによって、基板表面のSi系膜が反応生成物に変質される第1の工程と、
前記第1の工程よりも減圧された前記処理室内において、前記反応生成物が気化される第2の工程が行われ、
前記第1の工程と前記第2の工程が、2回以上繰り返され、
前記第1の工程と前記第2の工程において、基板の温度が前記反応生成物の昇華し始める温度以上にされ、
前記第1の工程と前記第2の工程において、基板の温度が変化しないことを特徴とする、基板処理方法。 - 前記第1の工程と前記第2の工程において、基板の温度が90℃以上にされることを特徴とする、請求項1に記載の基板処理方法。
- 基板表面のSi系膜が除去されることにより、基板表面において反応生成物に変質させられない膜が突出させられることを特徴とする、請求項1に記載の基板処理方法。
- 前記Si系膜がシリコン酸化膜であり、前記反応生成物に変質させられない膜がシリコン膜であることを特徴とする、請求項3に記載の基板処理方法。
- 前記第1の工程と前記第2の工程を、交互に2回以上行う除去工程を有し、
前記除去工程が前記処理室内で複数回繰り返し行われ、かつ、前記除去工程と前記除去工程との間に、前記処理室内から前記反応生成物を排出させる排気処理工程が行われ、
前記排気処理工程では、前記処理室内に不活性ガスを供給する第3の工程と、
前記処理室内を排気する第4の工程が、交互に2回以上行われることを特徴とする、請求項1に記載の基板処理方法。 - 前記第3の工程と前記第4の工程では、前記処理室内は前記反応生成物を気化させることができる圧力にされることを特徴とする、請求項5に記載の基板処理方法。
- 前記排気処理工程は、基板表面のSi系膜を除去する基板処理の最後に行われることを特徴とする、請求項5に記載の基板処理方法。
- 前記Si系膜は、シリコン酸化膜または窒化シリコン膜である、請求項1に記載の基板処理方法。
- 処理室内に収納した基板表面のSi系膜を除去する基板処理装置であって、
前記処理室内にフッ化水素ガスとアンモニアガスを供給するガス供給機構と、前記処理室内に収納した基板を温度調節する温度調節部材と、前記処理室内を排気する排気機構と、これらガス供給機構、温度調節部材および排気機構を制御する制御部を有し、
前記制御部の制御により、前記処理室内において、フッ化水素ガスとアンモニアガスによって、基板表面のSi系膜が反応生成物に変質される第1の工程と、前記第1の工程よりも減圧された前記処理室内において、前記反応生成物が気化される第2の工程が行われ、
前記第1の工程と前記第2の工程が、2回以上繰り返され、
前記第1の工程と前記第2の工程において、基板の温度が前記反応生成物の昇華し始める温度以上にされ、
前記第1の工程と前記第2の工程において、基板の温度が変化しないことを特徴とする、基板処理装置。 - 前記第1の工程と前記第2の工程において、基板の温度が90℃以上にされることを特徴とする、請求項9に記載の基板処理装置。
- 前記制御部の制御により、前記第1の工程と前記第2の工程を、交互に2回以上行う除去工程が行われ、
前記除去工程が前記処理室内で複数回繰り返し行われ、かつ、前記除去工程と前記除去工程との間に、前記処理室内から前記反応生成物を排出させる排気処理工程が行われ、
前記排気処理工程では、前記処理室内に不活性ガスを供給する第3の工程と、前記処理室内を排気する第4の工程が、交互に2回以上行われることを特徴とする、請求項9に記載の基板処理装置。 - 前記制御部の制御により、前記第3の工程と前記第4の工程では、前記処理室内は前記反応生成物を気化させることができる圧力にされることを特徴とする、請求項11に記載の基板処理装置。
- 前記制御部の制御により、前記排気処理工程は、基板表面のSi系膜を除去する基板処理の最後に行われることを特徴とする、請求項11に記載の基板処理装置。
- 前記Si系膜は、シリコン酸化膜または窒化シリコン膜である、請求項9に記載の基板処理装置。
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Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US11887861B2 (en) | 2020-01-24 | 2024-01-30 | Tokyo Electron Limited | Substrate processing method and substrate processing apparatus |
Families Citing this family (10)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP6405958B2 (ja) * | 2013-12-26 | 2018-10-17 | 東京エレクトロン株式会社 | エッチング方法、記憶媒体及びエッチング装置 |
| US9368370B2 (en) * | 2014-03-14 | 2016-06-14 | Applied Materials, Inc. | Temperature ramping using gas distribution plate heat |
| JP6435667B2 (ja) * | 2014-07-01 | 2018-12-12 | 東京エレクトロン株式会社 | エッチング方法、エッチング装置及び記憶媒体 |
| US10622205B2 (en) | 2015-02-16 | 2020-04-14 | Tokyo Electron Limited | Substrate processing method and substrate processing apparatus |
| JP6568769B2 (ja) * | 2015-02-16 | 2019-08-28 | 東京エレクトロン株式会社 | 基板処理方法及び基板処理装置 |
| JP6523119B2 (ja) * | 2015-09-28 | 2019-05-29 | 株式会社Kokusai Electric | 半導体装置の製造方法、基板処理装置およびプログラム |
| JP6643045B2 (ja) * | 2015-11-05 | 2020-02-12 | 東京エレクトロン株式会社 | 基板処理方法及び基板処理装置 |
| JP6692202B2 (ja) * | 2016-04-08 | 2020-05-13 | 東京エレクトロン株式会社 | 基板処理方法及び基板処理装置 |
| JP7550534B2 (ja) * | 2020-05-15 | 2024-09-13 | 東京エレクトロン株式会社 | エッチング方法およびエッチング装置 |
| TWI909053B (zh) * | 2021-05-31 | 2025-12-21 | 日商東京威力科創股份有限公司 | 基板處理方法及基板處理裝置 |
Citations (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008010619A (ja) * | 2006-06-29 | 2008-01-17 | Tokyo Electron Ltd | エッチング方法及び記録媒体 |
| JP2008507131A (ja) * | 2004-07-14 | 2008-03-06 | 東京エレクトロン株式会社 | 数式ベースのラン・ツウ・ラン制御 |
| JP2009164555A (ja) * | 2007-12-28 | 2009-07-23 | Hynix Semiconductor Inc | 半導体メモリ素子の素子分離膜形成方法 |
| JP2009231799A (ja) * | 2008-02-29 | 2009-10-08 | Elpida Memory Inc | 半導体装置の製造方法及び半導体製造装置 |
| JP2010109335A (ja) * | 2008-09-30 | 2010-05-13 | Tokyo Electron Ltd | シリコン酸化膜の除去方法及び処理装置 |
Family Cites Families (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7079760B2 (en) * | 2003-03-17 | 2006-07-18 | Tokyo Electron Limited | Processing system and method for thermally treating a substrate |
| US20040182315A1 (en) * | 2003-03-17 | 2004-09-23 | Tokyo Electron Limited | Reduced maintenance chemical oxide removal (COR) processing system |
| WO2007072708A1 (ja) * | 2005-12-22 | 2007-06-28 | Tokyo Electron Limited | 基板処理装置 |
| US20080045030A1 (en) * | 2006-08-15 | 2008-02-21 | Shigeru Tahara | Substrate processing method, substrate processing system and storage medium |
| JP5084250B2 (ja) | 2006-12-26 | 2012-11-28 | 東京エレクトロン株式会社 | ガス処理装置およびガス処理方法ならびに記憶媒体 |
| JP4949091B2 (ja) | 2007-03-16 | 2012-06-06 | 東京エレクトロン株式会社 | 基板処理装置、基板処理方法および記録媒体 |
| JP5352103B2 (ja) * | 2008-03-27 | 2013-11-27 | 東京エレクトロン株式会社 | 熱処理装置および処理システム |
| JP4968861B2 (ja) * | 2009-03-19 | 2012-07-04 | 東京エレクトロン株式会社 | 基板のエッチング方法及びシステム |
-
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Patent Citations (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008507131A (ja) * | 2004-07-14 | 2008-03-06 | 東京エレクトロン株式会社 | 数式ベースのラン・ツウ・ラン制御 |
| JP2008010619A (ja) * | 2006-06-29 | 2008-01-17 | Tokyo Electron Ltd | エッチング方法及び記録媒体 |
| JP2009164555A (ja) * | 2007-12-28 | 2009-07-23 | Hynix Semiconductor Inc | 半導体メモリ素子の素子分離膜形成方法 |
| JP2009231799A (ja) * | 2008-02-29 | 2009-10-08 | Elpida Memory Inc | 半導体装置の製造方法及び半導体製造装置 |
| JP2010109335A (ja) * | 2008-09-30 | 2010-05-13 | Tokyo Electron Ltd | シリコン酸化膜の除去方法及び処理装置 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US11887861B2 (en) | 2020-01-24 | 2024-01-30 | Tokyo Electron Limited | Substrate processing method and substrate processing apparatus |
Also Published As
| Publication number | Publication date |
|---|---|
| TW201225177A (en) | 2012-06-16 |
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| CN103081071A (zh) | 2013-05-01 |
| KR20160118387A (ko) | 2016-10-11 |
| US20130130499A1 (en) | 2013-05-23 |
| CN103081071B (zh) | 2015-09-30 |
| KR20130135233A (ko) | 2013-12-10 |
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| US8956546B2 (en) | 2015-02-17 |
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