JP5509724B2 - マルチチップモジュールの製造方法 - Google Patents

マルチチップモジュールの製造方法 Download PDF

Info

Publication number
JP5509724B2
JP5509724B2 JP2009191271A JP2009191271A JP5509724B2 JP 5509724 B2 JP5509724 B2 JP 5509724B2 JP 2009191271 A JP2009191271 A JP 2009191271A JP 2009191271 A JP2009191271 A JP 2009191271A JP 5509724 B2 JP5509724 B2 JP 5509724B2
Authority
JP
Japan
Prior art keywords
chips
lsi chips
lsi
heat spreader
multichip module
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
JP2009191271A
Other languages
English (en)
Other versions
JP2011044557A (ja
Inventor
正輝 小出
大輔 水谷
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
Priority to JP2009191271A priority Critical patent/JP5509724B2/ja
Priority to DE102010036812A priority patent/DE102010036812A1/de
Priority to US12/857,884 priority patent/US8546187B2/en
Publication of JP2011044557A publication Critical patent/JP2011044557A/ja
Application granted granted Critical
Publication of JP5509724B2 publication Critical patent/JP5509724B2/ja
Expired - Fee Related legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/10Bump connectors ; Manufacturing methods related thereto
    • H01L24/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L24/17Structure, shape, material or disposition of the bump connectors after the connecting process of a plurality of bump connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L24/49Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/73Means for bonding being of different types provided for in two or more of groups H01L24/10, H01L24/18, H01L24/26, H01L24/34, H01L24/42, H01L24/50, H01L24/63, H01L24/71
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/03Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
    • H01L25/04Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers
    • H01L25/065Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L27/00
    • H01L25/0655Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L27/00 the devices being arranged next to each other
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/50Multistep manufacturing processes of assemblies consisting of devices, each device being of a type provided for in group H01L27/00 or H01L29/00
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554External layer
    • H01L2224/05599Material
    • H01L2224/056Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05638Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/05647Copper [Cu] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13099Material
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48135Connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
    • H01L2224/48137Connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being arranged next to each other, e.g. on a common substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/49Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
    • H01L2224/491Disposition
    • H01L2224/4912Layout
    • H01L2224/49175Parallel arrangements
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73201Location after the connecting process on the same surface
    • H01L2224/73207Bump and wire connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/12Mountings, e.g. non-detachable insulating substrates
    • H01L23/13Mountings, e.g. non-detachable insulating substrates characterised by the shape
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/498Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
    • H01L23/49822Multilayer substrates
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/498Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
    • H01L23/49827Via connections through the substrates, e.g. pins going through the substrate, coaxial cables
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L24/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L24/81Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/00014Technical content checked by a classifier the subject-matter covered by the group, the symbol of which is combined with the symbol of this group, being disclosed without further technical details
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01004Beryllium [Be]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01005Boron [B]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01006Carbon [C]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01014Silicon [Si]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01029Copper [Cu]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01033Arsenic [As]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01074Tungsten [W]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01078Platinum [Pt]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01083Bismuth [Bi]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/013Alloys
    • H01L2924/014Solder alloys
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/102Material of the semiconductor or solid state bodies
    • H01L2924/1025Semiconducting materials
    • H01L2924/10251Elemental semiconductors, i.e. Group IV
    • H01L2924/10253Silicon [Si]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/153Connection portion
    • H01L2924/1531Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface
    • H01L2924/15311Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface being a ball array, e.g. BGA

Description

本件は、マルチチップモジュールの製造方法に関する。
異なる製造プロセスで製造されたシリコンチップを、基板上に複数個搭載したマルチチップモジュール(MCM:multi chip module)と呼ばれる半導体チップモジュールが、従来から存在している。このマルチチップモジュールでは、シリコンチップとして、むき出しの状態のベアチップが用いられており、各ベアチップをセラミックやビルドアップ基板等に形成した配線で接続している(例えば、特許文献1参照)。
特開平6−283661号公報
しかしながら、上記特許文献1では、上述のようにチップ間の接合をセラミックやビルドアップ基板等で行うことから、それらの配線仕様により生じるチャネルエリア確保のため、チップ間の間隔を大きくとる必要があった。
また、チップ間の接続精度は、マルチチップモジュールの良品率(歩留まり)に直接影響を与えるため、接続精度を高く維持することは非常に重要である。
そこで本件は上記の課題に鑑みてなされたものであり、マルチチップモジュールの歩留まりを向上することが可能なマルチチップモジュールの製造方法を提供することを目的とする
本明細書に記載のマルチチップモジュールの製造方法は、平板状部材の一側の面に、ハンダバンプを介して複数のチップを固定する工程と、前記平板状部材に固定された前記複数のチップの前記平板状部材とは反対側の面において、複数のチップ間をボンディングワイヤにより接続する工程と、前記ボンディングワイヤにより接続された前記複数のチップを、前記平板状部材とは反対側の面において基板に電気的に接続する工程と、を含むマルチチップモジュールの製造方法である。
本明細書に記載のマルチチップモジュールの製造方法は、マルチチップモジュールの歩留まりを向上することができるという効果を奏する
一実施形態に係るマルチチップモジュールを模式的に示す断面図である。 ボンディングワイヤによる接続状態を示す平面図である。 図3(a)〜図3(e)は、マルチチップモジュールの製造方法を説明するための図(その1)である。 図4(a)〜図4(d)は、マルチチップモジュールの製造方法を説明するための図(その2)である。 図5(a)、図5(b)は、マルチチップモジュールの製造方法を説明するための図(その3)である。 図6(a)、図6(b)は、マルチチップモジュールの製造方法を説明するための図(その4)である。 図7(a)、図7(b)は、マルチチップモジュールの変形例を示す図である。
以下、マルチチップモジュール及びマルチチップモジュールの製造方法の一実施形態について、図1〜図6に基づいて詳細に説明する。図1には、一実施形態にかかるマルチチップモジュール100の断面図が模式的に示されている。この図1に示すように、マルチチップモジュール100は、マザーボード200に対して、ハンダバンプ210を介して固定されている。
マルチチップモジュール100は、パッケージ基板10と、チップとしての4つのLSIチップ30A〜30D(LSIチップ30C,30Dについては、図2参照)と、平板状部材としてのヒートスプレッダ50と、を備える。
パッケージ基板10は、ビルドアップ基板とも呼ばれている。このパッケージ基板10は、コア基板と呼ばれる例えば4層の配線層を形成した基板の、表面及び裏面にそれぞれ1層から3層の配線層を形成した多層プリント基板である。パッケージ基板10に形成された配線は、マザーボード200とLSIチップ30A〜30Dとを接続するものである。基板の材料としては、例えば、エポキシ樹脂やポリイミドなどが用いられている。また、配線の材料としては、例えば、銅が用いられている。
LSIチップ30A〜30Dは、シリコンウエハに薄膜31を形成し、当該薄膜31に回路パターンを形成したものである。なお、以下においては、LSIチップ30A〜30Dの薄膜31を、薄膜回路31と呼ぶものとする。これらLSIチップ30A〜30Dは、LSIチップ30A〜30Dの位置関係を模式的に示す図2の平面図から分かるように、それぞれが近接して配置されている。
薄膜回路31の下面(パッケージ基板10側の面)には、図1に示すように、多数のパッド144が設けられている。これらパッド144のうち、図2において破線で囲んだ領域内に存在するパッド144aは、他のLSIチップの破線で囲んだ領域内に存在するパッド144aとボンディングワイヤ27により接続されている。ボンディングワイヤ27は、各LSIチップ30A〜30Dのパッド144a間を連結することにより、LSIチップ30A〜30Dを電気的に接続する。なお、図2では、ボンディングワイヤ27は、LSIチップ30Aと、LSIチップ30B,30Dとの間を接続し、LSIチップ30Cと、LSIチップ30B,30Dとの間を接続している。一方、パッド144b部分では、図1に示すように、ハンダバンプ140を介して、パッケージ基板10とLSIチップ30A〜30Dとを電気的に接続する。なお、LSIチップ30A〜30Dとパッケージ基板10との間の隙間は、樹脂(アンダーフィル材)38により封止されている。この樹脂38は、LSIの動作に支障の無い範囲の誘電率、誘電損失を有している。一方、LSIチップ30A〜30Dの上面側には、パッド139が複数設けられている。
ヒートスプレッダ50は、上面及び下面がフラットに形成された、例えば銅などの金属を材料とする板状部材である。このヒートスプレッダ50は、熱接合用ハンダバンプ40を間に介在させて、LSIチップ30A〜30Dの上面に固定されている。ヒートスプレッダ50は、LSIチップ30A〜30Dにおいて発生した熱を放散する機能を有している。なお、ヒートスプレッダ50の下面のハンダバンプ40が設けられていない部分には、ソルダーレジスト80が設けられている。
以上のように構成されるマルチチップモジュール100では、LSIチップ間がボンディングワイヤ27より接続されている。したがって、各LSIチップ30A〜30Dでは、パッド144bにおいてパッケージ基板10との電気的な接続を確保でき、かつ、LSIチップ30A〜30D全体で、擬似的に1つの大きなLSIチップとして扱うことができる。
次に、マルチチップモジュール100の製造方法について、図3〜図6に基づいて説明する。
まず、図3(a)〜図3(e)に沿って、LSIチップ30A〜30Dの製造方法について説明する。このLSIチップ30A〜30Dの製造においては、図3(a)に示すように、シリコンウエハWを用意し、図3(b)に示すように、シリコンウエハWの上面に薄膜回路31を形成する。この薄膜回路31の形成においては、半導体製造装置(半導体露光装置など)が用いられる。次いで、図3(c)に示すように、薄膜回路31上に信号用パッド144a、144bを銅などの金属をメッキして形成する。次いで、図3(d)に示すように、シリコンウエハWの薄膜回路31とは反対側の面に、パッド139を形成する。なお、この図3(d)が終了した段階で(又はそれ以前に)、シリコンウエハWは、所望の大きさにダイシングしておく必要がある。このダイシング後のものが、LSIチップ30A〜30Dとなる。次いで、図3(e)に示すように、LSIチップ30A〜30Dのパッド144b上にハンダバンプ140を形成する。なお、シリコンウエハWはハンダバンプ140を形成した後にダイシングしても良い。
次に、図4(a)に示すように、ヒートスプレッダ50を用意する。次いで、図4(b)に示すように、ヒートスプレッダ50の下面にソルダーレジスト80を貼付する。次いで、図4(c)に示すように、露光・現像工程を経てソルダーレジスト80に多数の開口部を形成する。なお、開口部においては、ヒートスプレッダ50の下面(金属面)が露出している。したがって、当該金属面には防錆処理を施しておくことが好ましい。次いで、図4(d)に示すように、ソルダーレジスト80の開口部にハンダバンプ40を形成する。
次に、図5(a)に示すように、LSIチップ30A〜30Dを、ヒートスプレッダ50の下面に搭載する。この場合、ハンダバンプ40を介して、LSIチップ30A〜30Dとヒートスプレッダ50とを接合した状態で、加熱することで、ヒートスプレッダ50とハンダバンプ40とを固定する。この状態では、LSIチップ30A〜30Dは、ヒートスプレッダ50のフラットな面(下面)に固定されているので、LSIチップ30A〜30Dの下面がほぼ面一に設定されている。
次いで、図5(b)に示すように、ボンディングワイヤ27により、LSIチップ30A〜30Dの間を電気的に接続する(ワイヤーボンディング工程)。このワイヤーボンディング工程は、ヒートスプレッダ50に対して、LSIチップ30A〜30Dが既に固定された状態で行われている。このため、LSIチップ30A〜30Dの下面がほぼ面一に設定された状態でワイヤーボンディングを行うことができるので、LSIチップ30A〜30D間の接続を精度良く行うことができる。
次いで、図6(a)に示すように、図5(b)までに製造された構造体を、パッケージ基板10上に搭載する(ハンダバンプ140で接着する)。そして、図6(b)に示すように、パッケージ基板10と、LSIチップ30A〜30Dとの間を樹脂38で封止することで、マルチチップモジュール100の製造が完了することになる。
その後、上記のようにして製造されたマルチチップモジュール100は、図1に示すように、ハンダバンプ210を介して、マザーボード200に固定される。
以上、詳細に説明したように、本実施形態によると、平板状のヒートスプレッダ50の一側の面(図5(a)における下側の面)に、ハンダバンプ40を介して複数のLSIチップ30A〜30Dを固定し、その複数のLSIチップ30A〜30Dのヒートスプレッダ50とは反対側の面(図5(b)における下側の面)において、チップ間をボンディングワイヤ27により接続する。そして、LSIチップ30A〜30Dのヒートスプレッダ50とは反対側の面(図6(a)における下側の面)において、パッケージ基板10を電気的に接続する。したがって、ヒートスプレッダ50に対してLSIチップ30A〜30Dが既に固定された状態、すなわち、LSIチップ30A〜30Dそれぞれの下面の高さをほぼ一致させた状態で、ワイヤーボンディングを行うことができる。これにより、LSIチップ間を、ボンディングワイヤ27で精度良く接続することが可能である。これにより、マルチチップモジュール100の歩留まりを向上することが可能である。
また、本実施形態によると、各LSIチップ30A〜30D間をボンディングワイヤ27で接続して、擬似的に1つのチップを構成することとしている。したがって、大きなチップを直接製造するような場合と比べて、大型の製造装置を用いる必要がない。このため、技術的に容易でかつコストの低減を図ることが可能である。
また、本実施形態では、パッケージ基板10をLSIチップ30A〜30Dに対して電気的に接続した後で、パッケージ基板10とLSIチップ30A〜30Dとの間を樹脂38により封止する。したがって、樹脂38として、LSIの動作に支障の無い範囲の誘電率、誘電損失を有する樹脂を用いることで、ボンディングワイヤにおける伝送効率を高く維持することが可能である。
また、本実施形態では、複数のLSIチップ30A〜30Dとヒートスプレッダ50との間に、ハンダバンプ40が設けられている。ここで、ハンダバンプ40は、ほぼ一定の径とすることができることから、LSIチップ30A〜30Dの下面の高さを同一に維持しつつ、LSIチップ30A〜30Dとヒートスプレッダ50との間を固定することが可能である。また、本実施形態では、LSIチップ30A〜30Dとヒートスプレッダ50との間にハンダバンプ40が設けられている。したがって、LSIチップ30A〜30Dにおいて発生した熱を、ハンダバンプ40を介して、ヒートスプレッダ50に効率的に伝達することができる。
更に、本実施形態では、LSIチップ30A〜30Dの薄膜回路31側(LSIチップ30A〜30Dの下面側)に、ボンディングワイヤ27が接続される。したがって、薄膜回路31に接続用の回路等を形成すれば良いことから、ボンディングワイヤ27が接続される部分を簡易に形成することができる。
なお、上記実施形態では、パッケージ基板10が平板状の基板である場合について説明したが、これに限られるものではない。例えば、図7(a)に示すように、パッケージ基板10の、ボンディングワイヤ27に近接する部分に、ボンディングワイヤ27との接触を回避するための凹部10aを設けることとしても良い。また、これに代えて、例えば、図7(b)に示すように、パッケージ基板10に貫通孔10bを設けることとしても良い。この場合、樹脂38は、図10(b)に示すように、貫通孔10b全体に満たされなくても良い。
なお、上記実施形態では、ヒートスプレッダ50とLSIチップ30A〜30Dとの間をハンダバンプ40で固定することとした。しかしながら、これに限られるものではなく、これに加えて、ヒートスプレッダ50とLSIチップ30A〜30D間に熱伝導性の樹脂を充填しても良い。これにより、LSIチップ30A〜30Dにおいて発生した熱をヒートスプレッダ50に効果的に伝達することができる。
また、上記実施形態では、LSIチップ30A〜30Dとパッケージ基板10との間に、樹脂38を設ける場合について説明したが、これに限らず、樹脂38を設けなくても良い。また、上記実施形態では、ヒートスプレッダ50の下面にLSIチップ30A〜30Dを固定してワイヤーボンディングを行う場合について説明した。しかしながら、これに限られるものではなく、ヒートスプレッダ50以外の平板状部材にLSIチップ30A〜30Dを固定してワイヤーボンディングを行うこととしても良い。
なお、上記実施形態では、LSIチップが4つ設けられた場合について説明したが、これに限らず、LSIチップは任意の数(複数)設けることとしても良い。また、上記実施形態では、チップとして、LSIチップを用いることとしたが、これに限らず、その他のチップを用いることとしても良い。
上述した実施形態は本発明の好適な実施の例である。但し、これに限定されるものではなく、本発明の要旨を逸脱しない範囲内において種々変形実施可能である。
10 パッケージ基板(基板)
27 ボンディングワイヤ
30A〜30D チップ(LSIチップ)
38 樹脂
40 ハンダバンプ
50 ヒートスプレッダ(平板状部材)
100 マルチチップモジュール

Claims (2)

  1. 平板状部材の一側の面に、ハンダバンプを介して複数のチップを固定する工程と、
    前記平板状部材に固定された前記複数のチップの前記平板状部材とは反対側の面において、複数のチップ間をボンディングワイヤにより接続する工程と、
    前記ボンディングワイヤにより接続された前記複数のチップを、前記平板状部材とは反対側の面において基板に電気的に接続する工程と、を含むマルチチップモジュールの製造方法。
  2. 前記基板を前記複数のチップに対して電気的に接続した後、前記基板と前記複数のチップとの間を樹脂により封止する工程を更に含む請求項1に記載のマルチチップモジュールの製造方法。
JP2009191271A 2009-08-20 2009-08-20 マルチチップモジュールの製造方法 Expired - Fee Related JP5509724B2 (ja)

Priority Applications (3)

Application Number Priority Date Filing Date Title
JP2009191271A JP5509724B2 (ja) 2009-08-20 2009-08-20 マルチチップモジュールの製造方法
DE102010036812A DE102010036812A1 (de) 2009-08-20 2010-08-03 Mehrchipmodul und Verfahren zu seiner Herstellung
US12/857,884 US8546187B2 (en) 2009-08-20 2010-08-17 Electronic part and method of manufacturing the same

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2009191271A JP5509724B2 (ja) 2009-08-20 2009-08-20 マルチチップモジュールの製造方法

Publications (2)

Publication Number Publication Date
JP2011044557A JP2011044557A (ja) 2011-03-03
JP5509724B2 true JP5509724B2 (ja) 2014-06-04

Family

ID=43495618

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2009191271A Expired - Fee Related JP5509724B2 (ja) 2009-08-20 2009-08-20 マルチチップモジュールの製造方法

Country Status (3)

Country Link
US (1) US8546187B2 (ja)
JP (1) JP5509724B2 (ja)
DE (1) DE102010036812A1 (ja)

Families Citing this family (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2013145459A1 (ja) * 2012-03-29 2013-10-03 アイシン・エィ・ダブリュ株式会社 コイル
US10692794B2 (en) * 2016-01-14 2020-06-23 Mitsubishi Electric Corporation Radiation plate structure, semiconductor device, and method for manufacturing radiation plate structure
US10304800B2 (en) * 2017-06-23 2019-05-28 Taiwan Semiconductor Manufacturing Company Ltd. Packaging with substrates connected by conductive bumps
US11652060B2 (en) * 2018-12-28 2023-05-16 Intel Corporation Die interconnection scheme for providing a high yielding process for high performance microprocessors
US20220320026A1 (en) * 2021-03-26 2022-10-06 Qualcomm Incorporated Package comprising wire bonds coupled to integrated devices

Family Cites Families (18)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01127040U (ja) * 1988-02-25 1989-08-30
JPH05275570A (ja) * 1992-03-27 1993-10-22 Nippon Steel Corp 半導体装置
JP3318786B2 (ja) 1993-03-29 2002-08-26 ソニー株式会社 マルチチップモジュールの構造
JP3235452B2 (ja) 1995-03-20 2001-12-04 松下電器産業株式会社 高周波集積回路装置
JPH0964252A (ja) * 1995-08-25 1997-03-07 Hitachi Ltd 半導体装置
US5796165A (en) 1996-03-19 1998-08-18 Matsushita Electronics Corporation High-frequency integrated circuit device having a multilayer structure
JPH1167963A (ja) 1997-08-26 1999-03-09 Matsushita Electric Works Ltd 半導体装置
US6525414B2 (en) * 1997-09-16 2003-02-25 Matsushita Electric Industrial Co., Ltd. Semiconductor device including a wiring board and semiconductor elements mounted thereon
JP2870533B1 (ja) 1997-11-27 1999-03-17 日本電気株式会社 半導体装置およびその製造方法
US20020074637A1 (en) * 2000-12-19 2002-06-20 Intel Corporation Stacked flip chip assemblies
JP3839267B2 (ja) * 2001-03-08 2006-11-01 株式会社ルネサステクノロジ 半導体装置及びそれを用いた通信端末装置
US7462509B2 (en) * 2006-05-16 2008-12-09 International Business Machines Corporation Dual-sided chip attached modules
US7592691B2 (en) * 2006-09-01 2009-09-22 Micron Technology, Inc. High density stacked die assemblies, structures incorporated therein and methods of fabricating the assemblies
TWI325617B (en) * 2006-12-18 2010-06-01 Chipmos Technologies Inc Chip package and method of manufacturing the same
TWI358816B (en) * 2008-03-19 2012-02-21 Chipmos Technologies Inc Chip package structure
US8008764B2 (en) * 2008-04-28 2011-08-30 International Business Machines Corporation Bridges for interconnecting interposers in multi-chip integrated circuits
US8174103B2 (en) * 2008-05-01 2012-05-08 International Business Machines Corporation Enhanced architectural interconnect options enabled with flipped die on a multi-chip package
TWI501376B (zh) * 2009-10-07 2015-09-21 Xintec Inc 晶片封裝體及其製造方法

Also Published As

Publication number Publication date
US8546187B2 (en) 2013-10-01
US20110042806A1 (en) 2011-02-24
DE102010036812A1 (de) 2011-02-24
JP2011044557A (ja) 2011-03-03

Similar Documents

Publication Publication Date Title
JP5635247B2 (ja) マルチチップモジュール
US20210398930A1 (en) Semiconductor device and manufacturing method thereof
TWI496270B (zh) 半導體封裝件及其製法
EP2555240B1 (en) Packaging substrate having embedded interposer and fabrication method thereof
JP5259095B2 (ja) 半導体装置
US7989959B1 (en) Method of forming stacked-die integrated circuit
US9230901B2 (en) Semiconductor device having chip embedded in heat spreader and electrically connected to interposer and method of manufacturing the same
US9548220B2 (en) Method of fabricating semiconductor package having an interposer structure
JP2011082293A (ja) インターポーザ実装配線基板及び電子部品装置
TW201405728A (zh) 半導體封裝及半導體封裝基座的製造方法
JP2008258621A (ja) 半導体デバイスパッケージの構造、および半導体デバイスパッケージ構造の形成方法
KR20130075251A (ko) 복수의 세그먼트로 구성된 인터포저를 포함하는 반도체 패키지
US8811031B2 (en) Multichip module and method for manufacturing the same
JP2008258604A (ja) 並列構成のマルチチップを有する半導体デバイスパッケージおよびその製造方法
JP5509724B2 (ja) マルチチップモジュールの製造方法
JP2008210912A (ja) 半導体装置及びその製造方法
JP5282005B2 (ja) マルチチップモジュール
JP2010074072A (ja) 半導体装置および半導体装置の製造方法
KR101824727B1 (ko) 반도체 디바이스의 제조 방법 및 이에 따른 반도체 디바이스
JP2005044989A (ja) 半導体パッケージ及びその製造方法
KR20210147453A (ko) 반도체 패키지 및 그 제조 방법
WO2014171403A1 (ja) 半導体装置
KR101753519B1 (ko) 반도체 디바이스의 제조 방법 및 이에 따른 반도체 디바이스
JP5297445B2 (ja) 半導体装置
JP2014078760A (ja) マルチチップモジュール

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20120405

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20130131

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20130212

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20130403

A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20131203

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20140108

A911 Transfer to examiner for re-examination before appeal (zenchi)

Free format text: JAPANESE INTERMEDIATE CODE: A911

Effective date: 20140203

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20140225

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20140310

R150 Certificate of patent or registration of utility model

Ref document number: 5509724

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150

LAPS Cancellation because of no payment of annual fees