JP5504985B2 - データ処理装置 - Google Patents
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Description
Claims (3)
- 回路構成を部分的に再構成可能な再構成可能回路と、
前記再構成可能回路の回路構成の再構成を制御する再構成制御手段と、
を備え、
前記再構成制御手段は、
1つのパイプラインを構成し且つ前記再構成可能回路上に同時に再構成可能な複数の部分回路を、前記パイプラインの先頭の部分回路から順に前記再構成可能回路上に再構成し、再構成された部分回路から順に起動していくデータ処理装置であって、
前記部分回路を前記再構成可能回路上に再構成する際に、前記パイプラインにおける当該部分回路の直前の部分回路が出力してメモリに記憶されたデータを、当該メモリから当該部分回路へと入力するための第1の入力回路と、当該部分回路から出力されたデータを前記メモリに記憶するための第1の出力回路と、を更に再構成し、
前記部分回路から出力されたデータが前記パイプラインにおける当該部分回路の次の部分回路に出力されるようにするための第2の出力回路と、前記第1の出力回路と前記第2の出力回路を択一的に選択する出力選択回路と、を更に再構成し、
前記データ処理装置は、更に、
前記次の部分回路が前記再構成可能回路上に再構成される前は前記出力選択回路が前記第1の出力回路を選択するように制御し、前記次の部分回路が前記再構成可能回路上に再構成された後は前記出力選択回路が前記第2の出力回路を選択するように制御する選択制御手段、を更に備える、
ことを特徴とするデータ処理装置。 - 回路構成を部分的に再構成可能な再構成可能回路と、
前記再構成可能回路の回路構成の再構成を制御する再構成制御手段と、
を備え、
前記再構成制御手段は、
1つのパイプラインを構成し且つ前記再構成可能回路上に同時に再構成可能な複数の部分回路を、前記パイプラインの先頭の部分回路から順に前記再構成可能回路上に再構成し、再構成された部分回路から順に起動していくとともに、
1つのパイプラインを構成し且つ前記再構成可能回路上に同時に再構成可能な複数の部分回路からなる組を表す回路情報を複数組分有しており、
当該複数組のうちの第1の組の回路情報に従って当該第1の組の複数の部分回路をパイプラインにおける順序に従って再構成して起動し、当該第1の組の複数の部分回路によるデータ処理の後、当該複数組のうちの第2の組の回路情報に従って当該第2の組の複数の部分回路をパイプラインにおける順序に従って再構成して起動する組順次再構成制御を実行し、
前記第2の組のパイプラインにおける先頭の部分回路は、前記第1の組のパイプラインにおける先頭の部分回路以外の部分回路と干渉しない領域に再構成されるよう設計されており、
前記組順次再構成制御では、前記第1の組のパイプラインの先頭の部分回路がデータ処理を完了した後、当該パイプラインの他の部分回路がデータ処理を完了する前に、前記第2の組の複数の部分回路のうちのパイプラインの先頭の部分回路の再構成を開始する、
ことを特徴とするデータ処理装置。 - 前記各部分回路を再構成するのに要する部分回路再構成時間は互いに同等であり、
前記データ処理装置は、
処理対象のデータを前記複数の部分回路からなるパイプラインで処理するのに要するデータ処理時間の方が、前記部分回路再構成時間より長い場合、前記処理対象のデータを前記複数の部分回路の個数に分割し、分割結果の部分データごとに、前記複数の部分回路の先頭の部分回路に入力する分割入力手段、
を更に備える請求項1に記載のデータ処理装置。
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