JP2006236106A - データ処理装置及びデータ処理方法 - Google Patents
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- G06F15/8007—Architectures of general purpose stored program computers comprising an array of processing units with common control, e.g. single instruction multiple data processors single instruction multiple data [SIMD] multiprocessors
Abstract
【解決手段】 データを処理する単位処理部が複数構成されたデータ処理部101に実行させるデータ処理の内容と複数の単位処理部の間の接続経路とを規定するデータ103をコンフィギュレーション制御部102に記憶しておき、記憶したデータ103に基づいてデータ処理部101が実行するデータ処理の内容と接続経路とを再構成する。
【選択図】 図1
Description
尚、上述のコンフィギュレーションデータ310、コンフィギュレーションデータ入力制御データ311、コンフィギュレーション手順データ312、コンフィギュレーション手順データ入力制御データ313、及びシーケンシャルトリガ314は、リコンフィギュラブル処理デバイスを制御する不図示のCPU等から供給されるものである。
102 コンフィギュレーション制御部
103 コンフィギュレーションデータ
201 単位処理部
202 第2のスイッチ
203 データ伝送部
204 第1のスイッチ
205 データ入力部
206 データ出力部
207 外部データ入出力部
301 コンフィギュレーションデータ記憶部
302 セレクタ
303 シーケンシャルセレクタ制御部
304 コンフィギュレーションデータ分配部
310 コンフィギュレーションデータ
311 コンフィギュレーションデータ入力制御データ
312 コンフィギュレーション手順データ
313 コンフィギュレーション手順データ入力制御データ
314 シーケンシャルトリガ
Claims (8)
- 複数のデータ処理手段と、
前記複数のデータ処理手段に実行させるデータ処理の内容と前記複数のデータ処理手段間の接続経路とを規定するデータを記憶する記憶手段と、
前記記憶手段に記憶されたデータに基づいて前記データ処理の内容と前記接続経路とを再構成する再構成手段とを有することを特徴とするデータ処理装置。 - 前記記憶手段は、複数のプレーンで構成され、各プレーンに異なるデータ処理の内容と異なる接続経路とをそれぞれ規定するデータを記憶することを特徴とする請求項1記載のデータ処理装置。
- 前記再構成手段は、前記複数のプレーンの何れか1つを選択する選択手段を含み、当該選択されたプレーンに記憶されたデータに基づいて前記データ処理の内容と前記接続経路とを再構成することを特徴とする請求項2記載のデータ処理装置。
- 前記選択手段は、所定のトリガ入力に基づいて前記複数のプレーンの何れか1つを選択することを特徴とする請求項3記載のデータ処理装置。
- 前記再構成手段は、前記データ処理の処理単位毎に前記記憶手段に記憶されたデータに基づいて前記データ処理の内容と前記接続経路とを再構成することを特徴とする請求項1乃至請求項4の何れか一項に記載のデータ処理装置。
- 複数のデータ処理手段と、前記複数のデータ処理手段に実行させるデータ処理の内容と前記複数のデータ処理手段間の接続経路とを規定するデータを記憶する記憶手段と、前記記憶手段に記憶されたデータに基づいて前記データ処理の内容と前記接続経路とを再構成する再構成手段とを有するデータ処理装置におけるデータ処理方法であって、
前記記憶手段に前記データ処理の内容を規定するデータと、異なるデータ処理の内容とを規定するデータとをそれぞれ記憶させる記憶工程と、
前記データ処理を実行中に、異なるデータ処理を実行させる際に、前記記憶工程で記憶された前記異なるデータ処理の内容を規定するデータを選択し、前記異なるデータ処理を実行させるように前記再構成手段を制御する制御工程とを有することを特徴とするデータ処理方法。 - 請求項6記載のデータ処理方法をコンピュータに実行させるためのプログラム。
- 請求項7記載のプログラムを記録したコンピュータ読み取り可能な記録媒体。
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