JP5172504B2 - 演算増幅器 - Google Patents
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- 238000001514 detection method Methods 0.000 claims description 22
- 239000003990 capacitor Substances 0.000 claims description 13
- 238000010586 diagram Methods 0.000 description 13
- 101001081606 Homo sapiens Islet cell autoantigen 1 Proteins 0.000 description 11
- 102100027640 Islet cell autoantigen 1 Human genes 0.000 description 11
- 230000010355 oscillation Effects 0.000 description 7
- 230000007423 decrease Effects 0.000 description 5
- 102100040121 Allograft inflammatory factor 1 Human genes 0.000 description 3
- 101000890626 Homo sapiens Allograft inflammatory factor 1 Proteins 0.000 description 3
- 102100026110 Protein THEMIS2 Human genes 0.000 description 2
- 101150104376 Themis2 gene Proteins 0.000 description 2
- 230000003321 amplification Effects 0.000 description 2
- 238000003199 nucleic acid amplification method Methods 0.000 description 2
- 230000006866 deterioration Effects 0.000 description 1
- 230000002542 deteriorative effect Effects 0.000 description 1
- 230000002265 prevention Effects 0.000 description 1
- 230000035945 sensitivity Effects 0.000 description 1
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Description
この演算増幅器は、前段増幅部101Aと、プリドライバ部102Aと、プッシュプル出力段103Aと、アイドル電流供給部104Aとに大別されて構成されてなるものである。
そして、この電流ICA1が過大であると、出力トランジスタQA1の性能劣化を招く原因となる。
すなわち、電流ICA1が所定値以上となると、電流検出用の抵抗器RA1における電圧降下により、トランジスタQA5のエミッタ・ベース間電圧VBEA5が上昇し、その結果、トランジスタQA5がオンとなり、電流ICA5がトランジスタQ10のベースへ向かって流れるととなる。そのため、ノードVpの電位が上昇し、先に述べた電流IB01の前段増幅部101への流れ込みを抑圧するよう作用し、出力トランジスタQA1における電流ICA1の増大が抑圧されるようになっている。
すなわち、図12の構成における出力トランジスタQA1のトランスコンダクタンスGmは、下記する式1により表される。
また、図12に示された過電流保護回路を設けた場合と、かかる過電流保護回路を有しない図11に示された従来回路とを、出力電流ICA1で比較して見ると、図7に示されたように過電流保護回路が無い場合に比して、過電流保護回路を有する従来回路にあっては、格段に電流制限がなされていることが確認できるが、その結果として、最大出力電圧も、過電流保護回路が無い場合に比して低下するものとなっている(図8参照)。
このように、従来回路においては、出力電流の温度特性を任意に設定することができず、抵抗器RA1の温度特性によっては出力電流の限界値ICA1maxの温度に対する感度が鋭敏となり動作の安定性を著しく悪化させるという問題を招くことがある。
本発明の他の目的は、発振を生ずることのない安定した動作が可能な過電流保護回路を有する演算増幅器を提供することにある。
本発明の他の目的は、出力電流の限界値の設定における温度依存性を軽減することにある。
本発明の他の目的は、熱暴走を招くことのない安定した動作が可能な過電流保護回路を有する演算増幅器を提供することにある。
入力信号に対して差動出力が得られるよう構成された前段増幅部と、前記前段増幅器の出力を電圧・電流変換するプリドライバ部と、前記プリドライバ部からの入力信号を増幅出力するプッシュプル出力段を具備してなる演算増幅器であって、
前記プリドライバ部は、ベースが前記前段増幅部の出力段に接続される一方、エミッタが第1の定電流源に接続されたPNP形の第1のトランジスタを有してなる一方、
前記第1のトランジスタのコレクタ電流の増大に応じて、前記プシュプル出力段の出力電流の増大を抑圧するよう構成されてなる過電流保護回路が設けられ、
当該過電流保護回路は、一端に第1の電源電圧が印加され、他端に過電流保護回路用カレントミラーを介して前記プリドライバ部の第1のトランジスタのコレクタ電流に応じた電流が流れるよう電流検出用抵抗器が設けられ、
当該電流検出用抵抗器と前記過電流保護回路用カンレントミラーとの接続点には、過電流保護用のPNP形トランジスタのベースが接続され、当該過電流保護用のPNP形トランジスタのエミッタには、前記第1の電源電圧が印加される一方、そのコレクタは、前記前段増幅部の出力段に接続され、
前記過電流保護回路用カレントミラーは、ベースとコレクタとが接続されたNPN形のカレントミラー用第1のトランジスタと、当該カレントミラー用第1のトランジスタとベースが相互に接続されたNPN形のカレントミラー用第2のトランジスタとを有し、前記カレントミラー用第1及び第2のトランジスタのエミッタには、共に第2の電源電圧が印加され、前記カレントミラー用第1のトランジスタのコレクタは、前記プリドライバ部の第1のトランジスタのコレクタに接続される一方、前記カレントミラー用第2のトランジスタのコレクタは、前記電流検出用抵抗器の一端に接続され、
前記プッシュプル出力段を構成するハイサイド側のトランジスタのベースが、前記プリドライバ部のPNP形の第1のトランジスタのエミッタに接続され、
前記過電流保護用のPNP形トランジスタのコレクタと、前記電流検出用抵抗器と前記過電流保護回路用カレントミラーのカレントミラー用第2のトランジスタのコレクタとの接続点との間に、キャパシタが接続され、
前記過電流保護用抵抗器の両端に、前記第1の定電流源とほぼ等しい温度特性を有する過電流保護回路用の定電流源が並列接続されて設けられてなるものである。
また、過電流保護回路のトランジスタのベースとコレクタとの間にキャパシタを設ける構成とすることにより、演算増幅器の外部帰還が無くなった場合の発振を防止し、安定した過電流保護動作を確保することができる。
また、過電流保護回路のトランジスタのベースにベース抵抗器を設ける構成とすることにより、熱暴走を確実に防止し、回路の信頼性の向上を図ることができる。
さらに、過電流保護回路に定電流源を設け、第1のトランジスタのエミッタに接続された第1の定電流源と同一の温度特性として、双方の電流を所定の関係に設定する構成とすることにより、出力電流の制限値の温度特性を、従来に比して、より容易に制御可能とすることができ、温度依存性を軽減することができる。
なお、以下に説明する部材、配置等は本発明を限定するものではなく、本発明の趣旨の範囲内で種々改変することができるものである。
最初に、本発明の実施の形態における演算増幅器の第1の構成例について、図1を参照しつつ説明する。
本発明の実施の形態における演算増幅器は、前段増幅部101と、プリドライバ部102と、プッシュプル出力段103と、アイドル電流供給部104と、過電流保護回路105に大別されて構成されたものとなっている。
以下、具体的に回路構成について説明することとする。なお、以下の説明において、第1、第2、第7乃至第10のトランジスタ1、2、7〜10にはPNP形が、第3乃至第6のトランジスタ3〜6、第11乃至第13のトランジスタ11〜13にはNPN形が、それぞれ用いられているものとする。
前段増幅部101の出力段には、プリドライバ部102を構成する第1のトランジスタ(図1においては「Q1」と表記)1のベースと、過電流保護回路105を構成する第10のトランジスタ(図1においては「Q10」と表記)10のコレクタが接続されている。
第1のトランジスタ1は、エミッタに定電流I01を出力する第1の定電流源21の一端に接続される一方、コレクタは、第11のトランジスタ(図1においては「Q11」と表記)11のコレクタが接続されている。
なお、第1の定電流源21は、その他端に第1の電源電圧V+が印加されるようになっている。
この第11のトランジスタ11のベースは、第12のトランジスタ(図1においては「Q12」と表記)12のベースに接続されており、第12のトランジスタ12のコレクタは、後述する過電流保護回路105を構成する電流検出用抵抗器31の一端及び第10のトランジスタ10のベースに接続される一方、エミッタは、第2の電源電圧V−が印加されるようになっている。
しかして、第11及び第12のトランジスタ11,12によりカレントミラーが構成されたものとなっている。
また、第2のトランジスタ2のエミッタには、第1の電源電圧V+が印加されるようになっており、第2のトランジスタ2は、ハイサイド側のトランジスタとされる一方、第3のトランジスタ3のエミッタは、第2の電源電圧V−が印加されるようになっており、第3のトランジスタ3は、ローサイド側のトランジスタとなっている。
そして、第2のトランジスタ2のベースは、プリドライバ部102の第1のトランジスタ1のエミッタに接続されている。
そして、第4のトランジスタ4のコレクタには、定電流I02を出力する第2の定電流源22の一端が接続されており、この第2の定電流源22の他端には、第1の電源電圧V+が印加されるようになっている。
また、第4のトランジスタ4のエミッタには、第6のトランジスタ(図1においては「Q6」と表記)6のコレクタ及びベースが接続されている。
一方、第5のトランジスタ5は、コレクタが先の第2のトランジスタ2のベースに接続される一方、エミッタは、定電流I05を出力する第5の定電流源25の一端に接続されており、この第5の定電流源25の他端は、第2の電源電圧V−が印加されるようになっている。
そして、第7のトランジスタ4のコレクタには、定電流I04を出力する第4の定電流源24の一端が接続されており、この第4の定電流源24の他端には、第2の電源電圧V−が印加されるようになっている。
第9のトランジスタ9は、上述のようにダイオード接続されており、エミッタは、第1の電源電圧V+が印加されるようになっている。
また、第8のトランジスタ8のコレクタは、第5のトランジスタ5のエミッタ及び第3のトランジスタ3のベースに接続されている。
すなわち、第10のトランジスタ10は、そのエミッタに第1の電源電圧V+が印加されるようになっている一方、コレクタは、先に述べたように第1のトランジスタ1のベースに接続されている。
さらに、第10のトランジスタ10のベースは、電流検出用抵抗器31と第12のトランジスタの相互の接続点に接続されており、電流検出用抵抗器31の他端は、第1の電源電圧V+が印加されるようになっている。
最初に、第2の構成例について、図2を参照しつつ説明する。なお、図1に示された構成要素と同一の構成要素については、同一の符号を付して、その詳細な説明を省略し、以下、異なる点を中心に説明することとする。
この第2の構成例は、図1に示された構成において、さらに、発振防止用のキャパシタ(図2においては「CB1」と表記)35を追加した構成となっているものである。
すなわち、キャパシタ35は、その一端が第10のトランジスタ10のコレクタに、他端が電流検出用抵抗器31と第12のトランジスタ12のコレクタとの接続点に接続されたものとなっている。
この第3の構成例は、定電流I06を出力する第6の定電流源26が、電流検出用抵抗器31に対して並列接続されて設けられたものである。
この第4の構成例は、第10のトランジスタ10のベース抵抗器(図4においては「RB2」と表記)32を設けたものである。
すなわち、ベース抵抗器32は、その一端が第10のトランジスタ10のベースに、他端が電流検出用抵抗器31と第12のトランジスタ12のコレクタとの接続点に接続されたものとなっている。
この第5の構成例は、図1に示された基本構成に対して、図2乃至図4に示されたそれぞれの構成を適用し、かつ、第11及び第12のトランジスタ11,12と共にカレントミラーを構成するNPN形の第13のトランジスタ(図5においては「Q13」と表記)13が設けられたものとなっている。
すなわち、第13のトランジスタ13は、そのベースが第11及び第12のトランジスタ11,13のベースと相互に接続される一方、コレクタは、第2のトランジスタ2のベースに接続され、エミッタは、第2の電源電圧V−が印加されるようになっている。
まず、反転入力端子43と正転入力端子42に、VIN-≫VIN+となる電圧が印加されたとする。これによって、前段増幅部101の出力段には、シンク電流IB01が第1のトランジスタ1のベースから流れ込み、ノードVpの電位が低下するため、第1のトランジスタ1は、コレクタ電流IC01を流すよう動作することとなる。
これにより、第2のトランジスタ2のコレクタには、ベース電流IBA1がβPNP倍されたコレクタ電流ICA1が流れることとなる(図6参照)。 なお、ここで、βPNPは、PNP形トランジスタの電流増幅率である。
したがって、第11〜13のトランジスタ11〜13の特性が等しい場合、下記する式4に示されたように電流検出用抵抗器31の抵抗値RB1を設定することにより、出力電流ICA1が所望の大きさとなった際に、過電流保護動作が行われるようにすることができる。
このように、本発明の実施の形態においては、電流検出用抵抗器31は、従来と異なり、出力段、すなわち、第2のトランジスタ2と直列接続されて設けられてないため、最大出力電圧を犠牲にすることなく過電流保護が可能となっている。
そして、図8には、本発明の実施の形態における演算増幅器と、従来の過電流保護回路を有する演算増幅器において、それぞれ出力電流の制限を同程度とした場合の、電源電圧の変化に対する最大出力電圧の変化特性例が示されている。同図によれば、本発明の実施の形態における演算増幅器の場合、過電流保護回路を有しない従来の演算増幅器と同様の最大出力電圧が得られるのに対して、従来の過電流保護回路を有する演算増幅器では、明らかに過電流保護回路が無い場合よりも、最大出力電圧が低下していることが確認できる。
すなわち、演算増幅器が過電流保護が作用しない通常の動作状態にある場合は、キャパシタ35はの両端子間は同相となるので、キャパシタ35が無い状態に等価である。しかし、先に説明したように過電流保護動作時には、キャパシタ35は、第10のトランジスタ10に対して差動的に作用して発振を防止するものとなっている。
図9には、キャパシタ35を有する場合と、有しない場合におけるパルス応答特性の例が示されており、同図によれば、キャパシタ35を設けることによって、キャパシタ35を設けない場合に比して発振が抑えられていることがわかる。
第6の定電流源26は、第1の定電流源21とほぼ等しい温度特性のもの用いることで、次述するように出力電流の限界値ICA1maxの温度特性の制御が従来に比して容易となる。
すなわち、まず、第6の定電流電源26から出力される定電流I06と、第1の定電流電源21から出力される定電流I01は、下記する式5に表される関係式を満足するように設定される。
この式6を温度Tについて偏微分して出力電流の制限値ICA1maxの温度係数を求めると下記する式7のようになる。
図10には、周囲温度25℃でICA1max≒30mAとした場合の、周囲温度変化に対する最大出力ソース電流の変化例が、本発明の実施の形態における回路と従来回路(図12参照)について示されている。
同図によれば、本発明の実施の形態における回路は、従来回路に比してICA1maxの温度依存性を確実に軽減するものであることが確認できる。
すなわち、前段増幅部101のシンク電流能力が十分に大きい場合に、周囲温度が高温状態において、その入力電圧がVin-≫Vin+の状態を続けると、第10のトランジスタ10ベース・エミッタ間電圧VBEB2が減少し、そのコレクタ電流ICB2が増加し、それによって第10のトランジスタ10の温度上昇を招き、最悪時には、熱暴走に至る虞がある。
102…プリドライバ部
103…プッシュプル出力段
105…過電流保護回路
Claims (2)
- 入力信号に対して差動出力が得られるよう構成された前段増幅部と、前記前段増幅器の出力を電圧・電流変換するプリドライバ部と、前記プリドライバ部からの入力信号を増幅出力するプッシュプル出力段を具備してなる演算増幅器であって、
前記プリドライバ部は、ベースが前記前段増幅部の出力段に接続される一方、エミッタが第1の定電流源に接続されたPNP形の第1のトランジスタを有してなる一方、
前記第1のトランジスタのコレクタ電流の増大に応じて、前記プシュプル出力段の出力電流の増大を抑圧するよう構成されてなる過電流保護回路が設けられ、
当該過電流保護回路は、一端に第1の電源電圧が印加され、他端に過電流保護回路用カレントミラーを介して前記プリドライバ部の第1のトランジスタのコレクタ電流に応じた電流が流れるよう電流検出用抵抗器が設けられ、
当該電流検出用抵抗器と前記過電流保護回路用カンレントミラーとの接続点には、過電流保護用のPNP形トランジスタのベースが接続され、当該過電流保護用のPNP形トランジスタのエミッタには、前記第1の電源電圧が印加される一方、そのコレクタは、前記前段増幅部の出力段に接続され、
前記過電流保護回路用カレントミラーは、ベースとコレクタとが接続されたNPN形のカレントミラー用第1のトランジスタと、当該カレントミラー用第1のトランジスタとベースが相互に接続されたNPN形のカレントミラー用第2のトランジスタとを有し、前記カレントミラー用第1及び第2のトランジスタのエミッタには、共に第2の電源電圧が印加され、前記カレントミラー用第1のトランジスタのコレクタは、前記プリドライバ部の第1のトランジスタのコレクタに接続される一方、前記カレントミラー用第2のトランジスタのコレクタは、前記電流検出用抵抗器の一端に接続され、
前記プッシュプル出力段を構成するハイサイド側のトランジスタのベースが、前記プリドライバ部のPNP形の第1のトランジスタのエミッタに接続され、
前記過電流保護用のPNP形トランジスタのコレクタと、前記電流検出用抵抗器と前記過電流保護回路用カレントミラーのカレントミラー用第2のトランジスタのコレクタとの接続点との間に、キャパシタが接続され、
前記過電流保護用抵抗器の両端に、前記第1の定電流源とほぼ等しい温度特性を有する過電流保護回路用の定電流源が並列接続されて設けられてなることを特徴とする演算増幅器。 - 前記過電流保護用のPNP形トランジスタのベースと、前記電流検出用抵抗器と前記過電流保護回路用カレントミラーのカレントミラー用第2のトランジスタのコレクタとの接続点との間に、ベース抵抗器が接続されてなることを特徴とする請求項1記載の演算増幅器。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2008175967A JP5172504B2 (ja) | 2008-07-04 | 2008-07-04 | 演算増幅器 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2008175967A JP5172504B2 (ja) | 2008-07-04 | 2008-07-04 | 演算増幅器 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2010016708A JP2010016708A (ja) | 2010-01-21 |
JP5172504B2 true JP5172504B2 (ja) | 2013-03-27 |
Family
ID=41702366
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2008175967A Active JP5172504B2 (ja) | 2008-07-04 | 2008-07-04 | 演算増幅器 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP5172504B2 (ja) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP5762231B2 (ja) * | 2011-09-16 | 2015-08-12 | 新日本無線株式会社 | 演算増幅器 |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS62122307A (ja) * | 1985-08-28 | 1987-06-03 | Toshiba Corp | 利得制御増幅回路 |
JP2900684B2 (ja) * | 1992-03-17 | 1999-06-02 | 日本電気株式会社 | 定電圧発生回路 |
JP2845065B2 (ja) * | 1992-12-04 | 1999-01-13 | 日本電気株式会社 | オペアンプ |
JP2002009603A (ja) * | 2000-06-20 | 2002-01-11 | Sony Corp | ドライバ回路 |
JP4549274B2 (ja) * | 2005-10-21 | 2010-09-22 | 新日本無線株式会社 | ドライバー出力回路 |
-
2008
- 2008-07-04 JP JP2008175967A patent/JP5172504B2/ja active Active
Also Published As
Publication number | Publication date |
---|---|
JP2010016708A (ja) | 2010-01-21 |
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Legal Events
Date | Code | Title | Description |
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A621 | Written request for application examination |
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|
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|
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|
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|
R150 | Certificate of patent or registration of utility model |
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|
R250 | Receipt of annual fees |
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|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
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R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
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R250 | Receipt of annual fees |
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R250 | Receipt of annual fees |
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