JP4723394B2 - 演算増幅器 - Google Patents
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Description
SR=I1/Cc (1)
によって決まる。
請求項2にかかる発明は、請求項1に記載の演算増幅器において、前記第1、第2、第3、第4、第5、第6のトランジスタを第1の導電型のトランジスタで構成し、前記カレントミラー回路を前記第1の導電型と反対の第2の導電型のトランジスタで構成したことを特徴とする。
SR=(I1+I2)/Cc (2)
によって決まる。
2:バッファ回路
10,10A:演算増幅器
Claims (2)
- 第1および第2のトランジスタを差動接続し、該差動接続の部分に第1の電流源を接続し、前記第1および第2のトランジスタのコレクタ側にカレントミラー回路を接続した差動増幅回路と、エミッタを前記第1のトランジスタのベースおよび第2の電流源に接続した第3のトランジスタと、エミッタを前記第2のトランジスタのベースおよび第3の電流源に接続した第4のトランジスタとを備え、前記第3のトランジスタのベースと前記第4のトランジスタのベースにそれぞれ入力信号を入力し、前記カレントミラー回路の出力側から電流を取り出すようにした演算増幅器において、
前記第2のトランジスタのエミッタにベースを接続し、前記第2のトランジスタのコレクタにコレクタを接続し、前記第3のトランジスタのエミッタにエミッタを接続した第5のトランジスタと、
前記第1のトランジスタのエミッタにベースを接続し、前記第1のトランジスタのコレクタにコレクタを接続し、前記第4のトランジスタのエミッタにエミッタを接続した第6のトランジスタと、
を有することを特徴とする演算増幅器。 - 請求項1に記載の演算増幅器において、
前記第1、第2、第3、第4、第5、第6のトランジスタを第1の導電型のトランジスタで構成し、前記カレントミラー回路を前記第1の導電型と反対の第2の導電型のトランジスタで構成したことを特徴とする演算増幅器。
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