JP4945883B2 - 電界効果トランジスタの駆動方法及び駆動回路 - Google Patents
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Description
前記第1絶縁体層は、RをCH2CH2CN又はHとした場合、
本発明の電界効果トランジスタの駆動方法及び駆動回路によれば、ドレイン電流を安定化させることができる。
(第1の実施形態)
図1は、第1の実施形態に係る電界効果トランジスタの縦断面構成を示す説明図である。
ソース電位VS= 0V
ドレイン電位VD= −40V
予備電位VPRE= −5V
駆動信号の最大値= 0V
駆動信号の最小値= −40V
予備信号の最大値= 0V
予備信号の最小値= −10V
また、駆動信号と予備電位VPREの本質的な違いは、予備電位VPREの印加はトランジスタ内に電荷を蓄積するために行われるという点であるが、極性は同一である。したがって、予備電位の印加はドレイン電流は生じない状態で行なうのが好ましい。例えば、ソース−ドレイン間に電圧をかけない状態で行なうのが好ましい。また、ソース−ドレイン間に電圧をかけた状態で予備印加を行なうのであれば、予備電位の印加は閾値電圧より小さい電圧で行なうのが好ましい。いっぽう駆動信号はドレイン電流の制御のために印加されるものであるから、通常ソース−ドレイン間に電圧がかかった状態で印加される。
図7は、第2の実施形態に係る電界効果トランジスタの縦断面構成を示す説明図である。この電界効果トランジスタと第1の電界効果トランジスタとの相違点は、絶縁体層2が、シアノ基を有しない第2絶縁体層2bを更に備えている点である。第2絶縁体層2bは、ゲート電極Gと第1絶縁体層2aとの間に介在している。
第2絶縁体層に誘電率の高い無機誘電体を使えば、ゲート電圧を小さくでき、有機誘電体を使えば軽量で柔軟な(フレキシブルな)トランジスタが得られる。
図8は、第3の実施形態に係る電界効果トランジスタの縦断面構成を示す説明図である。この電界効果トランジスタと第1の電界効果トランジスタとの相違点は、ソース電極S及びドレイン電極Dが絶縁体層2と有機半導体層3との間に介在している点である。この場合、ゲート電極Gに近い領域に、チャネルを形成することができる。
図9は、第4の実施形態に係る電界効果トランジスタの縦断面構成を示す説明図である。この電界効果トランジスタと第3の電界効果トランジスタとの相違点は、絶縁体層2が、シアノ基を有しない第2絶縁体層2bを更に備えている点である。第2絶縁体層2bは、ゲート電極Gと第1絶縁体層2aとの間に介在している。
図10は、第1の実施形態に係る電界効果トランジスタを用いた液晶表示素子の縦断面構成を示す説明図である。ドレイン電極Dには画素電極E1が電気的に接続されており、画素電極E1上には液晶層Lが形成されている。液晶層L上にはITOからなる透明電極E2が形成されている。駆動方法及び駆動回路は上述のものと同一である。
図11は、第2の実施形態に係る電界効果トランジスタを用いた液晶表示素子の縦断面構成を示す説明図である。この液晶表示素子と第1の液晶表示素子との相違点は、絶縁体層2が、シアノ基を有しない第2絶縁体層2bを更に備えている点である。第2絶縁体層2bは、ゲート電極Gと第1絶縁体層2aとの間に介在している。この場合、第2の実施形態と同様の効果がある。他の構成及び作用は第1の液晶表示素子と同一であり、駆動方法及び駆動回路も上述のものと同一である。
図12は、インバータ回路の回路図である。P型電界効果トランジスタTr1とN型電界効果トランジスタTr2が直列に接続されており、CMOSを構成している。CMOSの出力Aは、電界効果トランジスタTr3のゲート電極Gに入力される。P型電界効果トランジスタTr1のソースには駆動信号VDRIVEが入力され、N型電界効果トランジスタTr3のソースは予備電位VPREに接続されている。P型電界効果トランジスタTr1とN型電界効果トランジスタTr2双方のゲート電極には、スイッチング信号SWが入力される。
Claims (7)
- 電界効果トランジスタの駆動方法において、
前記電界効果トランジスタは、
ポリアセン類、ポリアルキルチオフェン又はチオフェンオリゴマーからなる有機半導体層と、
前記有機半導体層に接触する第1絶縁体層であって、シアノ基を有する有機高分子層からなる前記第1絶縁体層を有する絶縁体層と、
前記絶縁体層を前記有機半導体層と共に挟むゲート電極と、
前記ゲート電極の電位に応じて前記有機半導体層内に形成されるチャネルによって電気的に接続されるソース電極及びドレイン電極と、
を有しており、
前記駆動方法は、
ドレイン電流が生じる前記ゲート電極への負の駆動電位の印加前に、ドレイン電流が生じない状態で前記ゲート電極に負の予備電位を与えておくことを特徴とする電界効果トランジスタの駆動方法。 - 前記第1絶縁体層の厚みd1は、0.5nm〜500nmであることを特徴とする請求項1に記載の電界効果トランジスタの駆動方法。
- 前記絶縁体層は、シアノ基を有しない第2絶縁体層を更に備えていることを特徴とする請求項1又は2に記載の電界効果トランジスタの駆動方法。
- 前記第2絶縁体層の材料は、SiO2、Al2O3、SiNx、TiO2、ポリイミド、ポリエチレンテレフタレート、ポリフッ化ビリニデン及びポリメタクリレートからなる群から選択されることを特徴とする請求項3に記載の電界効果トランジスタの駆動方法。
- 前記第1絶縁体層の厚みをd1、前記第2絶縁体層の厚みをd2とした場合、以下の関係式:
d2×0.0005≦d1≦d2×10
を満たすことを特徴とする請求項3又は4に記載の電界効果トランジスタの駆動方法。 - 前記ゲート電極、前記ソース電極又は前記ドレイン電極は、Au、Al、Cu及びAgからなる群から選択される少なくとも1種を含むことを特徴とする請求項1乃至5のいずれか1項に記載の電界効果トランジスタの駆動方法。
- 電界効果トランジスタの駆動回路において、
前記電界効果トランジスタは、
ポリアセン類、ポリアルキルチオフェン又はチオフェンオリゴマーからなる有機半導体層と、
前記有機半導体層に接触する第1絶縁体層であって、シアノ基を有する有機高分子層からなる前記第1絶縁体層を有する絶縁体層と、
前記絶縁体層を前記有機半導体層と共に挟むゲート電極と、
前記ゲート電極の電位に応じて前記有機半導体層内に形成されるチャネルによって電気的に接続されるソース電極及びドレイン電極と、
を有しており、
前記駆動回路は、
ドレイン電流が生じる前記ゲート電極への負の駆動電位の印加前に、ドレイン電流が生じない状態でゲート電極に負の予備電位を与える予備電位付与手段を備えることを特徴とする電界効果トランジスタの駆動回路。
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