JP4777861B2 - コンパレータ回路 - Google Patents
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Description
第1の電圧と、第2トランジスタのゲート端子に入力される第2の電圧との電圧差に応じて出力レベルを変更する出力端子を有する比較コア回路部を備えたコンパレータであって、前記第2トランジスタを流れる電流の電流量が変化する遷移状態の場合には、この電流量に応じたモニタ電流を出力し、前記第2の電圧が前記第1の電圧よりも高く前記第2トランジスタに電流が流れない場合には前記モニタ電流を遮断するモニタ回路部と、前記モニタ電流を非線形的に増大させて、前記比較コア回路部を動作させるバイアスに加算する非線形増幅回路部とを備えたことを要旨とする。
の出力電流を入力電流とする第3のカレントミラー回路と、この第3のカレントミラー回路の出力側トランジスタに接続される定電流源とを備え、この出力側トランジスタは、前記第1トランジスタ及び前記第2トランジスタのソース端子に接続されていることを要旨とする。
図1に示すように、本実施形態のコンパレータ回路10は、正入力端子の第1の電圧V1と負入力端子の第2の電圧V2との比較を行なう比較器である。ここで、正入力端子が第1端子に相当し、負入力端子が第2端子に相当する。本実施形態のコンパレータ回路10は、電圧V1が電圧V2より高い場合にはハイレベルの出力電圧VOUTを出力し、電圧V1が電圧V2よりも低い場合にはローレベルの出力電圧VOUTを出力する。
比較コア回路部20は、電源電圧VCCラインに接続される定電流源21を備えている。この定電流源21は、電流値i1の電流を供給する。定電流源21は、トランジスタM1,M2を介して接地電圧GNDラインに接続されているとともに、トランジスタM3,M4を介しても接地電圧GNDラインに接続されている。
まず、電圧V2が電圧V1より十分に高く、第2トランジスタとしてのトランジスタM3に電流が流れない第1領域Iにおけるコンパレータ回路10の動作について、図3を用いて説明する。
(第2領域IIにおけるコンパレータ回路10の動作)
次に、電圧V2が電圧V1より十分に低く、第1トランジスタとしてのトランジスタM1に電流が流れない第2領域IIにおけるコンパレータ回路10の動作について、図4を用いて説明する。
昇し、出力電圧VOUTはハイレベルとなる。
次に、上述した第1領域Iと第2領域IIとの間の遷移領域である第3領域IIIにおける
動作について、図5〜図10を用いて説明する。
i1+iM5=iM6×(2α+1) …(1)
となる。
介して、接地電圧GNDラインに接続されている。更に、トランジスタM32のドレイン端子は、非線形増幅回路部30のトランジスタM5のソース端子に接続されている。このように定電流源32を構成にすることにより、現実に設計可能な非線形増幅回路部30の入出力特性を把握することができる。
Io3≒i2×[1−exp(−Ii3/Is3)] …(2)
本実施形態のコンパレータ回路10において、非線形増幅回路部30の入力電流Ii3に相当する電流はトランジスタM6を流れる電流値iM6であり、出力電流Io3に相当する電流は、トランジスタM5を流れる電流値iM5である。従って、
iM5=i2×[1−exp(−iM6/Is3)] …(3)
となる。この(3)式の電流値iM6に(1)式の関係を代入すると、
iM5=i2×[1−exp(−(i1+iM5)/Is3×(2α+1)] …(4)となる。
るため、トランジスタM1bとトランジスタM3には、「2α−1」の比の電流が流れると想定できる。
、Vi=0のときの電流がIb/2で、Vi=Vtのときの電流がIbとなる直線で近似できる。一方、第3領域IIIにおいて、トランジスタM1aを流れる電流の電流値Iaは
、Vi=0のときの電流がIb/2で、Vi=Vtのときの電流が0となる直線で近似できる。
Io2=(Ib/2)・(1+Vi/Vt) …(5)
Ia=(Ib/2)・(1−Vi/Vt) …(6)
で表わすことができる。ここで、電流値Ibは、合計電流Ii2から、トランジスタM1b,M3を流れる電流を除いたものであるから、
Ib=Ii2−Ia・(2α−1) …(7)
と表わすことができる。
Io2=[(Vi/Vt+1)・Ii2]/[(1−Vi/Vt)・(2α−1)+2]…(8)となる。
流が0で、Vi=0のときの電流がId/2となる直線で近似できる。一方、第3領域IIIにおいて、トランジスタM1を流れる電流の電流値Icは、Vi=−Vtのときの電流
がIcで、Vi=0のときの電流がId/2となる直線で近似できる。
α・Io2=(Id/2)・(Vi/Vt+1) …(9)
Ic=(Id/2)・(Vi/−Vt+1) …(10)
で示すことができる。ここで、電流値Idは、合計電流Ii2から、トランジスタM6を流れる電流を除いたものであるから、
Id=Ii2−Io2 …(11)
と表わすことができる。
Io2=[(Vi/Vt+1)・Ii2]/[(1+Vi/Vt)+2α] …(12)
となる。
・ 本実施形態では、コンパレータ回路10は、比較コア回路部20、モニタ回路部を構成するトランジスタM6及び非線形増幅回路部30から構成されている。非線形増幅回路部30は、トランジスタM6から供給されるモニタ電流を非線形的に増幅して比較コア回路部20に電流の供給を行なう。そして、この非線形増幅回路部30が増幅した電流が比較コア回路部20及びトランジスタM6に供給され、この電流に基づいてトランジスタM6はモニタ電流を流す。このため、図10に示すように第3領域IIIにおいては、比較
コア回路部20に供給される電流が滑らかに増加し、グリッチの発生を抑制することができる。また、非線形的に増幅するため、ローレベルとハイレベルの切換電位(Vi=0)においては、比較コア回路部20に供給する電流を十分に大きくすることができる。従って、トランジスタM3に電流が流れない場合には、コンパレータ回路10において消費される電流を小さくしても、切換電位付近においては、応答スピードが遅くならない大きい電流を供給することができる。このため、電流を小さくして、消費電流を低減することができる。
○ 上記実施形態においては、コンパレータ回路10に入力される負入力端子は1つとした。これに限らず、負入力端子を複数設けて、それぞれの負入力端子に異なる第2の電圧V2を供給し、正入力端子の第1の電圧V1と比較する第2の電圧V2を複数にしてもよい。この場合、比較コア回路部20に第2の電圧が供給されるトランジスタと、このトランジスタに対応するモニタ回路部のトランジスタとを更に設ける。具体的には、図11に示すように、比較コア回路部20に、pチャンネルのMOSトランジスタからなるトランジスタM30を設ける。このトランジスタM30は、トランジスタM3と同様に、そのソース端子が定電流源21に接続されており、そのドレイン端子が出力端子に接続されている。また、トランジスタM30のゲート端子には、トランジスタM3のゲート端子に接続される負入力端子の電圧V21とは異なる負入力端子の電圧V22が接続されている。加えて、モニタ回路部に、pチャンネルのMOSトランジスタからなるトランジスタM60を更に設ける。このトランジスタM60は、トランジスタM6と同様に、そのソース端子がトランジスタM6のソース端子と接続されており、そのドレイン端子がトランジスタM7のドレイン端子に接続されている。そして、トランジスタM60のゲート端子は、対応するトランジスタM30のゲート端子と共通化されている。
、滑らかに電流が増幅されるためグリッチの発生を抑制できるとともに、比較コア回路部20に十分な電流を供給できるので、トランジスタM3,M30に電流が流れない場合には消費電流を小さくすることができる。更に、トランジスタM3,M30がオフのときには、それぞれに対応するトランジスタM6,M60には電流が流れないので、いっそう消費電流を低減することができる。
タ回路10を採用する回路によっては、第2領域IIにおいては、第1領域Iと同様に低消費電流を実現する構成としてもよい。例えば、図10においてVi=0を中心として左右対称の曲線で電流が変化するコンパレータ回路としてもよい。
Claims (3)
- 第1トランジスタのゲート端子に入力される第1の電圧と、第2トランジスタのゲート端子に入力される第2の電圧との電圧差に応じて出力レベルを変更する出力端子を有する比較コア回路部を備えたコンパレータであって、
前記第2トランジスタを流れる電流の電流量が変化する遷移状態の場合には、この電流量に応じたモニタ電流を出力し、前記第2の電圧が前記第1の電圧よりも高く前記第2トランジスタに電流が流れない場合には前記モニタ電流を遮断するモニタ回路部であって、前記モニタ回路部は、前記第2トランジスタのゲート端子と共有するゲート端子と、前記第2トランジスタのソース端子と共有するソース端子とを有するトランジスタを含み、前記トランジスタは、前記第2トランジスタのサイズよりも小さい、前記モニタ回路部と、 前記モニタ電流を非線形的に増大させて、前記比較コア回路部を動作させるバイアスに加算する非線形増幅回路部と、
複数の第2端子であって、前記複数の第2端子の各々は異なる前記第2の電圧を入力し、前記比較コア回路部は、前記第2端子の各々に対応する前記第2トランジスタを含み、前記モニタ回路部は、前記第2トランジスタのそれぞれに対応するトランジスタを含み、各トランジスタは、対応する第2トランジスタのそれぞれのゲート端子及びソース端子を共有するゲート端子及びソース端子を有し、各トランジスタは、前記第1のカレントミラー回路に接続されているドレイン端子を有する、前記複数の第2端子と
を備えたことを特徴とするコンパレータ回路。 - 前記比較コア回路部は、
第1の定電流源と、
前記第1トランジスタに流れる電流を入力電流とし、前記第2トランジスタに流す電流を出力電流とする第1のカレントミラー回路とを更に備え、
前記第2トランジスタと前記第1のカレントミラー回路との接続ノードが出力端子であることを特徴とする、請求項1に記載のコンパレータ回路。 - 前記非線形増幅回路部は、
前記モニタ回路部に流れる電流を入力電流とする第2のカレントミラー回路と、
この第2のカレントミラー回路の出力電流を入力電流とする第3のカレントミラー回路と、
この第3のカレントミラー回路の出力側トランジスタに接続される第2の定電流源とを備え、
この出力側トランジスタは、前記第1トランジスタ及び前記第2トランジスタのソース端子に接続されていることを特徴とする、請求項2に記載のコンパレータ回路。
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