JP4633729B2 - 半導体装置の製造方法およびプラズマ酸化処理方法 - Google Patents
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Description
しかし、このRLSA方式のプラズマ処理装置を用いて再酸化処理を行なう過程で、タングステンによりチャンバーが汚染されると、その機構は未解明であるものの、ポリシリコンの酸化が妨げられ、酸化膜厚が低下するという現象が確認された。RLSA方式のプラズマ処理装置は、再酸化プロセスへの適用において多くのメリットを有するが、酸化膜厚が低下してしまうと半導体製品においてリーク電流の増大などを招き、再酸化の本来の目的を達成することさえできなくなる。
第2に、再酸化の過程でタングステン等の金属による半導体装置の汚染を極力低減することである。
第3に、RLSA方式のプラズマ処理装置を使用する再酸化プロセスにおいても、ポリシリコン層の酸化膜厚を低下させず、確実に再酸化を行なうことである。
複数のスロットを有する平面アンテナにてチャンバー内にマイクロ波を導入してプラズマを発生させるプラズマ処理装置により、Arガスと水素ガスと酸素ガスとからなる処理ガスを用い、Arガス流量を100〜3000mL/min、水素ガス流量を10〜1000mL、酸素ガス流量を10〜1000mL/minとし、処理ガス中の水素ガスと酸素ガスとの流量比を2以上20以下、かつArガスと水素ガスとの流量比を1.25以上10以下とし、処理温度を100〜900℃、処理室内の圧力を3〜700Paとして前記マイクロ波によりプラズマを生成してプラズマ処理を行い、前記ポリシリコン層を選択的に酸化して前記ポリシリコン層に酸化膜を形成することを特徴とする、半導体装置の製造方法が提供される。
このゲート絶縁膜上に、少なくとも、ポリシリコン層および高融点金属を主成分とする金属層を含む積層体を形成する工程と、
前記積層体をエッチング処理してゲート電極を形成する工程と、
複数のスロットを有する平面アンテナにてチャンバー内にマイクロ波を導入してプラズマを発生させるプラズマ処理装置により、Arガスと水素ガスと酸素ガスとからなる処理ガスを用い、Arガス流量を100〜3000mL/min、水素ガス流量を10〜1000mL、酸素ガス流量を10〜1000mL/minとし、処理ガス中の水素ガスと酸素ガスとの流量比を2以上20以下、かつArガスと水素ガスとの流量比を1.25以上10以下とし、処理温度を100〜900℃、処理室内の圧力を3〜700Paとして前記マイクロ波によりプラズマを生成してプラズマ処理を行い、前記ゲート電極中のポリシリコン層を選択的に酸化する工程と、
を含むことを特徴とする、半導体装置の製造方法が提供される。
複数のスロットを有する平面アンテナにてチャンバー内にマイクロ波を導入することによりプラズマを発生させるプラズマ処理装置により、Arガスと水素ガスと酸素ガスとからなる処理ガスを用い、Arガス流量を100〜3000mL/min、水素ガス流量を10〜1000mL、酸素ガス流量を10〜1000mL/minとし、処理ガス中の水素ガスと酸素ガスとの流量比を2以上20以下、かつArガスと水素ガスとの流量比を1.25以上10以下とし、処理温度を100〜900℃、処理室内の圧力を3〜700Paとして前記マイクロ波によりプラズマを生成してプラズマ処理を行なうことを特徴とする、プラズマ酸化処理方法が提供される。
複数のスロットを有する平面アンテナにて前記チャンバー内にマイクロ波を導入することによりプラズマを発生させるプラズマ供給源と、
配管を介して前記処理室内にArガスと水素ガスと酸素ガスとからなる処理ガスを導入するガス導入部材と、
被処理体を加熱するヒーターと、
前記チャンバー内に、前記ガス導入部からArガスと水素ガスと酸素ガスとからなる処理ガスをArガス流量:100〜3000mL/min、水素ガス流量:10〜1000mL、酸素ガス流量:10〜1000mL/minの範囲で導入し、処理ガス中の水素ガスと酸素ガスとの流量比を2以上20以下、かつArガスと水素ガスとの流量比を1.25以上10以下とし、処理温度を100〜900℃、処理室内の圧力を3〜700Paとして前記マイクロ波によりプラズマを生成してプラズマ処理することにより、少なくともポリシリコン層と高融点金属を主成分とする金属層とを有する積層体中の前記ポリシリコン層を選択的に酸化するプラズマ酸化処理が行なわれるように制御する制御部と、
を備えたことを特徴とする、プラズマ処理装置が提供される。
このゲート酸化膜上に、少なくとも、ポリシリコン層および高融点金属を主成分とする金属層を含む積層体を形成する工程と、
前記積層体をエッチング処理してゲート電極を形成する工程と、
前記ゲート電極中のポリシリコン層を選択的に酸化する工程と、
を有し、
前記ポリシリコン層を選択的に酸化する工程は、複数のスロットを有する平面アンテナにてチャンバー内にマイクロ波を導入してプラズマを発生させるプラズマ処理装置により、Arガスと水素ガスと酸素ガスとからなる処理ガスを用い、Arガス流量を100〜3000mL/min、水素ガス流量を10〜1000mL、酸素ガス流量を10〜1000mL/minとし、処理ガス中の水素ガスと酸素ガスとの流量比を2以上20以下、かつArガスと水素ガスとの流量比を1.25以上10以下とし、処理温度を600〜900℃、処理室内の圧力を3〜700Paとして前記マイクロ波によりプラズマを生成し、そのプラズマにより、前記ゲート酸化膜のエッジ部に形成されるバーズビークを前記ポリシリコン膜のエッジ部が僅かに丸みを帯びる程度に抑制するようにして行われることを特徴とする、半導体装置の製造方法が提供される。
さらに、タングステン汚染の低減もしくは抑制によって、チャンバー内をクリーンな状態に維持することができるので、同一チャンバー内で繰り返し再酸化処理を行なっても、RLSA方式のプラズマ処理装置による再酸化プロセスに特異的な現象であった酸化膜厚の低下を抑制することができる。
すなわち、RLSA方式のプラズマ処理装置を用いる場合、高密度で低電子温度のプラズマを形成できるため、他のプラズマ処理装置に比べてダメージの少ない良質な酸化膜を形成することが可能である。従って、ポリシリコン層側壁の酸化膜質が熱酸化処理による酸化膜質に比べ非常に良好であり、例えば400℃前後の低温処理の場合でも熱酸化処理以上のリーク電流特性を得ることが可能である。
図1は、本発明のプラズマ酸化処理方法の実施に適したプラズマ処理装置の一例を模式的に示す断面図である。このプラズマ処理装置は、複数のスロットを有する平面アンテナにて処理室内にマイクロ波を導入してプラズマを発生させるRLSA(Radial Line Slot Antenna;ラジアルラインスロットアンテナ)プラズマ生成技術を利用することにより、高密度かつ低電子温度のマイクロ波プラズマを発生させ得るものである。
また、H2ガスに対するArガスの流量比Ar/H2は、1〜20の範囲から選択することが好ましく、1.25〜10がより好ましい。
W + 3O* → WO3 ・・・ (1)
WO3 + 3H* → W+3OH* ・・・(2)
タングステン層66の上には、窒化シリコンなどのハードマスク層67を形成し、さらにフォトレジスト膜(図示せず)を形成しておく。
図6には、比較のため、処理ガス流量をAr/O2=1000/10mL/minとした場合の酸化によって酸化膜を形成したゲート電極の断面構造(TEM像)を示す。プラズマ酸化処理におけるSi基板61の温度は250℃、圧力は133.3Pa(1Torr)、プラズマへの供給パワーは3.5kW、処理時間は120秒であった。
図5および図6のゲート電極は、図4Cと同様に、Si基板61上にゲート絶縁膜62、ポリシリコン層63、タングステンナイトライドのバリア層65、タングステン層66(黒色の層)、窒化シリコンのハードマスク層67が順に積層された構造である。なお、図5および図6は実際のTEM像であるため、ゲート絶縁膜62、酸化膜68およびバリア層65は明瞭には描かれていない。
これに対して、H2/O2比1でプラズマ処理をした場合、図5に示すように、タングステン層66の酸化が抑制され、膨張は生じなかった。なお、図示していないが、H2/O2比8でプラズマ処理をした場合、Si基板温度500℃の酸化でも、図5と同様にタングステン層66の酸化と膨張が抑制されていた。従って、H2/O2の流量比が1以上20以下であれば、タングステン層66の側壁を酸化させずにポリシリコン層63を選択的に酸化することが可能であり、好ましくはH2/O2比を4以上、さらに好ましくはH2/O2比を8以上にすることにより、タングステン層66の露出部分の酸化をほぼ完全に抑制しつつ、ポリシリコン層63の露出部を酸化させる良好なプラズマ酸化処理が可能になる。
タングステンの酸化を抑制する上で好ましいH2/O2比は、1.5以上20以下であり、より好ましくは2以上であり、さらに4以上ではWO3の生成を略完全に抑制できることがわかる。また、シリコンの酸化レートを一定レベル以上に維持する観点での好ましいH2/O2比は、1以上15以下であり、好ましくは1.5以上15以下であることがわかる。
以上のことから、プラズマ処理装置100によるポリシリコン層の選択的再酸化において、タングステンの酸化を抑制するためのH2/O2比は、1.5以上20以下に設定することが好ましく、2以上20以下がより好ましい。また、シリコンの酸化レートを考慮した場合は、1以上15以下とすることが好ましい。
なお、比較のため、プラズマ酸化処理を行なっていない未処理の場合の結果も併せて示した。また、プラズマ酸化処理における処理ガスの流量比は、Ar/O2/H2=1000/10/10、またはAr/O2=1000/10とし、Si基板温度250℃、圧力は133.3Pa、プラズマへの供給パワーは3.5kW、処理時間はAr/O2 3.0nmが30秒、Ar/O2 5.0nmが227秒、Ar/H2/O2 3.0nmが21秒、Ar/H2/O2 5.0nmが68秒、Ar/H2/O2 8.0nmが177秒で行なった。
また、タングステン汚染を防止することによって、RLSA方式のプラズマ処理に特有の課題である酸化膜厚の低下も確実に防止できる。
プラズマ処理条件は、処理温度を800℃とし、他は上記選択酸化処理と同様の条件で実施した。すなわち、Ar/O2/H2流量は、1000/100/200mL/minであり、処理圧力は6.7Pa、プラズマへの供給パワーは2.2kWで行なった。
なお、図16において、曲線Aは、0deg、曲線Bは45deg、曲線Cは60degの測定結果をそれぞれ示している。
一方、図17Bは、バーズビーク71が形成された状態であり、ポリシリコン層63とSi基板61の界面に酸素ラジカル(O*)や酸素イオン(O−)等の活性な酸化剤が拡散して酸化が進み、酸化膜(ゲート絶縁膜62)が成長したものである。このようなバーズビーク71は、特に熱酸化処理においては顕著に形成され易い。
例えば、ゲート電極としては、ポリシリコンにタングステンまたはタングステンシリサイドを積層したものに限らず、他の高融点電極材料やそれらのシリサイドを積層した構造のゲート電極にも適用できる。
また、本発明方法は、トランジスタのゲート電極以外に、例えば、メタル材料の酸化を抑制しつつ、シリコンを含む材料を選択的に酸化させる必要のある種々の半導体装置の製造にも適用可能である。
産業上の利用の可能性
本発明は、各種半導体装置の製造において好適に利用可能である。
Claims (14)
- 少なくとも、ポリシリコン層と、高融点金属を主成分とする金属層と、を有する積層体に対し、
複数のスロットを有する平面アンテナにてチャンバー内にマイクロ波を導入してプラズマを発生させるプラズマ処理装置により、Arガスと水素ガスと酸素ガスとからなる処理ガスを用い、Arガス流量を100〜3000mL/min、水素ガス流量を10〜1000mL、酸素ガス流量を10〜1000mL/minとし、処理ガス中の水素ガスと酸素ガスとの流量比を2以上20以下、かつArガスと水素ガスとの流量比を1.25以上10以下とし、処理温度を100〜900℃、処理室内の圧力を3〜700Paとして前記マイクロ波によりプラズマを生成してプラズマ処理を行い、前記ポリシリコン層を選択的に酸化して前記ポリシリコン層に酸化膜を形成することを特徴とする、半導体装置の製造方法。 - 半導体基板の上にゲート絶縁膜を形成する工程と、
このゲート絶縁膜上に、少なくとも、ポリシリコン層および高融点金属を主成分とする金属層を含む積層体を形成する工程と、
前記積層体をエッチング処理してゲート電極を形成する工程と、
複数のスロットを有する平面アンテナにてチャンバー内にマイクロ波を導入してプラズマを発生させるプラズマ処理装置により、Arガスと水素ガスと酸素ガスとからなる処理ガスを用い、Arガス流量を100〜3000mL/min、水素ガス流量を10〜1000mL、酸素ガス流量を10〜1000mL/minとし、処理ガス中の水素ガスと酸素ガスとの流量比を2以上20以下、かつArガスと水素ガスとの流量比を1.25以上10以下とし、処理温度を100〜900℃、処理室内の圧力を3〜700Paとして前記マイクロ波によりプラズマを生成してプラズマ処理を行い、前記ゲート電極中のポリシリコン層を選択的に酸化する工程と、
を含むことを特徴とする、半導体装置の製造方法。 - 前記処理ガス中の水素ガスと酸素ガスとの流量比が、4以上であることを特徴とする、請求項1または請求項2に記載の半導体装置の製造方法。
- 前記処理ガス中の水素ガスと酸素ガスとの流量比が、8以上であることを特徴とする、請求項3に記載の半導体装置の製造方法。
- 前記金属層は、タングステン層、またはタングステンシリサイド層であることを特徴とする、請求項1から請求項4のいずれか1項に記載の半導体装置の製造方法。
- 少なくとも、ポリシリコン層と、高融点金属を主成分とする金属層と、を有する積層体中の前記ポリシリコン層をプラズマにより選択的に酸化するプラズマ酸化処理方法であって、
複数のスロットを有する平面アンテナにてチャンバー内にマイクロ波を導入することによりプラズマを発生させるプラズマ処理装置により、Arガスと水素ガスと酸素ガスとからなる処理ガスを用い、Arガス流量を100〜3000mL/min、水素ガス流量を10〜1000mL、酸素ガス流量を10〜1000mL/minとし、処理ガス中の水素ガスと酸素ガスとの流量比を2以上20以下、かつArガスと水素ガスとの流量比を1.25以上10以下とし、処理温度を100〜900℃、処理室内の圧力を3〜700Paとして前記マイクロ波によりプラズマを生成してプラズマ処理を行なうことを特徴とする、プラズマ酸化処理方法。 - 前記処理ガス中の水素ガスと酸素ガスとの流量比が、4以上であることを特徴とする、請求項6に記載のプラズマ酸化処理方法。
- 前記処理ガス中の水素ガスと酸素ガスとの流量比が、8以上であることを特徴とする、請求項7に記載のプラズマ酸化処理方法。
- 前記金属層は、タングステン層、またはタングステンシリサイド層であることを特徴とする、請求項6から請求項8のいずれか1項に記載のプラズマ酸化処理方法。
- プラズマにより被処理体を処理するための真空排気可能なチャンバーと、
複数のスロットを有する平面アンテナにて前記チャンバー内にマイクロ波を導入することによりプラズマを発生させるプラズマ供給源と、
配管を介して前記処理室内にArガスと水素ガスと酸素ガスとからなる処理ガスを導入するガス導入部材と、
被処理体を加熱するヒーターと、
前記チャンバー内に、前記ガス導入部からArガスと水素ガスと酸素ガスとからなる処理ガスをArガス流量:100〜3000mL/min、水素ガス流量:10〜1000mL、酸素ガス流量:10〜1000mL/minの範囲で導入し、処理ガス中の水素ガスと酸素ガスとの流量比を2以上20以下、かつArガスと水素ガスとの流量比を1.25以上10以下とし、処理温度を100〜900℃、処理室内の圧力を3〜700Paとして前記マイクロ波によりプラズマを生成してプラズマ処理することにより、少なくともポリシリコン層と高融点金属を主成分とする金属層とを有する積層体中の前記ポリシリコン層を選択的に酸化するプラズマ酸化処理が行なわれるように制御する制御部と、
を備えたことを特徴とする、プラズマ処理装置。 - 前記制御部は、前記処理ガス中の水素ガスと酸素ガスとの流量比が、4以上となるように制御することを特徴とする、請求項10に記載のプラズマ処理装置。
- 前記制御部は、前記処理ガス中の水素ガスと酸素ガスとの流量比が、8以上となるように制御することを特徴とする、請求項11に記載のプラズマ処理装置。
- 半導体基板の上にゲート酸化膜を形成する工程と、
このゲート酸化膜上に、少なくとも、ポリシリコン層および高融点金属を主成分とする金属層を含む積層体を形成する工程と、
前記積層体をエッチング処理してゲート電極を形成する工程と、
前記ゲート電極中のポリシリコン層を選択的に酸化する工程と、
を有し、
前記ポリシリコン層を選択的に酸化する工程は、複数のスロットを有する平面アンテナにてチャンバー内にマイクロ波を導入してプラズマを発生させるプラズマ処理装置により、Arガスと水素ガスと酸素ガスとからなる処理ガスを用い、Arガス流量を100〜3000mL/min、水素ガス流量を10〜1000mL、酸素ガス流量を10〜1000mL/minとし、処理ガス中の水素ガスと酸素ガスとの流量比を2以上20以下、かつArガスと水素ガスとの流量比を1.25以上10以下とし、処理温度を600〜900℃、処理室内の圧力を3〜700Paとして前記マイクロ波によりプラズマを生成し、そのプラズマにより、前記ゲート酸化膜のエッジ部に形成されるバーズビークを前記ポリシリコン膜のエッジ部が僅かに丸みを帯びる程度に抑制するようにして行われることを特徴とする、半導体装置の製造方法。 - 前記金属層は、タングステン層、またはタングステンシリサイド層であることを特徴とする、請求項13に記載の半導体装置の製造方法。
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| TWI408734B (zh) * | 2005-04-28 | 2013-09-11 | 半導體能源研究所股份有限公司 | 半導體裝置及其製造方法 |
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| CN101313393B (zh) * | 2006-02-28 | 2010-06-09 | 东京毅力科创株式会社 | 等离子体氧化处理方法和半导体装置的制造方法 |
| EP2259294B1 (en) * | 2006-04-28 | 2017-10-18 | Semiconductor Energy Laboratory Co, Ltd. | Semiconductor device and manufacturing method thereof |
| JP4421618B2 (ja) * | 2007-01-17 | 2010-02-24 | 東京エレクトロン株式会社 | フィン型電界効果トランジスタの製造方法 |
| US7645709B2 (en) | 2007-07-30 | 2010-01-12 | Applied Materials, Inc. | Methods for low temperature oxidation of a semiconductor device |
| WO2009114617A1 (en) | 2008-03-14 | 2009-09-17 | Applied Materials, Inc. | Methods for oxidation of a semiconductor device |
| JP5542364B2 (ja) * | 2008-04-25 | 2014-07-09 | 株式会社半導体エネルギー研究所 | 薄膜トランジスタの作製方法 |
| US8679970B2 (en) | 2008-05-21 | 2014-03-25 | International Business Machines Corporation | Structure and process for conductive contact integration |
| US9190495B2 (en) | 2008-09-22 | 2015-11-17 | Samsung Electronics Co., Ltd. | Recessed channel array transistors, and semiconductor devices including a recessed channel array transistor |
| JP2010118489A (ja) * | 2008-11-13 | 2010-05-27 | Hitachi Kokusai Electric Inc | 半導体装置の製造方法 |
| US20100297854A1 (en) * | 2009-04-22 | 2010-11-25 | Applied Materials, Inc. | High throughput selective oxidation of silicon and polysilicon using plasma at room temperature |
| JP2012054475A (ja) * | 2010-09-02 | 2012-03-15 | Hitachi Kokusai Electric Inc | 基板処理装置及び半導体装置の製造方法 |
| US20130149852A1 (en) * | 2011-12-08 | 2013-06-13 | Tokyo Electron Limited | Method for forming a semiconductor device |
| JP6254098B2 (ja) | 2012-02-13 | 2017-12-27 | アプライド マテリアルズ インコーポレイテッドApplied Materials,Incorporated | 基板の選択性酸化のための方法および装置 |
| JP6274826B2 (ja) * | 2013-11-14 | 2018-02-07 | ルネサスエレクトロニクス株式会社 | 半導体装置およびその製造方法 |
| KR102157839B1 (ko) * | 2014-01-21 | 2020-09-18 | 삼성전자주식회사 | 핀-전계효과 트랜지스터의 소오스/드레인 영역들을 선택적으로 성장시키는 방법 |
| CN103871859A (zh) * | 2014-03-19 | 2014-06-18 | 武汉新芯集成电路制造有限公司 | 一种形成侧墙氧化硅保护层的方法 |
| KR102238257B1 (ko) * | 2014-08-26 | 2021-04-13 | 삼성전자주식회사 | 반도체 소자의 제조 방법 |
| CN109417019B (zh) * | 2016-07-04 | 2023-12-05 | 三菱电机株式会社 | 半导体装置的制造方法 |
| JP7436769B2 (ja) * | 2019-10-17 | 2024-02-22 | 日清紡マイクロデバイス株式会社 | 半導体装置の製造方法 |
| JP7393376B2 (ja) * | 2021-03-19 | 2023-12-06 | 株式会社Kokusai Electric | 半導体装置の製造方法、基板処理方法、プログラム及び基板処理装置 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH08102534A (ja) * | 1994-09-30 | 1996-04-16 | Toshiba Corp | 半導体装置の製造方法 |
| JPH08111297A (ja) * | 1994-08-16 | 1996-04-30 | Tokyo Electron Ltd | プラズマ処理装置 |
Family Cites Families (11)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2624736B2 (ja) * | 1988-01-14 | 1997-06-25 | 株式会社東芝 | 半導体装置の製造方法 |
| US6357385B1 (en) * | 1997-01-29 | 2002-03-19 | Tadahiro Ohmi | Plasma device |
| JP4069966B2 (ja) | 1998-04-10 | 2008-04-02 | 東京エレクトロン株式会社 | シリコン酸化膜の成膜方法および装置 |
| JP2000332245A (ja) | 1999-05-25 | 2000-11-30 | Sony Corp | 半導体装置の製造方法及びp形半導体素子の製造方法 |
| WO2002059956A1 (en) | 2001-01-25 | 2002-08-01 | Tokyo Electron Limited | Method of producing electronic device material |
| US7049187B2 (en) * | 2001-03-12 | 2006-05-23 | Renesas Technology Corp. | Manufacturing method of polymetal gate electrode |
| US6596653B2 (en) * | 2001-05-11 | 2003-07-22 | Applied Materials, Inc. | Hydrogen assisted undoped silicon oxide deposition process for HDP-CVD |
| JP3828539B2 (ja) * | 2001-06-20 | 2006-10-04 | 忠弘 大見 | マイクロ波プラズマ処理装置、プラズマ処理方法及びマイクロ波放射部材 |
| KR20040059988A (ko) | 2002-12-30 | 2004-07-06 | 주식회사 하이닉스반도체 | 반도체 소자의 제조방법 |
| KR100899567B1 (ko) | 2002-12-30 | 2009-05-27 | 주식회사 하이닉스반도체 | 텅스텐막을 포함하는 게이트전극을 구비한 반도체 소자의제조 방법 |
| US6987056B2 (en) * | 2003-07-08 | 2006-01-17 | Hynix Semiconductor Inc. | Method of forming gates in semiconductor devices |
-
2005
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Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH08111297A (ja) * | 1994-08-16 | 1996-04-30 | Tokyo Electron Ltd | プラズマ処理装置 |
| JPH08102534A (ja) * | 1994-09-30 | 1996-04-16 | Toshiba Corp | 半導体装置の製造方法 |
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